KR940001351A - 반도체 소자의 격리방법 - Google Patents

반도체 소자의 격리방법 Download PDF

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KR940001351A
KR940001351A KR1019920010548A KR920010548A KR940001351A KR 940001351 A KR940001351 A KR 940001351A KR 1019920010548 A KR1019920010548 A KR 1019920010548A KR 920010548 A KR920010548 A KR 920010548A KR 940001351 A KR940001351 A KR 940001351A
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oxide film
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film
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KR1019920010548A
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Inventor
박주석
Original Assignee
문정환
금성일렉트론 주식회사
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Abstract

본 발명은 MOS형 반도체 기억소자 내의 각 개별소자간의 전기적인 고립을 위한 소자격리(isolation)방법에 관한 것으로서, 실리콘기판 위에 제1산화막과 제1질화막을 데포지션한 다음 포토에치하여 패터닝하는 공정과, 상기 공정 후 제1질화막과 패터닝 위치에 제2질화막과 제2산화막을 차례로 데포지션한 다음 상기 제2질화막과 제2산화막으로 에치백하여 사이드월과 실리콘기판에 트랜치를 형성하는 공정과, 상기 공정 후 사이드월을 습식식각으로 제거하고 트랜치 영역에 필드이온을 주입하는 공정으로 되어 기존의 2단계 필드이온주입에 비하여 1단계의 필드이온주입만을 실시하여 공정이 단순할 뿐만 아니라 측면의 도우펀트 확산량을 줄일 수 있어 액티브소자의 특성이 향상되며, 또한 격리특성인 소자와 소자 사이의 펀치 스로우 (Panch through) 특성을 개선할 수 있는 것이다.

Description

반도체소자의 격리방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 따른 반도체소자의 격리방법을 도시한 공정도.

Claims (2)

  1. 반도체소자의 격리방법에 있어서, 실리콘기판 위에 제1산화막과 제1질화막을 데포지션한 다음 필드영역과 액티브영역을 패터닝하는 공정과. 상기 공정 후 제2질화막과 제2산화막을 차례로 데포지션한 다음, 상기 제2질화막과 제2산화막을 차례로 에치백하여 산화막 사이드월과 실리콘기판에 트랜치를 형성하는 공정과, 상기 공정 후 사이드월을 습식식각으로 제거하고 트랜치영역에 필드이온을 주입한 후 열산화공정으로 필드산화막을 형성하는 공정으로 된 반도체소자의 격리방법.
  2. 제1항에 있어서, 제2질화막 하부에도 이온주입하여 실리콘기판에 불순물을 주입하도록 한 것을 특징으로 하는 반도체소자의 격리방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920010548A 1992-06-18 1992-06-18 반도체 소자의 격리방법 KR940001351A (ko)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100451519B1 (ko) * 2002-12-09 2004-10-07 주식회사 하이닉스반도체 반도체소자의 소자분리막 형성방법

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KR100451519B1 (ko) * 2002-12-09 2004-10-07 주식회사 하이닉스반도체 반도체소자의 소자분리막 형성방법

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