KR930022371A - 다중 포트 메모리 시스템 - Google Patents
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Abstract
메모리 어레이(12)의 판독 열 콘덕터(44)와 기록 열 콘덕터(34)는 개별적인 트리거 가능 순차적 펄스 발생기(40,30)에 의해 주소 지정되는데, 상기 발생기들은 각각의 트리거 펄스(RP,WP)를 수신하여 어레이의 각각의 열 콘덕터들에 각각의 판독 및 기록 어드레스 펄스들을 제공한다. 저장될 데이터는 기록 순차적 펄스 발생기(30)에 의해 결정된 비율로 한번에 한 열씩 메모리의 셀들에 병렬로 기록되고, 판독 순차적 펄스 발생기(40)에 의해 결정된 비율로 한 번에 한 열씩 복구된다. 장점으로는, (1) 판독과 기록 속도의 비는 비디오 데이터의 일정 지연, 시간 압축 또는 시간 확장을 제공하도록 선택될 수 있고, (2) 부가적으로 데이터가 버스 경쟁없이 동시에 기록 및 판독될 수 있으며, (3) 주소 지정은 펄스 발생기에 트리거 펄스를 시간 지정하여 인가함에 의해서 단순화되어 2진 주소 지정 데이터를 메모리에 인가할 필요가 없다는 점이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 구체화하는 이중 포드 비디오 메모리 시스템의 블록도이다.
제2도는 제1도의 시스템 동작을 예시하는 타이밍도이다.
제3도는 제1도의 시스템에 사용하기에 적합한 메모리셀의 회로도이다.
제4도는 제1도의 시스템에 대한 시간 지정된 관계의 프리 챠지 및 판독 펄스 타이밍 펄스들을 제공하기 위한 장치의 블록도이다.
제5도는 제1도의 메모리 시스템에 사용하기에 적합한 프리 챠지 및 래치회로의 회로도이다.
Claims (4)
- 셀들의 각 행당 두 개의 행 콘덕터(22,42)와 셀들의 각 열당 두 개의 열 콘덕터(33,44)를 구비하고, 상기 각각의 셀은 데이터 입력 행 콘덕터(22)에 접속된 제1단자, 데이터 출력 행 콘덕터(42)에 접속된 제2단자, 기록 어드레스 열 콘덕터(42)에 접속된 제2단자, 기록 어드레스 열 콘덕터(34)에 접속된 제3의 입력 및 판독 어드레스 열 콘덕터(44)에 접속된 제4의 입력을 가지며, 저장될 데이터를 상기 데이터 입력 행 콘덕터들에 인가하기 위한 입력 수단(16,18,20)과, 저장된 데이터를 상기 데이터 출력 행 콘덕터들로부터 복구하기 위한 출력 수단(46,48)을 구비하는 다중 포트 메모리(33,44)시스템에 있어서, 하나의 트리거 입력 단자와 상기 기록 어드레스 열 콘덕터(34)를에 결합된 다수의 출력 단자들을 갖고 셀어드레스 신호들을 상기 기록 열 콘덕터들에 제1의 소정율로 순차적으로 인가하도록 상기 트리거 입력 단자에 인가된 기록 트리거 펄스(WP)에 응답하는 제1의 트리거 가능 순차적 펄스 발생기(30)와, 하나의 트리거 입력 단자와 상기 판독 어드레스 열 콘텍터(44)들에 결합된 다수의 출력 단자를 갖고 셀 판독 어드레스 신호들을 상기 판독 열 어드레스 콘덕터들에 제2의 소정율로 순차적으로 인가하도록 상기 트리거 입력 단자에 인가된 판독 트리거 펄스(RP)에 응답하는 제2의 트리거 가능 순차적 펄스 발생기(40)와, 상기 판독 및 기록 트리거 펄스를 시간 지정된 관계로 발생하기 위한 제어 신호 발생기(28)를 포함한 것을 특징으로 하는 이중 포트 메모리(34,44) 시스템.
- 제1항에 있어서, 데이터의 압축을 위해 상기 제2의 소정율은 상기 제1의 소정율로 보다 큰 것을 특징으로 하는 이중 포트 메모리(34,44) 시스템.
- 제1항에 있어서, 데이터의 일정 지연을 제공하기 위해 상기 소정율들은 동일한 것을 특징으로 하는 이중 포트 메모리(34,44) 시스템.
- 제1항에 있어서, 데이터의 확장을 제공하기 위해 상기 제2의 소정율은 상기 제1의 소정율보다 작은 것을 특징으로 하는 이중 포트 메모리(34,44) 시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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