KR20140111936A - 3d 실딩 케이스 및 그 형성 방법 - Google Patents
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- 238000000034 method Methods 0.000 title claims description 27
- 229910052751 metal Inorganic materials 0.000 claims abstract description 177
- 239000002184 metal Substances 0.000 claims abstract description 177
- 239000012778 molding material Substances 0.000 claims abstract description 30
- 238000000465 moulding Methods 0.000 claims abstract description 7
- 239000000463 material Substances 0.000 claims description 8
- 229910000679 solder Inorganic materials 0.000 claims description 6
- 238000005272 metallurgy Methods 0.000 claims description 3
- 239000010410 layer Substances 0.000 description 18
- 239000011888 foil Substances 0.000 description 17
- 235000012431 wafers Nutrition 0.000 description 11
- 239000002131 composite material Substances 0.000 description 10
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 8
- 230000015572 biosynthetic process Effects 0.000 description 7
- 229910052802 copper Inorganic materials 0.000 description 7
- 239000010949 copper Substances 0.000 description 7
- 239000007921 spray Substances 0.000 description 7
- 238000004519 manufacturing process Methods 0.000 description 5
- 208000032365 Electromagnetic interference Diseases 0.000 description 4
- 229920002120 photoresistant polymer Polymers 0.000 description 4
- 239000000853 adhesive Substances 0.000 description 3
- 230000001070 adhesive effect Effects 0.000 description 3
- 239000007769 metal material Substances 0.000 description 3
- 239000002923 metal particle Substances 0.000 description 3
- 239000000203 mixture Substances 0.000 description 3
- 238000007747 plating Methods 0.000 description 3
- XEEYBQQBJWHFJM-UHFFFAOYSA-N Iron Chemical compound [Fe] XEEYBQQBJWHFJM-UHFFFAOYSA-N 0.000 description 2
- 239000012790 adhesive layer Substances 0.000 description 2
- 229910052782 aluminium Inorganic materials 0.000 description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 2
- 235000019994 cava Nutrition 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 239000003292 glue Substances 0.000 description 2
- 230000002452 interceptive effect Effects 0.000 description 2
- 238000012858 packaging process Methods 0.000 description 2
- 238000000059 patterning Methods 0.000 description 2
- 238000005240 physical vapour deposition Methods 0.000 description 2
- 239000000758 substrate Substances 0.000 description 2
- 239000004593 Epoxy Substances 0.000 description 1
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 1
- 241000724291 Tobacco streak virus Species 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 230000004075 alteration Effects 0.000 description 1
- 239000000969 carrier Substances 0.000 description 1
- 239000000919 ceramic Substances 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 239000011889 copper foil Substances 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 239000003989 dielectric material Substances 0.000 description 1
- 230000005672 electromagnetic field Effects 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000000227 grinding Methods 0.000 description 1
- 230000017525 heat dissipation Effects 0.000 description 1
- 229910052742 iron Inorganic materials 0.000 description 1
- 239000007788 liquid Substances 0.000 description 1
- 150000001247 metal acetylides Chemical class 0.000 description 1
- 229910001092 metal group alloy Inorganic materials 0.000 description 1
- 150000004767 nitrides Chemical class 0.000 description 1
- JMANVNJQNLATNU-UHFFFAOYSA-N oxalonitrile Chemical compound N#CC#N JMANVNJQNLATNU-UHFFFAOYSA-N 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 239000011347 resin Substances 0.000 description 1
- 229920005989 resin Polymers 0.000 description 1
- 230000008054 signal transmission Effects 0.000 description 1
- 238000005476 soldering Methods 0.000 description 1
- 238000006467 substitution reaction Methods 0.000 description 1
- 239000010936 titanium Substances 0.000 description 1
- 229910052719 titanium Inorganic materials 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 239000010937 tungsten Substances 0.000 description 1
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Abstract
패키지는 다이 및 다이를 내부에 몰딩하는 몰딩 물질을 포함한다. 금속 실드 케이스는 몰딩 물질 위에서 몰딩 물질와 접촉하는 제1 금속 메시, 다이 아래에 놓이는 제2 금속 메시, 및 다이를 에워싸는 링을 형성하고 몰딩 물질 내에 있는 쓰루-어셈블리 비아(TAV)를 포함한다. TAV는 제1 금속 메시 및 제2 금속 메시에 전기적으로 연결된다.
Description
이 출원은 2013년 3월 12일자로 출원된, "3D Shielding Case and Methods for Forming the Same"라는 제목의 미국 가출원 번호 제61/778,291호를 우선권으로 주장하며, 이로써 상기 출원은 인용에 의해 본원에 포함된다.
전자파 간섭(Electro-Magnetic Interference, EMI)은 집적 회로의 애플리케이션들에 있어서 공통적인 문제이다. EMI는 고주파수가 사용되는 애플리케이션들에서, 예를 들어, 무선 주파수(Radio Frequency, RF) 신호들이 사용되는 모바일 애플리케이션들에서 더욱 심각한 이슈가 되었다.
디바이스 다이들 간의 EMI를 감소시키기 위하여, 금속 실딩 케이스들은 디바이스 다이들을 실딩하는데 사용된다. 금속 실딩 케이스들은 통상적으로 스탬핑 프로세스를 사용하여 철로 형성된다. 금속 실딩 케이스들은 실딩될 디바이스 다이들의 형상들 및 사이즈들을 맞추도록 설계된다. 다이들이 인쇄 회로 보드에 본딩된 이후, 금속 실딩 케이스들은 다이들 상에 커버되고, PCB에 납땜된다. 금속 실딩 케이스들은 2-웨이 실딩을 제공하고, 다이들이 실딩 다이들 외부의 디바이스들에 간섭하는 것을 방지하며, 외부 디바이스들이 실딩된 다이들 내의 디바이스들에 간섭하는 것을 방지한다.
종래의 금속 실딩 방식에서, 금속 실딩 케이스들은 다이들의 형상들 및 사이즈들에 맞춤제작되어야 한다. PCB 상의 상이한 사이즈들을 갖는 복수의 다이들과 함께, 상이한 설계를 갖는 복수의 금속 실딩 케이스이 필요하다. 이것은 집적 회로들의 제조 비용에 있어 현저한 증가를 초래한다.
몇몇 실시예들에 따라, 패키지는, 다이 및 내부에 다이를 몰딩하는 몰딩 물질을 포함한다. 금속 실드 케이스는, 다이 및 몰딩 물질 위에 있고 그들과 접촉하는 제1 금속 메시(mesh), 다이 아래에 놓이는 제2 금속 메시, 및 다이를 둘러싸는 링을 형성하며 몰딩 물질 내에 있는 TAV를 포함한다. TAV는 제1 금속 메시 및 제2 금속 메시에 전기적으로 연결된다.
다른 실시예들에 따라, 패키지는 제1 다이, 내부에 제1 다이를 몰딩하는 제1 몰딩 물질을 포함한다. 제1 금속 실드 케이스는, 제1 몰딩 물질 및 제2 다이 위에 있고 그와 접촉하는 제1 금속 메시, 제1 다이 아래에 놓이는 제2 금속 메시, 및 제1 다이를 둘러싸는 링을 형성하는 TAV를 포함한다. TAV는 제1 금속 메시의 하부면에 접촉하는 상부 단부를 갖는다. 패키지는 금속 실드 케이스 위의 제2 다이, 내부에 제2 다이를 몰딩하는 제2 몰딩 물질, 및 금속 실딩 필름을 더 포함한다. 금속 실딩 필름은 제2 몰딩 물질의 상부면 위에 있고 그와 접촉하는 상부 부분, 제1 몰딩 물질의 측벽들에 접촉하는 측벽 부분, 제2 몰딩 물질의 측벽들, 제1 금속 메시의 에지들, 및 제2 금속 메시의 에지들을 포함한다.
또 다른 실시예들에 따라, 방법은 금속 호일 위에 다이를 배치하는 단계, 몰딩 물질로 다이를 몰딩하는 단계, 및 몰딩 물질 내에 TAV들을 형성하는 단계를 포함한다. TAV들은 금속 호일에 전기적으로 커플링되며, 다이를 둘러싸는 TAV 링을 포함한다. 제1 금속 메시 및 UBM들은 TAV들 위에 형성되고, TAV들에 전기적으로 커플링된다. 금속 호일은 제2 금속 메시 및 제2 금속 메시에 의하여 둘러싸이는 금속 패드들 내로 에칭된다.
실시예들 및 그 장점들의 더 완전한 이해를 위해, 이제 첨부된 도면들과 함께 취해지는 하기의 설명에 대한 참조가 이루어진다.
도 1 내지 15는 몇몇 예시적 실시예들에 따른 패키지 제조에 있어서의 중간 스테이지들의 단면도들 및 상면도들이며, 여기서 실딩 케이스들이 패키징 프로세스 동안 형성된다.
도 16은 몇몇 실시예들에 따른 패키지의 개략도를 예시하며, 여기서 패키지 내의 금속 연결부들이 예시된다.
도 16은 몇몇 실시예들에 따른 패키지의 개략도를 예시하며, 여기서 패키지 내의 금속 연결부들이 예시된다.
개시물의 실시예들의 제조 및 사용이 하기에서 상세히 논의된다. 그러나 실시예들은 광범위한 특정 문맥들에서 구현될 수 있는 복수의 적용가능한 개념들을 제공한다는 것이 인식되어야 한다. 논의된 특정 실시예들은 예시적인 것이며, 개시물의 범위를 제한하지 않는다.
빌트-인(built-in) 금속 실딩 케이스 및 그 형성 방법이 다양한 예시적 실시예들에 따라 제공된다. 패키징 프로세스에서 금속 실딩 케이스를 형성하는 중간 스테이지들이 예시된다. 금속 실딩 케이스의 변형들이 논의된다. 다양한 도면들 및 예시적 실시예들 전반에 걸쳐, 동일한 엘리먼트들을 지시하는데 동일한 참조 번호들이 사용된다.
도 1 내지 15는 몇몇 예시적 실시예들에 따른 빌트-인 금속 실딩 케이스를 포함하는 패키지 제조에 있어서의 중간 스테이지들의 단면도들 및 상면도들이다. 도 1은 캐리어(20) 및 캐리어(20) 상의 금속 호일(22)을 예시한다. 캐리어(20)는 유리 캐리어, 세라믹 캐리어 등일 수 있다. 금속 호일(22)은 또한 다른 전도성 물질들로도 또한 형성될 수 있지만, 예컨대 구리 호일일 수 있다. 금속 호일(22)의 두께(T1)는 약 1 ㎛ 내지 약 20 ㎛일 수 있다. 그러나 설명 전반에 걸쳐 언급된 값들은 단지 예들일 뿐이며, 상이한 값들로 변경될 수 있음이 인식된다. 몇몇 실시예들에서, 금속 호일(22)을 캐리어(20)에 부착하는데 사용되는 접착 층(미도시)이 존재한다. 접착 층은 예를 들어, 자외선(UV) 글루(glue)로 형성될 수 있다.
도 2는 금속 호일(22) 상의 디바이스 다이들(24 및 25)의 배치를 예시한다. 디바이스 다이들(24 및 25)은 금속 호일(22)에 면하는 배면들과 함께 배치되고, 따라서 다이들(24 및 25)의 배면들은 서로 동일한 높이이다. 디바이스 다이들(24 및 25)은 내부에 로직 트랜지스터들을 포함하는 로직 디바이스 다이들일 수 있다. 몇몇 예시적 실시예들에서, 디바이스 다이들(24 및 25)은 모바일 애플리케이션들을 위해 설계되는 다이들이며, 예를 들어 전력 관리 집적 회로(Power Management Integrated Circuit, PMIC) 및 트랜시버(Transceiver, TRX) 다이를 포함할 수 있다. 2개의 다이들(24 및 25)이 예시되나, 더 많은 다이들이 금속 호일(22) 위에 배치되고, 서로 동일한 레벨일 수 있다. 게다가, 서로 동일한 다이들(24)의 어레이 및 서로 동일한 다이들(25)의 어레이가 존재할 수 있고, 여기서 다이들(24 및 25)의 각각의 쌍은 패키지를 형성하는데 사용될 것이다.
몇몇 예시적 실시예들에서, 금속 범프들(26)(구리 포스트들과 같은)이 디바이스 다이들(24 및 25)의 상부 부분들로서 형성되고, 디바이스 다이들(24 및 25)의 디바이스에 전기적으로 커플링된다. 금속 범프들(26)은 다이들(24 및 25)의 나머지 부분들 위에 돌출할 수 있다. 금속 범프들(26)은 다이들(24 및 25) 내의 집적 회로 디바이스들에 전기적으로 연결된다. 설명 전반에 걸쳐, 금속 범프들(26)을 갖는 다이들(24 및 25)의 측면들은 전방측(front side)으로서 지칭된다.
도 3를 참고하여, 몰딩 물질(27)이 디바이스 다이들(24 및 25) 상에 몰딩된다. 몰딩 물질(27)은 디바이스 다이들(24 및 25) 사이의 갭들을 충진하고, 금속 호일(22)과 접촉할 수 있다. 게다가, 몰딩 물질(27)은 금속 범프들(26) 사이의 갭들 내로 충진될 수 있다. 몰딩 물질(27)은 몰딩 컴파운드(molding compound), 몰딩 언더필(molding underfill), 에폭시 또는 레진을 포함할 수 있다. 몰딩 물질(27)의 상부면은 금속 범프들(26)의 상부 단부들보다 더 높다. 다음으로, 그라인딩 단계일 수 있는 씨닝(thinning) 단계가 금속 범프들(26)이 노출될 때까지 몰딩 물질(27)을 씨닝하기 위해 수행된다.
다음으로, 전도성 포스트들(28)이 몰딩 물질(27) 내에 형성된다. 설명 전반에 걸쳐, 전도성 포스트들(28)은 대안적으로 쓰루-어셈블리 비아들(TAVs)(28)로서 지칭된다. 몇몇 실시예들에서, TAV들(28)은 도금에 의해 형성될 수 있다. TAV들(28)의 예시적인 형성 프로세스는 금속 호일(22)이 노출될 때까지 몰딩 물질(27) 내에 (TAV들(28)에 의해 점유되는) 개구들을 형성하는 단계 및 개구들 내에 TAV들(28)을 도금하는 단계를 포함할 수 있다. TAV들(28)의 물질은 구리, 알루미늄 등을 포함할 수 있다. 도 2의 결과적인 구조물에서, TAV들(28)의 하부 단부들은 디바이스 다이들(24 및 25)의 하부면과 실질적으로 동일한 레벨에 있다. 몇몇 실시예들에서, 금속 범프들(26)의 상부 단부들(26A)과 몰딩 물질(27)의 상부면(27A)과 TAV들(28)의 상부 단부들(28A)이 동일 레벨에 있도록 평탄화가 수행된다. TAV들(28)은 금속 포스트들(28-1) 및 금속 링들(28-2)을 포함할 수 있으며, TAV들(28-1 및 28-2)의 상면도 형상들이 도 10에 예시된다.
다음으로 도 5를 참고하여, 재분배 라인들(Redistribution Lines, RDLs)(42)은 금속 범프들(26) 및 TAV들(28)에 연결하기 위하여 몰딩 물질(27) 위에 형성된다. RDL들(42)은 또한 금속 범프들(26) 및 TAV들(28)을 상호연결시킬 수 있다. RDL들(42)은 유전체 층들(44) 내에 형성된다. 몇몇 실시예들에서, RDL들(42)은 금속 층들을 증착하는 단계, 금속 층들을 패터닝하는 단계, 및 유전체 층들(44)을 갖는 RDL들(42) 사이에 갭들을 충진하는 단계에 의하여 형성된다. 대안적인 실시예들에서, RDL들(42) 및 유전체 층들(44)은 다마신 프로세스들을 사용하여 형성된다. RDL들(42)은 알루미늄, 구리, 텅스텐 및/또는 이들의 합금들을 포함하는, 금속 또는 금속 합금을 포함할 수 있다.
도 6은 언더-범프 메탈러지(Under-Bump Metallurgy, UBM)들(46)(46A 및 46B를 포함함) 및 접지 메시(48)의 형성을 예시한다. 명세서 전반을 통해, 용어들 "접지 메시" 및 "금속 메시"는 상호교환 가능하게 사용된다. UBM들(46) 및 접지 메시(48)의 형성은 도 5의 구조물 위에 유전체 층(49)을 형성하고 패터닝하는 단계, 및 유전체 층(49) 위에 (티타늄 층 및 오버라잉(overlying) 구리 층과 같은(미도시)) 씨드(seed) 층을 증착하는 단계를 포함할 수 있다. 패터닝된 포토 레지스트(미도시)는 그 후 씨드 층 위에 형성되고, 패터닝된 포토 레지스트 내에 금속성 물질이 도금된다. 포토 레지스트는 그 후 제거되고, 포토 레지스트에 의하여 커버되는 씨드 층의 부분들은 제거된다. 도금된 금속성 물질의 나머지 부분들은 UBM들(46) 및 접지 메시(48)를 형성한다. UBM들(46A)은 접지 메시(48)에 물리적으로 그리고 전기적으로 연결되며, 전기적 접지 및 열방산을 위해 사용될 수 있다. UBM들(46B)은 접지 메시(48)로부터 물리적으로 분리(disconnect)되고, 전기적으로 절연되며, 신호-송신선들의 연결을 위해 사용될 수 있다. 설명 전반에 걸쳐, 도 6에 도시된 구조물은 복합 웨이퍼(100)로서 지칭된다.
도 7은 도 6의 구조물의 상면도를 예시한다. 도 6의 단면도는 도 7에서 라인(6-6)을 가로지르는 평면으로부터 획득된다. 도 7에 도시된 바와 같이, 접지 메시(48)는 큰 금속 호일을 형성한다. 몇몇 실시예들에서, 접지 메시(48)의 모든 부분들은 그들이 복수의 피스(piece)들을 형성할 수 있으나, 단일의 통합된 피스로 연결된다. 금속 메시(48)의 통합된 부분들인 UBM들(46A)은 하부에 놓인 TAV들(28) 및 금속 범프들(26)에 금속 메시(48)를 연결한다(도 6). UBM들(46B)은 공간들에 의해 접지 메시(48)로부터 분리된다. 접지 메시(48)의 전체 상면 면적은 복합 웨이퍼(100)의 전체 상면 면적의 약 50 퍼센트보다 클 수 있다. 몇몇 실시예들에서, UBM들(46B) 각각은 접지 메시(48)에 의해 UBM들(46B)의 나머지로부터 이격된다. 게다가, 대안적인 실시예들에서 수 개의 UBM들(46)이 접지 메시(48)가 사이에 삽입되지 않고 서로에 가까울 수 있음에도 불구하고, 몇몇 예시적 실시예들에서, 2개의 UBM들(46B)은 사이에 삽입된 접지 메시(48)의 부분 없이 서로의 바로 옆에 있지 않다.
캐리어 스위치가 수행된다. 캐리어 스위치 프로세스에서, 도 8에 도시된 바와 같이, 캐리어(50)는 먼저 복합 웨이퍼(100)에 부착되고, 캐리어들(50) 및 캐리어(20)(도 6)는 복합 웨이퍼(100)의 대향 면들 상에 있다. 캐리어(50)는 접착제(52)를 통해 복합 웨이퍼(100)에 부착될 수 있고, 상기 접착제는 UV 글루(glue), 테잎 등일 수 있다. 캐리어(20)는 그 후 복합 웨이퍼(100)로부터 부착 해제된다.
캐리어 스위치 이후에, 금속 호일(22)은 노출된다. 예시된 구조물에서, TAV들(28)의 후방 단부들(28B)은 디바이스 다이(24)의 배면(24A) 및 디바이스 다이(25)의 배면(25A)과 동일한 레벨에 있다. TAV들(28)의 후방 단부들(28B)은 또한 몰딩 물질(27)의 표면(27B)과 실질적으로 동일한 레벨에 있을 수 있다. 게다가, TAV들(28)은 금속 호일(22)의 하부면에 연결된다.
다음으로 도 9에 도시된 바와 같이, 금속 호일(22)을 패터닝하기 위하여 에칭 프로세스가 수행된다. 따라서 패터닝되는 금속 호일(22)은 금속 패드들(54) 및 금속 메시(56)을 형성하며, 금속 패드들(54) 및 금속 메시(56)는 서로로부터 물리적으로 분리되고, 서로로부터 전기적으로 분리될 수 있다. TAV들(28)은 금속 메시(56) 아래에 놓이고 금속 메시(56)에 연결되는 제1 부분, 및 금속 패드들(54) 아래에 놓이고 금속 패드들(54)에 연결되는 제2 부분을 포함한다.
도 10a는 금속 패드들(54) 및 금속 메시(56)의 상면도를 예시한다. 도 9의 단면도는 도 10의 라인(9-9)을 가로지르는 평면으로부터 획득될 수 있다. 도 10a에 도시된 바와 같이, 금속 메시(56)는 아래 놓인 TAV들(28-2)에 연결되고, 금속 패드들(54)은 아래놓인 TAV들(28-1)에 연결된다. 금속 패드들(54)은 공간들에 의해 접지 메시(48)로부터 물리적으로 분리되고, 전기적으로 분리된다. 도 9에 도시된 바와 같이, 금속 메시(56)는 다이들(24 및 25)의 배면 위에 있으며 그와 물리적으로 접촉한다. 따라서 금속 메시(56)는 다이들(24 및 25)에서 생성된 열을 방산시키는 기능을 갖는다. 도 10a는 또한 몇몇 별개의 TAV들(28-1로 표시됨)이 금속 포스트(post)들의 형상을 갖는 것으로 예시한다. TAV들(28)은 또한 다이들(24 및 25)을 둘러싸는 완전한 링들을 형성하는 몇몇 TAV들(28-2)을 포함할 수 있다.
도 10b는 대안적인 실시예들에 따른 복합 웨이퍼(100)의 상면도를 예시하고, 여기서 TAV들(28-2)은 완전한 링을 형성하는 대신, 링(57)에 대해 정렬된 별개의 금속 포스트들이고, 상기 링은 다이(24 또는 25)를 둘러싼다. 별개의 TAV들(28-2) 사이의 공간(S1)은 신호들을 실딩하기에 충분히 작다. 예를 들어, 공간(S1)은 고립될 신호의 파장의 약 1/4보다 더 작을 수 있으며, 신호는 다이들(24 및 25)에 의하여 반송(carry)될 수 있다.
몇몇 예시적 실시예들에서, 금속 메시(56)의 전체 상면 면적은 복합 웨이퍼(100)의 전체 상면 면적의 약 50 퍼센트보다 더 크다. 게다가, 금속 패드들(54) 각각은 금속 메시(56)에 의해 금속 패드들(54)의 나머지로부터 이격될 수 있다. 몇몇 실시예들에서, 수 개의 금속 패드들(54)이 접지 메시(48)가 사이에 삽입되지 않고 서로에 가까울 수 있음에도 불구하고, 2개의 금속 패드들(54)은 사이에 삽입된 금속 메시(56)의 부분 없이 서로의 바로 옆에 있지 않다.
도 11에 도시된 바와 같이, 다음으로 유전체 층들(58) 및 RDL들(60)이 형성된다. 몇몇 실시예들에서, 유전체 층들(58)은 산화물들, 질화물들, 탄화물들, 탄소 질화물, 이들의 조합물들 및/또는 이들의 다중-층들과 같은 유전체 물질들로 형성된다. RDL들(60)은 유전체 층(58) 내에 형성되며, 금속 패드들(54) 및 금속 메시(56)에 연결된다. RDL들(60) 중 일부는 디바이스 다이들(24 및 25) 위에서 연장되고 디바이스 다이들(24 및 25)에 맞추어 정렬될 수 있으며, 몇몇 다른 RDL들(60) 중 다른 일부는 다이들(24 및 25)의 경계선들 너머로 연장할 수 있다. 따라서, RDL들(60)은 팬-아웃(fan-out) 구조물을 갖는다.
도 12는 RDL들(60)에 대한 다이(62)의 본딩(bonding)을 예시하며, 여기서 본딩은 예컨대 솔더 본딩, 금속-대-금속 직접 본딩 등을 통해 수행될 수 있다. 몰딩 물질(64)은 다이(62), RDL(60) 및 유전체 층들(58)을 몰딩하는데 사용된다. 몇몇 실시예들에서, 몰딩 프로세스 이후에, 다이(62)의 배면이 노출되도록 평탄화가 수행된다. 평탄화 이후에, 캐리어(50)는 복합 웨이퍼(100)로부터 떼어내질 수 있다. 결과적인 구조물이 도 13에 도시된다. 다이 쏘우(die saw)가 그 후 스크라이브 라인들(66)을 따라 복합 웨이퍼(100) 상에서 수행된다. 따라서 복합 웨이퍼(100)는 서로 동일한 복수의 패키지들(110)로 분리된다.
도 14를 참고하여, 패키지(110)가 캐리어(68) 상에 장착된다. 금속 실딩 필름(70)은 그 후 패키지(110)의 외부 표면 상에 형성된다. 몇몇 실시예들에서, 다른 금속성 물질들이 사용될 수 있으나, 금속 실딩 필름(70)은 구리를 포함한다. 금속 실딩 필름(70)은 물리 기상 증착(PVD), 금속 스프레이, 도금 또는 이들의 조합들에 의해 형성될 수 있다. 금속 스프레이가 사용되는 실시예들에서, 구리 스프레이와 같은 금속-포함 스프레이(액체 또는 젤)가 패키지(110)의 상부면 및 측벽 면들 상에 스프레잉된다. 금속 스프레이는 그 후 경화되고, 나머지 재료는 금속 입자들(구리 입자들과 같은) 및 금속 입자들을 함께 접착시키는 몇몇 접착 물질들을 포함한다. 결과적인 경화된 금속 스프레이는 전기 전도성이다. 금속 스프레이는 스탬핑 프로세스들로 형성되는 미리 형성된 금속 실딩 케이스들로부터 구분될 수 있다. 예를 들어, 금속 실딩 필름(70)은 스탬핑 프로세스보다는 증착에 의해 형성되기 때문에, 금속 실딩 필름(70)과 금속 실딩 필름(70)에 의해 둘러싸이는 패키지(110)의 부분 사이에 갭(공간)이 존재하지 않는다. 게다가, 금속 실딩 필름(70)은 금속 입자들을 함께 접착하기 위하여 접착 물질을 포함할 수 있다.
패키지(110)의 하부면은 상부에 금속 실딩 필름(70)이 형성되지 않고, 따라서 UBM들(46) 및 접지 메시(48)는 서로로부터 분리된 채로 유지된다. 게다가, 금속 실딩 필름(70)은 접지 메시(48) 및 금속 메시(56)의 에지들에 접합(join)되어, 집적된 실딩 케이스들을 형성한다. 금속 실딩 필름(70)의 형성 이후에, 패키지(110)는 캐리어(68)로부터 분리된다.
도 15는 몇몇 예시적 실시예들에 따른 전기 커넥터들(72)의 형성을 예시한다. 커넥터들(72)의 형성은 UBM들(46A 및 46B)의 노출된 부분들 상에 솔더 볼들을 배치하는 단계 및 그 후 솔더 볼들을 리플로잉(reflowing)하는 단계를 포함할 수 있다. 대안적인 실시예들에서, 커넥터들(72)의 형성은 UBM들(46A 및 46B)의 솔더 영역들을 형성하기 위하여 도금 단계를 수행하는 단계 및 그 후 솔더 영역들을 리플로잉하는 단계를 포함한다. 결과적인 패키지(110)는 그 후 패키지 컴포넌트(74)에 본딩될 수 있으며, 이는 인터포저(interposer), 패키지 기판, PCB 등일 수 있다. 커넥터들(72)은 패키지 컴포넌트(74)의 접지에 패키지(110)의 전기 접지를 연결하는 접지 커넥터들(72A) 및 패키지 컴포넌트(74)의 신호선들에 패키지(110)의 신호선들을 연결하는 커넥터들(72B)을 포함한다.
도 16은 도 15의 구조물의 개략도를 예시한다. 구조물은 간략화되며, RDL들, 몇몇 TAV들 및 다이들은 예시되지 않는다. 도 16에 도시된 바와 같이, 금속 실딩 필름(70), TSV들(28-2)(원들을 형성할 수 있음), 금속 메시(56) 및 접지 메시(48)는 함께 금속 실딩 케이브들(76A, 76B 및 76C)을 내부에 동봉하는 금속 실딩 케이스들을 형성한다. 금속 실딩 케이브들(76A, 76B 및 76C) 각각은 금속 실딩 케이스들 중 하나에 의하여 둘러싸이며, 이는 전자기장을 실딩할 수 있는 금속 피쳐들로 형성된다. 금속 실딩 구조물은 3D 구조물이다. 금속 실딩 케이스들은 금속 실딩 케이스들의 안팎으로 신호의 라우팅을 위해 일부 갭들이 남겨지는 것을 제외하고, 실질적으로 완전히 둘러싸인다.
본 개시물의 실시예들에서, 금속 실딩 케이스들은, 사전-형성되는 대신, 패키지 프로세스들에서 형성된다. 실시예들에 따른 금속 실딩 케이스들을 형성하는 제조 비용은, 스탬핑 프로세스들, 금속 실딩 케이스들 배치, 및 금속 실딩 케이스를 PCB에 납땜하는 것을 포함하는 종래 프로세스보다 낮다. 금속 실딩 케이스들은 통합된 3D 구조물들을 형성할 수 있으며, 따라서 결과적인 패키지의 점유된 공간은 향상된다. 게다가, 금속 실딩 케이스들은 다이들의 배면(back surface)과 접촉하고, 따라서 다이들의 열방산을 향상시킬 수 있다.
실시예들 및 그들의 장점들이 상세히 설명되었으나, 첨부된 청구항들에 의해 정의되는 바와 같은 실시예들의 진의 및 범위를 벗어나지 않고 다양한 변화들, 대체들 및 개조들이 이루어질 수 있음이 이해되어야 한다. 또한, 본 출원의 범위는 명세서에 설명된 프로세스, 머신, 상품, 물질의 조성, 수단, 방법들 및 단계들의 특정 실시예들로 제한되는 것으로 의도되지 않는다. 본 기술분야의 당업자가 개시내용으로부터 용이하게 인식할 것과 같이, 본 명세서에 설명된 대응 실시예들과 실질적으로 동일한 기능을 수행하거나 실질적으로 동일한 결과를 달성하는, 현재 존재하거나 추후에 개발될 프로세스들, 머신들, 상품, 물질의 조성들, 수단, 방법들 또는 단계들은 개시물에 따라 이용될 수 있다. 따라서 첨부된 청구항들은 그러한 프로세스들, 머신들, 상품, 물질 조성들, 수단, 방법 또는 단계들을 발명의 범위 내에 포함시키도록 의도된다. 또한, 각각의 청구항은 개별적 실시예를 구성하며, 다양한 청구항들 및 실시예들의 조합이 개시물의 범위 내에 있다.
Claims (10)
- 금속 실드 케이스(metal shield case)를 포함하는 패키지에 있어서,
상기 금속 실드 케이스는,
제1 금속 메시(mesh); 및
상기 제1 금속 메시 위의 쓰루-어셈블리 비아(Through-Assembly Via, TAV)
를 포함하며, 상기 TAV는 링을 형성하고, 상기 TAV 및 상기 제1 금속 메시는 전기적으로 상호연결되고 전기적으로 접지되는, 패키지. - 제1항에 있어서,
상기 금속 실드 케이스는,
상기 TAV 위에 있고 상기 TAV 및 상기 제1 금속 메시에 전기적으로 연결되는, 제2 금속 메시를 더 포함하는, 패키지. - 제2항에 있어서,
상기 제2 금속 메시와 동일한 레벨에 있고 상기 제2 금속 메시와 동일한 물질로 형성되는, 복수의 언더-범프 메탈러지(Under-Bump Metallurgy, UBM)들; 및
상기 복수의 UBM들 각각에 연결되는 솔더(solder) 영역
을 더 포함하는, 패키지. - 제3항에 있어서,
상기 복수의 UBM들은,
상기 제2 금속 메시로부터 전기적으로 분리(disconnect)되는 제1 UBM들; 및
전기적으로 접지되는 제2 UBM들 ― 상기 제2 UBM들은 상기 제2 금속 메시의 집적된(integrated) 부분들임 ―
을 포함하는, 패키지. - 제1항에 있어서,
상기 제1 금속 메시와 동일한 레벨에 있고 상기 제1 금속 메시와 동일한 물질로 형성되는, 복수의 금속 패드들을 더 포함하며,
상기 복수의 금속 패드들 각각은 상기 제1 금속 메시에 의하여 둘러싸이는, 패키지. - 제5항에 있어서,
상기 복수의 금속 패드들 각각은 상기 제1 금속 메시에 의하여 상기 복수의 금속 패드들 중 나머지 모든 금속 패드로부터 분리되는, 패키지. - 패키지에 있어서,
금속 실드 케이스(metal shield case); 및
상기 금속 실드 케이스 위의 금속 실딩 필름
을 포함하며, 상기 금속 실드 케이스는,
제1 금속 메시(mesh);
상기 제1 금속 메시와 동일한 레벨에 있고 상기 제1 금속 메시와 동일한 물질로 형성되는, 복수의 금속 패드들 ― 상기 복수의 금속 패드들 각각은 상기 제1 금속 메시에 의하여 둘러싸임 ― ;
상기 제1 금속 메시 아래에 놓인 제2 금속 메시; 및
링을 형성하는 쓰루-어셈블리 비아(Through-Assembly Via, TAV) ― 상기 TAV는 상기 제1 금속 메시의 하부면과 접촉하는 상부 단부(top end)를 가지며, 상기 제2 금속 메시 위에 있음 ―
를 포함하고, 상기 금속 실딩 필름은.
상기 제1 금속 메시 위에 있고 상기 제1 금속 메시로부터 이격되는, 상부 부분; 및
상기 제1 금속 메시의 에지들 및 상기 제2 금속 메시의 에지들에 접촉하는, 측벽 부분
을 포함하는, 패키지. - 제7항에 있어서,
상기 복수의 금속 패드들 각각은 상기 제1 금속 메시에 의하여 상기 복수의 금속 패드들 중 나머지 모든 금속 패드로부터 분리되는, 패키지. - 제7항에 있어서,
상기 금속 실드 케이스 내의 제1 다이; 및
상기 제1 다이를 몰딩하는 제1 몰딩 물질
를 더 포함하며, 상기 복수의 금속 패드들 중 하나의 금속 패드는 상기 제1 다이에 전기적으로 연결되는, 패키지. - 제1 몰딩 물질로 제1 다이를 몰딩하는 단계;
상기 제1 몰딩 물질 내에 쓰루-어셈블리 비아(Through-Assembly Via, TAV)들을 형성하는 단계 ― 상기 TAV들은 상기 제1 다이를 둘러싸는 TAV 링을 포함함 ― ; 및
상기 TAV들 위에 있고 상기 TAV들에 전기적으로 연결되는 언더-범프 메탈러지(Under-Bump Metallurgy, UBM)들 및 제1 금속 메시를 형성하는 단계
를 포함하는, 방법.
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US201361778291P | 2013-03-12 | 2013-03-12 | |
US61/778,291 | 2013-03-12 | ||
US13/926,938 | 2013-06-25 | ||
US13/926,938 US9337073B2 (en) | 2013-03-12 | 2013-06-25 | 3D shielding case and methods for forming the same |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20140111936A true KR20140111936A (ko) | 2014-09-22 |
KR101650224B1 KR101650224B1 (ko) | 2016-08-22 |
Family
ID=51522429
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020130149834A KR101650224B1 (ko) | 2013-03-12 | 2013-12-04 | 패키지 및 그 형성 방법 |
Country Status (2)
Country | Link |
---|---|
US (2) | US9337073B2 (ko) |
KR (1) | KR101650224B1 (ko) |
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KR101650224B1 (ko) | 2016-08-22 |
US20140262475A1 (en) | 2014-09-18 |
US9337073B2 (en) | 2016-05-10 |
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