KR20070033286A - 상호접속 층의 교체를 위한 본드 패드 아래에서 라우팅 - Google Patents

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반스 디. 아처 3세
미쉘 씨. 아유카와
마크 에이. 베크먼
다니엘 피. 체서
성 에이치. 강
태호 국
세이레쉬 엠. 머천트
커트 쥐. 스테이너
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Abstract

본 발명은 솔더 범프 구조를 갖는다. 일 특징으로는, 솔더 범프 구조는 집적 회로와 같은 반도체 장치에서 사용된다. 반도체 장치는 반도체 기판 위에 위치된 능동 장치들, 능동 장치들 위에 형성된 구리를 포함하는 상호접속 층들 및 상호접속 층들 위에 배치된 최외각 금속화 층을 포함한다. 최외각 금속화 층은 알루미늄을 포함하고 적어도 하나의 본드 패드 및 상호접속 층에 각각 전기적으로 접속된 적어도 하나의 상호접속 런너를 포함한다. 언더 범프 금속화 층(UBM)은 본드 패드 위에 배치되고, 솔더 범프는 UBM 위에 위치한다.
상호접속 런너, 본드 패드, 알루미늄 층, 패시베이션 층, 최외곽 금속화 층

Description

상호접속 층의 교체를 위한 본드 패드 아래에서 라우팅{Routing under bond pad for the replacement of an interconnect layer}
도1은 종래 기술의 솔더 범프 구조의 부분을 도시한 도면.
도2a 내지 2i는 본 발명에 의해 제공되는 솔더 범프 구조 및 이 솔더 범프 구조의 제조의 각종 스테이지들을 부분적으로 도시한 도면.
도3은 본 발명의 솔더 범프 구조가 사용될 수 있는 IC를 부분적으로 도시한 도면.
* 도면의 주요 부분에 대한 부호의 설명 *
205: 최외곽 상호접속 층
205a: 런너
210: 유전체 층
215: 패시베이션 층
본 발명은 일반적으로 반도체 장치에 관한 것이며, 특히, 상호접속 층을 교체하는 본드 패드 구조 아래에서 새로운 라우팅을 이용하는 반도체 장치에 관한 것 이다.
감소하는 피쳐 크기들로 인해, 반도체 집적 회로 산업체에서 알루미늄(Al) 또는 Al-합금 상호접속들을 구리(Cu)-계 금속화 층들로의 이동 필요성이 제기되었다. Cu 상호접속의 최대 10 레벨을 포함하는 멀티레벨 구조들이 현대 장치들에서 보편화되었다. 구리는 Al-계 합금들보다 저항율을 낮고, 저-k 유전체들과 결합하여 사용될 때, Cu는 RC 상호접속 지연들을 감소시킨다. 게다가, Cu-계 상호접속들은 Al-계 합금들에 비해서 신뢰성이 좋다.
상호접속들의 최상위 레벨들은 전형적으로 저-k 유전체들을 포함하지 않는데, 그 이유는 이들의 기계적 및 화학적 안정성이 나쁘기 때문이다. 이들 재료들은 인덴테이션 및 전단(indentation and shear)에 대한 나쁜 강도 및 낮은 저항을 갖고, 본질적으로 부숴지기 쉽다. 따라서, 이들 재료들은 와이어 본딩 또는 플립 칩 어셈블리 기술들에 대해서 부적합하다. 그러므로, 산업체는 종래의 SiO2-계 유전체 내에서 형성되는 최상위(또는 최상위에서 2번째) Cu 금속화 층들을 갖는 마이크로전자 장치들을 제조한다. 게다가, 최상위 Cu 금속층은 실리콘 나이트리드, 실리콘 다이옥사이드, 실리콘 옥시나이트리드(SiN/SiO2/SiON) 또는 이들의 조합물들과 같은 배리어 유전체들로 패시베이팅되어야 한다. 종래의 반도체 장치(100)가 도1에 도시되어 있는데, 이 도면에서 큰 Cu 본드 패드(110)는 최외곽 유전체 층(115)에 형성되는 최종 또는 최외곽 Cu 상호접속 층의 부분으로서 도시된다. 게이트들 및 상호접속 층들과 같은 이 장치의 다른 반도체 피쳐들은 간결성을 위하여 생략된다.
많은 수의 I/Os를 갖는 장치들은 전형적으로 플립 칩 어셈블리 기술들로 제조된다. Cu로의 직접적인 범핑이 통상 가장 상업적인 어셈블리 동작들로부터 이용될 수 없기 때문에, 플립 칩 범프를 제조하기 전 구리 금속화의 최상위 레벨에서 Cu 본드 패드(110) 위에 위치되는 Al-합금 본드 패드(120)를 제조하기 위하여 Cu 상호접속들을 함유하는 플립 칩 장치들을 제조하는 것이 보편적인 방법이다. Al-합금 본드 패드(120)는 도1에 도시된 바와 같이 Cu 본드 패드(110)를 부분적으로 커버하는 웨이퍼 패시베이션 층(125)의 형성 후에 제조된다. 배리어 층(도시되지 않음)은 전형적으로 Al-합금 본드 패드(120)를 구리 본드 패드(110)로부터 분리시킨다. 최종 패시베이션 층(130)은 그 위에 증착된다. 패시베이션 층(130)은 패턴닝되어 Al-합금 본드 패드(120)에 전기 접속하게 된다. 언더 범프 금속화(UBM) 층(135)은 Al-합금 본드 패드(120) 위에 위치된다. 본 기술 분야에 널리 공지된 바와 같이, UBM 층(135)은 Al-합금 본드 패드(120)를 솔더 범프(140)로부터 분리시킨다. Al-합금 본드 패드(120)는 Cu 본드 패드(110)를 통해서 반도체 장치의 밑에 놓인 능동 요소들에 전기적으로 접속되는데, 이 Cu 본드 패드는 밑에 놓인 상호접속 금속화 층(도시되지 않음)에 전기 접속된다. 따라서, 도1에 도시된 구조로부터 알 수 있는 바와 같이, 부가적인 상호접속 금속 층(즉, Cu 본드 패드(110))은 Al-합금 본드 패드(120)를 밑에 놓인 능동 장치들과 전기적으로 접속시키는데 필요로 된다. Cu 본드 패드(110)의 제조는 부가적인 프로세싱 및 마스킹 단계들을 필요로 함으로, 제조 비용을 증가시킨다.
본 기술 분야에서 필요로 되는 것은 상술된 종래 구조의 결점들을 처리하는 개선된 본드 패드 구조를 갖는 반도체 장치이다.
종래 기술의 상술된 결점들을 처리하기 위하여, 본 발명은 일 실시예에서 적어도 하나의 본드 패드 및 적어도 하나의 상호접속 런너를 포함하는 알루미늄 층을 포함하는 반도체 장치를 제공하는 것인데, 상기 상호접속 런너는 밑에 놓인 구리 상호접속 층에 전기적으로 결합된다.
또 다른 실시예에서, 본 발명은 반도체 기판 위에 위치되는 능동 장치들, 적어도 제1 및 제2 런너 부분들로 세그먼트되고 상기 능동 장치들 위에 형성되는 최외곽 상호접속 층, 및 상기 상호접속 층 위에 위치되는 세그먼트된 본드 패드 층을 포함하는 반도체 장치를 제공한다. 본드 패드 층은 본드 패드 부분 및 상호접속 런너 부분을 포함한다. 이 장치는 상기 최외곽 상호접속 층 및 상기 본드 패드 층 간에 위치되는 패시베이션 층을 더 포함한다. 패시베이션 층은 비아들을 포함하는데, 이 비아들은 상기 패시베이션 층을 통해서 신장되어 상호접속 층과 접촉한다. 본드 패드 및 상호접속 런너 부분들은 비아들을 통해서 신장된다. 본드 패드 부분은 비아들 중 적어도 한 비아에 의해 제1 부분에 전기적으로 접속되고, 상기 상호접속 런너 부분은 비아들 중 적어도 한 비아에 의해 상기 제2 부분에 전기적으로 접속된다. 언더 범프 금속화(UBM) 층은 본드 패드 부분 위에 위치된다.
또 다른 실시예에서, 본 발명은 반도체 기판 위에 위치되는 트랜지스터들, 상기 트랜지스터들 위에 위치되는 유전체 층들, 상기 트랜지스터들 위에 그리고 상기 유전체 층들 내에 형성되는 구리를 포함하는 상호접속 층들, 및 상기 상호접속 층들 위에 위치되는 최외곽 금속화 층을 포함하는 집적 회로(IC)를 제공한다. 최외곽 금속화 층은 Al을 포함하고 최외곽 상호접속 층에 각각 전기적으로 접속되는 복수의 상호접속 런너들 및 복수의 본드 패드들을 포함한다.
또 다른 실시예에서, 반도체 장치를 제조하는 방법이 제공되는데, 상기 방법은 기판 위에 구리 상호접속 층을 형성하는 단계, 및 상기 구리 상호접속 층 위에 적어도 하나의 본드 패드 및 적어도 하나의 상호접속 런너를 포함하는 알루미늄 층을 형성하는 단계를 포함하는데, 상기 상호접속 런너는 상기 구리 상호접속 층에 전기적으로 접속된다.
또 다른 실시예에서, 본 발명은 반도체 장치 위에 위치되는 능동 장치들, 상기 능동 장치들 위에 형성되는 구리를 포함하는 상호접속 층들, 및 상기 상호접속 층들 위에 위치되는 최외곽 금속화 층을 포함하는 반도체 장치를 제공한다. 최외곽 금속화 층은 알루미늄을 포함하고 상호접속 층에 각각 전기적으로 접속되는 적어도 하나의 상호접속 런너 및 적어도 하나의 본드 패드를 포함한다.
이하의 본 발명의 상세한 설명으로부터 당업자가 이해할 수 있는 본 발명의 바람직하고 대안적인 특징들이 상술되었다. 후술되는 본 발명의 부가적인 특징들은 본 발명의 청구범위의 요지를 형성한다. 본 발명의 목적을 실행하기 위한 다른 구조들을 설계 또는 수정하기 위한 근간으로서 서술된 개념 및 특정 실시예가 이용될 수 있다는 것을 당업자는 인지할 것이다. 당업자는 또한 이와 같은 등가의 구성들이 본 발명의 원리 및 범위를 벗어남이 없이 실현된다는 것을 알 수 있다.
지금부터, 본 발명의 더욱 완전한 이해를 위하여 첨부 도면을 참조하여 설명 될 것이다.
본 발명을 따르면, 반도체 장치의 최외곽 상호접속 금속화 층들의 하나 이상의 레벨들을 본드 패드 상호접속 층으로 교체하는데 유용하다. 본드 패드 상호접속 층은 본드 패드 목적들을 위하여 전기 상호접속들을 제공할 뿐만 아니라 반도체 장치의 다른 전기 기능들을 위한 일반적인 전기 접속들을 제공한다. 이는 웨이퍼 처리 비용들 및 수율 손실을 크게 절약한다. 최외곽 상호접속 금속화 층을 제거하면서 본드 패드 층을 상호접속 층으로서 이용함으로써 이 교체를 실행하는 것이 현재 제안되었다. 최종 상호접속 금속 층을 제거하는 새로운 라우팅 레이아웃이 제공된다.
도2a에서, 본 발명을 따른 본드 패드 구조(200)의 한 가지 유용한 실시예는 반도체 장치에 사용될 수 있다. 이 실시예는 유전층(210) 내에 위치되는 최외곽 상호접속 층(205) 또는 레벨을 포함한다. 상호접속 층(205)은 패턴닝되어 복수의 상호접속들 또는 런너들(205a) (또한 금속 라인들로 공지됨)로 세그먼트된다. 본원에 사용된 바와 같이, 층은 단일 층 또는 층들의 스택일 수 있다는 것을 이해하여야 한다. 이들 런너들(205a)은 유전층(210)을 따라서 신장되어 비아들을 통해서 밑에 놓인 금속 레벨들(도시되지 않음)에 접속들을 이룬다. 상호접속 층(205)에 위에는 패시베이션 층(215)이 위치된다. 패시베이션 층(215)은 패턴닝되어 이를 통해서 비아들을 형성한다. 비아들은 각종 밑에 놓인 런더들(205)에 접촉한다. 본드 패드 층(220)은 패시베이션 층(215)위에 위치되고 세그먼트되거나 분할되고, 본드 패드 부분(220a) 및 적어도 하나의 상호접속 또는 런너 부분(220b)을 형성한다. 최종 패시베이션 층(222)은 본드 패드(220a)위에 부분적으로 위치되고 런너 부분들(220b) 위에 위치된다. UMB 층(224)은 본드 패드 부분(220a) 위에 위치되고 솔더 범프(226)는 UBM(224) 위에 위치된다. 도2A에 도시된 실시예에서, 2개의 런너 부분들(220b) 및 하나의 본드 패드 부분(220a)이 도시되지만, 다른 실시예들에서, 하나 이상의 본드 패드 부분(220a)이 있을 수 있고 2개 이상의 런너 부분들(220b)이 있을 수 있다. 영역들(205a 및 220a 및 220b)을 포함하는 재료들의 내부 확산을 방지하는 배리어 층/층들은 간결성을 위하여 도시되지 않았다.
상술된 실시예에서 알 수 있는 바와 같이, 본 발명의 본드 패드 구조(200)는 전체 금속화 레벨을 제거하는 구조를 제공하고 필요로 되는 전기 접속 정도를 성취한다. 게다가, 본드 패드 구조(200)는 세그먼트된 본드 패드 층(220)을 이용하여 본드 패드의 목적들을 위한 전기 접속들을 제공할 뿐만 아니라 반도체 장치 내의 다른 전기적인 기능들을 위한 일반적인 상호접속을 제공한다. 이는 밑에 놓인 상호접속 층(205)에 직접 접속하는 본드 패드 부분(220a) 및 런너 부분들(220b)을 통해서 성취된다. 일반적으로 설명된 본드 패드 구조(200)의 일 실시예의 일반적인 구조를 따라서 상기 장치를 제조하는 한가지 방법이 지금부터 설명될 것이다.
도2b는 제조의 한 스테이지에서 도2a의 구조(200)를 도시한 것이다. 이 실시예에서, 하부 상호접속 층들 및 능동 층들(도시되지 않음)이 형성된다. 따라서, 도2b는 유전체 층(210) 내에서 형성되는 본드 패드 구조(200)의 최외곽 상호접속 층(205)을 도시한 것이다. 도시된 상호접속 층(205)은 종래의 프로세스들 및 재료 들을 이용하여 형성될 수 있다. 예를 들어, 상호접속 층(205)은, 상호접속 층(205)의 런너 부분들(205a)을 발생시키는 다마신 또는 이중 다마신 제조 프로세스를 이용하여 형성될 수 있다. 이와 같은 실시예들에서, 유전체 층(210)은 종래의 포토리소그래픽 및 에칭 프로세스들을 이용하여 유전체 층(210)에 개구들 또는 트렌치들을 형성하도록 패턴닝된다.
그 후, 도전성 금속은 개구들 및 트렌치들 내로 증착되고 과다 금속은 종래의 화학적/기계적 폴리싱(CMP) 프로세스들을 이용하여 제거된다. 전형적으로, 트렌치들 또는 개구들은 탄탈/탄탈 나이트리드(Ta/TaN) 또는 티타늄/티타늄 나이트리드(Ti/TiN)과 같은 종래의 배리어 층 또는 층들(도시되지 않음)와 일렬로 된다. 유용한 실시예에서, 도전성 금속은 구리 또는 이들의 합금들을 포함한다. 다른 종래의 상호접속 구조들이 또한 본 발명에서 사용될 수 있다는 것을 유의하여야 한다. 예를 들어, 어떤 예들에서, 상호접속 구조는 비아들에 의해 밑에 놓인 구조들에 접속되는 유전체 층의 최상부 상에 위치되는 금속 런너들을 포함할 수 있다.
상호접속 층(205)의 평탄화 다음에, 패시베이션 층(215)이 도2c에 도시된 바와 같이 상호접속 층(205) 위에 증착된다. 종래의 증착 프로세스들은 및 재료들은 패시베이션 층(215)을 형성하기 위하여 사용되고 도시된 실시예인 단층 또는 층들의 스택을 포함할 수 있다. 예를 들어, 패시베이션 층(215)은 종래의 프로세스들을 이용하여 증착되는 실리콘 나이트리드, 실리콘 다이옥사이드, 실리콘 나이트리드, 실리콘 카보-나이트리드, 실리콘 옥시카바이드, 실리콘 옥시나이트리드 또는 이들의 조합물들의 적층들로 구성될 수 있다. 도시된 실시예가 유전체 층(210) 및 상호 접속 층(205) 위에 직접 위치되는 패시베이션 층(215)을 도시하지만, 다른 실시예들에서, 이 두개 간에 위치되는 인터비닝 층들이 존재한다.
본 발명에서, 패시베이션 층(215)은 특정 방식으로 패턴닝되는데, 즉, 도2d에 도시된 바와 같이 밑에 놓인 런너들(205a) 위에 비아들(217)(간결성을 위하여 지정된 단지 2개)을 개방하기 위하여 패턴닝된다. 접속을 위하여, 전형적인 비아 직경 크기는 0.5 및 10 미크론들 사이의 범위에 있는데, 바람직하게는 약 3미크론 직경이다. 또 다른 실시예에서, 개구들은 일련의 트렌치들(예를 들어, 3미크론 트렌치 폭을 갖는다)이다. 당업자는 이 설명에서 전달하고자 하는 것이 개구들의 실제 치수들이 아니라 바로 이 개념이라는 것을 이해할 것이다. 이들 치수들은 장치 컨덕터 기하형태들, 형상들 및 크기들에 따라서 가변될 것이다.
패시베이션 층(215)의 패턴닝은 종래의 프로세스들 및 구조들과 다르다. 종래의 공정들에서, 패시베이션 층(215)은 통상적으로 구리 패드 위에 패턴닝되는데, 이는 구리 패드 및 솔더 범프 간의 전기 접속을 형성하기 위하여 그 내에 Al을 증착시키기 위한 것이다. 그러나, 패시베이션 층(215)은 분할되거나 세그먼트되어, 비아들이 결국 전체 상호접속 구조의 부분을 갖는 상이한 런너들(205a) 상으로 개방되도록 한다. 비아들의 형성 후, Ti/TiN 또는 Ta/TaN 또는 이들의 조합물들과 같은 종래의 배리어 층은 그 내에 증착될 수 있다. 본 발명의 이 양상은 도시되지 않았지만, 이와 같은 배리어 층들이 제공될 수 있다는 것을 이해하여야 한다.
도2e에서, 본드 패드 층(220)은 패시베이션 층(215) 위에 증착되고, 존재하는 경우 비아들 내로 그리고 배리어 층 위에 층작된다. 배리어 층을 포함하는 비아 내에 위치되는 본드 패드 층(220)의 부분은 각종 상호접속 런너들(205a) 및 본드 패드 층(220) 간에 전기 접속을 제공한다. 종래의 프로세스들 및 재료들은 본드 패드 층(220)을 형성하기 위하여 사용될 수 있다. 예를 들어, 유용한 실시예에서, 본드 패드 층(220)은 Al 또는 이들의 합금들을 포함하고 물리적 기상 증착(PVD) 또는 화학적 기상 증착(CVD) 또는 원자층 증착(ALD) 프로세스들과 같은 증착 프로세스들이 적절한 두께로 본드 패드 층(220)을 형성하도록 사용될 수 있다.
그 후, 종래의 리소그래픽 및 에칭 프로세스는 도2f에 도시된 바와 같이 본드 패드 부분(220a) 및 런너 부분들(220b)으로 본드 패드 층(220)을 특정하게 패턴닝하도록 사용될 수 있다. 선택된 에칭 화학물질은 본드 패드 층(220)을 위하여 선택되는 금속의 유형에 좌우될 것이다. 당업자는 어떤 에칭 화학물질들이 이용되는지를 이해할 것이다. 도시된 실시예에서, 본드 패드 부분(220a)은 본딩 프로세스들을 위하여 밑에 놓인 상호접속 런너들(205a)에 전기 접속을 제공하고 런너 부분들(220b)은 일반적인 상호접속 목적들을 위하여 밑에 놓인 상호접속 런너들(205a)에 전기 접속을 제공한다.
최종 웨이퍼 패시베이션 층일 수 있는 제2 패시베이션 층(222)은 도2g에 도시된 바와 같이 패턴닝된 본드 패드 층(220) 위에 층작되는 블랭킷이다. 종래의 프로세스들 및 재료는 제2 패시베이션 층(222)을 증착시키기 위하여 사용될 수 있다. 예를 들어, 제2 패시베이션 층(222)은 종래의 PVD 또는 CVD 프로세스들로 증착되는 옥사이드/나이트리드 2층으로 구성될 수 있다. 그 후, 제2 패시베이션 층(222)은 런너 부분들(220b)을 커버하면서 다음에 증착되는 UBM 및 솔더 범프를 수용할 밑에 놓이는 본드 부분(220A)의 부분을 노출시키도록 패턴닝된다. 종래의 에칭 프로세스들은 제2 패시베이션 층(222)을 패턴닝하기 위하여 사용될 수 있다.
도2i에서, UBM 층(224)은 증착되고 패턴닝되어 도시된 실시예를 성취한다. CVD, PVD 또는 ALD와 같은 종래의 프로세스들 및 재료들은 UBM 층(224)을 형성하기 위하여 사용될 수 있다. 예를 들어, UBM 층(224)은 티타늄, 니켈/바나듐-구리, 또는 구리/크롬과 같은 금속을 포함할 수 있고, 습식 에칭은 UBM 구조(224)를 형성하기 위하여 도통될 수 있다. UBM 층(224)의 증착 및 패턴닝 후, 솔더 범프(226)는 도2a에 도시된 구조(200)를 성취하기 위하여 종래 방법으로 제조된다.
도3을 간략히 참조하면, 도2a에 도시된 솔더 범프 구조(200)를 포함하는 집적 회로(IC)(300), 예를 들어, 플리칩(IC)과 같은 반도체 장치를 부분적으로 도시한다. 솔더 범프 구조(200)는 밑에 놓인 트랜지스터 구조(310)에 전기적으로 접속된다. IC(300)는 종래의 설계일 수 있고, 따라서, 이의 제조의 상세한 설명은 필요로 되지 않는다. 게다가, IC(300)는 어떤 특정 장치 또는 설계로 제한되지 않는다. 예를 들어, 광전 장치 또는 전기화학 장치일 수 있다. 트랜지스터들(310)은 본드 패드(220a) 및 런너들(220b)을 포함한 솔더 범프 구조(200)에 전기적으로 접속된다. 트랜지스터들(310) 및 솔더 범프 구조(200) 간의 전기 접속들은 도시되지 않았지만, 당업자는 장치들이 전기적으로 접속되는 방법을 이해할 것이다. 솔더 범프 구조(200)는 상호접속들(320)이 형성되는 유전층들(315) 위에 위치된다. 상호접속들(320)은 다마신 또는 이중 다마신 상호접속 구조들과 같은 종래의 설계로 이루어질 수 있다. 당업자는 솔더 범프 구조(200)가 납 또는 이의 합금들을 포함할 수 있 다는 것을 이해할 것이다. 대안적으로, 실질적으로 무납(lead-free)(납의 트레이스 량 미만, 예를 들어 0.5% 미만을 포함)일 수 있고 당업자에게 공지된 무납 합금들을 포함할 수 있다.
본 발명이 상세히 설명되었지만, 당업자는 본 발명의 원리를 벗어남이 없이 각종 변경들, 치환들, 대체들을 행할 수 있다는 것을 이해할 것이다.
본 발명은 적어도 하나의 본드 패드 및 적어도 하나의 상호접속 런너를 포함하는 알루미늄 층을 포함하는데, 상기 상호접속 런너는 밑에 놓인 구리 상호접속 층에 전기적으로 결합됨으로써, Cu 본드 패드의 제조시 필요로 되는 부가적인 프로세싱 및 마스킹 단계들을 제거하여 제조 비용을 감소시킨다.

Claims (10)

  1. 반도체 장치에 있어서,
    적어도 하나의 본드 패드 및 적어도 하나의 상호접속 런너를 포함하는 알루미늄 층을 포함하고, 상기 상호접속 런너는 하부 구리 상호접속 층에 전기적으로 결합되는, 반도체 장치.
  2. 제1항에 있어서,
    상기 구리 상호접속 층은 세그먼트되는, 반도체 장치.
  3. 제2항에 있어서,
    상기 상호접속 층은 적어도 제1 및 제2 런너 부분들로 세그먼트되고, 상기 적어도 하나의 본드 패드는 적어도 하나의 비아에 의해 상기 제1 부분에 전기적으로 접속되고 상기 적어도 하나의 상호접속 런너는 적어도 하나의 비아에 의해 상기 제2 부분에 전기적으로 접속되는, 반도체 장치.
  4. 제1항에 있어서,
    상기 알루미늄 층 및 상기 상호접속 층 간에 위치되는 패시베이션 층을 더 포함하고, 상기 패시베이션 층은 자신을 통해서 신장하는 비아들을 갖고 상기 알루미늄 층은 상기 비아들로 신장되는, 반도체 장치.
  5. 제1항에 있어서,
    상기 알루미늄 층은 알루미늄 합금을 포함하고 상기 구리 상호접속 층은 구리 합금을 포함하는, 반도체 장치.
  6. 반도체 장치에 있어서,
    반도체 기판 위에 위치되는 능동 장치들;
    상기 능동 장치들 위에 형성되는 적어도 제1 및 제2 런너 부분들로 세그먼트되는 최외곽 상호접속 층;
    상기 최외곽 상호접속 층 위에 위치되는 세그먼트된 본드 패드 층으로서, 상기 본드 패드 층은 본드 패드 부분 및 상호 접속 런너 부분을 포함하는, 세그먼트된 본드 패드 층;
    상기 최외곽 상호접속 층 및 상기 본드 패드 층 간에 위치되는 패시베이션 층으로서, 상기 패시베이션 층은 자신을 통해서 신장하여 상기 최외곽 상호접속 층에 접촉하는 비아들을 갖고, 상기 본드 패드 및 상호접속 런너 부분들은 상기 비아들로 신장되며, 상기 본드 패드 부분은 상기 비아들 중 적어도 한 비아에 의해 상기 제1 부분에 전기적으로 접속되고, 상기 상호접속 런너 부분은 상기 비아들 중 또 다른 적어도 한 비아에 의해 상기 제2 부분에 전기적으로 접속되는, 상기 패시베이션 층; 및
    상기 본드 패드 부분위에 위치되는 언더 범프 금속화(Under Bump Metallization; UBM) 층을 포함하는, 반도체 장치.
  7. 제6항에 있어서,
    상기 본드 패드 층은 알루미늄 또는 이의 합금들을 포함하고 상기 최외곽 상호접속 층은 구리 또는 이의 합금들을 포함하는, 반도체 장치.
  8. 제6항에 있어서,
    상기 제1 부분은 제1 복수의 런너들로 분할되고 상기 제2 부분은 제2 복수의 런너들로 분할되며, 상기 본드 패드 부분은 적어도 하나의 비아에 의해 상기 제1 복수의 런너들 각각에 전기적으로 접속되고 상기 적어도 하나의 상호접속 런너 부분은 적어도 하나의 비아에 의해 상기 제2 복수의 런너들 각각에 전기적으로 접속되는, 반도체 장치.
  9. 집적 회로에 있어서,
    반도체 기판 위에 위치되는 트랜지스터들;
    상기 트랜지스터들 위에 위치되는 유전체 층들;
    상기 트랜지스터들 위에 그리고 상기 유전체 층들 내에 형성되는 구리를 포함하는 상호접속 층들; 및
    상기 상호접속 층들 위에 위치되는 최외곽 금속화 층으로서, 상기 최외곽 금속화 층은 알루미늄을 포함하고, 최외곽 상호접속 층에 각각 전기적으로 접속되는 복수의 상호접속 런너들 및 복수의 본드 패드들로 분할되는, 최외곽 금속화 층을 포함하는, 집적 회로.
  10. 반도체 장치에 있어서,
    반도체 기판 위에 위치되는 능동 장치들;
    상기 능동 장치들 위에 형성되는 구리를 포함하는 상호접속 층들; 및
    상기 상호접속 층들 위에 위치되는 최외곽 금속화 층으로서, 상기 최외곽 금속화 층은 알루미늄을 포함하고, 상호접속 층에 각각 전기적으로 접속되는 적어도 하나의 본드 패드 및 적어도 하나의 상호접속 런너를 포함하는, 반도체 장치.
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