KR19990007023A - 코드 효율이 높은 초장 명령어를 실행하는 프로세서 - Google Patents
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Abstract
Description
Claims (29)
- 2개 이상의 연산 필드를 갖는 명령을 해독하여 실행하는 초장 명령어(VLIW) 프로세서에 있어서,여기에서 제 1의 상기 연산 필드에는 연산의 종류를 지정하는 1개의 연산 코드만이 배치되고, 제 2의 상기 연산 필드에는 1개의 연산 코드와 연산의 대상이 되는 데이터를 지정하는 1개 이상의 오퍼랜드의 조(組)가 배치되며,상기 제 1 연산 필드에 배치된 연산 코드를 해독하는 제 1 해독수단과,상기 제 1 해독수단에 의한 해독결과에 따라 상기 연산 코드에 의해 지정된 연산을 실행하는 제 1 실행수단과,상기 제 2 연산 필드에 배치된 연산 코드를 해독하는 제 2 해독수단과,상기 제 2 해독수단에 의한 해독결과에 기초하여 상기 오퍼랜드에 의해 지정된 데이터에 대하여 상기 연산 코드에 의해 지정된 연산을 실행하는 제 2 실행수단을 포함하는 것을 특징으로 하는 VLIW 프로세서.
- 제 1항에 있어서,상기 제 1 연산 필드의 자리수는 상기 제 2 연산 필드의 자리수보다 작은 것을 특징으로 하는 VLIW 프로세서.
- 제 2항에 있어서,상기 제 1 연산 필드에 배치된 연산 코드의 자리수는 상기 제 2 연산 필드에 배치된 연산 코드의 자리수와 같은 것을 특징으로 하는 VLIW 프로세서.
- 제 3항에 있어서,상기 명령에 포함되는 연산 필드는 3개이고,제 3의 상기 연산 필드는 상기 제 2 연산 필드와 같은 자리수로서 1개의 연산 코드와 1개 이상의 오퍼랜드의 조가 배치되며,상기 VLIW 프로세서는 또한,상기 제 3 연산 필드에 연산 코드가 배치된 경우에 상기 연산 코드를 해독하는 제 3 해독수단과,상기 제 3 해독수단에 의한 해독결과에 따라 상기 오퍼랜드에 의해 지정된 데이터에 대하여 상기 연산 코드에 의해 지정된 연산을 실행하는 제 3 실행수단을 구비하는 것을 특징으로 하는 VLIW 프로세서.
- 제 4항에 있어서,상기 제 1 실행수단은 실행할 명령이 포함되는 프로그램의 흐름을 제어하는 것을 특징으로 하는 VLIW 프로세서.
- 제 5항에 있어서,상기 제 2 실행수단은 상기 제 2 연산 필드에 배치된 오퍼랜드에 의해 지정된 데이터의 전송을 제어하고,상기 제 3 실행수단은 상기 제 3 연산 필드에 배치된 오퍼랜드에 의해 지정된 데이터의 산술 논리연산을 실행하는 것을 특징으로 하는 VLIW 프로세서.
- 2개 이상의 연산 필드를 갖는 명령을 해독하여 실행하는 VLIW 프로세서에 있어서,여기에서 제 1의 상기 연산 필드에는 연산의 종류를 지정하는 1개의 연산 코드만 또는 정수만 배치되고, 제 2의 상기 연산 필드에는 1개의 연산 코드와 연산의 대상이 되는 데이터를 지정하는 1개 이상의 오퍼랜드의 조 또는 정수만이 배치되며,상기 제 1 연산 필드에 연산 코드가 배치된 경우에 상기 연산 코드를 해독하는 제 1 해독수단과,상기 제 1 해독수단에 의한 해독결과에 따라 상기 연산 코드에 의해 지정된 연산을 실행하는 제 1 실행수단과,상기 제 2 연산 필드에 연산 코드가 배치된 경우에 상기 연산 코드를 해독하는 제 2 해독수단과,상기 제 2 해독수단에 의한 해독결과에 따라 상기 오퍼랜드에 의해 지정된 데이터에 대하여 상기 연산 코드에 의해 지정된 연산을 실행하는 제 2 실행수단을 포함하는 것을 특징으로 하는 VLIW 프로세서.
- 제 7항에 있어서,상기 명령은 또한,상기 제 1 및 제 2 연산 필드 각각에 정수만이 배치되어 있는지의 여부를 지정하는 포맷 코드가 배치된 포맷 코드를 포함하며,상기 VLIW 프로세서는 또한,상기 포맷 코드를 해독하는 포맷 해독수단과,상기 포맷 해독수단에 의해 상기 제 1 및 제 2의 적어도 하나의 연산 필드에 정수만이 배치되어 있다고 해독된 경우 그 정수를 페치하여 기억하는 정수 기억수단을 구비하는 것을 특징으로 하는 VLIW 프로세서.
- 제 8항에 있어서,상기 제 1 연산 필드의 자리수는 상기 제 2 연산 필드의 자리수보다 작은 것을 특징으로 하는 VLIW 프로세서.
- 제 9항에 있어서,상기 제 1 연산 필드에 배치된 연산 코드의 자리수는 상기 제 2 연산 필드에 배치된 연산 코드의 자리수와 같은 것을 특징으로 하는 VLIW 프로세서.
- 제 10항에 있어서,상기 명령에 포함되는 연산 필드는 3개이고,제 3의 상기 연산 필드는 상기 제 2 연산 필드와 같은 자리수로서 1개의 연산 코드와 1개 이상의 오퍼랜드의 조가 배치되고,상기 VLIW 프로세서는 또한,상기 제 3 연산 필드에 연산 코드가 배치된 경우 상기 연산 코드를 해독하는 제 3 해독수단과,상기 제 3 해독수단에 의한 해독결과에 따라 상기 오퍼랜드에 의해 지정된 데이터에 대하여 상기 연산 코드에 의해 지정된 연산을 실행하는 제 3 실행수단을 구비하는 것을 특징으로 하는 VLIW 프로세서.
- 제 11항에 있어서,상기 제 1 실행수단은 실행할 명령이 포함되는 프로그램의 흐름을 제어하는 것을 특징으로 하는 VLIW 프로세서.
- 제 12항에 있어서,상기 제 2 실행수단은 상기 제 2 연산 필드에 배치된 오퍼랜드에 의해 지정된 데이터의 전송을 제어하고,상기 제 3 실행수단은 상기 제 3 연산 필드에 배치된 오퍼랜드에 의해 지정된 데이터의 산술논리연산을 실행하는 것을 특징으로 하는 VLIW 프로세서.
- 제 13항에 있어서,상기 포맷 필드의 자리수, 상기 제 1 연산 필드의 자리수, 상기 제 2 및 제 3 연산 필드에 배치된 연산 코드의 자리수, 상기 제 2 및 제 3 연산 필드에 배치된 각 오퍼랜드의 자리수는 모두 n비트인 것을 특징으로 하는 VLIW 프로세서.
- 제 14항에 있어서,상기 명령은 32비트 길이이고,상기 n은 4인 것을 특징으로 하는 VLIW 프로세서.
- 3개 이상의 연산 필드를 가지는 명령을 해독하여 실행하는 VLIW 프로세서에 있어서,여기에서 제 1의 상기 연산 필드에는 실행할 명령이 포함되는 프로그램의 흐름을 제어하는 연산 코드가 배치되며, 제 2의 상기 연산 필드에는 데이터 전송을 제어하는 연산 코드가 배치되고, 제 3의 상기 연산 필드에는 데이터의 산술논리연산을 제어하는 연산 코드가 배치되며,상기 제 1 연산 필드에 배치된 연산 코드를 해독하는 제 1 해독수단과,상기 제 1 해독수단에 의한 해독결과에 따라 상기 연산 코드에 의해 지정된 실행할 명령의 흐름의 제어를 실행하는 제 1 실행수단과,상기 제 2 연산 필드에 배치된 연산 코드를 해독하는 제 2 해독수단과,상기 제 2 해독수단에 의한 해독결과에 따라 상기 연산 코드에 의해 지정된 데이터 전송의 제어를 실행하는 제 2 실행수단과,상기 제 3 연산 필드에 배치된 연산 코드를 해독하는 제 3 해독수단과,상기 제 3 해독수단에 의한 해독결과에 따라 상기 연산 코드에 의해 지정된 산술논리연산을 실행하는 제 3 실행수단을 포함하는 것을 특징으로 하는 VLIW 프로세서.
- 제 16항에 있어서,상기 제 1 연산 필드의 자리수는 상기 제 2 및 제 3 연산 필드의 어느 쪽의 자리수보다도 작은 것을 특징으로 하는 VLIW 프로세서.
- 제 17항에 있어서,상기 제 1, 제 2 및 제 3 연산 필드에 배치된 각 연산 코드의 자리수는 같은 것을 특징으로 하는 VLIW 프로세서.
- 제 17항에 있어서,상기 제 2 연산 필드의 자리수는 상기 제 3 연산 필드의 자리수와 같은 것을 특징으로 하는 VLIW 프로세서.
- 제 16항에 있어서,상기 명령이 32비트 길이인 것을 특징으로 하는 VLIW 프로세서.
- 3개 이상의 연산 필드와 포맷 필드를 갖는 명령을 해독하여 실행하는 VLIW 프로세서에 있어서,여기에서 제 1의 상기 연산 필드에는 실행할 명령이 포함되는 프로그램의 흐름을 제어하는 연산 코드 또는 정수가 배치되며, 제 2의 상기 연산 필드에는 데이터 전송을 제어하는 연산 코드 또는 정수가 배치되고, 제 3의 상기 연산 필드에는 산술논리연산을 제어하는 연산 코드 또는 정수가 배치되며, 상기 포맷 필드에는 상기 제 1, 제 2 및 제 3 연산 필드 각각에 정수가 배치되어 있는지의 여부를 지정하는 포맷 코드가 배치되고,상기 제 1 연산 필드에 배치된 연산 코드를 해독하는 제 1 해독수단과,상기 제 1 해독수단에 의한 해독결과에 따라 상기 연산 코드에 의해 지정된 실행할 명령의 흐름의 제어를 실행하는 제 1 실행수단과,상기 제 2 연산 필드에 배치된 연산 코드를 해독하는 제 2 해독수단과,상기 제 2 해독수단에 의한 해독결과에 따라 상기 연산 코드에 의해 지정된 데이터 전송의 제어를 실행하는 제 2 실행수단과,상기 제 3 연산 필드에 배치된 연산 코드를 해독하는 제 3 해독수단과,상기 제 3 해독수단에 의한 해독결과에 따라 상기 연산 코드에 의해 지정된 산술논리연산을 실행하는 제 3 실행수단과,상기 포맷 코드를 해독하는 포맷 해독수단과,상기 포맷 해독수단에 의해 상기 제 1, 제 2 및 제 3의 적어도 하나의 연산 필드에 정수가 배치되어 있다고 해독된 경우 그 정수를 페치하고 기억하는 정수 기억수단을 포함하는 것을 특징으로 하는 VLIW 프로세서.
- 제 21항에 있어서,상기 명령이 32비트 길이인 것을 특징으로 하는 VLIW 프로세서.
- n개의 연산 필드를 갖는 L비트 길이의 명령을 페치하는 페치수단과,각각은 페치된 상기 명령의 각 연산 필드에 대응하고, 그 대응하는 연산 필드에 의해 지정되어 있는 연산을 독립적이면서 병렬로 실행하는 n개의 연산 유니트를 구비하는 VLIW 프로세서에 있어서,상기 n개의 연산 필드는 불균일하고, 상기 L은 상기 n으로 나누어 떨어지지 않는 것을 특징으로 하는 VLIW 프로세서.
- 제 23항에 있어서,상기 n개의 연산 필드의 적어도 하나는 그 필드길이가 다른 하나와 다른 것을 특징으로 하는 VLIW 프로세서.
- 제 24항에 있어서,상기 n은 3이고, 상기 L은 32인 것을 특징으로 하는 VLIW 프로세서.
- 제 23항에 있어서,상기 n개의 연산 필드의 적어도 하나는 그 연산 필드에 포함되는 오퍼랜드의 수가 다른 하나와 다른 것을 특징으로 하는 VLIW 프로세서.
- 제 26항에 있어서,상기 n은 3이고, 상기 L은 32인 것을 특징으로 하는 VLIW 프로세서.
- 제 23항에 있어서,상기 n개의 연산 필드에는 연산 코드만으로 이루어지는 연산 필드와, 연산 코드와 오퍼랜드로 이루어지는 연산 필드가 포함되는 것을 특징으로 하는 VLIW 프로세서.
- 제 28항에 있어서,상기 n은 3이고, 상기 L은 32인 것을 특징으로 하는 VLIW 프로세서.
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