KR101343770B1 - 필드 플레이트 확장부를 가지는 fet를 사용하는 스위치모드 전력 증폭기 - Google Patents
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Abstract
스위치 모드 전력 증폭기와 스위치 모드 전력 증폭기용으로 특히 적합한 전계 효과 트랜지스터가 개시된다. 트랜지스터는 소오스 터미널, 드레인 터미널 및 그들 사이에 위치하고 유전체 물질 상에 위치하는 게이트 터미널을 가지는 화합물 고전자 이동성 트랜지스터(high electron mobility transistor; HEMT)가 바람직하다. 필드 플레이트는 유전체 물질로 이루어진 적어도 2 층들 상에서 게이트 터미널로부터 드레인으로 연장된다. 바람직하게는, 유전층들은 실리콘 산화물과 실리콘 질화물을 포함한다. 실리콘 산화층들 사이에 실리콘 질화층이 배치되도록 제 3 실리콘 산화물층이 제공될 수 있다. 식각 선택비는 게이트 터미널을 위한 리세스의 식각에 이용된다.
스위치 모드 전력 증폭기, 필드 플레이트, 고전자 이동성 트랜지스터(HEMT), 전계 효과 트랜지스터(FET)
Description
본 발명은 일반적으로 전력 증폭기들에 관한 것으로서, 더욱 상세하게는, 스위치-모드 전력 증폭기들 및 그 내부에서 유용한 트랜지스터들에 관한 것이다.
고주파 신호들의 고효율 전력 증폭을 요구하는 애플리케이션들에 사용되기 위하여 스위치 모드 전력 증폭기들에 많은 관심이 집중되어 왔다. 이러한 소자들의 어플리케이션들의 예들은 무선 통신 시스템들, 위성 통신 시스템들, 및 진보된 레이더 시스템들을 위한 전력 증폭기들을 포함한다. 특히, 고전력, 고주파 전력 증폭기들은 3G 및 4G PCS 시스템들, WiFi, WiMax 및 디지털 비디오 방송 시스템들과 같은 디지털 통신 시스템들에 필요하다. 고출력 전력을 요구하는 애플리케이션들에 있어서, 전력 증폭기는 시스템에 의하여 소비되는 전체 전력의 상당한 부분을 담당한다. 따라서, 통신 시스템에서 전력 증폭기 회로의 효율성을 최대화하는 것이 바람직하다.
동시 출원 계속중(co-pending)인 제11/132,619호(supra)는, 입력 신호의 신호 수준에 따라 온-상태(on state) 또는 오프-상태(off state) 중 어느 하나로 작동하도록 구성된 능동 소자 스위치 트랜지스터를 포함하는 단일 스테이지 스위치 모드 증폭기 회로를 개시한다. 상기 스위치 트랜지스터는, 부하 임피던스(impedance)에 좁은 대역폭의 출력 신호를 제공하기 위하여 상기 스위치 트랜지스터로부터의 신호 출력을 필터링하는 부하 네트워크와 연결된 출력을 가진다. 상기 부하 네트워크에 의하여 거부된 에너지는, 스위치 트랜지스터가 오프-상태에 있는 동안에 출력 신호의 구동을 계속하는 스위치 캐패시터에 저장된다. 소오스 전류 내의 순간적인 변화를 방지하는 드레인 인덕터를 통하여, 스위치 트랜지스터에 대한 드레인 전압이 제공된다. 일부 실시예들에 있어서, 상기 증폭기는 Class E 모드로 작동된다.
일부 실시예들에 있어서, 스위치 모드 증폭기 회로는 입력 정합 스테이지(input matching stage), 활성 스테이지 및 출력 정합 스테이지(output matching stage)를 포함한다. 상기 활성 스테이지는 스위치 캐패시터와 병렬인 능동 소자 스위치 트랜지스터를 포함한다. 상기 스위치 트랜지스터는 부하 네트워크 및 부하 임피던스와 연결된 출력을 포함한다. 부하 임피던스에 걸리는 전압을 포함하는 상기 소자의 출력은 출력 정합 스테이지에 제공되어, 활성 스테이지의 출력 임피던스가 상기 회로의 소정의 출력 임피던스로 변환된다. 다른 실시예들에 있어서, 다중 활성 트랜지스터 스테이지들 및 정합 네트워크들은 추가적인 증폭기 이득(예를 들어, 2-스테이지 증폭기들 등.)을 제공하기 위하여 사용될 수 있다.
스위치 트랜지스터는, 1.0 GHz를 초과하는 주파수들에서 작동되는 동안 높은 드레인 전압들 및/또는 높은 전류 수준들을 견딜 수 있는, 넓은 밴드갭 MESFET 트랜지스터를 포함할 수 있다. 일부 실시예들에 있어서, 상기 스위치 트랜지스터는 갈륨 질화물(GaN)계 고전자 이동성 트랜지스터(high electron mobility transistor, HEMT)를 포함한다. 일부 실시예들에 있어서, 상기 스위치 트랜지스터는 약 3.6 mm의 총 게이트 주변 영역(periphery)을 가지는 GaN계 HEMT를 포함한다. 일부 실시예들에 있어서, 상기 스위치 트랜지스터는 GaN MESFET를 포함한다. 다른 실시예들에 있어서, 상기 스위치 트랜지스터는 SiC MESFET, SiC LDMOS, SiC 바이폴라 트랜지스터, 또는 GaN MOSFET 소자와 같은 다른 넓은 밴드갭 고주파 트랜지스터를 포함한다.
증폭기에서 전계 효과 트랜지스터들의 스위치 모드 작동은 고압축하에서 마이크로웨이브 주파수들에서 강한 동작을 요구한다. 실질적으로, 이는, 스위치 모드 동작에 필요한 고 입력 구동하에서 게이트로부터 소오스로 흐르는 매우 큰 순방향 전류 때문에 구현되기가 어렵다.
본 발명은 고압축하에서 더 강한 동작을 하는 스위치 모드 전력 증폭기에 사용될 수 있는 전계 효과 트랜지스터와 관련된다.
더욱 상세하게는, 상기 트랜지스터는, 고 입력 구동 하에서 게이트로부터 소오스로의 순방향 전도를 제한하고 고전압, 고온 동작 중에 게이트 누설을 억제하기 위한 게이트 유전체를 포함하는 고전자 이동성 트랜지스터(high electron mobility transistor, HEMT)이다.
또한, 게이트 필드 플레이트 확장부(gate field plate extension)는, 추가적인 게이트 캐패시턴스 상에 충격을 최소로 하는 피크 전기장을 형상하도록 제공될 수 있다. 상기 필드 플레이트 하부에는 2 또는 그 이상의 유전층들이 배치될 수 있고, 게이트 캐패시턴스에의 충격을 최소화하기 위하여 더 두꺼운 유전체를 제공할 수 있다.
본 발명의 일 태양에 있어서, 2 개의 다른 절연체들 사이의 식각 선택비는 게이트 전극을 제조하기 위하여 사용될 수 있다.
본 발명 및 그의 목적과 태양은 도면을 참조하여 이하의 상세한 설명과 첨부된 청구항들에 의하여 더욱 명백하게 될 수 있다.
도 1은 본 발명의 일실시예에 따른 스위치 모드 전력 증폭기의 개략도이다.
도 2는 본 발명에 따른 스위치 모드 전력 증폭기의 기능 블록도이다.
도 3은 본 발명의 일실시예에 따라 스위치 모드 전력 증폭기에 유용한 고전자 이동성 트랜지스터(high electron mobility transistor, HEMT)의 단면도이다.
도 4는 본 발명의 다른 실시예에 따라 스위치 모드 전력 증폭기에 유용한 고전자 이동성 트랜지스터(HEMT)의 단면도이다.
도 1을 참조하면, 본 발명의 일실시예에 따른 단일 스테이지 스위치 모드 전력 증폭기 회로 모델(10)이 도시되어 있다. 증폭기(10)는 온/오프 스위치로서 기능하는 넓은 밴드갭 트랜지스터를 포함하는 금속-절연체-반도체 트랜지스터(12)를 포함한다. 일부 실시예들에 있어서, 반도체 본체로부터 게이트를 분리하는 절연체의 사용은 높은 스트레스 구동 하에서 게이트로부터 소오스로의 순방향 전도를 제 한한다. 트랜지스터(12)는 GaN HEMT를 포함한다. 또는, 트랜지스터(12)는 SiC MESFET, GaN MESFET, SiC LDMOS, SiC 바이폴라 트랜지스터 또는 GaN MOSHFET 소자와 같은 다른 넓은 밴드갭 고주파 트랜지스터를 포함할 수 있다.
입력 전압 신호(vi)는 트랜지스터(12)의 게이트에 인가되어 트랜지스터(12)의 상태를 제어한다. 입력 전압 신호(vi)는 트랜지스터(12)의 핀치 오프(pinch-off) 전압과 근사하게 바이어스된다. 트랜지스터(12)의 드레인은 출력 노드(S)에 커플링되고, 트랜지스터(12)의 소오스는 접지에 커플링된다. 공급 전압(VDD)은 인덕터(LDS)를 통하여 출력 노드(S)에 커플링된다. 출력 노드(S)에서의 전압은 인덕터(L0)와 캐패시터(C0)를 포함하는 직렬 공진 회로(14)에 인가된다. 일부 애플리케이션들에 있어서, 직렬 공진 회로(14)는 증폭기 회로(10)의 소정의 출력 주파수(f0)를 중심으로 좁은 범위의 주파수들을 통과하도록 동조되는 대역통과(bandpass) 회로일 수 있다. 레이더 애플리케이션들과 같은 다른 애플리케이션들에 있어서, 상기 직렬 공진 회로(14)는 더 넓은 범위의 주파수들을 통과시키도록 동조될 수 있다. 출력 주파수에서, 트랜지스터 출력은 R + jX에 등가인 부하로 나타나며, 여기에서 X는 출력측에서 나타나는 공진 회로의 리액턴스이다.
트랜지스터(12)가 온 상태(on state)가 되면(즉, 상기 트랜지스터가 포화됨), 소자는 접지에 대해 단락 회로(short circuit)로 기능하며, 노드(S)의 전압을 0으로 만든다. 이어서, 인덕터(LDS)를 통하는 전류는 선형적으로 증가한다. 상기 트랜지스터가 오프 상태(off state)가 되면, 인덕터(LDS)를 통하는 전류는 드레인-소오스간 캐패시턴스(CDS)로 흐르게 되고, 노드(S)에서의 전압이 최대값에 도달할 때까지 증가하며, 상기 최대값에서는 드레인-소오스간 캐패시턴스(CDS)가 부하로 역류하는 전류원이 되면서 노드(S)에서의 전압이 감소되기 시작한다. 상기 트랜지스터가 다시 온 상태가 되기 전에 정상상태(steady state)에서 노드(S)에서의 전압이 대략 0이 되도록, 공진 회로(14)가 동조된다.
공진 회로(14)는 이상적으로는 노드(S)에서의 전압의 기본 주파수(fundamental frequency)만을 통과시킨다. 입력 전압(vi)은 증폭된 출력 신호에 나타나는 변조된 주파수 또는 위상 정보를 반송할 수 있다.
도 2에 도시된 바와 같이, 증폭기 회로(20)는 입력(10A)과 출력(10B)을 가지는 클래스 E 증폭기(10)를 포함할 수 있다. 입력 정합 네트워크(22)는 증폭기(10)의 입력(10A)에 커플링되고, 출력 정합 네트워크(24)는 증폭기(10)의 출력(10B)에 커플링된다. 입력 정합 네트워크(22)는 입력 신호(Vi)에 의한 임피던스를 증폭기(10)의 입력 임피던스에 정합시키고, 반면 출력 정합 네트워크(24)는 증폭기(10)의 출력 임피던스를 소정의 출력 임피던스, 예를 들어, 50 ohms으로 변환한다.
도 3 및 도 4를 참조하면, 본 발명에 따른 2 개의 실시예인 전계 효과 트랜지스터들의 단면도가 도시되어 있다.
도 3에 있어서, 상기 트랜지스터는 특허출원 제11/132,619호(supra)에 개시 된 구조와 유사할 수 있는 구조를 포함한다. 예를 들어, 기판(30)은 실리콘 카바이드(silicon carbide)일 수 있고, 버퍼층 또는 핵생성층(32)은 AlGaN 또는 GaN일 수 있고, 채널층(34)은 InAlGaN, GaN 또는 AlGaN일 수 있고, 배리어층(36)은 III족의 질화물일 수 있다. 특허출원 제11/132,619호에 개시된 바와 같이, 기판(30) 상의 버퍼층(32)은 기판(30)과 소자의 나머지 부분 사이에 적절한 결정 변이를 제공한다. 버퍼층(32)은 하나 또는 그 이상의 InAlGaN 층들을 포함할 수 있다. 일부 실시예들에 있어서, 버퍼층(32)은 GaN, AlN 또는 AlGaN를 포함할 수 있다. 실리콘 카바이드는, III족의 질화물 소자들을 위한 매우 통상적인 기판 물질인 사파이어(Al2O3)에 비하여 III족의 질화물에 대한 더 근접한 결정격자 정합성을 가진다. 이러한 근접한 격자 정합은 사파이어 상에서 일반적으로 얻을 수 있는 것보다 더 높은 품질을 갖는 III족의 질화물 박막을 얻을 수 있다. 또한, 실리콘 카바이드는 매우 높은 열전도도를 가지므로, 실리콘 카바이드 상의 III족의 질화물 소자들의 총 출력 전력은, 일반적으로, 사파이어 상에 형성된 동일한 소자와 같이 기판의 열발산(thermal dissipation)에 의하여 제한되지 않는다. 또한, 준절연성(semi-insulating) 실리콘 카바이드 기판들의 유용성은 소자 분리와 감소된 기생 캐패시턴스를 제공할 수 있다. 예시적인 HEMT 구조들은 미국등록특허 제6,316,793호, 제6,586,781호, 제6,548,333호, 제5,192,987호, 및 제5,296,395호와 미국 특허공개공보 제2002/0167023호 및 제2003/0020092호에 개시되어 있으며, 이들 각각은 본 명세서에 그 전체가 개시된 바와 같이 참조에 의해 본 명세서에 포함된다.
준절연성 실리콘 카바이드가 바람직한 기판 물질이라고 하여도, 본 발명의 실시예들은 사파이어(sapphire), 알루미늄 질화물(aluminum nitride), 알루미늄 갈륨 질화물(aluminum gallium nitride), 갈륨 질화물, 실리콘, GaAs, LGO, ZnO, LAO, 및 InP 등과 같은 다른 적절한 기판을 사용할 수 있다. 또한, 상기 기판은 도전성, 준절연성 또는 높은 저항성일 수 있다. MMIC를 포함하는 실시예들에 있어서, 준절연성 또는 높은 저항성 기판을 사용하는 것이 바람직하다. 일부 실시예들에 있어서, 적절한 버퍼층이 또한 형성될 수 있다.
배리어층(36) 상에 제1 유전층(38)이 제공되고, 제1 유전층(38) 상에 제2 유전층(40)이 제공된다. 콘택홀들이 제1 및 제2 유전층들(38, 40)을 통하여 식각되어 소오스 콘택(42) 및 드레인 콘택(44)이 형성된다. 게이트 유전층(38) 상에 형성된 게이트 콘택(46)을 형성하도록 유전체(40)만을 식각하는 식각액이 사용될 수 있다. 예를 들어, 유전층(38)은 실리콘 산화물일 수 있고, 유전층(40)은 실리콘 질화물일 수 있다. 또는, 상기 두 개의 유전층들은, 상기 두 층을 형성하기 위한 프로세스 내에서 다른 시간에 증착되거나 형성된 동일한 물질일 수 있다. 다른 공지된 배리어층 물질들이 또한 사용될 수 있다.
본 발명의 일 태양에 있어서, 게이트 콘택(46)은 유전층(40) 상에서 상기 드레인을 향하여 연장될 수 있으며, 부재번호 46'으로 도시된 바와 같은 필드 플레이트 확장부(field plate extension)를 형성한다. 더 두꺼운 유전층 상에서 드레인을 향하는 게이트 전극의 상기 필드 플레이트 확장부는 증가된 게이트 캐패시턴스에 대한 충격을 최소로 하는 피크 전기장을 형상하도록 설계될 수 있다. 다른 애 플리케이션들에 대한 필드 플래이트의 사용은 공지되어 있다.
도 4는 본 발명의 다른 실시예에 따른 전계 효과 트랜지스터의 단면도를 도시한다. 여기에서 기판(30)과 층들(32, 34, 36)은 도 3에 도시된 바와 동일할 수 있다. 그러나, 본 실시예에 있어서, 제3 유전층(48)과 함께 도 3에 도시된 층들(38, 40)을 포함하는 3 개의 유전층들이 적용된다. 여기에서, 게이트 콘택 개구부가 유전층들(38, 40)을 통하여 식각되고, 이어서 상기 제3 유전체가 게이트 개구부에 증착된다. 이어서, 적층된 유전체 상에 게이트 금속배선이 증착되어, 다른 구조들에 비하여 더 짧은 게이트 길이(LG)와 더 낮은 캐패시턴스를 가지는 게이트 전극(46)을 형성한다.
도 3과 도 4에 있어서, 유전체(38)는 d1 두께를 가지며, 유전체(40)는 d2 두께를 가지고, 유전체(48)는 d3 두께를 가진다. 상기 두께들(d1, d2, d3)은, VGD를 신뢰성있게 지지하고, 주파수 응답을 유지하고, Cgd and Cgs를 최소화하도록 최적화된다. 게이트 길이(LG)는 원하는 동작 주파수로 동조된다. 도 4에 있어서, 유전체들(38, 40)은 SiO2 및 SiN 또는 도 3과 동일한 물질일 수 있고, 유전체(48)는 SiO2일 수 있다. 가장 바람직하게는, 상부 및 저부의 유전체들은 중간 유전체에 비하여 높은 밴드갭을 가져야 한다.
스위치-모드 증폭기에서 이와 같은 소자의 신규한 사용은, 트랜지스터가 온 상태가 되는 일부 사이클 동안, 해로운 큰 순방향 게이트 전류를 피할 수 있기 때문에, 동작의 신뢰성을 제공할 수 있다.
미국공개특허 제2003/0020092A1호는 본 발명의 실시에 적용될 수 있는 금속 콘택들과 절연 게이트 구조들을 개시한다. 따라서, 본 발명이 특정한 실시예를 참조하여 개시되었다고 하여도, 개시 사항은 본 발명을 예시적으로 설명하기 위함이며, 본 발명을 제한하는 것으로서 해석되어서는 아니 된다. 본 발명의 기술 분야의 당업자에게는 첨부된 청구항들에 의하여 한정되는 본 발명의 실질적인 범위와 기술적 사상으로부터 벗어나지 않고 다양한 변형 및 응용들이 가능할 것이다.
본 발명에 따른 트랜지스터는 게이트 유전체를 포함하는 고전자 이동성 트랜지스터(HEMT)를 사용하여, 고 입력 구동 하에서 게이트로부터 소오스로의 순방향 전도를 제한하고 고 전압, 고온 동작 중에 게이트 누설을 억제할 수 있다.
스위치-모드 증폭기에서 이와 같은 소자의 신규한 사용은, 트랜지스터가 온 상태가 되는 일부 사이클 동안, 해로운 큰 순방향 게이트 전류를 피할 수 있기 때문에, 동작의 신뢰성을 제공할 수 있다.
Claims (24)
- a) 고전자 이동성(high electron mobility) 전계 효과 트랜지스터 - 상기 고전자 이동성 전계 효과 트랜지스터는 화합물 반도체 채널층 및 상기 화합물 반도체 채널층 상의 배리어층을 포함하고 소오스 터미널, 드레인 터미널 및 게이트 콘택을 포함하며, 유전체가 상기 게이트 콘택과 상기 배리어층을 분리하고, 상기 유전체는 상기 배리어층 상의 실리콘 산화물의 제1 유전층, 상기 제1 유전층 상의 실리콘 질화물의 제2 유전층 및 상기 제2 유전층 상의 실리콘 산화물의 제3 유전층을 포함하고, 상기 게이트 콘택은 상기 제3 유전층 상에 있고, 상기 게이트 콘택은 상기 제1 및 제2 유전층을 통해 상기 배리어층을 향해 연장되고, 상기 게이트 콘택은 상기 제3 유전층에 의해 상기 제1 및 제2 유전층과 상기 배리어층으로부터 분리됨 - ;b) 제어 터미널에 커플링된 신호 입력 터미널;c) 상기 드레인 터미널에 도전성으로 커플링된 전력 터미널;d) 상기 소오스 터미널에 커플링된 접지 터미널;e) 상기 드레인 터미널을 출력 터미널에 커플링시키는 공진 회로; 및f) 상기 출력 터미널을 상기 접지 터미널에 커플링시키는 저항을 포함하며,입력 신호는 상기 트랜지스터의 통전을 제어하고,전원으로부터 상기 드레인 터미널로 흐르는 전류가 증가되어 상기 트랜지스터가 통전되는 경우에는 상기 드레인 터미널은 접지에 커플링되며,상기 트랜지스터가 오프되는 경우, 상기 전원으로부터의 전류는 상기 트랜지스터의 내부 캐패시턴스 내로 흘러 상기 드레인 터미널의 전압을 최대값까지 상승시킨 후 감소하게 하며,상기 드레인 터미널의 전압은 상기 공진 회로를 통하여 상기 출력 터미널에 커플링되는 고주파 애플리케이션을 위한 스위치 모드 전력 증폭기.
- 제 1 항에 있어서,상기 게이트 콘택으로부터 상기 드레인 터미널로 향하는 필드 플레이트 확장부(field plate extension)를 더 포함하는 것을 특징으로 하는 스위치 모드 전력 증폭기.
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- 제 2 항에 있어서,상기 트랜지스터는 고전자 이동성 트랜지스터(high electron mobility transistor, HEMT)를 포함하고, 상기 반도체 물질은 화합물 반도체 물질을 포함하는 것을 특징으로 하는 스위치 모드 전력 증폭기.
- 제 9 항에 있어서,상기 반도체 물질은 실리콘 카바이드(silicon carbide) 및 주기율표의 III족의 질화물들로 이루어진 군에서 선택된 것을 특징으로 하는 스위치 모드 전력 증폭기.
- 제 9 항에 있어서, 상기 트랜지스터는,화합물 반도체 기판;상기 기판 상에 형성된 버퍼층;상기 버퍼층 상에 형성된 채널층; 및상기 채널층 상에 형성된 배리어층을 포함하는 것을 특징으로 하는 스위치 모드 전력 증폭기.
- 제 11 항에 있어서, 상기 기판은 실리콘 카바이드를 포함하고, 상기 버퍼층, 채널층 및 배리어층은 III족의 질화물 물질을 포함하는 것을 특징으로 하는 스위치 모드 전력 증폭기.
- 제 12 항에 있어서,상기 기판은 실리콘 카바이드를 포함하고,상기 버퍼층은 InAlGaN, GaN, AlGaN 또는 AlN을 포함하고,상기 채널층은 InGaN, InAlGaN, GaN 또는 AlGaN을 포함하며,상기 배리어층은 제1 III족의 질화물(first group III nitride)을 포함하는 것을 특징으로 하는 스위치 모드 전력 증폭기.
- 스위치 모드 전력 증폭기에 사용되기 위한 전계 효과 트랜지스터로서,a) 화합물 반도체 기판;b) 상기 기판 상에 형성된 버퍼층;c) 상기 버퍼층 상에 형성된 채널층;d) 상기 채널층 상에 형성된 배리어층;e) 상기 배리어층 상의 적어도 2 개의 유전층들;f) 상기 2 개의 유전층들을 통하여 연장되고, 상기 배리어층을 연결하는 소오스 및 드레인 전극들; 및g) 상기 소오스와 드레인 전극들 사이의 유전체 물질 상에 위치하는 게이트 전극을 포함하고,상기 게이트 전극은 상기 적어도 2 개의 유전층들 중 적어도 하나에 의해 상기 배리어층으로부터 분리되고,상기 적어도 2 개의 유전층들은 상기 배리어층 상의 실리콘 산화물의 제1 유전층, 상기 제1 유전층 상의 실리콘 질화물의 제2 유전층 및 상기 제2 유전층 상의 실리콘 산화물의 제3 유전층을 포함하고,상기 게이트 전극은 상기 제3 유전층 상에 있고, 상기 게이트 전극은 상기 제1 및 제2 유전층을 통해 상기 배리어층을 향해 연장되고, 상기 게이트 전극은 상기 제3 유전층에 의해 상기 제1 및 제2 유전층과 상기 배리어층으로부터 분리되는,전계 효과 트랜지스터.
- 제 14 항에 있어서,h) 상기 적어도 2 개의 유전층들 상에서 상기 게이트 전극으로부터 상기 드레인 터미널로 향하는 필드 플레이트 확장부를 더 포함하는 것을 특징으로 하는 전계 효과 트랜지스터.
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- 제 15 항에 있어서,상기 스위치 모드 전력 증폭기는 제 1 항에 기재된 상기 스위치 모드 전력 증폭기이고,상기 반도체 물질은 실리콘 카바이드 및 주기율표의 III족의 질화물들로 이루어진 군에서 선택되는 것을 특징으로 하는 전계 효과 트랜지스터.
- 제 18 항에 있어서,상기 스위치 모드 전력 증폭기는 제 1 항에 기재된 상기 스위치 모드 전력 증폭기이고,상기 기판은 실리콘 카바이드를 포함하고,상기 버퍼층, 채널층 및 배리어층은 III족의 질화물 물질을 포함하는 것을 특징으로 하는 전계 효과 트랜지스터.
- 제 19 항에 있어서,상기 기판은 실리콘 카바이드를 포함하고,상기 버퍼층은 InAlGaN, GaN, AlGaN 또는 AlN을 포함하고,상기 채널층은 InGaN, InAlGaN, GaN 또는 AlGaN을 포함하고,상기 배리어층은 제1 III족의 질화물을 포함하는 것을 특징으로 하는 전계 효과 트랜지스터.
- 제 15 항에 있어서,상기 반도체 물질은 실리콘 카바이드 및 주기율표의 III족의 질화물들로 이루어진 군에서 선택된 것을 특징으로 하는 전계 효과 트랜지스터.
- 제 21 항에 있어서,상기 기판은 실리콘 카바이드를 포함하고,상기 버퍼층, 채널층 및 배리어층은 III족의 질화물 물질을 포함하는 것을 특징으로 하는 전계 효과 트랜지스터.
- 제 22 항에 있어서,상기 기판은 실리콘 카바이드를 포함하고,상기 버퍼층은 InAlGaN, GaN, AlGaN 또는 AlN을 포함하고,상기 채널층은 InGaN, InAlGaN, GaN 또는 AlGaN을 포함하고,상기 배리어층은 제1 III족의 질화물을 포함하는 것을 특징으로 하는 전계 효과 트랜지스터.
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