KR100722772B1 - 박막 구조물 및 이의 박막 구조물 형성 방법과, 커패시터및 이의 커패시터 형성 방법 - Google Patents
박막 구조물 및 이의 박막 구조물 형성 방법과, 커패시터및 이의 커패시터 형성 방법 Download PDFInfo
- Publication number
- KR100722772B1 KR100722772B1 KR1020060039972A KR20060039972A KR100722772B1 KR 100722772 B1 KR100722772 B1 KR 100722772B1 KR 1020060039972 A KR1020060039972 A KR 1020060039972A KR 20060039972 A KR20060039972 A KR 20060039972A KR 100722772 B1 KR100722772 B1 KR 100722772B1
- Authority
- KR
- South Korea
- Prior art keywords
- film
- oxide
- titanium
- aluminum
- oxygen diffusion
- Prior art date
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L28/00—Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
- H01L28/40—Capacitors
- H01L28/60—Electrodes
- H01L28/75—Electrodes comprising two or more layers, e.g. comprising a barrier layer and a metal layer
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B12/00—Dynamic random access memory [DRAM] devices
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B12/00—Dynamic random access memory [DRAM] devices
- H10B12/01—Manufacture or treatment
- H10B12/02—Manufacture or treatment for one transistor one-capacitor [1T-1C] memory cells
- H10B12/03—Making the capacitor or connections thereto
- H10B12/033—Making the capacitor or connections thereto the capacitor extending over the transistor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L28/00—Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
- H01L28/40—Capacitors
- H01L28/60—Electrodes
- H01L28/82—Electrodes with an enlarged surface, e.g. formed by texturisation
- H01L28/90—Electrodes with an enlarged surface, e.g. formed by texturisation having vertical extensions
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B12/00—Dynamic random access memory [DRAM] devices
- H10B12/30—DRAM devices comprising one-transistor - one-capacitor [1T-1C] memory cells
- H10B12/31—DRAM devices comprising one-transistor - one-capacitor [1T-1C] memory cells having a storage electrode stacked over the transistor
- H10B12/318—DRAM devices comprising one-transistor - one-capacitor [1T-1C] memory cells having a storage electrode stacked over the transistor the storage electrode having multiple segments
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Manufacturing & Machinery (AREA)
- Semiconductor Memories (AREA)
Abstract
Description
Claims (17)
- 알루미늄을 포함하는 도전막;상기 도전막 상에 형성된 지르코늄 산화물 또는 티타늄 산화물을 포함하는 산화막; 및상기 산화막을 재 산화할 시에 상기 도전막 및 산화막 계면에 생성된 알루미늄 산화물로 이루어진 산소 확산 방지막을 포함하는 박막 구조물.
- 제1항에 있어서, 상기 산소 확산 방지막의 두께는 2 내지 5Å인 것을 특징으로 하는 박막 구조물.
- 알루미늄을 포함하는 도전막을 형성하는 단계;상기 도전막 상에 지르코늄 산화물 또는 티타늄 산화물을 포함하는 산화막을 형성하는 단계; 및상기 산화막을 재 산화하여 상기 도전막 및 산화막 계면에 알루미늄 산화물을 포함하는 산소 확산 방지막을 생성시키는 단계를 포함하는 박막 구조물 형성 방법.
- 제1항에 있어서, 상기 산소 확산 방지막은 2 내지 5Å의 두께로 생성되는 것을 특징으로 하는 박막 구조물 형성 방법.
- 알루미늄을 포함하는 스토리지 전극;상기 스토리지 전극 상에 형성된 지르코늄 산화물 또는 티타늄 산화물을 포함하는 유전막;상기 유전막을 재 산화할 시에 상기 스토리지 전극 및 유전막 계면에 생성된 알루미늄 산화물로 이루어진 산소 확산 방지막; 및상기 유전막 상에 형성된 플레이트 전극을 포함하는 커패시터.
- 제5항에 있어서, 상기 스토리지 전극은 티타늄 알루미늄 질화막을 포함하는 것을 특징으로 하는 커패시터.
- 제5항에 있어서, 상기 산소 확산 방지막의 두께는 2 내지 5Å인 것을 특징으로 하는 커패시터.
- 제5항에 있어어, 상기 산소 확산 방지막은 산소 플라즈마를 200 내지 400℃에서 2 내지 5분 동안 수행하여 생성된 막인 것을 특징으로 하는 커패시터.
- 알루미늄을 포함하는 스토리지 전극을 형성하는 단계;상기 스토리지 전극 상에 지르코늄 산화물 또는 티타늄 산화물을 포함하는 유전막을 형성하는 단계;상기 유전막을 재 산화할 시에 상기 스토리지 전극 및 유전막 계면에 생성된 알루미늄 산화물로 이루어진 산소 확산 방지막을 생성시키는 단계; 및상기 유전막 상에 플레이트 전극을 형성하는 단계를 포함하는 커패시터 형성 방법.
- 제9항에 있어서, 상기 산소 확산 방지막은 2 내지 5Å의 두께로 형성되는 것을 특징으로 하는 커패시터 형성 방법.
- 제9항에 있어서, 상기 재 산화는 산소 플라즈마를 이용하여 200 내지 400℃의 온도에서 2 내지 5분 동안 수행되는 것을 특징으로 하는 커패시터 형성 방법.
- 제9항에 있어서, 상기 산소 확산 방지막과 유전막이 1:15 내지 1:25의 두께 비를 갖도록 형성하는 것을 특징으로 하는 커패시터 형성 방법.
- 제9항에 있어서, 상기 도전막은 티타늄 알루미늄 질화물(TiAlN)을 포함하는 것을 특징으로 하는 커패시터 형성 방법.
- 제13항에 있어서, 상기 티타늄 알루미늄 질화물은, 사염화티타늄(TiCl4)을 포함하는 제1 반응 물질과, TMA(trimethyl aluminum)을 포함하는 제2 반응 물질을 교번하여 유입하는 싸이클릭 화학 기상 증착 방법 또는 원자 적층 방법을 수행하여 형성되는 것을 특징으로 하는 커패시터 형성 방법.
- 제9항에 있어서, 상기 지르코늄 산화물은, 지르코늄-부톡사이드(zirconium butoxide, Zr(OtBu)4), TEMAZ(tetra ethyl methyl amino zirconium, Zr[N(CH3)(C2H5)4]), 지르코늄-에톡사이드(zirconium ethoxide, Zr(OEt)4), 지르코늄-이소프로폭사이드(zircoinium iso-propoxide, Zr(OC3H7)4) 및 Zr[TMHD]4(tetra methyl hepta diene zirconium, Zr(C11H19O2)4)로 구성되는 그룹으로부터 선택되는 어느 하나를 포함하는 반응 물질과 상기 반응 물질을 산화시키기 위한 O3, O2, H2O, 플라즈마 O2 및 리모트 플라즈마 O2로 구성되는 그룹으로부터 선택되는 어느 하나를 포함하는 산화제를 사용하여 싸이클릭 화학 기상 증착 방법 또는 원자 적층 방법을 수행하여 형성되는 것을 특징으로 하는 커패시터 형성 방법.
- 제9항에 있어서, 상기 티타늄 산화물은, 티타늄-부톡사이드(titanium butoxide, Ti(OtBu)4), TEMAT(tetra ethyl methyl amino titanium, Ti[N(CH3)(C2H5)4]), 티타늄-에톡사이드(titanium ethoxide, Ti(OEt)4), 티타늄-이소프로폭사이드(titanium iso-propoxide, Ti(OC3H7)4) 및 Ti[TMHD]2(tetra methyl hepta diene titanium, Ti(C11H19O2)2)로 구성되는 그룹으로부터 선택되는 어느 하나를 포함하는 반응 물질과 상기 반응 물질을 산화시키기 위한 O3, O2, H2O, 플라즈마 O2 및 리모트 플라즈마 O2로 구성되는 그룹으로부터 선택되는 어느 하나를 포함하는 산화제를 사용하는 싸이클릭 화학 기상 증착 방법 또는 원자 적층 방법을 수행하여 형성되는 것을 특징으로 하는 커패시터 형성 방법.
- 제9항에 있어서, 상기 플레이트 전극은 라듐(Ra) 또는 티타늄 질화물(TiN)을 포함하는 것을 특징으로 하는 커패시터 형성 방법.
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020060039972A KR100722772B1 (ko) | 2006-05-03 | 2006-05-03 | 박막 구조물 및 이의 박막 구조물 형성 방법과, 커패시터및 이의 커패시터 형성 방법 |
US11/733,970 US7514315B2 (en) | 2006-05-03 | 2007-04-11 | Methods of forming capacitor structures having aluminum oxide diffusion barriers |
US12/392,360 US20090195962A1 (en) | 2006-05-03 | 2009-02-25 | Multilayer electrode structures including capacitor structures having aluminum oxide diffusion barriers |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020060039972A KR100722772B1 (ko) | 2006-05-03 | 2006-05-03 | 박막 구조물 및 이의 박막 구조물 형성 방법과, 커패시터및 이의 커패시터 형성 방법 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR100722772B1 true KR100722772B1 (ko) | 2007-05-30 |
Family
ID=38278494
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020060039972A KR100722772B1 (ko) | 2006-05-03 | 2006-05-03 | 박막 구조물 및 이의 박막 구조물 형성 방법과, 커패시터및 이의 커패시터 형성 방법 |
Country Status (2)
Country | Link |
---|---|
US (2) | US7514315B2 (ko) |
KR (1) | KR100722772B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9978753B2 (en) | 2016-06-02 | 2018-05-22 | Samsung Electronics Co., Ltd. | Semiconductor device and method of manufacturing the same |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100791339B1 (ko) * | 2006-08-25 | 2008-01-03 | 삼성전자주식회사 | 평탄화 저항 패턴을 포함하는 복합칩 반도체 소자 및 그제조 방법 |
US20100102417A1 (en) * | 2008-10-27 | 2010-04-29 | Applied Materials, Inc. | Vapor deposition method for ternary compounds |
JP5410174B2 (ja) * | 2009-07-01 | 2014-02-05 | 株式会社日立国際電気 | 半導体装置の製造方法、基板処理方法および基板処理システム |
KR101647384B1 (ko) * | 2010-03-16 | 2016-08-24 | 삼성전자주식회사 | 반도체 소자 |
US20170117464A1 (en) * | 2015-10-22 | 2017-04-27 | Winbond Electronics Corp. | Resistive random access memory device |
KR102633069B1 (ko) * | 2019-02-20 | 2024-02-05 | 에스케이하이닉스 주식회사 | 반도체장치 및 그 제조 방법 |
US11251261B2 (en) * | 2019-05-17 | 2022-02-15 | Micron Technology, Inc. | Forming a barrier material on an electrode |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08236708A (ja) * | 1995-01-13 | 1996-09-13 | Internatl Business Mach Corp <Ibm> | 高融点金属上のアルミニウムからなる薄膜多層酸素拡散バリア |
KR20020054896A (ko) * | 2000-12-28 | 2002-07-08 | 윤종용 | 고유전 물질을 유전막으로 사용하는 반도체 메모리 소자의커패시터 및 그 제조방법 |
KR20030040530A (ko) * | 2000-10-10 | 2003-05-22 | 에이에스엠 아메리카, 인코포레이티드 | 유전 접합막과 그 방법 |
KR20040059761A (ko) * | 2002-12-30 | 2004-07-06 | 주식회사 하이닉스반도체 | 산소확산방지막을 구비한 캐패시터 및 그의 제조 방법 |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100504430B1 (ko) | 1998-12-30 | 2006-05-17 | 주식회사 하이닉스반도체 | 플러그를갖는커패시터의하부전극형성방법 |
JP2001085639A (ja) | 1999-08-31 | 2001-03-30 | Vanguard Internatl Semiconductor Corp | 誘電体層の形成方法 |
KR100308131B1 (ko) * | 1999-10-01 | 2001-11-02 | 김영환 | 반도체 소자의 커패시터 제조 방법 |
KR100363084B1 (ko) * | 1999-10-19 | 2002-11-30 | 삼성전자 주식회사 | 박막 구조를 위한 다중막을 포함하는 커패시터 및 그 제조 방법 |
KR100772531B1 (ko) | 2001-06-30 | 2007-11-01 | 주식회사 하이닉스반도체 | 캐패시터의 제조 방법 |
US7115518B2 (en) * | 2001-10-02 | 2006-10-03 | Matsushita Electric Industrial Co., Ltd. | Method for fabricating semiconductor device comprising forming holes in a multi-layer insulating film |
KR101062812B1 (ko) | 2002-12-30 | 2011-09-07 | 주식회사 하이닉스반도체 | 반도체 소자의 하프늄 산화막 캐패시터 형성방법 |
KR100505679B1 (ko) * | 2003-03-19 | 2005-08-03 | 삼성전자주식회사 | 반도체 메모리 소자 및 그 제조방법 |
KR100818267B1 (ko) | 2003-10-27 | 2008-03-31 | 삼성전자주식회사 | 커패시터, 이를 구비한 반도체 소자 및 그 제조 방법 |
KR100732773B1 (ko) * | 2006-06-29 | 2007-06-27 | 주식회사 하이닉스반도체 | 절연층들간의 들뜸을 방지한 반도체 소자 제조 방법 |
-
2006
- 2006-05-03 KR KR1020060039972A patent/KR100722772B1/ko active IP Right Grant
-
2007
- 2007-04-11 US US11/733,970 patent/US7514315B2/en active Active
-
2009
- 2009-02-25 US US12/392,360 patent/US20090195962A1/en not_active Abandoned
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08236708A (ja) * | 1995-01-13 | 1996-09-13 | Internatl Business Mach Corp <Ibm> | 高融点金属上のアルミニウムからなる薄膜多層酸素拡散バリア |
KR20030040530A (ko) * | 2000-10-10 | 2003-05-22 | 에이에스엠 아메리카, 인코포레이티드 | 유전 접합막과 그 방법 |
KR20020054896A (ko) * | 2000-12-28 | 2002-07-08 | 윤종용 | 고유전 물질을 유전막으로 사용하는 반도체 메모리 소자의커패시터 및 그 제조방법 |
KR20040059761A (ko) * | 2002-12-30 | 2004-07-06 | 주식회사 하이닉스반도체 | 산소확산방지막을 구비한 캐패시터 및 그의 제조 방법 |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9978753B2 (en) | 2016-06-02 | 2018-05-22 | Samsung Electronics Co., Ltd. | Semiconductor device and method of manufacturing the same |
US10297600B2 (en) | 2016-06-02 | 2019-05-21 | Samsung Electronics Co., Ltd. | Semiconductor device and method of manufacturing the same |
US10636795B2 (en) | 2016-06-02 | 2020-04-28 | Samsung Electronics Co., Ltd. | Semiconductor device and method of manufacturing the same |
US11177263B2 (en) | 2016-06-02 | 2021-11-16 | Samsung Electronics Co., Ltd. | Semiconductor device and method of manufacturing the same |
Also Published As
Publication number | Publication date |
---|---|
US7514315B2 (en) | 2009-04-07 |
US20090195962A1 (en) | 2009-08-06 |
US20070257370A1 (en) | 2007-11-08 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100722772B1 (ko) | 박막 구조물 및 이의 박막 구조물 형성 방법과, 커패시터및 이의 커패시터 형성 방법 | |
US7153786B2 (en) | Method of fabricating lanthanum oxide layer and method of fabricating MOSFET and capacitor using the same | |
JP4111427B2 (ja) | 半導体素子のキャパシタ製造方法 | |
KR20060036625A (ko) | 커패시터 제조 방법 | |
US20090126173A1 (en) | Method of manufacturing a capacitor and memory device including the same | |
US20040152255A1 (en) | Capacitor with electrodes made of ruthenium and method for patterning layers made of ruthenium or ruthenium(IV) oxide | |
KR100390849B1 (ko) | 하프늄산화막을 구비하는 캐패시터의 제조 방법 | |
JP2006060230A (ja) | 3次元半導体キャパシタおよびその製造方法 | |
JP2001291843A (ja) | 半導体素子の製造法 | |
US20060046378A1 (en) | Methods of fabricating MIM capacitor employing metal nitride layer as lower electrode | |
JP2015231025A (ja) | 半導体装置及びその製造方法 | |
JP2014135311A (ja) | 半導体装置 | |
KR100763506B1 (ko) | 커패시터 제조 방법 | |
KR100406549B1 (ko) | 지르코늄산화막을 구비하는 캐패시터의 제조 방법 | |
KR100672935B1 (ko) | 금속-절연막-금속 커패시터 및 그 제조방법 | |
KR20060136191A (ko) | 커패시터 제조 방법 | |
US20130337625A1 (en) | Method for manufacturing semiconductor device | |
KR100587088B1 (ko) | 반도체 소자의 캐패시터 형성방법 | |
KR20060027747A (ko) | 금속전극들을 갖는 커패시터 제조방법 | |
KR100533981B1 (ko) | 반도체 장치의 캐패시터 제조방법 | |
KR20070106286A (ko) | 루틸구조로 결정화된 티타늄산화막의 형성 방법 및 그를이용한 캐패시터의 제조 방법 | |
KR100615612B1 (ko) | 금속 질화막을 하부전극으로 채택하는 엠아이엠 캐패시터제조 방법들 | |
KR100557965B1 (ko) | 반도체 소자의 캐패시터 형성방법 | |
KR100826638B1 (ko) | 반도체 소자의 캐패시터 및 그 형성방법 | |
KR100680463B1 (ko) | 반도체 소자의 캐패시터 제조 방법 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 20130430 Year of fee payment: 7 |
|
FPAY | Annual fee payment |
Payment date: 20140430 Year of fee payment: 8 |
|
FPAY | Annual fee payment |
Payment date: 20150430 Year of fee payment: 9 |
|
FPAY | Annual fee payment |
Payment date: 20160429 Year of fee payment: 10 |
|
FPAY | Annual fee payment |
Payment date: 20170427 Year of fee payment: 11 |
|
FPAY | Annual fee payment |
Payment date: 20180430 Year of fee payment: 12 |
|
FPAY | Annual fee payment |
Payment date: 20190429 Year of fee payment: 13 |