KR100208919B1 - 플라즈마 디스플레이의 구동 방법 및 플라즈마 디스플레이 장치 - Google Patents

플라즈마 디스플레이의 구동 방법 및 플라즈마 디스플레이 장치 Download PDF

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Abstract

1 개의 서브 필드로 다른 단계의 휘도를 표현할 수 있도록 한 것으로, 고세밀 대화면 패널에서의 풀컬러 고휘도 표시를 실현하는 동시에, 동화상 표시시의 부자연스러움을 없애고 표시 품질을 향상시킨다.
선택적으로 방전 발광을 행하는 복수의 셀을 가지는 플라스마 디스플레이 패널(100)과, 표시 데이터에 따라서 플라스마 디스플레이 패널의 각 셀에 선택적으로 전압을 인가하고, 셀마다 표시 데이터에 대응하는 전하를 축적시키는 어드레스 수단(101, 102)과, 복수의 셀에 주기적으로 극성이 변화하는 전압을 인가하며, 소정의 전하가 축적된 셀에서 방전을 발생시켜서 발광을 행하게 하는 유지 방전 수단(101, 104)을 구비하는 플라스마 디스플레이 장치에 있어서, 어드레스 수단은 표시하는 계조에 대응하는 복수의 다른 전압을 각 셀에 인가하고, 유지 방전 수단은 인가 전압의 강도를 변화시킨다.

Description

플라즈마 디스플레이의 구동 방법 및 플라즈마 디스플레이 장치
제1도는 본 발명의 제1실시예의 PDP의 전체 구성을 도시하는 도면.
제2도는 제1실시예의 X 공통 드라이버의 회로 구성을 도시하는 도면.
제3도는 제1실시예의 Y 드라이버의 회로 구성을 도시하는 도면.
제4도는 제1실시예의 어드레스 드라이버의 회로 구성을 도시하는 도면.
제5도는 제1실시예에 있어서의 기본 동작을 도시하는 도면.
제6도는 제1실시예의 구동 파형을 도시하는 도면.
제7도는 제2실시예의 구동 파형을 도시하는 도면.
제8도는 제3실시예의 구동 파형을 도시하는 도면.
제9도는 제4실시예의 구동 파형을 도시하는 도면.
제10도는 제5실시예의 구동 파형을 도시하는 도면.
제11도는 제6실시예의 구동 파형을 도시하는 도면.
제12도는 3전극·면 방전·AC형 PDP의 개략 평면도.
제13도는 3전극·면 방전·AC형 PDP의 개략 단면도.
제14도는 3전극·면 방전·AC형 PDP의 개략 단면도.
제15도는 3전극·면 방전·AC형 PDP의 구동 회로의 블럭도.
제16도는 종래의 구동 파형을 도시하는 도면.
제17도는 PDP에서 계조 표시하는 어드레스/유지 방전 분리형 어드레스 방식으 타임차트.
* 도면의 주요부분에 대한 부호의 설명
11 : Y 전극(제2 전극) 12 : X 전극(제1 전극)
13 : 어드레스 전극(제3 전극) 100 : 플라즈마 디스플레이 패널
101 : Y 드라이버 102 : Y 스캔 드라이버
103 : Y 공통 드라이버 104 : X 공통 드라이버
105 : 어드레스 드라이버 106 : 제어 회로
본 발명은 메모리 기능을 가지는 표시 소자인 셀 집합으로 구성된 표시 패널을 구동하는 기술에 관한 것으로, 구체적으로 말하면 AC(교류)형 플라즈마 디스플레이 패널(Plasma Display Panel : PDP)에 있어서, 계조 표시를 행하는 경우 표시 데이터의 기록 및 유지 방전에 의해서 발광 표시를 행하는 구동 방법 및 그 방법을 실현하는 표시 장치에 관한 것이다.
상기의 AC형 PDP는 2개의 유지 전극에 교대로 전압 파형을 인가하는 것으로 방전을 지속하여 발광 표시를 행한다. 한번의 방전은 펄스 인가후, 1 ㎲ 내지 수 ㎲ 후에 종료된다. 방전에 의하여 발생한 정(+)전하 이온은 부(-)의 전압이 인가되어 있는 전극상의 절연층의 표면에 축적되고, 부(-)전하 전자는 정(+)의 전압이 인가되어 있는 전극상의 절연층의 표면에 축적된다.
따라서, 처음에 높은 전압(기록 전압)의 펄스 (기록 펄스)로 방전시켜서 벽전하를 생성한 후, 극성이 다르고 전회(前回)보다도 낮은 전압(유지 전압 또는 유지 방전 전압)의 펄스(유지 펄스 또는 유지 방전 펄스)를 인가하면, 이전에 축적된 벽전하가 증복되고, 방전 공간에 대한 전압은 커지며, 방전 전압의 임계치를 초과하여 방전을 개시한다. 즉, 한번 기록 방전을 행하여 벽전하가 형성된 셀은 그 후, 유지 펄스를 교대로 역극성으로 인가하는 것으로, 방전을 유지하는 특징이 있다. 이것을 메모리 효과 또는 메로리 기능으로 칭해지고 있다. 일반적으로 AC형 PDP는 상기 메모리 효과를 이용하여 표시를 행한다.
AC형 PDP에는 2개의 전극으로 선택 방전(어드레스 방전) 및 유지 방전을 행하는 2 전극형과, 제 3 전극을 이용하여 어드레스 방전을 행하는 3 전극형이 있다. 계조 표시를 행하는 컬러 PDP에서는 방전에 의해 발생하는 자외선에 의해서 방전 셀 내에 형성한 형광체를 여기(勵起)하고 있지만, 상기 형광체는 방전에 의해 동시에 발생하는 정(+)전하 이온의 충격에 약하다는 결점이 있다. 상기의 2 전극형에서는 형광체가 이온에 직접 닿는 구성으로 되어 있기 때문에, 형광체의 수명 저하를 초래할 우려가 있다. 이것을 회피하기 위해서 컬러 PDP에서는 면 방전을 이용한 3 전극 구조가 일반적으로 이용되고 있다. 또, 상기 3 전극형에서도 유지 방전을 행하는 제1 및 제2 전극이 배치되어 있는 기판에 제3 전극을 형성하는 경우와, 대향하는 다른 기판에 배치하는 경우가 있다. 또한, 동일 기판에 상기의 3종 전극을 형성하는 경우에도 유지 방전을 행하는 2개의 전극 위에 제3 전극을 배치하는 경우와, 그 아래에 제3 전극을 배치하는 경우가 있다. 또, 형광체로부터 발생된 가시광선을 그 형광체를 투과하여 보는 경우(투과형)와, 형광체로부터의 반사를 보는 경우(반사형)가 있다. 또한, 방전을 행하는 셀은 장벽(리브(rib), 배리어(barrier))에 의하여 인접 셀과의 공간적인 결합이 단절되어 있다. 상기 장벽은 방전 셀을 둘러싸도록 사방에 설치되어 완전히 밀봉되어 있는 경우와, 한쪽에만 설치되고 다른쪽은 전극간의 갭(거리)의 적정화에 의해 결합이 끊어져 있는 경우 등이 있다. 본 발명은 어느 쪽의 구성에도 적용가능하지만, 여기서는 유지 방전을 행하는 전극 기판이 아닌 다른 대향 기판에 제3 전극을 형성한 패널에, 장벽이 수직 방향(즉, 제1 전극과 제2 전극에 직교하고 제3 전극과 평행에만) 형성되고 유지 전극의 일부가 투명 전극에 의하여 형성되어 있는 반사형을 예로서 설명한다.
제12도에는 상기의 3전극·면 방전의 PDP의 개략 평면도가 도시되어 있다. 또한, 제13도는 제12도의 패널의 1개의 방전 셀에 있어서의 개략적 단면도(수직 방향)이고, 제14도는 수평 방향의 개략적 단면도이다. 또, 이하에 도시된 도면에 있어서는 동일 기능 부분에는 동일 참조 번호를 부여하여 표시하는 것으로 한다.
패널은 2장의 유리 기판(21, 29)으로 구성되어 있다. 제1 기판(21)에는 평행한 유지 전극인 제1 전극(X 전극)(12) 및 제2 전극(T 전극)(11)이 구비되어 있으며, 이들 전극은 투명 전극(22a, 22b)과 버스 전극(23a, 23b)으로 구성되어 있다. 투명 전극은 형광체로부터의 반사광을 투과시키는 역할을 하기 때문에 ITO(산화 인듐을 주성분으로 하는 투명한 도체막) 등으로 형성된다. 또한, 버스 전극은 전기 저항에 의한 전압 강하를 막기 위하여 저저항으로 형성할 필요가 있으며 Cr(크롬)이나 Cu(구리)로 형성된다. 또, 그것을 유전체층(유리)(24)으로 피복하고, 방전면에는 보호막으로서 MgO(산화마그네슘)막(25)을 형성한다. 또한, 제1 유리기판(21)과 마주보는 제2 기판(28)에는 제3 전극(어드레스 전극)(13)을 유지 전극과 직교하는 형태로 형성한다. 또한, 어드레스 전극간에는 장벽(14)을 형성하고, 그 장벽의 사이에는 어드레스 전극을 씌우는 형태로 빨강·초록·파랑의 발광 특성을 가진 형광체(27)를 형성한다. 장벽(14)의 능선과, MgO면(25)이 밀착하는 형태로 2장의 유리 기판이 조립된다. 형광체(27)과 MgO면(25) 사이의 공간이 방전 공간 (26)이다.
또한, 제15도는 제12도 내지 제14도에 도시한 PDP를 구동하기 위한 주변 회로를 도시한 개략적 블록도이다. 어드레스 전극(13-1, 13-2,…)마다 어드레스 드라이버(105)를 접속하고, 그 어드레스 드라이버에 의하여 어드레스 방전시 어드레스 펄스가 인가된다. 또한, Y 전극(11-1, 11-2,…)은 Y 드라이버(101)에 접속된다. Y 드라이버(101)는 Y 스캔 드라이버(102)와 Y 공통 드라이버(103)로 구성되며, Y 전극들은 각각 Y 스캔 드라이버(102)에 접속된다. Y 스캔 드라이버(102)는 Y 공통 드라이버(103)에 접속되고, 어드레스 방전시의 펄스는 Y 스캔 드라이버(102)로부터 발생하며, 유지 펄스 등은 Y 공통 드라이버(103)에서 발생하고, Y 스캔 드라이버(102)를 경유하여 Y 전극에 인가된다. X 전극(12)은 패널의 전표시 라인에 걸쳐서 공통으로 접속되어 취출된다. X 공통 드라이버(104)는 기록 펄스, 유지 펄스 등을 발생시킨다. 이들 드라이버 회로는 제어 회로에 의하여 제어 되고, 그 제어 회로는 장치의 외부로부터 입력되는 동기 신호나 표시 데이터 신호에 의하여 제어된다.
PDP에서의 계조 표시는 통상 표시 데이터의 각 비트를 서브 필드 기간에 대응시키고 비트의 가중에 따라서 서브 필드 기간의 길이를 변경시킴으로써 행해진다. 예컨대, 256 계조 표시를 행하는 경우에는 표시 데이터는 8비트로 표시되고, 1 프레임의 표시를 8개의 서브 필드 기간동안 행하며, 각 비트 데이터의 표시를 각 서브 필드 기간동안 행한다. 서브 필드 기간의 길이는 1:2:4:8:16:32:64:128로 되어 있다.
제16도는 제12도 내지 제14도에 도시된 PDP를 제15도에 도시한 회로에 의하여 구동하는 종래의 방법을 도시하는 파형도이고, 소위 종래의 「어드레스/유지 방전 기간 분리형·기록 어드레스 방식」에 있어서의 1 서브 필드 기간을 도시하고 있다. 상기 예에서는 1 서브 필드는 리셋 기간과 어드레스 기간 또는 유지 방전 기간으로 분할된다. 리셋 기간에서는 우선 모든 Y 전극이 0V 레벨로 되고, 동시에 X 전극에 전압 Vs+Vw(약 330V)의 전면 기록 펄스가 인가되고, 그때까지의 표시 상태에 관계없이 모든 표시 라인의 모든 셀에서 방전이 행해진다. 이 때에 어드레스 전극 전위는 약 100V(Vaw)이다. 다음에, X 전극과 어드레스 전극의 전위가 0V로 되고, 모든 셀에 있어서 벽전하 자체의 전압이 방전 개시 전압을 초과하고, 방전이 개시된다. 이 방전은 자기 중화(自己 中和)하여 방전이 종식되며, 소위 자기 소거 방전이다. 이 자기 소거 방전에 의하여 패널 내의 모든 셀의 상태가 벽전 하가 없는 균일한 상태로 된다. 이 리셋 기간에는 이전의 서브 필드의 점등 상태에 관계없이 모든 셀을 같은 상태로 하는데, 이것은 다음 어드레스(기록) 방전을 안정 되게 행할 수 있도록 하기 위한 것이다.
다음에, 어드레스 기간에 있어서 표시 데이터에 따른 셀의 온/오프를 행하기 위하여 선순차(線順次)적으로 어드레스 방전이 행해진다. 우선 Y 전극에 -VY 레벨(약 150V)의 스캔 펄스를 인가하는 동시에, 어드레스 전극내 유지 방전을 일으키는 셀, 즉 점등시키는 셀에 대응하는 어드레스 전극에 전압 Va(약 50V)의 어드레스 펄스가 선택적으로 인가되며, 점등시키는 셀의 어드레스 전극과 Y 전극의 사이에서 방전이 일어난다. 다음에, 이것을 프라이밍(불씨)으로 하여 X 전극(전압 Vx=50V)과 Y 전극간의 방전이 행해지고 양전극의 MgO면에 유지 방전이 가능한 양의 벽전하가 축적된다.
이하, 순차적으로 다른 표시 라인에 관해서도 같은 동작이 행해지고, 모든 표시 라인에 있어서 새로운 표시 데이터의 기록이 행해진다.
그 후, 유지 방전 기간이 되면, Y 전극과 X 전극에 교대로 Vs(약 180V) 전압의 유지 펄스가 인가되어 유지 방전이 행해지고, 1 서브필드의 화상 표시가 행해진다. 이 때, 어드레스 전극과 X 전극 또는 Y 전극간의 방전을 피하기 위하여 어드레스 전극에 약 100V의 전압 Vaw를 인가하고 있다.
또, 이러한 「어드레스/유지 방전 기간 분리형·기록 어드레스 방식」에 있어서는 유지 방전 기간의 장단, 즉 유지 펄스의 회수에 의하여 휘도가 결정된다. 구체적으로는 다계조 표시의 일예로서 256 계조 표시를 행하는 경우의 구동 방법을 제17도에 도시한다. 이 예에서는 1 프레임은 8개의 서브필드(SF1~SF8)로 구분된다.
그리고, 이들의 서브필드, SF1~SF8에서 리셋 기간과 어드레스 기간의 길이는 동일하다. 또한, 유지 방전 기간의 길이는 1:2:4:8:16:32:64:128의 비율로 된다. 따라서, 점등시키는 서브필드를 선택하는 것으로 0에서 255까지의 256 계조의 휘도 차이를 표시할 수 있다.
상술된 바와 같이, AC형 플라즈마 디스플레이 패널의 종래의 구동 방법에서는 1회의 어드레스 사이클에서, 표시 데이터의 재기록을 행할 수 있는 것은 1 표시 라인이고, 1000개의 표시 라인을 가진 패널에 있어서는 1000 회의 어드레스 사이클을 필요로 하였다.
또한, 계조 표시를 행하는 경우, 1 프레임을 발광 회수가 다른 여러장의 서브필드로 구성할 필요가 있기 때문에, 그 서브필드마다 표시 라인분의 어드레스 사이클이 필요해진다.
밝은 표시를 행하기 위해서는 유지 방전의 회수를 크게 할 필요가 있었다. 일정한 시간에 많은 유지 방전 사이클을 끼워넣는 방법도 생각할 수 있지만, 메모리 효과를 충분히 발휘하여 보다 낮은 전압(적은 전력)으로 동작시키기 위해서는 유지 펄스의 폭을 길게 할 필요가 있다. 통상적으로, 5㎲ 정도의 펄스 폭이 필요하며, 전력을 희생시킨 경우에는 높은 전압을 인가하여 3 ㎲ 정도의 펄스 폭에서도 유지 방전이 가능하지만 이 정도가 한계였다. 따라서 고휘도 표시를 위해서는 프레임 내의 유지 방전 기간을 길게 취할 필요가 있다. 그렇게 하면, 발광에 기여하지 않는 기간인 어드레스 기간을 희생으로 할 필요가 있지만, 그 경우, 안정된 어드레스 방전에도 3 ㎲~5 ㎲의 시간이 필요하기 때문에, 많은 표시 라인을 가진 패널에 있어서 다계조 표시를 할 수 없게 된다. 표시 라인수와 다계조 표시를 우선적으로 생각하면 휘도를 희생하게 된다.
이와 같이, 휘도(유지 방전의 회수)와, 계조 표시 또는 표시 라인수나 전압등은 트레이드 오프(trade-off)의 관계에 있고, 고정밀 대화면 패널에서의 풀 컬러 고휘도 표시(full-color high-luminance display)를 저해하고 있다.
플라즈마 디스플레이에 의해 계조 표시를 행하는 수법으로서 이용되는 서브 필드법에서는 전술된 시간적 제약에 의해 저해되는 문제이외에, 1 프레임동안 발광 하는 화면이 시간적으로 분할되기 때문에 동화상 표시시에 서브필드마다 화상이 분리되어 보이기 때문에, 부자연스러움이 발생하였다.
이상과 같이, 현상의 서브핑드법에 의한 계조 표현은 장치의 표시 품질을 크게 저해하였다. 본 발명은 이러한 문제를 해결하고 고정밀 대화면 패널에서의 풀컬러 고휘도 표시의 실현을 목적으로 한다.
상기 목적을 달성하기 위해서, 본 발명의 플라즈마 디스플레이의 구동 방법 및 플라즈마 디스플레이 장치에 있어서는 각 셀로의 기록 전압을 계조에 따라서 변화시키고, 유지 방전에서 기록된 전압에 따라서 발광 강도를 다르게 하는 것으로 계조 표시를 행한다.
즉, 본 발명의 플라즈마 디스플레이의 구동 방법은 선택적으로 방전 발광을 행하는 복수의 셀을 가지며, 표시 데이터에 따라서 각 셀에 선택적으로 전압을 인가하고 셀마다 표시 데이터에 대응하는 전하를 축적시키는 어드레스 기간과, 복수의 셀에 유지 방전 전압을 인가하고 소정의 전하가 축적된 셀에서 방전을 발생시켜서 발광을 행하게 하는 유지 방전 기간을 구비하는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 상기 목적을 달성하기 위하여 어드레스 기간에 있어서는 표시하는 계조에 대응하는 복수의 다른 전압을 각 셀에 인가하여 셀마다 인가된 전압에 대응한 양의 전하를 축적하고, 유지 방전 기간에 있어서는 인가 전압의 강도를 변화시키는 것을 특징으로 한다.
또한, 본 발명의 플라즈마 디스플레이 장치는 선택적으로 방전 발광을 행하는 복수의 셀을 가지며, 표시 데이터에 따라서 각 셀에 선택적으로 전압을 인가하고 셀마다 표시 데이터에 대응하는 전하를 축적시키는 어드레스 수단과, 복수의 셀에 유지 방전 전압을 인가하고 소정의 전하가 축적된 셀에서 방전을 발생시켜서 발광을 행하게 하는 유지 방전수단을 구비하는 플라즈마 디스플레이 장치에 있어서, 상기 목적을 달성하기 위하여 어드레스 수단에 있어서는 표시하는 계조에 대응하는 복수의 다른 전압을 각 셀에 인가하고, 유지 방전수단에 있어서는 인가 전압의 강도를 변화시키는 것을 특징으로 한다.
유지 방전에 있어서도 인가 전압을 변화시키고, 각 셀이 유지한 벽전하의 양에 따라서 선택적으로 발광하도록 한다. 이것에 의해, 각 셀은 유지한 벽전하의 양에 따라서 유지 방전을 행하는 기간이 변화하기 때문에, 기록시의 인가 전압에 따라서 실효적인 휘도가 변화한다.
본 발명의 면 방전을 이용한 3 전극형의 플라즈마 디스플레이 장치에 적용한 경우에는 플라즈마 디스플레이 패널은 평행하게 배치된 복수의 제1 전극과 복수의 제2 전극과, 복수의 제1 전극과 복수의 제2 전극에 대하여 직각으로 배치된 복수의 제3 전극을 구비하고 있으며, 셀은 제1, 제2 및 제3 전극으로 규정된다. 어드레스 기간에는 복수의 제2 전극에 스캔 펄스를 순차적으로 인가함으로써 스캔 펄스가 인가되는 제2 전극에 대응하는 1개의 표시 라인을 순차적으로 선택하고, 각 표시 라인이 선택되는 기간 내에 복수의 제3 전극에 표시 데이터에 대응하는 전압을 1 라인분 인가하는 것을 모든 표시 라인에 관하여 행하며, 유지 방전 기간에는 복수의 제1 전극과 복수의 제2 전극과의 사이에 주기적으로 극성이 변화하는 전압을 인가한다. 이러한 경우, 각 셀에 표시하는 계조에 대응하는 복수의 다른 전압을 인가 한다. 이러한 경우, 각 셀에 표시하는 계조에 대응하는 복수의 다른 전압을 인가하기 위해서는 복수의 제3 전극에 인가하는 전압을 표시 데이터의 계조에 따라서 다르거나, 각 표시 라인이 선택되는 기간 내에 제2 전극에 인가하는 전압을 변화시키고, 복수의 제3 전극으로의 전압의 인가 타이밍을 표시 데이터의 계조에 따라서 변화시키거나, 각 표시 라인이 선택되는 기간 내에 상기 제1 전극에 인가하는 전압을 변화시키고, 복수의 제3 전극으로의 전압의 인가 타이밍을 표시 데이터의 계조에 따라서 변화시키는 것으로 실현된다. 어드레스 기간 동안 각 셀에 인가되는 전압은 디지털 데이터와 같이 단계적으로 다른 복수의 전압 레벨을 취할 수 있도록 하거나, 아날로그 데이터와 같이 연속적으로 다른 전압을 취할 수 있도록 한다.
본 발명은 표시 셀의 선택을 위한 방전인 어드레스 방전시에 전극에 대한 인가 전압의 차에 의하여 방전 수속후에 생성되는 벽전하의 전압치에 차이가 생기고, 벽전하의 전압치의 차이에 의해 유지 방전이 개시되는 인가 전압을 변화시키는 것에 착안하여 어드레스 기간에 있어서의 인가 전압을 계조에 따라서 변화시켜서 벽전화의 전압치에 차이를 발생시키고, 그 차에 따라서 유지 방전 기간을 변화시키는 것으로 계조 표시를 행하게 한다. 바꿔 말하면, 1회의 기록 동작, 즉 1 서브필드동안 복수 단계의 휘도를 표시할 수 있게 된다.
제1도는 본 발명의 제1 실시예의 3 전극·AC형 PDP(플라즈마 디스플레이 패널)의 전체 구성을 도시하는 도면이다.
제1도에 있어서, 참조 번호 100은 플라즈마 디스플레이 패널, 참조 번호 101은 Y 드라이버, 참조 번호 102는 Y 스캔 드라이버, 참조 번호 103은 Y 공통 드라이버, 참조 번호 104는 X 공통 드라이버, 참조 번호 105는 어드레스 드라이버, 참조 번호 106은 제어 회로, 참조 번호 112는 Y 드라이버(101)의 레벨 변화 회로(level shifting circuit), 참조 번호 113은 X 공통 드라이버(104)의 레벨 변화 회로(level shifting circuit), 참조 번호 114-1~114-M은 어드레스 드라이버(105)의 레벨 선택 회로, 참조 번호 115는 시프트 레지스터를 나타낸다.
본 실시예의 플라즈마 디스플레이 패널은 제12도 내지 제14도에 도시한 종래의 것과 동일한 구성을 가진다. Y 드라이버(101), X 공통 드라이버(104) 및 어드레스 드라이버(105)는 종래의 것과 거의 같은 구성을 가지지만, 각각은 Y전극, X전극 및 어드레스 전극에 인가하는 전압을 종래부터 다수의 레벨로 변화시키기 위한 레벨 변화 회로(112, 113) 및 레벨 선택 회로(114-1 내지 114-M)을 가지고 있는 점을 제외하고, 종래와 동일한 구성을 가지고 있으므로, 여기서는 다른 점에 관해서만 설명한다. 또, 제어 회로(106)도 Y 전극, X 전극 및 어드레스 전극에 인가하는 전압의 레벨을 변화시키기 위한 구성이외는 종래와 동일한 구성을 가지고 있다.
상기 제1 실시예에 도시한 구동 회로는 Y 전극, X 전극, 어드레스 전극의 구동 회로에 각각 레벨 변화 회로를 가지는 구성으로 도시하고 있지만, 이하에 도시하는 인가 파형의 형태에 따라서 필요한 회로가 한정된다.
제2도 내지 제4도에 제1 실시예의 구동 파형을 각 전극에 인가하기 위한 구동 회로를 도시한다. 이들의 도면은 전극에 전압을 인가하는 고압부만 도시하고 있기 때문에, 제어신호를 발생하는 제어부나 각 고압 회로의 인가하는 전원의 회로는 생략하고 있다.
제2도는 X 공통 드라이버(104)의 회로의 개략도이다. X 전극은 유지 방전기간에 있어서 3치의 유지 펄스를 발생시키기 위하여 Vs1, Vs2, Vs3의 각각 3종류의 전원에 접속된 스위칭 소자인 FET(전계 효과 트랜지스터)(201, 202, 203)와 GND(0V)에 접속된 FET(204)로 구성된다. 각 FET의 게이트에는 각 신호 S1, S2, S3, S4가 인가된다. 유지 기간을 분할한 최초 기간인 제1 유지 기간에 있어서는 FET(201)과 FET(204)가 2번째 기간인 제2 유지 기간에 있어서는 FET(202)와 FET(204)가 3번째 기간인 제3 유지 기간에 있어서는 FET(203)과 FET(204)가 각각 교대로 스위칭을 반복하고, 소정의 전압의 유지 펄스를 X 전극에 인가한다. 여기서, 종래는 제26도에 도시된 바와 같은 일정한 전압 Vs와 GND의 사이에서 전환되는 유지 펄스를 인가할 뿐이므로, FET(201)와 FET(204)로 구성되는 회로만을 가지고 있었다.
제3도는 Y 전극을 구동하는 회로의 개략도이다. FET(211)로부터 FET(216) 까지가 Y 공통 드라이버(103)에 해당하고 FET(217)가 Y 스캔 드라이버(103)에 해당한다. FET(217)는 Y 전극마다 설치되어 있다. FET(211)로부터 FET(214)까지는 X 공통 드라이버(104)와 같은 동작을 행하고, 각각의 유지 기간에 있어서 교대로 스위칭을 반복한다. 한편, 어드레스 기간에서는 FET(215)가 오프되고, 선택하는 Y 전극에 대응하는 스캔 드라이버의 FET(217)가 온되며, 다음에 FET(216)가 온되는 것으로, 선택한 Y 전극을 소정의 VY의 전위까지 내린다. 이 동작을 선택 전극마다 순차적으로 행한다. 또한, 유지 방전 기간에서는 FET(215)와 FET(217)가 온으로 되어 있는 상태로 되기 때문에, Y 전극으로의 전류의 공급과 인입은 FET(215)와 FET(217)( 및 내장된 다이오드)를 통하여 행해진다.
제4도는 어드레스 전극을 구동하는 회로, 소위 어드레스 드라이버(105)의 레벨 선택 회로의 개략도이다. 이러한 레벨 선택 회로가 각 어드레스 전극마다 설치되어 있다. 어드레스 전극은 어드레스 기간에서 3치의 어드레스 펄스를 발생시키기 위하여 Vs1, Vs2, Vs3의 각 3종류의 전원에 접속된 FET(221, 222, 223)와 GND(0V)에 접지된 FET(224)에 의하여 각각의 비트가 구성된다. 목적 전압에 따라서 각각의 FET가 온되고, 소정의 어드레스 펄스를 인가한다.
또, 이하에서 설명하는 제2 내지 제6 실시예의 PDP도 제1 실시예의 PDP와 같은 구성을 가진다.
제5도는 제1 실시예에 있어서의 동작을 도시하는 흐름도이다. 제1 실시예에 있어서의 기본적인 동작을 상기 흐름도를 참조하여 설명하고, 그 후 타임차트를 이용하여 보다 구체적으로 설명한다.
먼저, 단계 501에서는 제16도에 도시한 리셋 동작을 행한다.
단계 502에서는 제어 회로(106)로부터 보내져 오는 1열째의 표시 데이터에 따라서 각 어드레스 전극에 인가하는 레벨을 선택한다.
단계 503에서는 단계 502에서 선택한 레벨에 따라서 제4도의 신호 S21, S22, S23, S24중 어느 하나가 「고」 상태로 되어 표시 데이터에 대응하는 전압이어드레스 전극에 인가된다. 동시에, 제3도의 신호 S15는 「저」 상태로 되고, 신호 S16가 「고」 상태로 되며, 선택되는 Y 전극에 접속되는 FET의 게이트에 인가되는 신호 S17가 「고」 상태가 된다. 이것에 의하여 선택된 Y 전극와 어드레스 전극의 사이에서 어드레스 전극에 인가되는 전압에 다른 강도로 방전이 행해진다. 따라서, 어드레스 전극에 GND의 전압이 인가되었을 때에는 방전은 행해지지 않게 된다.
이상의 단계 502와 503의 동작을 모든 Y전극에 관하여 행할 때까지 반복한다. 단계 504에서는 단계 502와 503의 동작이 모든 Y 전극에 관하여 종료했는지가 판정된다. 이상의 동작이 종료하면 기록 동작이 종료한다.
단계 505에서는 레지스터 n에 N을 기억시킨다.
단계 506에서는 N 단계중의 n 번째의 레벨의 전압을 인가하고, 그 레벨에 대응하여 미리 정해진 기간, 유지 방전을 행한다. 구체적으로는 제2도와 제3도의 신호 S5를 「고」 상태로 하고, 신호 S1과 S11, S2과 S12, S3과 S13 중의 n 번째의 세트와, S4와 S14를 교대로 「고」 상태로 한다.
단계 507에서는 N 단계의 유지 방전이 종료하였는지 판정한다. 실제로는 레지스터 n의 값이 제로인지를 판정함으로써 행한다.
단계 508에서는 레지스터 n의 값을 1 감하여 단계 506으로 되돌아간다.
이상으로 1 화면(프레임)의 표시가 종료한다. 혹시, 계조 표시의 일부를 서브필드로 분할하여 각 서브필드의 기간을 변경시킴으로써 행하고, 일부를 본 발명의 기록의 전압 강도를 변화시켜서 행하는 경우에는 제5도의 일련의 동작을 각 서브필드마다 실행하여 1 프레임의 표시를 종료한다.
다음에, 제1 실시예의 동작을 타임차트로 설명한다.
제6도는 본 발명의 제1 실시예에 있어서의 각 전극의 구동 파형을 도시하는 도면이다.
본 발명에 있어서는 어드레스 전극의 전압 펄스를 표시 데이터에 따라서, 즉, 점등해야 할 셀의 필요한 휘도에 따라서 가변하고 있다. 어드레스 전극에 인가되는 전압 펄스는 비선택의 전위를 포함시키면, 0V, Va1, Va2, Va3의 4치를 가지고 있다. 따라서, 스캔 펄스가 인가되었을 때에 일어나는 방전의 규모는 어드레스 펄스가 어떤 전압치를 취할지에 의해 결정되며, 그 방전에 의하여 방전 셀 내에 축적되는 벽전하의 양, 즉, 전압치도 각각의 다른 값을 가진다.
상기 수법에 의하면, 0V에서 방전을 실행하지 않는 경우도 포함시키고, 4치의 벽전하에 의한 전압치(벽전압이라 칭함)가 선택된다. 소정의 표시 라인의 스캔이 종료하면, 유지 방전 기간으로 들어간다.
유지 방전 펄스도 3치의 값을 가지며, 어드레스 기간에 형성된 벽전압의 차에 의하여 방전을 개시하는 타이밍이 달라진다. 구체적으로 말하면, 어드레스 펄스가 0V이고 비선택된 셀은 벽전압이 0V이기 때문에 어느 유지 펄스에 의해서도 방전은 행해지지 않는다. 전압 Va1의 어드레스 펄스에 의하여 어드레스 방전이 행해진 셀은 형성된 벽전압이 작기 때문에, 큰 전압의 유지 펄스에 있어서만 방전을 개시하는 것이 가능하고, VS3의 유지 전압이 인가된 시점에서 유지 방전을 지속시킨다. 다음에, 전압 Va2의 어드레스 펄스에 의하여 어드레스 방전이 행해진 셀은 형성된 벽전압이 중간 규모이기 때문에, VS2의 유지 전압이 인가된 시점에서 유지 방정을 지속한다. 따라서, VS3의 유지 펄스가 인가된 시점에서도 유지 방전은 행한다. 또, 전압 Va3의 어드레스 펄스에 의하여 어드레스 방전이 행해진 셀은 형성된 벽전압이 크기 때문에, 낮은 전압의 유지 펄스에서의 방전 개시를 가능하게 하기 위하여 전압 VS1의 처음 유지 펄스로부터 방전을 행하고, 이후 계속한다.
1개의 패널의 특성을 예로 실제의 전압 조건을 다음에 도시한다. 어드레스 전극과 Y 전극간의 방전 개시 전압(Vfay)은 150V이다. X 전극과 Y전극간에서 유지 방전을 실행하는데 필요한 유지 전압의 하한치(Vsm)는 150V이고, X 전극과 Y 전극간에서 방전을 개시하는데 필요한 방전 개시 전압은 220V이다. 따라서, 스캔 펄스(-VY) 전압은 -140V이고, 어드레스 펄스의 Va1는 20V, Va2는 40V, Va3는 60V이다. 또한, 유지 펄스의 VS1는 160V, VS2는 180V, VS3는 200V이다. Va1(20V)의 어드레스 펄스가 인가되고, Y 전극에 스캔 펄스(-VY=-140V)가 인가되면, 양전극간의 전위차는 160V가 되며, 어드레스 전극과 Y 전극간의 방전 개시 전압을 초과하여 어드레스 방전이 행해진다. 이 방전에 의하여, Y 전극과 X 전극간에 형성되는 벽전압은 30V 정도이기 때문에, VS3(200V)의 유지 펄스가 인가된 시점에서 벽전압과 인가 전압과의 합이 방전 개시 전압인 220V를 초과하기 때문에 유지 방전이 행해진다. 또한, Va3(60V)의 어드레스 펄스가 인가된 경우는 스캔 펄스와의 전압이 200V에 달하고, 어드레스 방전에 의하여 Y 전극과 X 전극간에 형성되는 벽전압은 70V 정도가 되기 때문에, 전압이 160V의 처음의 유지 전압이 인가된 시점에서 벽전압과 인가 전압과의 합이 방전 개시 전압을 넘어서 유지 방전이 행해진다. 이 셀은 유지 방전 기간의 종료시까지 방전을 반복한다.
이와 같이, 제1 실시예에 있어서는 1번의 스캔에 있어서 4단계의 밝기의 차이를 표현할 수 있다. 즉, 4계조의 표현에 종래에는 2개의 서브필드가 필요하였으나, 본 발명서는 1개의 서브필드만을 필요로 한다.
제7도는 본 발명의 제2실시예의 구동 파형도이다. 제7도에 따라서, 제2 실시예의 동작을 설명한다.
어드레스 기간의 동작은 제1 실시예와 완전히 동일하지만, 유지 방전 기간에 인가하는 유지 펄스는 전압 VS1의 유지 펄스가 반복 인가되는 동안에 일정 기간마다 전압 VS2와 전압 VS3의 유지 펄스가 각각 인가되는 Va3의 어드레스 펄스에 의하여 방전된 셀은 처음의 유지 펄스로부터 방전을 행한다. VS1의 어드레스 펄스에 의하여 방전되고, 작은 벽전압을 가진 셀은 VS3의 유지 펄스가 인가된 시점에서 방전을 행하며, 이후 작은 전압의 유지 펄스에서도 방전을 반복한다.
제1 실시예와 제2 실시예의 차이를 설명한다. 일반적으로, 플라즈마 디스플레이는 인가 전압에 의하여 방전의 강도가 결정되고 그것에 따라서 휘도가 커지는 특성을 가지고 있다. 따라서, 제1 실시예의 경우는 제1 유지 기간보다 제3 유지 기간쪽이 1번의 방전으로는 고휘도의 방전이 행해진다. 한편, 제2 실시예의 경우에는 단발적으로 삽입되는 VS2 및 VS3의 유지 펄스 이외는 일정한 휘도로 방전을 반복하기 때문에, 휘도는 어떤 유지 기간에서도 동일하며 유지 방전의 회수에 의해서만 결정된다. 펄스에 의한 방전은 VS1의 전압으로 반복되는 유지 방전 기간의 모든 수에 비하여 무시할 수 있을 정도로 영향은 작다.
어드레스 펄스의 선택이 직선적인 휘도비로 선택되는 경우, 즉 표시하고 싶은 휘도비가 1:2:3인 경우는 제2 실시예에 있어서는 제1, 제2, 제3 유지 기간9즉, 유지 펄스의 수)은 같은 시간으로하는 것이 좋다. 한편, 제1 실시예에 있어서는 제1 유지기간보다 제3 유지 기간쪽이 1회의 방전에서의 발광 휘도가 크기 때문에, 적은 회수로 소정의 휘도가 얻어지기 때문에, 제3 유지 기간은 짧게 할 필요가 있다. 즉, 제1에서 제2, 제3 기간의 휘도를 동일하게 하면 좋다. 또한, 비선형적인 휘도비를 바라는 경우는 그 특성에 따라서 각 유지 기간의 펄스의 회수를 설정하면 좋다.
이상의 실시예는 예로 1 서브필드로 4치의 휘도를 표현할 수 있지만, 어드레스 펄스 및 유지 펄스가 취할 수 있는 단계를 증가시킴으로써 더욱 많은 계조 표현을 행할 수 있다. 최종적으로 구동 회로가 수반되면, 무한 단계, 즉 아날로그적인 휘도 표현이 가능하다.
제8도는 제3 실시예의 파형도이다.
제8도에 있어서는 어드레스 기간에 있어서의 인가 전압만을 도시하고 있고, 유지 방전 기간의 동작은 제1 혹은 제2 실시예와 같다.
제3 실시예는 어드레스 펄스는 일정한 전압만을 인가하게 되고, 1 라인의 선택 기간에 있어서 스캔 펄스의 전압을 서서히 저하시키고 있다. 최대 휘도를 표현 하고 싶은 경우에는 제1 및 제2 실시예와 같이 큰 벽전압을 형성해야하기 때문에, 스캔 펄스가 최대의 전압(VY4)을 취하는 시점에서 어드레스 펄스를 인가한다. 한편, 최소 휘도의 경우에는 스캔 펄스가 최소의 전압(VY1)이 된 시점에서 어드레스 펄스를 인가하면 좋다. 이 동작을 순차적으로 행함으로써 표시 데이터의 계조에 따른 벽전압을 모든 표시 셀에 형성하는 것이 가능하다.
제3 실시예에 있어서는 스캔 펄스의 전압을 4단계에 걸쳐서 변화시킬 필요가 있다. 이러한 동작을 실현하기 위해서는 예컨대, 제3도의 회로의 각 Y 전극에 접속되는 Y 스캔 드라이버에 각각 FET(211 내지 213)으로 구성되는 회로를 설치하면 좋다. 4단계이기 때문에 FET를 또 1개 추가하여 각각 공급하는 전원을 4종류로 한다.
제9도는 제4 실시예의 파형도이다. 기본적으로는 제3 실시예와 같지만, 스캔 펄스의 전압을 아날로그적으로 변화시키고, 그것에 따라서 어드레스 펄스를 인가하는 타이밍도 아날로그적으로 변화시키는 것을 가능하게 한 실시예이다. 여기서는 아날로그적으로 변화하는 유지 펄스를 수반하면, 아날로그적인 계조 표현이 가능해진다.
각 전압 펄스와 패널 특성의 관계를 기술하면, 스캔 펄스의 최소 전압과 어드레스 펄스 전압의 합이 어드레스 전극과 Y 전극간의 방전 개시 전압 보다 큰 값으로 설정된다. 또한, 스캔 펄스의 최대 전압은 0V의 전위에 있는 X 전극과의 사이에서 방전을 개시하기 않은 값으로 설정한다.
제4 실시예에 있어서는 스캔 펄스의 전압을 아날로그적으로 연속적으로 변화시킬 필요가 있다. 이러한 동작을 실현하기 위해서는 예컨대, 제3도의 회로의 각 Y 전극에 접속되는 Y 스캔 드라이버에 각 오퍼레이션 앰프 등으로 구성되는 증폭 회로를 설치하고, 선형적으로 변화하는 신호를 인가할 필요가 있다.
제10도는 제5 실시예의 파형도이다. 제10도에 있어서는 어드레스 기간에 있어서의 인가 전압만을 도시하고 있고, 유지 방전 기간의 동작은 제1 혹은 제2 실시예에서와 동일하다.
제5 실시예는 어드레스 펄스 및 스캔 펄스는 일정한 전압만을 인가하게 되고, 1 라인의 선택 기간에 있어서 X 전극의 전압을 서서히 저하시키고 있다. 최대휘도를 표현하고 싶은 경우는 제1 및 제2 실시예와 동일한 바와 같이 큰 벽전압을 형성할 필요가 있기 때문에 X 전극의 전압이 최대의 전압을 취하는 시점에서 어드레스 펄스를 인가한다. 한편, 최소 휘도의 경우는 X 전극의 전압이 최소의 전압의 시점에서 어드레스 펄스를 인가하면 좋다. 상기 동작을 순차적으로 행함으로써, 표시 데이터의 계조에 따른 벽전압을 모든 표시 셀에 형성하는 것이 가능해진다.
제5 실시예에 있어서는 X 공통 드라이버(104)의 출력을 어드레스 기간에 단계적으로 변화시킬 필요가 있지만, X 공통 드라이버(104)는 유지 방전 기간에 동일한 동작을 행하고 있고, 제2도의 회로에서 부여하는 신호를 변경하면 좋다.
제11도는 제6 실시예의 파형도이다. 기본적인 동작은 제5 실시예와 동일하지만, X 전극의 전압을 아날로그적으로 변화시키고, 그것에 따라서 어드레스 펄스를 인가하는 타이밍도 아날로그적으로 인가하는 것을 가능하게 한 실시예이다. 여기서는 아날로그적으로 변화하는 유지 펄스를 수반하면 아날로그적인 계조 표현이 가능해진다.
각 전압 펄스와 패널 특성의 관계를 기술하면, 스캔 펄스의 전압과 어드레스 펄스 전압의 합이 어드레스 전극과 Y 전극간의 방전 개시 전압을 초과한 값으로 설정된다. 또한, 최대의 X 전극의 전압은 스캔 펄스의 전압과의 사이에서 방전을 개시하지 않은 값으로 설정된다.
제6 실시예에 있어서도, X 공통 드라이버에 제4 실시예와 같은 오퍼레이션 앰프 등으로 구성되는 증폭 회로를 설치하고 선형태로 변화하는 신호를 인가할 필요가 있다.
상술된 바와 같이 본 발명에 의하면, 1개의 서브필드동안 다단계의 휘도를 표현할 수 있다. 따라서, 휘도(유지 방전 회수)와, 계조 표시 또는 표시 라인수에 있어서 종래와 같은 제약을 받지 않고, 고정밀 대화면 패널에서의 풀 컬러 고휘도 표시를 실현할 수 있다. 또, 1 프레임으로 발광 표시하는 화면을 시간적으로 집약할 수있기 때문에, 동화상 표시시 부자연스러움을 없애고, 표시 품질은 향상시킬 수있다.

Claims (16)

  1. 서로 평행하게 정렬된 복수의 제1 및 제2 전극 쌍과 상기 복수의 제1 및 제2 전극 쌍에 대하여 직각으로 정렬된 제3 전극을 갖는 디스플레이 패널과, 상기 제1, 제2 및 제3 전극에 의해 규정되고 선택적으로 방전하여 발광하는 복수의 셀을 포함한 플라즈마 디스플레이 구동 방법에 있어서, 어드레스 기간 동안, 상기 복수의 제2 전극에 스캔 펄스를 순차적으로 인가하여 상기 스캔 펄스가 인가되는 상기 제2 전극에 대응하는 1개의 표시 라인을 순차적으로 선택하고, 상기 1개의 표시 라인이 선택되는 동안의 기간 동안 1개의 표시 라인을 구성하는 상기 복수의 제2 전극에 표시 데이터에 대응하고 상기 표시 데이터에 의해 나타나는 계조 레벨에 달라지는 다른 전압을 인가하는 단계와; 유지 방전 기간 동안, 상기 복수의 제1 및 제2 전극 쌍 사이에 극성이 주기적으로 반전하고 강도가 변화하는 유지 방전 전압을 인가하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  2. 제1항에 있어서, 상기 유지 방전 전압의 강도는 상기 유지 방전 기간 동안에 점차적으로 증가되는 것을 특징으로 하는 플라즈마 디스플레이 구동방법.
  3. 제1항에 있어서, 상기 유지 방전 전압은 강도가 다른 복수의 펄스를 동기화한 신호의 전압인 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  4. 서로 평행하게 정렬된 복수의 제1 및 제2 전극 쌍과 상기 복수의 제1 및 제2 전극 쌍에 직각으로 정렬되는 복수의 제3 전극을 갖는 플라즈마 디스플레이 패널과, 상기 제1, 제2 및 제3 전극에 의해 규정되고 선택적으로 방전하여 발광하는 복수의 셀을 포함하는 플라즈마 디스플레이 구동 방법에 있어서, 어드레스 기간 동안에, 1개의 표시 라인이 상기 어드레스 기간 내에서 선택되는 동안의 기간 동안 전압이 변화되는 스캔 펄스를 상기 복수의 제2 전극에 순차적으로 인가하여, 상기 스캔 펄스가 인가되는 상기 제2 전극에 대응하는 1개의 표시 라인을 순차적으로 선택하고, 상기 1개의 표시 라인이 선택되는 동안의 기간 동안 1개의 표시 라인을 구성하는 상기 복수의 제3 전극에 표시 데이터에 대응하는 전압을 상기 표시 데이터에 의해 나타나는 계조 레벨에 따라 변화하는 타이밍으로 인가하는 단계와, 상기 유지 방전 기간 동안에 상기 제1 및 제2 전극 쌍 사이에 극성이 주기적으로 반전되고 강도가 변화하는 유지 방전 전압을 인가하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  5. 제4항에 있어서, 상기 어드레스 기간에서 상기 1개의 표시 라인이 선택되는 동안의 기간 동안 상기 제2 전극에 인가되는 상기 전압은 단계적으로 변화되는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  6. 제4항에 있어서, 상기 어드레스 기간에서 상기 1개의 표시 라인이 선택되는 동안의 기간 동안 상기 제2 전극에 인가되는 상기 전압은 연속적으로 변화되는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  7. 제4항에 있어서, 상기 유지 방전 전압의 강도는 상기 유지 방전 기간 동안에 점차적으로 증가되는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  8. 제4항에 있어서, 상기 유지 방전 전압은 강도가 서로 다른 복수의 펄스를 동기화한 신호의 전압인 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  9. 서로 평행하게 정렬된 복수의 제1 및 제2 전극 쌍과 상기 복수의 제1 및 제2 전극 쌍에 직각으로 정렬되는 복수의 제3 전극을 갖는 플라즈마 디스플레이 패널과, 상기 제1, 제2 및 제3 전극에 의해 규정되고 선택적으로 방전하여 발광하는 복수의 셀을 포함하는 플라즈마 디스플레이 구동 방법에 있어서, 어드레스 기간 동안에, 상기 복수의 제2 전극에 스캔 펄스를 순차적으로 인가하여 상기 스캔 펄스가 인가되는 제2 전극에 대응하는 1개의 표시 라인을 순차적으로 선택하고, 상기 1개의 표시 라인이 선택되는 동안의 상기 기간동안 1개 표시 라인을 구성하는 상기 복수의 제3 전극에 표시 데이터에 대응하는 전압을 인가하며, 상기 어드레스 기간에서 상기 1개의 표시 라인이 선택되는 동안의 상기 기간 동안 상기 제1 전극에 인가되는 상기 전압을 변화시키고, 상기 복수의 제3 전극에 전압을 인가하는 타이밍을 표시 데이터에 의해 나타나는 계조 레벨에 따라 변화시키는 단계와; 유지 방전 기간 동안, 상기 복수의 제1 및 제2 전극 쌍사이에 극성이 주기적으로 반전되고 강도가 변화되는 유지 방전 전압을 인가하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  10. 제9항에 있어서, 상기 어드레스 기간에서 상기 1개의 표시 라인이 선택되는 동안의 상기 기간 동안 상기 제1 전극에 인가되는 상기 전압은 단계적으로 변화되는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  11. 제9항에 있어서, 상기 어드레스 기간에서 상기 1개의 표시 라인이 선택되는 동안의 상기 기간 동안 상기 제 1전극에 인가되는 상기 전압은 연속적으로 변화되는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  12. 제9항에 있어서, 상기 유지 방전 기간 동안 상기 유지 방전 전압의 강도가 점차적으로 증가되는 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  13. 제9항에 있어서, 상기 유지 방전 전입은 강도가 다른 복수의 펄스를 동기화한 신호의 전압인 것을 특징으로 하는 플라즈마 디스플레이 구동 방법.
  14. 서로 평행하게 정렬되는 복수의 제1 및 제2 전극 쌍과 상기 복수의 제1 및 제2 전극 쌍에 직각으로 정렬되는 복수의 제3 전극을 갖는 플라즈마 디스플레이 패널과; 상기 제1, 제2 및 제3 전극에 의해 규정되고 선택적으로 방전하여 발광하는 복수의 셀과; 상기 복수의 제2 전극에 스캔 펄스를 순차적으로 인가하는 Y 스캔 드라이버, 및 표시 데이터에 의해 나타나는 계조 레벨에 따라 상이한 전압들 중에서 상기 복수의 제3 전극에 인가될 전압을 선택하여 그 선택된 전압을 1개의 스캔 펄스가 제2 전극에 인가되는 동안의 기간 동안에 1개의 표시 라인을 구성하는 상기 복수의 제3 전극에 인가하는 어드레스 드라이버를 갖는 어드레스 회로와; 상기 복수의 제1 전극에 극성이 주기적으로 반전되는 전압을 인가하는 X 공통 드라이버, 및 상기 복수의 제2 전극에 극성이 주기적으로 반전되는 전압을 인가하는 Y 공통 드라이버를 갖는 유지 드라이버를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  15. 서로 평행하게 정렬되는 복수의 제1 및 제2 전극 쌍과 상기 복수의 제1 및 제2 전극 쌍에 직각으로 정렬되는 복수의 제3 전극을 갖는 플라즈마 디스플레이 패널과; 상기 제1, 제2 및 제3 전극에 의해 규정되고 선택적으로 방전하여 발광하는 복수의 셀과; 상기 복수의 제2 전극에 전압이 1개의 표시 라인이 선택되는 동안의 기간 동안에 변화되는 스캔 펄스를 순차적으로 인가하는 Y 스캔 드라이버, 및 1개의 스캔 펄스가 표시 데이터에 의해 나타나는 계조 레벨에 따라 다른 타이밍에서 제2 전극에 인가되는 동안의 기간 동안 1개의 표시 라인을 구성하는 상기 복수의 제3 전극에 표시 데이터에 대응하는 전압을 인가하는 어드레스 드라이버를 갖는 어드레스 회로와; 상기 복수의 제1 전극에 극성이 주기적으로 반전되는 전압을 인가하는 X 공통 드라이버, 및 상기 복수의 제2 전극에 극성이 주기적으로 반전되는 전압을 인가하는 Y 공통 드라이버를 갖는 유지 드라이버를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  16. 서로 평행하게 정렬되는 복수의 제1 및 제2 전극 쌍과 상기 복수의 제1 및 제2 전극 쌍에 직각으로 정렬된 복수의 제3 전극을 갖는 플라즈마 디스플레이 패널과; 상기 제1, 제2 및 제3 전극에 의해 규정되고 선택적으로 방전하여 발광하는 복수의 셀과; 상기 복수의 제2 전극에 스캔 펄스를 순차적으로 인가하는 Y 스캔 드라이버, 표시 데이터에 의해 나타나는 계조 레벨에 따른 타이밍에서 1개의 스캔펄스가 제2 전극에 인가되는 동안의 기간 동안 1개의 표시 라인을 구성하는 상기 복수의 제3 전극에 표시 데이터에 대응하는 전압을 인가하는 어드레스 드라이버, 및 상기 1개의 표시 라인이 선택되는 동안의 기간 동안에 상기 제1 전극에 인가되는 전압을 변경시키고 표시 데이터에 의해 나타나는 계조 레벨에 따라 상기 복수의 제3 전극에 전압을 인가하는 타이밍을 변경시키는 레벨 변화 회로를 갖는 어드레스 회로와; 상기 복수의 제1 전극에 극성이 주기적으로 반전되는 전압을 인가하는 X 공통 드라이버, 및 상기 복수의 제2 전극에 극성이 주기적으로 반전되는 전압을 인가하는 Y 공통 드라이버를 갖는 유지 드라이버를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
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