JPWO2013145545A1 - 半導体装置 - Google Patents
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Abstract
Description
また、炭化珪素JBSにおいては、pnダイオードがオンしにくいため、サージ電流などが発生してもショットキダイオードにのみサージ電流が流れ、ショットキダイオードに過電流が流れて半導体装置が破壊される場合があった。
まず、本発明の実施の形態1における半導体装置の構成を説明する。ここでは、第1導電型をn型、第2導電型をp型としている。
p型の第1ウェル領域30は、p型不純物として1×1017cm-3〜1×1018cm-3の濃度のAlを含み、深さは、0.1〜0.5μmである。p型の第2ウェル領域40は、p型不純物としてのAlを含み、その幅は第1ウェル領域30の幅より小さく、深さは、0.5〜6μmである。第2ウェル領域40のp型不純物の濃度は、第1ウェル領域30のp型不純物の濃度より少なく、例えば1〜2桁少ないものとする。また、終端構造70は、主にp型の領域であり、形状は、断面形状が長方形、断面形状が離散的なFLR(Field Limiting Ring)などから適宜選択されればよく、また、そのそれぞれの部分の濃度も適宜決められればよい。ショットキ電極50はTi、オーミック電極60はNiとした。
まず、図3(a)に示すように、n型不純物として1×1018cm-3程度かこれ以上の濃度の窒素を含有するn型で低抵抗の炭化珪素の半導体基板10上に、化学気相堆積(Chemical Vapor Deposition:CVD)法によりn型の不純物濃度が1×1013cm-3〜1×1016cm-3で1〜5μmの厚さの炭化珪素で構成されるドリフト層第一領域21をエピタキシャル成長する。
つづいて、図3(b)に示すように、ドリフト層第一領域21の所定の位置に第2導電型不純物のAlをイオン注入することにより第2ウェル領域第一領域41を形成する。
つづいて、図3(d)に示すように、ドリフト層第二領域22の第2ウェル領域第一領域41に対応した平面上の位置に第2導電型不純物のAlをイオン注入することにより第1ウェル領域第一領域41とつながった第2ウェル領域第二領域42を形成する。
次に、ドリフト層20などの表面にショットキ電極50をスパッタ法で形成し、半導体基板10の裏面(第2の主面)側にオーミック電極60をスパッタ法で形成することにより、図1に断面を示すような、本実施の形態の半導体装置である炭化珪素JBSダイオードを製造できる。
また、第1ウェル領域30は、第2ウェル領域40より高濃度の第2導電型不純物を有し、第1ウェル領域30の幅も第2ウェル領域40の幅より大きいので、オフ時においても、完全には空乏化されない、すなわち、空乏化されない領域が残る。
図4は、一般的な炭化珪素JBSダイオードおよび炭化珪素pnダイオードの断面構造を示す断面模式図であり、図4(a)は、炭化珪素JBSダイオードの断面図、図4(b)は、炭化珪素pnダイオードのダイオードである。
JBSダイオードでは、オン電流はショットキ電極50直下から、第1ウェル領域30、及び第2ウェル領域40の下部へ回り込むように流れるが、この結果は、第1ウェル領域30直下では、第1ウェル領域30が無い領域(ショットキダイオード部)に近い第1ウェル領域30の断面横方向の端部に近いほどオン電流の電流密度が高く、その電流が流れる領域が第1ウェル領域30の端部からおよそ25%の領域であることを示している。
より望ましくは、図1(a)の構造の炭化珪素JBSダイオードの第1ウェル領域30の断面横方向端部から25%の幅の部分をショットキダイオードから広がる電流経路としてn型にしておく、すなわち、第2ウェル領域40の断面横方向の幅を第1ウェル領域30の3/4以下にすることにより、オン電流の大幅な低下を招かないようにすることができる。
さらに、本実施の形態の半導体装置である炭化珪素JBSダイオードは、オフ時にも第1ウェル領域30が完全には空乏化しないので、第1ウェル領域30間のドリフト層20に空乏層が広がりやすく耐圧が確保できる。
このように、平面構造は、図2に示したものに限るものではなく、上面から見て多角形や円の形状であってもよい。
また、ショットキ電極50としてTi、オーミック電極60は、Niの例を示して説明したが、ショットキ電極50、オーミック電極60の材料としてはこれらに限るものではなく、ショットキ電極50であれば、n型のドリフト層20とショットキ接続するMo、Ni等から適宜選択すればよい。また、オーミック電極60であれば、n型の半導体基板10とオーミック接続する金属であれば他の金属であってもよい。
また、上記では、オフ時に第1ウェル領域30から延びる空乏層が隣接する第1ウェル領域間のショットキ電極50に接するドリフト層20の表層部(ショットキ界面)を全て空乏化する例を説明したが、耐圧が高くない半導体装置においては、オフ時にショットキ界面が完全に空乏化する必要はなく、オフ時にショットキ界面が完全に空乏化しなくてもよい。
さらに、上記では、オフ時に第2ウェル領域40が完全に空乏化する例を説明したが、耐圧が高くない半導体装置においては、オフ時に第2ウェル領域40が完全に空乏化する必要はなく、オフ時に第2ウェル領域40が完全に空乏化しなくてもよい。
図12は、本実施の形態の半導体装置である炭化珪素JBSダイオードの断面模式図である。図12においては、実施の形態1の第2ウェル領域40の不純物濃度が一定であったのに対し、第2ウェル領域44が縦方向に3段階の不純物濃度階調の領域を有している。第2ウェル領域44の中では、不純物濃度は、深さが深いほど低濃度になるように第2ウェル領域44が形成されている。すなわち、第2ウェル領域44において、第1ウェル領域30に隣接した領域より半導体基板10に最近接した箇所でp型不純物濃度が低くなっている。その他の点については、実施の形態1と同様であるので詳しい説明を省略する。以下の動作説明においては、第1ウェル領域30の不純物濃度が2×1018cm−3で、第2ウェル領域44の不純物濃度が浅い方から順に、2×1018cm−3、2×1017cm−3、2×1016cm−3で、3つの領域(浅い方から順に44A、44B、44C)の厚さがそれぞれ2μmに設定されたものについて説明する。ここでは、第2ウェル領域44の平均不純物濃度が第1ウェル領域30不純物濃度より低くなっている。
図15は、本実施の形態の半導体装置である炭化珪素JBSダイオードの断面模式図である。図12においては、実施の形態1の第2ウェル領域40の幅が一定であったのに対し、第2ウェル領域45が縦方向に2段階の幅を有している。第2ウェル領域45の中で、深さが深いほど幅が小さくなるように第2ウェル領域45が形成されている。すなわち、第2ウェル領域44において、第1ウェル領域30に隣接した領域より半導体基板10に最近接した箇所で幅が狭くなっている。その他の点については、実施の形態1と同様であるので詳しい説明を省略する。以下の動作説明においては、第1ウェル領域30の不純物濃度が2×1018cm−3で、第2ウェル領域44の幅が浅い方から順に、3μm、1.5μmで、2つの領域(浅い方から順に45A、45B)の厚さがそれぞれ3μmに設定されたものについて説明する。
図18は、本実施の形態の半導体装置である炭化珪素JBSダイオードの断面模式図である。図18においては、実施の形態1のn型ドリフト層20の不純物濃度を均一にしていたのに対し、ドリフト層20の表層部でドリフト層20がショットキ電極50と接する領域にドリフト層20よりもn型の不純物濃度が高いn型の高濃度ドリフト領域80が形成されている。高濃度ドリフト領域80は、第2ウェル領域40よりも浅く形成されている。その他の点については実施の形態1で説明した炭化珪素JBSダイオードと同様であるので、詳しい説明を省略する。
また、図20にその断面模式図を示すように、高濃度ドリフト領域80を第1ウェル領域30が形成されていない領域の一部にのみ形成してもよい。
図4は、一般的な炭化珪素JBSダイオードおよび炭化珪素pnダイオードの断面構造を示す断面模式図であり、図4(a)は、炭化珪素JBSダイオードの断面図、図4(b)は、炭化珪素pnダイオードの断面図である。
より望ましくは、図1の構造の炭化珪素JBSダイオードの第1ウェル領域30の断面横方向端部から25%の幅の部分をショットキダイオードから広がる電流経路としてn型にしておく、すなわち、第2ウェル領域40の断面横方向の幅を第1ウェル領域30の3/4以下にすることにより、オン電流の大幅な低下を招かないようにすることができる。
図12は、本実施の形態の半導体装置である炭化珪素JBSダイオードの断面模式図である。図12においては、実施の形態1の第2ウェル領域40の不純物濃度が一定であったのに対し、第2ウェル領域44が縦方向に3段階の不純物濃度階調の領域を有している。第2ウェル領域44の中では、不純物濃度は、深さが深いほど低濃度になるように第2ウェル領域44が形成されている。すなわち、第2ウェル領域44において、第1ウェル領域30に隣接した領域より半導体基板10に最近接した箇所でp型不純物濃度が低くなっている。その他の点については、実施の形態1と同様であるので詳しい説明を省略する。以下の動作説明においては、第1ウェル領域30の不純物濃度が2×1018cm−3で、第2ウェル領域44の不純物濃度が浅い方から順に、2×1018cm−3、2×1017cm−3、2×1016cm−3で、3つの領域(浅い方から順に44A、44B、44C)の厚さがそれぞれ2μmに設定されたものについて説明する。ここでは、第2ウェル領域44の平均不純物濃度が第1ウェル領域30の不純物濃度より低くなっている。
図15は、本実施の形態の半導体装置である炭化珪素JBSダイオードの断面模式図である。図1においては、実施の形態1の第2ウェル領域40の幅が一定であったのに対し、第2ウェル領域45が縦方向に2段階の幅を有している。第2ウェル領域45の中で、深さが深いほど幅が小さくなるように第2ウェル領域45が形成されている。すなわち、第2ウェル領域45において、第1ウェル領域30に隣接した領域より半導体基板10に最近接した箇所で幅が狭くなっている。その他の点については、実施の形態1と同様であるので詳しい説明を省略する。以下の動作説明においては、第1ウェル領域30の不純物濃度が2×1018cm−3で、第2ウェル領域45の幅が浅い方から順に、3μm、1.5μmで、2つの領域(浅い方から順に45A、45B)の厚さがそれぞれ3μmに設定されたものについて説明する。
Claims (10)
- 第1導電型のワイドバンドギャップ半導体基板と、
前記ワイドバンドギャップ半導体基板の第1の主面に形成され、ワイドバンドギャップ半導体で構成された第1導電型のドリフト層と、
前記ドリフト層の表層部に、所定の間隔で互いに隣接して形成された、複数の第2導電型の第1ウェル領域と、
前記第1ウェル領域の前記半導体基板側に前記第1ウェル領域に隣接して、前記第1ウェル領域より低い第2導電型不純物濃度、前記第1ウェル領域より小さい幅で形成された第2ウェル領域と、
前記ドリフト層および前記第1不純物領域の表面上に形成され、前記ドリフト層とショットキ接続するショットキ電極と、
前記半導体基板の前記第1の主面の反対側の第2の主面に接して形成されたオーミック電極と
を備えることを特徴とする半導体装置。 - 半導体装置がオフ状態にあるとき、
前記第1ウェル領域に空乏化しない領域が残ることを特徴とする請求項1に記載の半導体装置。 - 前記半導体装置がオフ状態にあるとき、
前記第2ウェル領域が全て空乏化することを特徴とする請求項1に記載の半導体装置。 - 半導体装置がオフ状態にあるとき、隣り合う第1ウェル領域から延びる空乏層が前記第1ウェル領域間の前記ショットキ電極に接する前記ドリフト層の表層部を全て空乏化することを特徴とする請求項1乃至3のいずれか1項に記載の半導体装置。
- 前記第2ウェル領域の幅は、前記第1ウェル領域の3/4以下の値であることを特徴とする請求項1乃至4のいずれか1項に記載の半導体装置。
- 前記第2ウェル領域と前記半導体基板との間には、前記ドリフト層が設けられていることを特徴とする請求項1乃至4のいずれか1項に記載の半導体装置。
- 前記第2ウェル領域は、前記第1ウェル領域に隣接した領域より前記半導体基板に最近接した箇所で第2導電型不純物濃度が低いことを特徴とする請求項1乃至4のいずれか1項に記載の半導体装置。
- 前記第2ウェル領域は、前記第1ウェル領域に隣接した領域より前記半導体基板に最近接した箇所で幅が狭いことを特徴とする請求項1乃至4のいずれか1項に記載の半導体装置。
- 前記ドリフト層の表層部の前記ショットキ電極と接する位置に前記ドリフト層より第1導電型不純物の濃度が高い高濃度ドリフト領域が設けられていることを特徴とする請求項1乃至4のいずれか1項に記載の半導体装置。
- 前記ワイドバンドギャップ半導体基板は、炭化珪素半導体基板であり、前記ワイドバンドギャップ半導体は、炭化珪素半導体であることを特徴とする請求項1乃至9のいずれか1項に記載の半導体装置。
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