JPWO2004055773A1 - 表示装置及びその駆動方法 - Google Patents

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Abstract

本発明は、画素をスイッチング素子と、発光素子で形成し、１列の画素に対して複数のソース信号線を設け、スイッチング素子の入力端子を複数のソース信号線のいずれかに接続し、スイッチング素子の出力端子を発光素子に接続することによって、スイッチング素子がオンしたときに発光が可能になる。同時に複数行の画素を発光させることによって、発光時間を長くすることができ、それによって素子の寿命を長くし、消費電力を下げることができる。

Description

本発明は、表示装置に関し、特にエレクトロルミネセンス（Ｅｌｅｃｔｒｏ Ｌｕｍｉｎｅｓｃｅｎｃｅ；以下、ＥＬと略記する。）素子を発光媒体として用いた表示装置に関する。
近年、通信技術の進歩に伴って、携帯電話機が普及している。今後は更に動画の伝送やより多くの情報伝達が予想される。一方、パーソナルコンピュータもその軽量化によって、モバイル対応の製品が生産されている。電子手帳に始まったＰＤＡと呼ばれる情報端末も多数生産され普及しつつある。また、表示装置の発展により、それらの携帯情報機器のほとんどにはフラットパネルディスプレイが装備されている。
また、フラットパネルディスプレイの中でも、近年では、低温で結晶化した多結晶半導体を用いた薄膜トランジスタ（以下薄膜トランジスタをＴＦＴと表記する）を有する表示装置の製品化が進められている。上記低温とは、結晶化温度が６００℃以下であり、従来の結晶化温度１０００℃以上と比較すると低温であるという意味である。低温で結晶化した多結晶半導体を用いたＴＦＴは画素だけでなく、画素部の周囲に信号線駆動回路を一体形成することが可能であるため、表示装置の小型化や、高精細化が可能であり、今後はさらに普及が見込まれる。
低温で結晶化した多結晶半導体を用いたＴＦＴを有する表示装置では、液晶表示装置のほかに、発光素子特に有機ＥＬ素子を用いた表示装置が開発されている。
一方、有機ＥＬ素子を用いた表示装置としては、パッシブマトリクス駆動の表示装置が開発され、携帯電話機、カーステレオなどの表示装置として、生産されている。
図２に、従来のパッシブマトリクス駆動の表示装置の概略を示す。図２で示す表示装置はガラス等の基板２０１の中央に画素部が配置されている。画素部は、発光素子、カラム信号線、ロウ信号線が配置されている。基板２０１の上側には、カラム信号線を制御するための、カラム信号線駆動回路２０２が、基板２０１の左には、ロウ信号線を制御するための、ロウ信号線駆動回路２０３が配置されている。さらに、カラム信号線駆動回路２０２とロウ信号線線駆動回路２０３を制御するために、コントローラ２４０が配置されている。なお、カラム信号線駆動回路２０２およびロウ信号線駆動回路２０３はＬＳＩチップによって構成され、ＦＰＣ（Ｆｌｅｘｉｂｌｅ Ｐｒｉｎｔｅｄ Ｃｉｒｃｕｉｔ）によって基板２０１に接続されている（例えば、特許文献１参照）。
特開平９−２３２０７４号公報
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次に図２を参照して、パッシブマトリクス型表示装置の動作について説明する。まず、第１行目のロウ信号線２２０が選択される。ここで選択されることは、スイッチ２１２がＧＮＤに接続されることである。次にカラムドライバーのスイッチ２０８〜２１１がオンとなる。スイッチ２０８〜２１１は片側が定電流源２０４〜２０７に、反対側がカラム信号線２１６〜２１９に接続されている。スイッチ２０８〜２１１がオンになると、定電流源２０４〜２０７から出力された電流はスイッチ２０８〜２１１、カラム信号線２１６〜２１９を介して、発光素子２２４〜２２７に流れる。そして電流は、発光素子２２４〜２２７を通過したのちロウ信号線２２０を介して、スイッチ２１２を通ってＧＮＤに流れる。このように発光素子２２４〜２２７に電流が流れることによって、発光素子は発光を行う。また、スイッチ２０８〜２１１がオンになっている時間はスイッチごとに異なり、スイッチがオンになっている時間によって表示装置は階調表示をおこなう。スイッチ２０８〜２１１が全てオフになった後にロウ信号線駆動回路のスイッチ２１２はＶＣＣ接続になり、次にスイッチ２１３がＧＮＤ接続になり、上記を繰り返していく。ロウ信号線駆動回路のスイッチがＶＣＣ接続になっている場合には、その行の発光素子に逆バイアスが加わるので、電流が流れる事はなく、発光することはない。
発光素子２２４〜２３９の輝度、つまり発光素子２２４〜２３９を流れる電流量は、カラム信号線駆動回路の定電流源２０４〜２０７の電流値、およびスイッチ２０８〜２１１のオンになっている時間によって制御出来る。図３に示すのはカラム信号線駆動回路の例である。まず、内蔵した定電圧源３０１にて、一定の電圧を発生させる。定電圧源としては、公知のバンドギャップレギュレータなどがよく使用され、温度係数の小さな電源が使用される。この定電圧をオペアンプ３０２、トランジスタ３０３および抵抗３０４によって、電流に変換し、温度係数が小さな定電流を作ることが可能になる。その電流をトランジスタ３０５〜３０９、抵抗３１４〜３１８によって構成されるカレントミラー回路で反転、且つ複数に複写しスイッチ３１０〜３１３を介してカラム信号線に供給する。
次に、発光素子の階調表示の方式について述べる。図２に示したカラム信号線駆動回路において、スイッチ２０８〜２１１のオン時間が１通りのみであると、この表示装置の階調は２通りのみである。この表示装置での階調の表現法について、図４を参照して説明する。
図４は時間階調方式のタイミングチャートを簡単に示している。フレーム周波数を６０Ｈｚとし、時間階調方式によって３ビットの階調を得る例である。フレーム周波数が６０Ｈｚの場合、１フレーム期間は１６．６ｍｓとなる。この期間を垂直方向の画素数で割った値がほぼ１水平ライン期間４０１となる。例えば垂直方向の画素数が２２０個とすると、１水平ライン期間は７５μｓとなる。上述した方式では、この水平ライン期間のうちの９０％が映像期間（映像信号が存在する期間）とすると、映像期間は６８μｓとなる。この期間を３ビットすなわち８階調で表示を行なう場合には、図４に示すように、階調に比例してスイッチがオンしている時間、すなわち点灯期間４０２を設定すればよい。図４において、４０３で示す期間は非点灯期間で、４０４で示す期間は帰線期間である。
時間階調方式においては、以上のようにして階調表現を行う。もちろん、カラー表示装置においても、同様の階調表現が可能である。
また、アクティブマトリクス駆動の表示装置としては、図５に示すようなものがある。図５のアクティブマトリクス型表示装置の画素は、スイッチ用ＴＦＴ５０８〜５１１、ＥＬ駆動用ＴＦＴ５１２〜５１５、保持容量５１６〜５１９、ＥＬ素子５２０〜５２３よりなっている。以下にその動作を説明する。
ソース信号線駆動回路５０１に接続されたソース信号線５０３、５０４より供給される映像信号は、ゲート信号線駆動回路５０２に接続されたゲート信号線５０５がハイになるとスイッチ用ＴＦＴ５０８、５１０がオンするため、保持容量５１６、５１８およびＥＬ駆動用ＴＦＴ５１２、５１４のゲートに入力される。そして、その電圧値に応じた電流を駆動用ＴＦＴ５１２、５１４は電源線５０７からＥＬ素子５２０、５２２に流す。ここで、駆動用ＴＦＴ５１２、５１４は電圧電流変換素子としての役割を示す。ゲート信号線５０５がロウになると、スイッチ用ＴＦＴ５０８、５１０はオフになるが、保持容量５１６、５１８には電荷が保持されているので、ＥＬ駆動用ＴＦＴ５１２、５１４は同じ状態を保ち、ＥＬ素子５２０、５２２に電流を流し続ける。このように、アクティブマトリクスでは、画素がメモリ性を持つため、次の書き込みが行われるまで、同じ状態の発光は続けることができる。
同様にゲート信号線５０６がハイになるとスイッチ用ＴＦＴ５０９、５１１がオンし、ソース信号線の映像信号をＥＬ駆動用ＴＦＴ５１３、５１５のゲートおよび保持容量５１７、５１９に書きこみ、ＥＬ駆動用ＴＦＴ５１３、５１５はＥＬ素子５２１、５２３に電流を流し、ＥＬ素子５２１、５２３は発光する。（以上の説明は、例えば、特許文献２に開示されている。）
特開２００２−１０８２８５号公報
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また、アクティブマトリクス型表示装置では図６に示すようなカレントミラー回路を使用した表示装置も開発されている。この表示装置はＴＦＴ６０９と６１０、ＴＦＴ６１１と６１２、ＴＦＴ６１３と６１４、ＴＦＴ６１５と６１６によってカレントミラー回路を画素内部に設けている。ソース信号線駆動回路６０１より、輝度信号を電圧でなく電流でソース信号線６０３、６０４に供給し、ゲート信号線駆動回路６０２によって、ゲート信号線６０５、６０６が制御される。スイッチ６２１〜６２８がオンすると、カレントミラー回路が動作し、ソース信号線駆動回路の出力電流に比例した電流がＥＬ素子６２９〜６３２に流れる。ゲート信号線駆動回路がスイッチをオフさせても、容量６１７〜６２０に電荷が蓄積されていれば、ＴＦＴ６１０、６１２、６１４、６１６は動作し、電流をＥＬ素子６２９〜６３２に流し続ける（例えば、特許文献３参照）。
特開２００１−１４７６５９
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前述したような従来の有機ＥＬ表示装置には以下に示すような課題があった。まずパッシブマトリクス型有機ＥＬ表示装置には、画素数をあまり大きくできないという問題点があった。パッシブマトリクス型ＥＬ表示装置は、画素に保持機能がなく、瞬間的な発光しかできないため、発光期間は１フレーム期間をカラム線の数で割った値になり、画素数が増えると必然的にカラム線の数も増加し、発光期間は短いものになっていた。通常１フレームはフリッカの問題から１６．６ｍｓ程度であり、画素が１７６ｘＲＧＢｘ２２０の場合、１ラインの点灯時間は７５μｓとなる。このように発光期間が短く、且つ点灯輝度が高い場合、画素の有機ＥＬ素子には大電流を流さねばならず、これは、有機ＥＬ素子の寿命を短縮させ、また、順方向電圧の上昇による消費電力の増大といった不具合をまねいていた。実用的なパッシブマトリクスの点灯時間は２５０μｓ以上に設定する場合が多く、このため、パッシブマトリクス型ＥＬ表示装置では画素数を増やすことは困難であった。
一方、図５に示すようなアクティブマトリクス型の有機ＥＬ表示装置では、画素にメモリ機能があるため、画素の有機ＥＬ素子は、１フレーム期間にわたって、点灯することが可能であり、パッシブマトリクス型のような問題は生じない。しかし、前述したアクティブ型では容量に保持した電圧を画素内部のＴＦＴによって、電流に変換するため、その電流がＴＦＴの特性ばらつきの影響を受ける。低温ポリシリコンＴＦＴは線状レーザー光を用いて結晶を作るため、そのばらつきによって縞状にＴＦＴ特性がばらつく。このため、縞状に輝度むらが発生するという問題点があった。
図６に示すようなカレントミラー回路を使用した表示装置ではカレントミラーのペアＴＦＴ６０９、６１０の特性がそろっていれば、前述した輝度ムラをなくすことができる。また、ＴＦＴ６０９、６１０はＴＦＴサイズを大きくすることによって、より特性をそろえることが可能になる。しかし、このような表示装置では画素内のＴＦＴ面積が増大し、開口率が低下するために小さな画素には適応できないという課題があった。
以上のような問題を解決するため、本発明者は１つ又はそれ以上の薄膜トランジスタと、発光素子とで画素を構成し、同時に複数の行の画素を点灯するものとする。このようにすることによって、従来の表示装置で課題であった、発光期間が短くなるという問題、画素ＴＦＴのばらつきによる表示ムラの問題、開口率の低下の問題を解消することが可能になる。
本発明の要旨の一つは、基板上にスイッチング素子および発光素子よりなる複数の画素がマトリクス状に配置された表示装置であって、１列の画素列に対し複数のソース信号線が配置され、１行の画素列に対し１本のゲート信号線が配置され、前記スイッチング素子は入力端子、出力端子、制御端子を有し、前記入力端子は前記複数のソース信号線のいずれかに電気的に接続され、前記出力端子は前記発光素子に電気的に接続され、前記制御端子は前記ゲート信号線に電気的に接続されているものである。前記スイッチング素子は、１つの薄膜トランジスタで構成することができる。また前記スイッチング素子は、マルチゲートの薄膜トランジスタ、例えばダブルゲート又はトリプルゲートの薄膜トランジスタで構成することもできる。さらに、前記発光素子としてＥＬ素子を用いることができる。
本発明の要旨の一つは、基板上にスイッチング素子および発光素子よりなる複数の画素がマトリクス状に配置された表示装置であって、１列の画素列に対し複数のソース信号線が配置され、１行の画素列に対し１本のゲート信号線が配置され、前記スイッチング素子は入力端子、出力端子、制御端子を有し、前記入力端子は前記複数のソース信号線のいずれかに電気的に接続され、前記出力端子は前記発光素子に電気的に接続され、前記制御端子は前記ゲート信号線に電気的に接続され、前記複数のソース信号線の少なくとも１つに電気的に接続されたソース信号線駆動回路を複数有するものである。前記ソース信号線駆動回路は電流出力型のソース信号線駆動回路であって、また、薄膜トランジスタで形成されていても良い。前記ソース信号線駆動回路は前記スイッチング素子と同一基板上に形成することができる。前記ソース信号線駆動回路は半導体チップを実装したものであっても良い。複数の前記ソース信号線駆動回路は前記複数の画素が配置された領域の両側（当該領域の上下又は左右）に分けて配置されていても良い。さらに、前記ソース信号線駆動回路は、前記複数のソース信号線のいずれか１つを駆動するものである。前記スイッチング素子は、１つの薄膜トランジスタで構成することができる。また、前記スイッチング素子は、マルチゲートの薄膜トランジスタ、例えばダブルゲート又はトリプルゲートの薄膜トランジスタで構成することもできる。さらに、前記発光素子としてＥＬ素子を用いることができる。
本発明の要旨の一つは、基板上にスイッチング素子および発光素子よりなる複数の画素がマトリクス状に配置された表示装置であって、１列の画素列に対し複数のソース信号線が配置され、１行の画素列に対し１本のゲート信号線が配置され、前記スイッチング素子は入力端子、出力端子、制御端子を有し、前記入力端子は前記複数のソース信号線のいずれかに電気的に接続され、前記出力端子は前記発光素子に電気的に接続され、前記制御端子は前記ゲート信号線に電気的に接続され、前記ゲート信号線を同時に複数本駆動させる１つのゲート信号線駆動回路を有するものである。前記ゲート信号線駆動回路は薄膜トランジスタで構成することができる。前記ゲート信号線駆動回路は前記スイッチング素子と同一基板上に形成することができる。前記ゲート信号線駆動回路は半導体チップを実装したものであっても良い。前記スイッチング素子は、１つの薄膜トランジスタで構成することができる。また前記スイッチング素子は、マルチゲートの薄膜トランジスタ、例えばダブルゲート又はトリプルゲートの薄膜トランジスタで構成することもできる。さらに、前記発光素子としてＥＬ素子を用いることができる。
上記した本発明において、前記ソース信号線駆動回路または前記ゲート信号線駆動回路は単一の極性のトランジスタによって構成することができる。
本発明の要旨の一つは、基板上にスイッチング素子および発光素子よりなる画素がマトリクス状に配置され、１列の画素列に対し複数のソース信号線が配置され、１行の画素列に対し１本のゲート信号線が配置され、前記スイッチング素子は入力端子、出力端子、制御端子を有し、前記入力端子は前記複数のソース信号線のいずれかに電気的に接続され、前記出力端子は前記発光素子に電気的に接続され、前記制御端子は前記ゲート信号線に電気的に接続された表示装置の駆動方法であって、前記ゲート信号線を同時に複数本駆動させて複数の前記スイッチング素子をオン状態にすることにより、前記複数のソース信号線のいずれかの信号を前記発光素子に入力し、前記発光素子を駆動させる方法である。この発光装置の駆動方法において、スイッチング素子は１つの薄膜トランジスタ、または、マルチゲートの薄膜トランジスタで構成したものを適用することができる。
第１図は、本発明の実施形態を示す図である。
第２図は、従来のパッシブマトリクス型ＥＬ表示装置を示す図である。
第３図は、従来の電流源回路を示す図である。
第４図は、従来のパッシブマトリクス型ＥＬ表示装置の階調を示す図である。
第５図は、従来のアクティブマトリクス型ＥＬ表示装置の画素を示す図である。
第６図は、カレントミラーを用いた従来のアクティブマトリクス型ＥＬ表示装置の画素を示す図である。
第７図は、本発明の画素とソース信号線駆動回路を示す図である。
第８図は、本発明のソース信号線駆動回路のブロック図である。
第９図は、本発明のソース信号線駆動回路のブロック図である。
第１０図は、本発明の定電流源のブロック図である。
第１１図は、本発明のアナログ映像信号を用いたソース信号線駆動回路を示す図である。
第１２図は、本発明のアナログ映像信号を用いたソース信号線駆動回路を示す図である。
第１３図は、本発明のスイッチング素子を一つのＴＦＴで構成した実施例を示す図である。
第１４図は、本発明のスイッチング素子を複数のＴＦＴで構成した実施例を示す図である。
第１５図は、本発明の画素の平面図である。
第１６図は、本発明のゲート信号線を接続した実施例を示す図である。
第１７図は、本発明の単極性のＴＦＴを用いた信号線駆動回路の実施例である。
第１８図は、本発明の表示装置を用いた電子機器の図である。
第１９図は、本発明の信号線駆動回路を画素部の両側に設置した実施例を示す図である。
以下、本発明の実施形態を図面を用いて説明する。
図１に本発明の表示装置の概略図を示す。図１において、１つの画素は１つのスイッチング素子と１つの発光素子によって構成されている。１列の画素に対して４本のソース信号線が配置され、１行の画素に対して１本のゲート信号線が配置されている。本実施形態では１列の画素に対して配置されたソース信号線は４本であるが４本には限定されない。
ソース信号線駆動回路１０１に接続されたソース信号線１０３〜１１０はスイッチング素子の入力端子に接続され、発光素子の一方の電極はスイッチング素子の出力端子に接続され、ゲート信号線駆動回路１０２に接続されたゲート信号線はスイッチング素子の制御端子に接続される。使用するソース信号線駆動回路１０１は図３に示したようなソース信号線に電流を出力するタイプのものであることが望ましいが限定はされない。ソース信号線駆動回路１０１から電流が出力され、ゲート信号線１１１〜１１４がハイ（アクティブ）になると、スイッチング素子１１９〜１２２、１２７〜１３０がオンし、スイッチング素子を通して発光素子１３５〜１３８、１４３〜１４６、そして共通のカソードに電流が流れ、発光素子１３５〜１３８、１４３〜１４６は発光する。
次に、ゲート信号線１１１〜１１４がロウになるとスイッチング素子１１９〜１２２、１２７〜１３０がオフになる。続いて、ゲート信号線１１５〜１１８がハイになると、スイッチング素子１２３〜１２６、１３１〜１３４がオンし、発光素子１３９〜１４２、１４７〜１５０に電流がながれ、発光する。これを繰り返すことによって画面全体が発光する。
階調を表現する場合には図４で示したのと同じように、ソース信号線に流れる電流を制御することによって、表現ができる。
このとき、従来のパッシブマトリクス型ＥＬ表示装置と異なるのは、本発明では複数のゲート信号線１１１〜１１４を同時にオンさせていることである。図１では、ソース信号線は縦１列に対して４本あり、４本のゲート信号線をオンさせることができる。
これによって、従来のパッシブマトリクス型ＥＬ表示装置では、画素数を１７６ｘＲＧＢｘ２２０とした場合、１ラインの点灯期間が約７５μｓであったのに対し、本発明では同時に４ラインが点灯できるため、３００μｓ期間点灯が可能になる。これによって、画素数の多くないパッシブマトリクス型ＥＬ表示装置と同様の信頼性が確保できる。
ソース信号線駆動回路、ゲート信号線駆動回路はスイッチング素子と同様に基板上に同時形成しても良いし、また、スイッチング素子とは別にドライバ回路を作製し、画素基板に貼り付けてもよい。ドライバ回路は単結晶シリコンでも良いし、ポリシリコンなど非単結晶を用いても良い。
また、各画素にあるスイッチング素子は電流のオンオフを制御するだけであり、電圧電流変換を行わないので、スイッチング素子のばらつきによって輝度ムラを発生させることはない。また、スイッチング素子のオフ電流によって、電荷が放電してしまうということもない。よって、従来のアクティブマトリクス型ＥＬ表示装置のように、レーザー結晶化のばらつきによって、画質を低下させることはない。また、１つの画素にあるスイッチング素子は１つであり、複雑な回路を画素内に入れる必要はない。また、ばらつき低減のため、スイッチング素子サイズを大きくしなければならないということはない。したがって、開口率の低下は発生せず、且つ小さな画素でも対応できるという利点がある。
以上に説明したように、本発明では、パッシブマトリクス型ＥＬ表示装置のように、ＥＬ素子の点灯期間が非常に短くなるという問題や、従来のアクティブ型ＥＬ発光装置のように、素子のばらつきによって、縞状の輝度ムラが発生するという問題、開口率が低下するという問題を解決することが可能である。
図１３に本発明の表示装置の概略図を示す。図１３において、１つの画素は１つのＴＦＴと１つの発光素子によって構成されている。ソース信号線駆動回路１３０１に接続されたソース信号線は、ＴＦＴのソース電極またはドレイン電極のいずれか一方に接続され、発光素子の一方の電極は、ＴＦＴのソース電極またはドレイン電極の他方に接続され、ゲート信号線駆動回路１３０２に接続されたゲート信号線はＴＦＴのゲート電極に接続される。使用するソース信号線駆動回路１３０１は、図３に示したようなソース信号線に電流を出力するタイプのものであることが望ましいが、限定はされない。
ソース信号線駆動回路１３０１から、ソース信号線１３０３〜１３１０に電流が出力され、ゲート信号線１３１１〜１３１４がハイ（画素ＴＦＴがＮチャネル型の場合）になると、ＴＦＴ１３１９〜１３２２、１３２７〜１３３０に電流が流れ、ＴＦＴを通してＥＬ素子１３３５〜１３３８、１３４３〜１３４６、そして共通のカソードに電流が流れ、ＥＬ素子１３３５〜１３３８、１３４３〜１３４６は発光する。
次に、ゲート信号線１３１１〜１３１４がロウ（画素ＴＦＴがＮチャネル型の場合）になるとＴＦＴ１３１９〜１３２２、１３２７〜１３３０がオフになる。続いて、ゲート信号線１３１５〜１３１８がハイになると、ＴＦＴ１３２３〜１３２６、１３３１〜１３３４がオンし、ＥＬ素子１３３９〜１３４２、１３４７〜１３５０に電流が流れ、発光する。これを繰り返すことによって画面全体が発光する。以上、画素ＴＦＴがＮチャネル型の場合を述べたが、画素がＰチャネル型の場合はゲート信号線の電位は逆となる。
ソース信号線駆動回路１３０１、ゲート信号線駆動回路１３０２は画素ＴＦＴと同様に基板上に同時形成しても良いし、また、画素ＴＦＴとは別に、ドライバ回路を作製し、画素基板に貼り付けてもよい。ドライバ回路は単結晶シリコンでも良いし、ポリシリコンなど非単結晶を用いても良い。
階調を表現する場合には図４で示したのと同じように、ソース信号線に流れる電流を制御することによって、表現ができる。
図１４に示すのはスイッチング素子をダブルゲートのＴＦＴで構成した例である。このようにスイッチング素子を構成するＴＦＴを複数にすることによって、スイッチング素子のリークが大きい場合でも、発光装置の歩留まり低下を抑えることができる。本実施例ではスイッチング素子をダブルゲートＴＦＴとしたが、本発明はこれに限らず、マルチゲートＴＦＴ、例えばトリプルゲートＴＦＴであってもかまわないし、その他の構成であっても良い。
ソース信号線駆動回路１４０１から、ソース信号線１４０３〜１４１０に電流が出力され、ゲート信号線１４１１〜１４１４がハイ（画素ＴＦＴがＮチャネル型の場合）になると、ＴＦＴ１４１９〜１４２２、１４２７〜１４３０に電流が流れ、ＴＦＴを通してＥＬ素子１４３５〜１４３８、１４４３〜１４４６、そして共通のカソードに電流が流れ、ＥＬ素子１４３５〜１４３８、１４４３〜１４４６は発光する。
次に、ゲート信号線１４１１〜１４１４がロウ（画素ＴＦＴがＮチャネル型の場合）になるとＴＦＴ１４１９〜１４２２、１４２７〜１４３０がオフになる。続いて、ゲート信号線１４１５〜１４１８がハイになると、ＴＦＴ１４２３〜１４２６、１４３１〜１４３４がオンし、ＥＬ素子１４３９〜１４４２、１４４７〜１４５０に電流がながれ、発光する。これを繰り返すことによって画面全体が発光する。以上、画素ＴＦＴがＮチャネル型の場合を述べたが、画素がＰチャネル型の場合はゲート信号線の電位は逆となる。
ソース信号線駆動回路１４０１、ゲート信号線駆動回路１４０２は画素ＴＦＴと同様に基板上に同時形成しても良いし、また、画素ＴＦＴとは別にドライバ回路を作製し、画素基板に貼り付けてもよい。ドライバ回路は単結晶シリコンでも良いし、ポリシリコンなど非単結晶を用いても良い。
階調を表現する場合には図４で示したのと同じように、ソース信号線に流れる電流を制御することによって、表現ができる。
本実施例で示すスイッチング素子は、本明細書の他の実施例にも適用できる。
図１６に、ゲート信号線の同時駆動のタイミングを、前述した実施形態及び実施例１及び実施例２と変えた例を示す。本実施例では、ゲート信号線駆動回路１６０２と各ゲート信号線の接続関係は前述した実施形態及び実施例１及び実施例２と異なっている。
ソース信号線駆動回路１６０１から、ソース信号線１６０３〜１６１０に電流が出力され、ゲート信号線１６１１、１６１３、１６１５、１６１７がハイ（画素ＴＦＴがＮチャネル型の場合）になると、ＴＦＴ１６１９、１６２１、１６２３、１６２５、１６２７、１６２９、１６３１、１６３３に電流が流れ、ＴＦＴを通してＥＬ素子１６３５、１６３７、１６３９、１６４１、１６４３、１６４５、１６４７、１６４９、そして共通のカソードに電流が流れ、ＥＬ素子１６３５、１６３７、１６３９、１６４１、１６４３、１６４５、１６４７、１６４９は発光する。
次に、ゲート信号線１６１１、１６１３、１６１５、１６１７がロウ（画素ＴＦＴがＮチャネル型の場合）になるとＴＦＴ１６１９、１６２１、１６２３、１６２５、１６２７、１６２９、１６３１、１６３３がオフになる。続いて、ゲート信号線１６１２、１６１４、１６１６、１６１８がハイになると、ＴＦＴ１６２０、１６２２、１６２４、１６２６、１６２８、１６３０、１６３２、１６３４がオンし、ＥＬ素子１６３６、１６３８、１６４０、１６４２、１６４４、１６４６、１６４８、１６５０に電流がながれ、発光する。これを繰り返すことによって画面全体が発光する。以上、画素ＴＦＴがＮチャネル型の場合を述べたが、画素がＰチャネル型の場合はゲート信号線の電位は逆となる。
ソース信号線駆動回路１６０１、ゲート信号線駆動回路１６０２は画素ＴＦＴと同様に基板上に同時形成しても良いし、また、画素ＴＦＴとは別に、ドライバ回路を作製し、画素基板に貼り付けてもよい。ドライバ回路は単結晶シリコンでも良いし、ポリシリコンなど非単結晶を用いても良い。
階調を表現する場合には図４で示したのと同じように、ソース信号線に流れる電流を制御することによって表現ができる。本発明では、上記の説明に限らず、同様に他の組み合わせで同時駆動を行うことも可能であり、どのゲート信号線を同時駆動するかを任意に設定することが可能である。
図７に本発明のソース信号線駆動回路を示す。図７に示すように、本実施例では画素１列に対して、ソース信号線ごとにソース信号線駆動回路７０１〜７０４を設けることが可能である。図７において、７０６〜７１３はソース信号線を示し、７０５はゲート信号線駆動回路を示す。図８は個々のソース信号線駆動回路（たとえば７０１）の構成内容を示したものである。図４に示したような駆動を行うことに対応している。図４は３ビットの例であるので、図８に示す実施例も３ビットに対応しているが、３ビットに限定するものではない。以下にその動作を説明する。
まず、映像信号線８２８に入力されたデジタル映像信号はシフトレジスタ８０１の出力パルスによってラッチ回路８０２〜８０４、８１５〜８１７に記憶される。１ライン分のデータが記憶されると水平帰線期間中にラッチ信号線８３０がハイになり、ラッチ回路８０５〜８０７、８１８〜８２０にデータが転送される。次の映像期間においては、再びラッチ回路８０２〜８０４、８１５〜８１７にデジタル映像信号が記憶される。
一方、ラッチ回路８０５〜８０７、８１８〜８２０に蓄えられたデータと、カウント信号線８２９より入力されるデータはＥＸＮＯＲ８０８〜８１０、８２１〜８２３によって比較される。ＥＸＮＯＲの出力はＡＮＤ８１１、８２４に入力されすべてがハイになったときラッチ回路８１２、８２５の状態が変化する。この状態変化に応じてスイッチ８１４、８２７が開閉し、定電流源８１３、８２６の電流をソース信号線８３１、８３２に流すか、流さないかを制御する。
カウント信号線には０００〜１１１までの信号が順に出力され、ラッチ回路８０５〜８０７のデータがそれぞれ１、０、１であればカウント信号が１０１のときにラッチ回路８１２が動作し、スイッチが閉じる。よって、カウント信号が０００〜１０１の期間は電流がソース信号線に流れ、点灯が行われる。このように、デジタル映像信号のデータによって、ソース信号線に電流に流れる期間が制御され、階調を表現することができる。
本実施例に示すソース信号線駆動回路は、本明細書の他の実施例にも適用できる。
図９は階調をビットごとのオンオフで表現する場合のソース信号線駆動回路の実施例である。このような場合は、映像信号は特定のビットデータしか、入力されないので、ソース信号線駆動回路は簡略化できる。以下にその動作を説明する。映像信号線９１０に入力されたデジタル映像信号はシフトレジスタ９０１の出力パルスによって、ラッチ回路９０２、９０６に記憶される。次にラッチ信号線９１１がハイになるとラッチ回路９０３、９０７に転送される。そして、次のデジタル映像信号がラッチ回路９０２、９０６に記憶される。ラッチ回路９０３、９０７の出力によってスイッチ９０５、９０９が制御され、定電流源９０４、９０８の電流がソース信号線９１２、９１３に流れるか、流れないかが決まる。このようにして、画素を発光させることが可能になる。
図１０に定電流源の実施例を示す。定電流源の従来例は図３で示したものであるが、カレントミラー回路を多く使用するため、誤差が発生しやすい。よってその対策を行ったものを示す。図１０の定電流回路はソース信号線駆動回路の外部、または内部に基準電流源１００２を設け、その電流をＴＦＴ１００４〜１００６に順に流し、そのときのＴＦＴ１００４〜１００６のゲート・ソース間電圧を保持容量１００７〜１００９に記憶しておくことによって、定電流源１００２と同じ電流を出力端子１０１６〜１０１８に流すものである。
以下にその動作を説明する。シフトレジスタ１００１は出力パルスを順次シフトしていく。まずシフトパルスがスイッチ１０１０、１０１１に加えられ、スイッチ１０１０、１０１１がオンすると電源線１００３よりＴＦＴ１００４、スイッチ１０１１、１０１０を介して、定電流源１００２に電流が流れる。シフトレジスタの出力パルスがスイッチ１０１２、１０１３に加わると、同様に電源線１００３よりＴＦＴ１００５、スイッチ１０１３、１０１２を介して、定電流源１００２に電流が流れる。そのとき、スイッチ１０１０、１０１１はすでにオフしているが、容量１００７には電荷が蓄えられているので、ＴＦＴ１００４はオンしたままであり、電源線１００３から出力端子１０１６に電流が流れる。
シフトレジスタの出力パルスがスイッチ１０１４、１０１５に加わると、同様に電源線１００３よりＴＦＴ１００６、スイッチ１０１５、１０１４を介して、定電流源１００２に電流が流れる。そのとき、スイッチ１０１０、１０１１、１０１２、１０１３はすでにオフしているが、容量１００７、１００８には電荷が蓄えられているので、ＴＦＴ１００４、１００５はオンしたままであり、電源線１００３から出力端子１０１６、１０１７に電流が流れる。このようにして、基準定電流源１００２を基にして、ソース信号線を駆動する電流源を構成することができる。この電流源は容量に蓄えられる電荷が保持できれば、原理的にＴＦＴ１００４〜１００６の素子ばらつきの影響を受けることがないので、ばらつきの少ない電流源を構成することができる。
図１１に本発明のソース信号線駆動回路の実施例を示す。図１１はアナログ映像信号（電圧）を入力し、それに応じた電流をソース信号線に出力するソース信号線駆動回路である。
まず第１行目に対応するアナログ映像信号をアナログ映像信号線１１２４に入力する。シフトレジスタ１１０１の出力パルスによって、スイッチ１１０３、１１１０、１１１７をオンオフし、アナログ映像信号をサンプリングして、容量１１０４、１１１１、１１１８に保持する。この電圧がＴＦＴ１１０５、１１１２、１１１９のゲート・ソース間電圧となる。１行目のサンプリングが終了するまで、スイッチ１１０９、１１１６、１１２３はＴＦＴ１１０８、１１１５、１１２２とそれに応じたソース信号線１１２８、１１２９、１１３０を接続し、ＴＦＴ１１０５、１１１２、１１１９とソース信号線は接続されない。よって、ＴＦＴ１１０５、１１１２、１１１９のゲート・ソース間に電圧が印加されても、電流は流れない。サンプリングが終了したのち、スイッチ１１０９、１１１６、１１２３を切り換え、ＴＦＴ１１０５、１１１２、１１１９とソース信号線は接続される。このようにして、ソース信号線にアナログ映像信号に応じた電流が出力される。
次に第２行目に対応するアナログ映像信号をアナログ映像信号線１１２６に入力する。シフトレジスタ１１０２の出力パルスによって、スイッチ１１０６、１１１３、１１２０をオンオフし、アナログ映像信号をサンプリングして、容量１１０７、１１１４、１１２１に保持する。この電圧がＴＦＴ１１０８、１１１５、１１２２のゲート・ソース間電圧となる。２行目のサンプリングが終了するまで、スイッチ１１０９、１１１６、１１２３はＴＦＴ１１０５、１１１２、１１１９とそれに応じたソース信号線を接続し、ＴＦＴ１１０８、１１１５、１１２２とソース信号線は接続されない。よって、ＴＦＴ１１０８、１１１５、１１２２のゲート・ソース間に電圧が印加されても、電流は流れない。サンプリングが終了したのち、スイッチ１１０９、１１１６、１１２３を切り換え、ＴＦＴ１１０８、１１１５、１１２２とソース信号線は接続される。このようにして、ソース信号線にアナログ映像信号に応じた電流が出力される。
次に第３行目に対応するアナログ映像信号をアナログ映像信号線１１２４に入力する。シフトレジスタ１１０１の出力パルスによって、アナログ映像信号をサンプリングしていく。これを繰り返すことによって、アナログ映像信号に応じた電流をソース信号線に出力していく。
図１１において、１１２５及び１１２７はそれぞれ電源線を示す。
図１２に本発明のソース信号線駆動回路の実施例を示す。図１２はアナログ映像信号（電流）を入力し、それに応じた電流をソース信号線に出力するソース信号線駆動回路である。
まず第１行目に対応するアナログ映像信号をアナログ電流源１２０１から入力する。シフトレジスタ１２０３の出力パルスによって、スイッチ１２１０〜１２１５をオンオフし、アナログ電流映像信号をサンプリングして、ＴＦＴ１２０４〜１２０６のゲート・ソース間に必要な電圧を発生させる。そして容量１２０７〜１２０９に保持する。１行目のサンプリングが終了するまで、スイッチ１２２９〜１２３１はＴＦＴ１２１７〜１２１９とそれに応じたソース信号線を接続し、ＴＦＴ１２０４〜１２０６とソース線は接続されない。よって、ＴＦＴ１２０４〜１２０６のゲート・ソース間に電圧が印加されても、電流は流れない。サンプリングが終了したのち、スイッチ１２２９〜１２３１を切り換え、ＴＦＴ１２０４〜１２０６とソース信号線は接続される。このようにして、ソース信号線にアナログ映像信号に応じた電流が出力される。
次に第２行目に対応するアナログ映像信号をアナログ電流源１２０２から入力する。シフトレジスタ１２１６の出力パルスによって、スイッチ１２２３〜１２２８をオンオフし、アナログ電流映像信号をサンプリングして、ＴＦＴ１２１７〜１２１９のゲート・ソース間に必要な電圧を発生させる。そして容量１２２０〜１２２２に保持する。２行目のサンプリングが終了するまで、スイッチ１２２９〜１２３１はＴＦＴ１２０４〜１２０６とそれに応じたソース信号線を接続し、ＴＦＴ１２１７〜１２１９とソース線は接続されない。よって、ＴＦＴ１２１７〜１２１９のゲート・ソース間に電圧が印加されても、電流は流れない。サンプリングが終了したのち、スイッチ１２２９〜１２３１を切り換え、ＴＦＴ１２１７〜１２１９とソース信号線は接続される。このようにして、ソース信号線にアナログ映像信号に応じた電流が出力される。
次に第３行目に対応するアナログ映像信号をアナログ電流源１２０１から入力する。シフトレジスタ１２０３の出力パルスによって、アナログ電流映像信号をサンプリングしていく。これを繰り返すことによって、アナログ映像信号に応じた電流をソース信号線に出力していく。
図１５に本発明の画素の平面図を示す。ソース信号線１５０１〜１５０４はこの例では４本としてあり、ソース信号線１５０４が画素ＴＦＴ１５０６のソースまたはドレイン電極に接続されている。画素ＴＦＴのソース信号線１５０４に接続されない方ソースまたはドレイン電極は画素電極１５０７に接続される。画素電極１５０７はＥＬ素子のアノードまたはカソードとなる。ゲート信号線１５０５はＴＦＴ１５０６のゲートに接続される。
本発明はソース信号線の本数が従来のアクティブマトリクス型ＥＬ発光装置より多いが、画素のカラー化を塗り分け方式で行う場合には、各色の境界の部分にソース信号線を入れることが可能になる。また、ＴＦＴは１つの画素に対して１つのみしか必要とせず、また、保持容量は不要であるので、開口率を高くすることができる。
また、ＥＬ素子の画素電極と異なる対向電極を透明電極として、ＥＬ素子の発光を上方から取り出した上方発光型の場合は、ソース信号線上に絶縁膜を成膜し、その上に画素電極を置くことができ、その場合は画素の９割以上を画素電極とすることも可能である。
本発明は、画素ＴＦＴを単にスイッチとしてしか使わないので、画素ＴＦＴには高性能のトランジスタを必要としない。よって、画素ＴＦＴをアモルファスＴＦＴ、有機ＴＦＴなどとすることも可能ある。この場合、ソース信号線駆動回路、ゲート信号線駆動回路は一体形成できないので、単結晶トランジスタ、または多結晶トランジスタで構成し、画素ＴＦＴ基板に貼り付けて動作をおこなう。
大型表示装置では、そのコストの大半がソース信号線駆動回路、ゲート信号線駆動回路などの駆動回路ではなく、画素部であるため、ポリシリコンＴＦＴを用いずアモルファスＴＦＴなどを用いることによって大幅なコストダウンを図ることができる。
また、本実施例は前述した他の実施例と組み合わせて使用することが可能である。
図１７は単極性のＴＦＴを用いて、シフトレジスタを構成した例である。図１７はＮチャネル型の例であるが、単極性はＮチャネル型のみまたはＰチャネル型のみのいずれを用いても良い。単極性トランジスタのプロセスを用いたソース信号線駆動回路、またはゲート信号線駆動回路のいずれか、あるいは両方を用いることによって、表示装置製造のためのマスク枚数の低減が可能となる。
図１７において、スタートパルスＳＰは走査方向切り換えスイッチ１７０２に入力され、スイッチ用ＴＦＴ１７１１を経て、シフトレジスタ１７０１に入力される。シフトレジスタはブートストラップを用いたセットリセット型のシフトレジスタである。以下にシフトレジスタ１７０１の動作を説明する。
スタートパルスはＴＦＴ１７０３のゲートとＴＦＴ１７０６のゲートに入力される。ＴＦＴ１７０６がオンになるとＴＦＴ１７０４のゲートはロウになりＴＦＴ１７０４はオフになる。また、ＴＦＴ１７１０のゲートもロウになるためＴＦＴ１７１０もオフとなる。ＴＦＴ１７０３のゲートは電源電位まで上がるため、まずＴＦＴ１７０９のゲートは「電源−Ｖｇｓ」まで上昇する。出力１は初期電位がロウであるため、ＴＦＴ１７０９は出力１と容量１７０８を充電しながらソース電位を上げていく、ＴＦＴ１７０９のゲートが「電源−Ｖｇｓ」まで上昇したときに、ＴＦＴ１７０９はまだオンしているので、出力１はさらに上昇を続ける。ＴＦＴ１７０９のゲートは放電経路がないので、ソースに合わせて上昇し、電源をこえてもさらに上昇を続ける。
ＴＦＴ１７０９のドレイン、及びソースが等電位になったときに、電流が出力に流れるのが停止し、そこでＴＦＴ１７０９の電位上昇が止まる。このようにして、出力１は電源電位に等しいハイ電位を出力できる。この時はＣＬｂの電位はハイとする。ＣＬｂがロウに落ちると、容量１７０８電荷はＴＦＴ１７０９を介してＣＬｂにぬけて、出力１はロウに落ちる。出力１のパルスは次の段のシフトレジスタに伝わっていく。本実施例は本明細書の他の実施例と組み合わせて使用することができる。
図１９にソース信号線駆動回路を画素部の両側に配置した実施例を示す。このように配置を行い、両側のソース信号線駆動回路を同時に動かすことにより、図１９の例では８行の画素を同時に点灯することができ、ＥＬ素子の発光時間をさらに長くとることができる。以下に動作を説明する。
ソース信号線駆動回路１９０１から、ソース信号線１９０４〜１９１１に電流が出力され、ゲート信号線１９５２〜１９５５がハイ（画素ＴＦＴがＮチャネル型の場合）になると、ＴＦＴ１９２０〜１９２７に電流が流れ、ＴＦＴを通してＥＬ素子１９２８〜１９３５、そして共通のカソードに電流が流れ、ＥＬ素子１９２８〜１９３５は発光する。
以上の動作と同時に、ソース信号線駆動回路１９０２から、ソース信号線１９１２〜１９１９に電流が出力され、ゲート信号線１９５６〜１９５９がハイ（画素ＴＦＴがＮチャネル型の場合）になると、ＴＦＴ１９３６〜１９４３に電流が流れ、ＴＦＴを通してＥＬ素子１９４４〜１９５１、そして共通のカソードに電流が流れ、ＥＬ素子１９４４〜１９５１は発光する。
ソース信号線駆動回路１９０１、１９０２、ゲート信号線駆動回路１９０３は画素ＴＦＴと同様に基板上に同時形成しても良いし、また、画素ＴＦＴとは別に、ドライバ回路を作製し、画素基板に貼り付けてもよい。ドライバ回路は単結晶シリコンでも良いし、ポリシリコンなど非単結晶を用いても良い。
階調を表現する場合には図４で示したのと同じように、ソース信号線に流れる電流を制御することによって、表現ができる。
以上のようにして作製される表示装置は各種電子機器の表示部として用いることができる。以下に、本発明を用いて形成された表示装置を表示媒体として組み込んだ電子機器について説明する。
その様な電子機器としては、ビデオカメラ、デジタルカメラ、ヘッドマウントディスプレイ（ゴーグル型ディスプレイ）、ゲーム機、カーナビゲーション、パーソナルコンピュータ、携帯情報端末、携帯電話機、電子書籍などが挙げられる。それらの一例を図１８に示す。
図１８（Ａ）はデジタルカメラであり、本体３１０１、表示部３１０２、受像部３１０３、操作キー３１０４、外部接続ポート３１０５、シャッター３１０６、音声出力部３１０７を含む。本発明の表示装置はカメラの表示部３１０２に用いることができる。
図１８（Ｂ）はノートパソコンであり、本体３２０１、筐体３２０２、表示部３２０３、キーボード３２０４、外部接続ポート３２０５、ポインティングマウス３２０６、音声出力部３２０７を含む。本発明の表示装置は表示部３２０３に使用することができる。
図１８（Ｃ）は携帯情報端末であり、本体３３０１、表示部３３０２、スイッチ３３０３、操作キー３３０４、赤外線ポート３３０５、音声出力部３３０６を含む。本発明の表示装置は表示部３３０２に使用することができる。
図１８（Ｄ）は記録媒体を備えた画像再生装置（具体的にはＤＶＤ再生装置）であり、本体３４０１、筐体３４０２、記録媒体（ＣＤ、ＬＤまたはＤＶＤ等）読込部３４０５、操作スイッチ３４０６、音声出力部３４０７、表示部（ａ）３４０３、表示部（ｂ）３４０４等を含む。表示部（ａ）は主として画像情報を表示し、表示部（ｂ）は主として文字情報を表示するが、本発明の表示装置は記録媒体を備えた画像再生装置の表示部（ａ）、（ｂ）に用いることができる。なお、記録媒体を備えた画像再生装置としては、ＣＤ再生装置、ゲーム機器などに本発明を用いることができる。
図１８（Ｅ）は折りたたみ式携帯表示装置であり、本体３５０１に本発明を用いた表示部３５０２を装着することができる。３５０３は音声出力部を示す。
図１８（Ｆ）は腕時計型表示装置であり、ベルト３６０１、表示部３６０２、操作スイッチ３６０３、音声出力部３６０４を含む。本発明の表示装置は表示部３６０２に用いることができる。
図１８（Ｇ）は携帯電話機であり、本体３７０１は、筐体３７０２、表示部３７０３、音声入力部３７０４、アンテナ３７０５、操作キー３７０６、外部接続ポート３７０７、音声出力部３７０８を含む。本発明の表示装置を表示部３７０３に用いることができる。
以上の様に、本発明の適用範囲は極めて広く、あらゆる分野の電子機器に適用することが可能である。また、本実施例の電子機器は実施例１〜１２のどのような組み合わせからなる構成を用いても実現することができる。

Claims (22)

  1. 基板上にスイッチング素子および発光素子よりなる複数の画素がマトリクス状に配置され、
    １列の画素列に対し複数のソース信号線が配置され、
    １行の画素列に対し１本のゲート信号線が配置され、
    前記スイッチング素子は入力端子、出力端子、制御端子を有し、
    前記入力端子は前記複数のソース信号線のいずれかに電気的に接続され、
    前記出力端子は前記発光素子に電気的に接続され、前記制御端子は前記ゲート信号線に電気的に接続されていることを特徴とした表示装置。
  2. 基板上にスイッチング素子および発光素子よりなる複数の画素がマトリクス状に配置され、
    １列の画素列に対し複数のソース信号線が配置され、
    １行の画素列に対し１本のゲート信号線が配置され、
    前記スイッチング素子は入力端子、出力端子、制御端子を有し、
    前記入力端子は前記複数のソース信号線のいずれかに電気的に接続され、
    前記出力端子は前記発光素子に電気的に接続され、
    前記制御端子は前記ゲート信号線に電気的に接続され、
    前記複数のソース信号線の少なくとも１つに電気的に接続されたソース信号線駆動回路を複数有することを特徴とした表示装置。
  3. 基板上にスイッチング素子および発光素子よりなる複数の画素がマトリクス状に配置され、
    １列の画素列に対し複数のソース信号線が配置され、
    １行の画素列に対し１本のゲート信号線が配置され、
    前記スイッチング素子は入力端子、出力端子、制御端子を有し、
    前記入力端子は前記複数のソース信号線のいずれかに電気的に接続され、
    前記出力端子は前記発光素子に電気的に接続され、
    前記制御端子は前記ゲート信号線に電気的に接続され、
    前記ゲート信号線を同時に複数本駆動させる１つのゲート信号線駆動回路を有することを特徴とした表示装置。
  4. 請求の範囲第２項において、
    前記ソース信号線駆動回路は電流出力型のソース信号線駆動回路であることを特徴とした表示装置。
  5. 請求の範囲第２項において、
    前記ソース信号線駆動回路は薄膜トランジスタで構成されていることを特徴とした表示装置。
  6. 請求の範囲第２項において、
    前記ソース信号線駆動回路は前記スイッチング素子と同一基板上に形成されていることを特徴とした表示装置。
  7. 請求の範囲第２項において、
    前記ソース信号線駆動回路は半導体チップを実装したものであることを特徴とした表示装置。
  8. 請求の範囲第２項において、
    複数の前記ソース信号線駆動回路は前記複数の画素が配置された領域の両側に分けて配置されていることを特徴とした表示装置。
  9. 請求の範囲第２項において、
    前記ソース信号線駆動回路は前記複数のソース信号線のいずれか１つを駆動するものであることを特徴とした表示装置。
  10. 請求の範囲第２項において、
    前記ソース信号線駆動回路は単一の極性のトランジスタによって構成されていることを特徴とした表示装置。
  11. 請求の範囲第３項において、
    前記ゲート信号線駆動回路は薄膜トランジスタで構成されていることを特徴とした表示装置。
  12. 請求の範囲第３項において、
    前記ゲート信号線駆動回路は前記スイッチング素子と同一基板上に形成されていることを特徴とした表示装置。
  13. 請求の範囲第３項において、
    前記ゲート信号線駆動回路は半導体チップを実装したものであることを特徴とした表示装置。
  14. 請求の範囲第３項において、
    前記ゲート信号線駆動回路は、単一の極性のトランジスタによって構成されていることを特徴とした表示装置。
  15. 請求の範囲第１項乃至第３項のいずれか一において、
    前記スイッチング素子は１つの薄膜トランジスタで構成されていることを特徴とした表示装置。
  16. 請求の範囲第１項乃至第３項のいずれか一において、
    前記スイッチング素子はマルチゲートの薄膜トランジスタで構成されていることを特徴とした表示装置。
  17. 請求の範囲第１項乃至第３項のいずれか一において、
    前記発光素子はＥＬ素子であることを特徴とした表示装置。
  18. 請求の範囲第１項乃至３項のいずれか一における表示装置が組み込まれたデジタルカメラ、ノートパソコン、携帯情報端末、記録媒体を備えた画像再生装置、折りたたみ式携帯表示装置、腕時計型表示装置、または携帯電話機。
  19. 基板上にスイッチング素子および発光素子よりなる複数の画素がマトリクス状に配置され、１列の画素列に対し複数のソース信号線が配置され、１行の画素列に対し１本のゲート信号線が配置され、前記スイッチング素子は入力端子、出力端子、制御端子を有し、前記入力端子は前記複数のソース信号線のいずれかに電気的に接続され、前記出力端子は前記発光素子に電気的に接続され、前記制御端子は前記ゲート信号線に電気的に接続された表示装置の駆動方法であって、
    前記ゲート信号線を同時に複数本駆動させて複数の前記スイッチング素子をオン状態にすることにより、前記複数のソース信号線のいずれかの信号を前記発光素子に入力し、前記発光素子を駆動させることを特徴とした表示装置の駆動方法。
  20. 請求の範囲第１９項において、
    前記スイッチング素子は１つの薄膜トランジスタで構成されていることを特徴とした表示装置の駆動方法。
  21. 請求の範囲第１９項において、
    前記スイッチング素子はマルチゲートの薄膜トランジスタで構成されていることを特徴とした表示装置の駆動方法。
  22. 請求の範囲第１９項において、
    前記発光素子はＥＬ素子であることを特徴とした表示装置の駆動方法。
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