JPS6290733A - Ｒａｍ内容表示装置 - Google Patents
Ｒａｍ内容表示装置Info
- Publication number
- JPS6290733A JPS6290733A JP60230347A JP23034785A JPS6290733A JP S6290733 A JPS6290733 A JP S6290733A JP 60230347 A JP60230347 A JP 60230347A JP 23034785 A JP23034785 A JP 23034785A JP S6290733 A JPS6290733 A JP S6290733A
- Authority
- JP
- Japan
- Prior art keywords
- data
- address
- ram
- program
- control circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Debugging And Monitoring (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
- Microcomputers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（イ） 産業上の利用分野
本見明は、量産用のワンチップマイクロコンピュータに
書き込むプログラムの評価を行うデバッグ装置に於いて
、プログラムの実行中にＲＡＭの内容を表示するＲＡＭ
内容表示装置に関する。
書き込むプログラムの評価を行うデバッグ装置に於いて
、プログラムの実行中にＲＡＭの内容を表示するＲＡＭ
内容表示装置に関する。
（ロ） 従来の技術
一般に、フンチップマイクロコンピュータは、プログラ
ムを記憶するＲＯＭ（１−ド・オンリー・メモリ）を内
蔵しており、ユーザー等が予め作成したプログラムがワ
ンチップマイクロコンピュータの製造時にマスクによっ
て書き込まれる。そこで、プログラムを開発する場合、
あるいは、プログラムを評価する場合には、量産用のワ
ンチップマイクロコンピュータと略同一機能を有した二
′ゝリュエーションチップと呼ばれるマイクロコンピュ
ータを使用したデバッグ装置を利用しているつところで
、従来のエバリユエーションチップは。
ムを記憶するＲＯＭ（１−ド・オンリー・メモリ）を内
蔵しており、ユーザー等が予め作成したプログラムがワ
ンチップマイクロコンピュータの製造時にマスクによっ
て書き込まれる。そこで、プログラムを開発する場合、
あるいは、プログラムを評価する場合には、量産用のワ
ンチップマイクロコンピュータと略同一機能を有した二
′ゝリュエーションチップと呼ばれるマイクロコンピュ
ータを使用したデバッグ装置を利用しているつところで
、従来のエバリユエーションチップは。
量産用フンチップマイクロコンピュータノ入出力瑞子の
他に、命令コードを外部から印加するための端子、内部
のプログラムカウンタの内容を出力するだめの端子、内
部に設けられたＲＡＭのアドレスを出力する端子、ＲＡ
Ｍの読み出しあるいは畜き込みデータを出力する端子、
及び、各種の制御端子が設けられる。プログラムの評価
を行う場“合ニハ、エバリユエーションチップに外付さ
れたプログラムメモリに記憶されたプログラムを順次読
み出して、エバリユエーションチップに印加し、その命
令の実行の結果を入出力端子あるいは内部のＲＡＭのデ
ータを読み出して動作をチェックしている。
他に、命令コードを外部から印加するための端子、内部
のプログラムカウンタの内容を出力するだめの端子、内
部に設けられたＲＡＭのアドレスを出力する端子、ＲＡ
Ｍの読み出しあるいは畜き込みデータを出力する端子、
及び、各種の制御端子が設けられる。プログラムの評価
を行う場“合ニハ、エバリユエーションチップに外付さ
れたプログラムメモリに記憶されたプログラムを順次読
み出して、エバリユエーションチップに印加し、その命
令の実行の結果を入出力端子あるいは内部のＲＡＭのデ
ータを読み出して動作をチェックしている。
上述のことは、本願出顔人が昭和５８年１１月３０日に
発行したマイコン資料シリーズＮ１１３ｒＬＣｓｓｏｏ
シリーズユーザーズマニユアル」の第５１頁から窮６４
頁に記載されているっ（ハ） 発明が解決しようとする
問題点ところが、プログラムの評価時にＲＡＭの内容を
確認する場合には、エバリユエーションチップに外部か
ら割込み要求を行い、それまでのプログラムの実行を停
止させて、ＲＡＭの内容を外部に出力する命令を含むプ
ログラムを実行し、ＲＡＭの内部データな叡り出してい
た。従って、グログラムの評価中に随時リアルタイムで
ＲＡＭの内容を確認することができず、プログラムの評
価に時間１！ｌｔかかる欠点があった。
発行したマイコン資料シリーズＮ１１３ｒＬＣｓｓｏｏ
シリーズユーザーズマニユアル」の第５１頁から窮６４
頁に記載されているっ（ハ） 発明が解決しようとする
問題点ところが、プログラムの評価時にＲＡＭの内容を
確認する場合には、エバリユエーションチップに外部か
ら割込み要求を行い、それまでのプログラムの実行を停
止させて、ＲＡＭの内容を外部に出力する命令を含むプ
ログラムを実行し、ＲＡＭの内部データな叡り出してい
た。従って、グログラムの評価中に随時リアルタイムで
ＲＡＭの内容を確認することができず、プログラムの評
価に時間１！ｌｔかかる欠点があった。
に）問題点を解決するための手段
本発明は、上述した点に鑑みて為されたものでアリ、エ
バリユエーションチップから出力されるＲＡＭのアドレ
ス、ＲＡＭの内容を示すデータ。
バリユエーションチップから出力されるＲＡＭのアドレ
ス、ＲＡＭの内容を示すデータ。
及び、書き込み信号を入力し保持するバッファと。
書き込み信号が出力されたときＲＡＭのアドレス及びデ
ータをバッファから取り出し、アドレス及びデータを対
応させて表示するための表示データを作成するコントロ
ール回路と、該コントロール回路から表示データを受け
喉りＣＲＴに前記アドレスとデータを対応して表示させ
るＣＲＴコントローラとを備えたものであり、ＲＡＭの
内８ｂ”リアルタイムで確認できるものである。
ータをバッファから取り出し、アドレス及びデータを対
応させて表示するための表示データを作成するコントロ
ール回路と、該コントロール回路から表示データを受け
喉りＣＲＴに前記アドレスとデータを対応して表示させ
るＣＲＴコントローラとを備えたものであり、ＲＡＭの
内８ｂ”リアルタイムで確認できるものである。
（ホ） 作用
上述の手段によれば、評価すべきプログラムの実行中に
ＲＡＭの書き込み命令が実行されるたびに、ＲＡＭのア
ドレス及び書き込まれるデータがバッファに敗り込まれ
記憶保持される。一方、書き込信号によりコントロール
回路は・くツファに保持されたＲＡＭのアドレス及びデ
ータを取り込んで、そのアドレス立置を認識し且つその
データ内容を内部に設けられたメモリに記憶すると共に
。
ＲＡＭの書き込み命令が実行されるたびに、ＲＡＭのア
ドレス及び書き込まれるデータがバッファに敗り込まれ
記憶保持される。一方、書き込信号によりコントロール
回路は・くツファに保持されたＲＡＭのアドレス及びデ
ータを取り込んで、そのアドレス立置を認識し且つその
データ内容を内部に設けられたメモリに記憶すると共に
。
ＣＲＴに表示するための表示データを作成する。
この表示データの印加されたＣＲＴコントローラは、実
際にＣＲＴを駆動するだめのドツトデータを作成しこの
ドツトデータに基いてＣＲＴの表示を行うつ （へ）実施例 嘉１図は本発明の実施例を示すブロック図であり、（１
）はエバリユエーションチップ、（２）はバッファ、（
３）は入力ボーと、（４）はコントロール回路、（５）
はＣＲＴコントローラ、（６）はＣＲＴディスプレイで
ある。エバリユエーションチップｉｌｌは、を産出のワ
ンチップマイクロコンピュータと略同一機能を存し、外
部接続されたプログラムメモリ（図示せず）にプログラ
ムカウンタの内容を送出し、順次読み出された命令コー
ドＩＲが印加される。また、エバリユエーションチク７
’＋１）ＫはＲＡＭ（７）が内蔵されており、このＲＡ
Ｍ （７１をアクセスするためのアドレスデータＡＤ
とＲＡＭ（７）に書き込まれるデータＲＤと書き込み信
号ＷＵａ；外部出力される。バッファ（２）はファース
トイン−ファーストアウトのバッファであり、入力には
工／＜リュエーションチップ（１）からのアドレスデー
タＡＤとデータＲＤが印加され、書き込み信号ＷＲによ
ってこれらの信号を取り込み記憶保持するっこの・くツ
ファ（２）は、エバリユエーションチップ（１）の−命
令が実行される時間内に、コントロール回路（４）及び
ＣＲＴコントローラ（５）がＲＡＭ（７）のアドレスデ
ータＡＤ及びデータＲＤを入力及び処理してＣＲＴ＋６
１に表示させることが非常に困難であるため、アドレス
データＡＤ及びデータＲＤの一時保持用として設けられ
る。
際にＣＲＴを駆動するだめのドツトデータを作成しこの
ドツトデータに基いてＣＲＴの表示を行うつ （へ）実施例 嘉１図は本発明の実施例を示すブロック図であり、（１
）はエバリユエーションチップ、（２）はバッファ、（
３）は入力ボーと、（４）はコントロール回路、（５）
はＣＲＴコントローラ、（６）はＣＲＴディスプレイで
ある。エバリユエーションチップｉｌｌは、を産出のワ
ンチップマイクロコンピュータと略同一機能を存し、外
部接続されたプログラムメモリ（図示せず）にプログラ
ムカウンタの内容を送出し、順次読み出された命令コー
ドＩＲが印加される。また、エバリユエーションチク７
’＋１）ＫはＲＡＭ（７）が内蔵されており、このＲＡ
Ｍ （７１をアクセスするためのアドレスデータＡＤ
とＲＡＭ（７）に書き込まれるデータＲＤと書き込み信
号ＷＵａ；外部出力される。バッファ（２）はファース
トイン−ファーストアウトのバッファであり、入力には
工／＜リュエーションチップ（１）からのアドレスデー
タＡＤとデータＲＤが印加され、書き込み信号ＷＲによ
ってこれらの信号を取り込み記憶保持するっこの・くツ
ファ（２）は、エバリユエーションチップ（１）の−命
令が実行される時間内に、コントロール回路（４）及び
ＣＲＴコントローラ（５）がＲＡＭ（７）のアドレスデ
ータＡＤ及びデータＲＤを入力及び処理してＣＲＴ＋６
１に表示させることが非常に困難であるため、アドレス
データＡＤ及びデータＲＤの一時保持用として設けられ
る。
コントロール回路（４）は１例えばマイクロコンピュー
タで構成され、入力ポート（３）を介してバッファ（２
）の出力、即ち、ＲＡＭ（７）のアトＶスデータＡＤ出
力及びデータＲＤ出力と接続されろうまた、エバリユエ
ーションチップｆｉｌからは書き込み信号ＷＲが割込入
力端子ＩＮＴに印加され、書き込み信号ＷＲによって割
込みが発生するとコントロール回路（４）は、入力ポー
ト（３）を制御してバ、７７ア（２）からＲＡ Ｍ （
７１のアドレスデータＡＤ及びデータＲＤを収り込む、
更に、コントロール回路（４）内には、エバリユエーシ
ョンチップｆｉｌ内に設けられたＲＡＭ（７）よりも容
量の大きいメモリ（８）が設けられてあり、そのメモリ
（８）の一部がエバリユエーションチップｉｌｌのＲＡ
Ｍ ＋７１と対応する如く使用され、取り込まれたデ
ータはそのアドレスと対応するアドレスに記憶される。
タで構成され、入力ポート（３）を介してバッファ（２
）の出力、即ち、ＲＡＭ（７）のアトＶスデータＡＤ出
力及びデータＲＤ出力と接続されろうまた、エバリユエ
ーションチップｆｉｌからは書き込み信号ＷＲが割込入
力端子ＩＮＴに印加され、書き込み信号ＷＲによって割
込みが発生するとコントロール回路（４）は、入力ポー
ト（３）を制御してバ、７７ア（２）からＲＡ Ｍ （
７１のアドレスデータＡＤ及びデータＲＤを収り込む、
更に、コントロール回路（４）内には、エバリユエーシ
ョンチップｆｉｌ内に設けられたＲＡＭ（７）よりも容
量の大きいメモリ（８）が設けられてあり、そのメモリ
（８）の一部がエバリユエーションチップｉｌｌのＲＡ
Ｍ ＋７１と対応する如く使用され、取り込まれたデ
ータはそのアドレスと対応するアドレスに記憶される。
また、コントロール回路（４）は、エバリユエーション
チップ（１）のＲＡＭ（７１と対応する内戚されたメモ
リ（８）の領Ｊ或を読み出し、そのアドレスデータとデ
ータとを表示データに変換する。
チップ（１）のＲＡＭ（７１と対応する内戚されたメモ
リ（８）の領Ｊ或を読み出し、そのアドレスデータとデ
ータとを表示データに変換する。
表示データは、ＣＲＴコントローラ（５）に印加され、
ＣＲＴコントローラ（５）に於いて、ＣＲＴ（６）を駆
動するためのドツトデータに変換される。これにより、
ＣＲＴ（６１には、アドレスとそのアドレスに対応する
データの内容が表示されるっ 第２図は、第１図に示された装置によってＣＲＴ（６）
に表示される例を示す図であり、横軸にはアドレスの嘉
１桁が１６進数で表示され、縦軸にはアドレスの第２桁
が１６進数で表示される。即ち、例えば、横軸ｒＡＪと
縦軸「２」の交点は、アドレス「２人」を示し、その点
に表示される１６進数がアドレス「２人」に記憶されて
いるデータを表示している。また、横軸と縦軸の交点に
表示されていないアドレスは、それまでのプログラムに
よってエバリユエーションチツプ（１）がそのアドレス
をアクセスしなかったことを示している。即ち。
ＣＲＴコントローラ（５）に於いて、ＣＲＴ（６）を駆
動するためのドツトデータに変換される。これにより、
ＣＲＴ（６１には、アドレスとそのアドレスに対応する
データの内容が表示されるっ 第２図は、第１図に示された装置によってＣＲＴ（６）
に表示される例を示す図であり、横軸にはアドレスの嘉
１桁が１６進数で表示され、縦軸にはアドレスの第２桁
が１６進数で表示される。即ち、例えば、横軸ｒＡＪと
縦軸「２」の交点は、アドレス「２人」を示し、その点
に表示される１６進数がアドレス「２人」に記憶されて
いるデータを表示している。また、横軸と縦軸の交点に
表示されていないアドレスは、それまでのプログラムに
よってエバリユエーションチツプ（１）がそのアドレス
をアクセスしなかったことを示している。即ち。
プログラムの実行を実施する前にＲＡＭ内容表示装置の
ｔ源を投入した場合、コントロール回路（４）は、イニ
シャル設定に於いて、エバリユエーションチップ（１）
のＲＡＭ（７１に対応する内部メモ１Ｊ（８）＋７）各
アドレスにブランクを示すデータを書き込む。
ｔ源を投入した場合、コントロール回路（４）は、イニ
シャル設定に於いて、エバリユエーションチップ（１）
のＲＡＭ（７１に対応する内部メモ１Ｊ（８）＋７）各
アドレスにブランクを示すデータを書き込む。
そして、エバリユエーションチップ（１）のＲＡＭ（７
１のアクセスされたアドレスに対応するメモリ（８）の
アドレスにデータが書き込まれることにより、その書き
込まれたアドレスのデータだけがＣＲＴＩ６１に！示さ
れ、ブランクを示すデータが書き込まれたアドレスに１
・１何も表示されない。よって、アクセスされたアドレ
スが確認できるのである。
１のアクセスされたアドレスに対応するメモリ（８）の
アドレスにデータが書き込まれることにより、その書き
込まれたアドレスのデータだけがＣＲＴＩ６１に！示さ
れ、ブランクを示すデータが書き込まれたアドレスに１
・１何も表示されない。よって、アクセスされたアドレ
スが確認できるのである。
この様に、エバリユエーションチップ（１）に於いて、
プログラムの実行中にＲＡＭ＋７）の書き込み命令が実
行され、書き込み信号ＷＲカー出力されると、コントロ
ール回路（４）に割込みが発生し、その割込み処理によ
ってバッファ（２）に一時記憶されたアドレスデータ人
り及びデータＲＤが人力ポート（３）を介してコントロ
ール回路（４）に取り込まれ、内部のメモリ（８）に書
き込まれるウモして、コントロール回路（４）は、メモ
リ（８）を順次アクセスして、そのアドレスと読み出さ
れたデータとを表示データに変換しＣＲＴコントローラ
（５）に印加する。更に、ＣＲＴコントローラ（５）は
表示データをドツトデータに変換してＣＲＴ（６１に表
示を行うことにより、工／＜ ＩＪユエーションチノフ
（１）のＲＡ Ｍ （７１のアクセスとリアルタイムで
、アクセスされたアドレスとそのデータ内容が確認でき
る。
プログラムの実行中にＲＡＭ＋７）の書き込み命令が実
行され、書き込み信号ＷＲカー出力されると、コントロ
ール回路（４）に割込みが発生し、その割込み処理によ
ってバッファ（２）に一時記憶されたアドレスデータ人
り及びデータＲＤが人力ポート（３）を介してコントロ
ール回路（４）に取り込まれ、内部のメモリ（８）に書
き込まれるウモして、コントロール回路（４）は、メモ
リ（８）を順次アクセスして、そのアドレスと読み出さ
れたデータとを表示データに変換しＣＲＴコントローラ
（５）に印加する。更に、ＣＲＴコントローラ（５）は
表示データをドツトデータに変換してＣＲＴ（６１に表
示を行うことにより、工／＜ ＩＪユエーションチノフ
（１）のＲＡ Ｍ （７１のアクセスとリアルタイムで
、アクセスされたアドレスとそのデータ内容が確認でき
る。
（ト） 発明の効果
上述の如く本発明によれば、評価すべきプログラムを実
行する際にその実行とリアルタイムでＲＡＭの内容が表
示されるため、プログラムによる動作の確認が容易とな
り、プログラムの評価時間が短縮される。従って、プロ
グラムの開発からワンチップマイクロコンピュータの生
産着手までの期間つを短くなり、ユーザーの要求に迅速
に対応で永る利点を有する。
行する際にその実行とリアルタイムでＲＡＭの内容が表
示されるため、プログラムによる動作の確認が容易とな
り、プログラムの評価時間が短縮される。従って、プロ
グラムの開発からワンチップマイクロコンピュータの生
産着手までの期間つを短くなり、ユーザーの要求に迅速
に対応で永る利点を有する。
第１図は木宛明の実施例を示すブロック図、第２図は嘉
１図に示されたＣＲＴＫ表示される例を示す図であろう ｆｉｌ・・・エバリユエーションチツ７’、＋２）・・
・バッファ、（３）・・・入力ポーと、 （４）・・・
コントロール回路、（５）・・・ＣＲＴコントローラ、
（６）・・・ＣＲＴ 、 （７）・・・ＲＡＭ、
（８）・・・メモリ。 出願人 三洋戒機械式会社 外１名 代哩人 弁理士 佐 野 静 夫 第１図 ！ 第２図
１図に示されたＣＲＴＫ表示される例を示す図であろう ｆｉｌ・・・エバリユエーションチツ７’、＋２）・・
・バッファ、（３）・・・入力ポーと、 （４）・・・
コントロール回路、（５）・・・ＣＲＴコントローラ、
（６）・・・ＣＲＴ 、 （７）・・・ＲＡＭ、
（８）・・・メモリ。 出願人 三洋戒機械式会社 外１名 代哩人 弁理士 佐 野 静 夫 第１図 ！ 第２図
Claims (1)
- １、量産用のワンチップマイクロコンピュータと略同一
機能を有し、内蔵されたＲＡＭ（ランダム・アクセス・
メモリ）のアドレス、及び、書き込み信号を出力すると
共に該アドレス及び書き込み信号でＲＡＭに転送される
データを出力する端子を有するエバリュエーションチッ
プと、該エバリュエーションチップから前記書き込み信
号が出力されたとき前記アドレス及びデータを記憶する
バッファと、前記書き込み信号が出力されたとき前記バ
ッファに保持されているアドレス及びデータを入力しア
ドレス及びデータを表示するための表示データを作成す
るコントロール回路と、該コントロール回路から表示デ
ータを受け取りＣＲＴに前記アドレスとデータを表示さ
せるＣＲＴコントローラとを備えて成るＲＡＭ内容表示
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60230347A JPS6290733A (ja) | 1985-10-16 | 1985-10-16 | Ｒａｍ内容表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60230347A JPS6290733A (ja) | 1985-10-16 | 1985-10-16 | Ｒａｍ内容表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6290733A true JPS6290733A (ja) | 1987-04-25 |
Family
ID=16906424
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60230347A Pending JPS6290733A (ja) | 1985-10-16 | 1985-10-16 | Ｒａｍ内容表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6290733A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0397744U (ja) * | 1990-01-23 | 1991-10-08 | ||
| JP2005284557A (ja) * | 2004-03-29 | 2005-10-13 | Fujitsu Ltd | 内部メモリをモニタ可能なマイクロコンピュータ |
| JP2008310702A (ja) * | 2007-06-15 | 2008-12-25 | Nec Electronics Corp | モニタ装置及びモニタ方法 |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57141760A (en) * | 1981-02-25 | 1982-09-02 | Nec Corp | Semiconductor information processor |
| JPS59114650A (ja) * | 1982-12-21 | 1984-07-02 | Fujitsu Ltd | プログラムトレ−ス方式 |
| JPS59135555A (ja) * | 1983-01-21 | 1984-08-03 | Matsushita Electric Ind Co Ltd | プログラムトレ−ス装置 |
| JPS61133445A (ja) * | 1984-11-30 | 1986-06-20 | Nitto Seiko Co Ltd | プログラムデバツグ装置 |
-
1985
- 1985-10-16 JP JP60230347A patent/JPS6290733A/ja active Pending
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57141760A (en) * | 1981-02-25 | 1982-09-02 | Nec Corp | Semiconductor information processor |
| JPS59114650A (ja) * | 1982-12-21 | 1984-07-02 | Fujitsu Ltd | プログラムトレ−ス方式 |
| JPS59135555A (ja) * | 1983-01-21 | 1984-08-03 | Matsushita Electric Ind Co Ltd | プログラムトレ−ス装置 |
| JPS61133445A (ja) * | 1984-11-30 | 1986-06-20 | Nitto Seiko Co Ltd | プログラムデバツグ装置 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0397744U (ja) * | 1990-01-23 | 1991-10-08 | ||
| JP2005284557A (ja) * | 2004-03-29 | 2005-10-13 | Fujitsu Ltd | 内部メモリをモニタ可能なマイクロコンピュータ |
| JP2008310702A (ja) * | 2007-06-15 | 2008-12-25 | Nec Electronics Corp | モニタ装置及びモニタ方法 |
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