JPS6235789A - デ−タ分離回路 - Google Patents
デ−タ分離回路Info
- Publication number
- JPS6235789A JPS6235789A JP17456885A JP17456885A JPS6235789A JP S6235789 A JPS6235789 A JP S6235789A JP 17456885 A JP17456885 A JP 17456885A JP 17456885 A JP17456885 A JP 17456885A JP S6235789 A JPS6235789 A JP S6235789A
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- JP
- Japan
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- circuit
- comparator
- clock
- output
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、テレビジョン装置の信号処理回路に関し、特
に複号映像信号のブランキング内に重畳されたバケット
データを取出す回路に関する。
に複号映像信号のブランキング内に重畳されたバケット
データを取出す回路に関する。
（従来の技術及び問題点）
複号映像信号のブランキングを利用し、制御信号等の映
像以外の信号を映像信号と共に伝送する゛ 方式の１つ
として、デジタル的なデータをそのデータのデータレー
トに相当するクロックランと識別の為のフレーミングコ
ードとを含むバケットデータとして重畳する方式がある
。この場合、伝送特性等から、バケットデータについて
は波型整形により立ち上がり及び立ち下がりを正弦波形
にするのが一般的である。従来、重ｉすれなバケットデ
ータを分離する為に、第２図の様に複号映像信号９９を
クランプ回路１によりクランプし、コンパレータ５によ
りデジタルデータ１０５として取り出していた。第３図
（ａ）はバケットデータの構成を示し、第３図（ｂ）は
コンパレータ５の入力のバケットデータ１０１とコンパ
レータ出力１０５との波形を示す図である。これら図に
おける９６は第２図の回路に於るコンパレータ５のリフ
ァレンスを示す。この場合、図で明らかな様に、入力信
号全体又はバケットデータのレベルが変化したときコン
パレータ出力１０５のデユーティが変化し、レベルが半
分まで下がったとき（第３図（ｂ）の破線）にはデータ
の分離ができなくなる。コンパレータ出力１０５は第３
図（ｂ）の様な場合デユーティ５０ｘが好ましい。この
ように第２図に示す従来のデータ分離回路では入力レベ
ルの変化に対し、極めて許容範囲が狭い欠点があった。
像以外の信号を映像信号と共に伝送する゛ 方式の１つ
として、デジタル的なデータをそのデータのデータレー
トに相当するクロックランと識別の為のフレーミングコ
ードとを含むバケットデータとして重畳する方式がある
。この場合、伝送特性等から、バケットデータについて
は波型整形により立ち上がり及び立ち下がりを正弦波形
にするのが一般的である。従来、重ｉすれなバケットデ
ータを分離する為に、第２図の様に複号映像信号９９を
クランプ回路１によりクランプし、コンパレータ５によ
りデジタルデータ１０５として取り出していた。第３図
（ａ）はバケットデータの構成を示し、第３図（ｂ）は
コンパレータ５の入力のバケットデータ１０１とコンパ
レータ出力１０５との波形を示す図である。これら図に
おける９６は第２図の回路に於るコンパレータ５のリフ
ァレンスを示す。この場合、図で明らかな様に、入力信
号全体又はバケットデータのレベルが変化したときコン
パレータ出力１０５のデユーティが変化し、レベルが半
分まで下がったとき（第３図（ｂ）の破線）にはデータ
の分離ができなくなる。コンパレータ出力１０５は第３
図（ｂ）の様な場合デユーティ５０ｘが好ましい。この
ように第２図に示す従来のデータ分離回路では入力レベ
ルの変化に対し、極めて許容範囲が狭い欠点があった。
（問題点を解決するための手段）
前述の問題点を解決するために本発明が提供する手段は
、クロックラン、フレーミングコード及びデータ部から
構成されるバケットデータが重畳された復号映像信号と
、前記バケットデータのタイミングを与える同期信号と
、クランプパルスとを入力とし、前記複号映像信号をク
ランプし。
、クロックラン、フレーミングコード及びデータ部から
構成されるバケットデータが重畳された復号映像信号と
、前記バケットデータのタイミングを与える同期信号と
、クランプパルスとを入力とし、前記複号映像信号をク
ランプし。
コンパレータにより前記バケットデータを取り出す回路
であって、前記コンパレータの出力からクロックの再生
及びフレーミングコードの検出を行なう回路と、前記再
生クロックを積分する回路と、この積分回路の出力を受
けるピークホールド回路と、前記フレーミングコードの
検出ができない場合に前記ピークホールド回路をリセッ
トする回路と、前記同期信号を基にして前記クロック再
生及び前記フレーミングコード検出のタイミングを与え
る回路とを備え、前記コンパレータは前記ピークホール
ド回路の出力に基づく電圧を基Ｉ′１ｇ電圧とすること
を特徴とする。
であって、前記コンパレータの出力からクロックの再生
及びフレーミングコードの検出を行なう回路と、前記再
生クロックを積分する回路と、この積分回路の出力を受
けるピークホールド回路と、前記フレーミングコードの
検出ができない場合に前記ピークホールド回路をリセッ
トする回路と、前記同期信号を基にして前記クロック再
生及び前記フレーミングコード検出のタイミングを与え
る回路とを備え、前記コンパレータは前記ピークホール
ド回路の出力に基づく電圧を基Ｉ′１ｇ電圧とすること
を特徴とする。
（実施例）
次に本発明の実施例について図面を参照して説明する。
第１図は本発明の一実施例のブロック図である。クラン
プ回路１は複号映像信号９９をクランプして、コンパレ
ータ５により、分離データ出力１０５が得られる。クロ
ック再生回路６は、コンパレータ５の出力１０５からク
ロックラン部分をとり出し、クロックの再生を行なう、
その再生クロック１０６ａは積分回路２で積分される。
プ回路１は複号映像信号９９をクランプして、コンパレ
ータ５により、分離データ出力１０５が得られる。クロ
ック再生回路６は、コンパレータ５の出力１０５からク
ロックラン部分をとり出し、クロックの再生を行なう、
その再生クロック１０６ａは積分回路２で積分される。
ピークホールド回路３は積分回路２の出力１０２を直流
電圧１０３に変換する。ピークホールド回路３の直流電
圧１０３は増幅器４で増幅されて、コンパレータ５の他
の入力へレファレンス電圧１０４として与えられる。
電圧１０３に変換する。ピークホールド回路３の直流電
圧１０３は増幅器４で増幅されて、コンパレータ５の他
の入力へレファレンス電圧１０４として与えられる。
シフトレジスタ９は、クロック再生回路６の再生クロッ
ク１０６ｂによりコンパレータ５の出力１０５から、フ
レーミングコード検出の為のパラレルデータ１０９を得
るもので、次のフレーミングコードデコーダ８はこのパ
ラレルデータ１０９からフレーミングコードのデコード
を行なう。この検出結果により、ピークホールド回路３
を一定の時定数でリセットする。タイミングパルス発生
回路７は、同期信号９７に基づき、クロック再生回路６
及びフレーミングコードデコーダ８にタイミング信号１
０７ａ及び１０７ｂをそれぞれ与える。
ク１０６ｂによりコンパレータ５の出力１０５から、フ
レーミングコード検出の為のパラレルデータ１０９を得
るもので、次のフレーミングコードデコーダ８はこのパ
ラレルデータ１０９からフレーミングコードのデコード
を行なう。この検出結果により、ピークホールド回路３
を一定の時定数でリセットする。タイミングパルス発生
回路７は、同期信号９７に基づき、クロック再生回路６
及びフレーミングコードデコーダ８にタイミング信号１
０７ａ及び１０７ｂをそれぞれ与える。
第４図（ａ）〜（ｃ）は、コンパレータ入力１０１、再
生クロック１０６ａ、積分波形１０２及びピークホール
ド出力１０３が複号映像信号９９のレベルに応じて変化
する様子を示す６本図（ａ）はその信号９９のレベルが
小さい場合を、同図（ｂ＞は信号９９のレベルが大きい
場合を、同図（ｅ＞は信号９９のレベルが中程度の場合
をそれぞれ示す。本実施例では、ピークホールド出力１
０３ヲコンパレータ５のリファレンス電圧１０４として
増幅器４を介して供給するので、複号映像信号９９のレ
ベルの変動に対し、常に適正はりファレンス電ＥＥ １
０４を与えることができる。又、ピークホールドで保持
した電圧は入力レベルが下がった場合には特定数が大き
い為、応答が遅れる（第５図１０３の破線）ので、フレ
ーミングコードの検知出力（第５図１０８）によりある
時定数をもってピークホールド回路３にリセットをかけ
る様にして、応答の遅れを補っている（第５図１０３の
実線）、尚、第５図９９ａが入力のパケット、１０７ｂ
がフレーミングコード検出のタイミング、１０８が検出
した結果、１０３がピークホールドの波形をそれぞれ示
す。
生クロック１０６ａ、積分波形１０２及びピークホール
ド出力１０３が複号映像信号９９のレベルに応じて変化
する様子を示す６本図（ａ）はその信号９９のレベルが
小さい場合を、同図（ｂ＞は信号９９のレベルが大きい
場合を、同図（ｅ＞は信号９９のレベルが中程度の場合
をそれぞれ示す。本実施例では、ピークホールド出力１
０３ヲコンパレータ５のリファレンス電圧１０４として
増幅器４を介して供給するので、複号映像信号９９のレ
ベルの変動に対し、常に適正はりファレンス電ＥＥ １
０４を与えることができる。又、ピークホールドで保持
した電圧は入力レベルが下がった場合には特定数が大き
い為、応答が遅れる（第５図１０３の破線）ので、フレ
ーミングコードの検知出力（第５図１０８）によりある
時定数をもってピークホールド回路３にリセットをかけ
る様にして、応答の遅れを補っている（第５図１０３の
実線）、尚、第５図９９ａが入力のパケット、１０７ｂ
がフレーミングコード検出のタイミング、１０８が検出
した結果、１０３がピークホールドの波形をそれぞれ示
す。
（発明の効果）
以上説明したように、本発明は、複合映像入力から重畳
されたバケットデータを取り出すコンパレータのリファ
レンスとして、コンパレータ出力から再生したクロック
を積分、ピークホールドした電圧を与えると共に、フレ
ーミングコード検出出力により、ピークホールドをリセ
ットすることにより、入力レベルの変動にかかわらず、
コンパレータ出力として安定な分離データを得ることが
できる。
されたバケットデータを取り出すコンパレータのリファ
レンスとして、コンパレータ出力から再生したクロック
を積分、ピークホールドした電圧を与えると共に、フレ
ーミングコード検出出力により、ピークホールドをリセ
ットすることにより、入力レベルの変動にかかわらず、
コンパレータ出力として安定な分離データを得ることが
できる。
第１図は本発明の一実施例を示すブロック図、第２図は
従来のデータ分離回路を示すブロック図、第３図（ａ）
はバケットデータの構成を示す図、同図（ｂ）は第２図
回路の各部侶号の波形図、第４図（ａ）〜（Ｃ）第１図
実施例の各部信号の波形やレベルが入力信号のレベルに
応じて変わる様子を示す区、第５図は第１図実施例にお
ける各部侶号のタイミングを示す図である。 １・・・クランプ回路、２・・・積分回路、３・・・ピ
ークホールド回路、４・・・増幅器、５・・・コンパレ
ータ、６・・・クロック再生回路、７・・・タイミング
パルス発生回路、８・・・フレーミングコードデコーダ
、９・・・シフトレジスタ、１０１・・・コンパレータ
入力、 １０４・・・コンパレータリファレンス、１０
５・・・コンパレータ出力、１０６ａ・・・再生クロッ
ク、１０３・・・ピークホールド出力、９９ａ・・・入
力のバケットデータ、１０７ｂ・・・フレーミングコー
ドのタイミングパルス、１０８・・・フレーミングコー
ド検出出力、１０３・・・ピークホールド出力。 代理人 弁理士 本 庄 伸 介 第１図 第２図 第４図 （ａ） （ｂ） （ｃ）第５図
従来のデータ分離回路を示すブロック図、第３図（ａ）
はバケットデータの構成を示す図、同図（ｂ）は第２図
回路の各部侶号の波形図、第４図（ａ）〜（Ｃ）第１図
実施例の各部信号の波形やレベルが入力信号のレベルに
応じて変わる様子を示す区、第５図は第１図実施例にお
ける各部侶号のタイミングを示す図である。 １・・・クランプ回路、２・・・積分回路、３・・・ピ
ークホールド回路、４・・・増幅器、５・・・コンパレ
ータ、６・・・クロック再生回路、７・・・タイミング
パルス発生回路、８・・・フレーミングコードデコーダ
、９・・・シフトレジスタ、１０１・・・コンパレータ
入力、 １０４・・・コンパレータリファレンス、１０
５・・・コンパレータ出力、１０６ａ・・・再生クロッ
ク、１０３・・・ピークホールド出力、９９ａ・・・入
力のバケットデータ、１０７ｂ・・・フレーミングコー
ドのタイミングパルス、１０８・・・フレーミングコー
ド検出出力、１０３・・・ピークホールド出力。 代理人 弁理士 本 庄 伸 介 第１図 第２図 第４図 （ａ） （ｂ） （ｃ）第５図
Claims (1)
- クロックラン、フレーミングコード及びデータ部から構
成されるバケットデータが重畳された複号映像信号と、
前記バケットデータのタイミングを与える同期信号と、
クランプパルスとを入力とし、前記複合映像信号をクラ
ンプし、コンパレータにより前記バケットデータを取り
出す回路に於て、前記コンパレータの出力からクロック
の再生及びフレーミングコードの検出を行なう回路と、
前記再生クロックを積分する回路と、この積分回路の出
力を受けるピークホールド回路と、前記フレーミングコ
ードの検出ができない場合に前記ピークホールド回路を
リセットする回路と、前記同期信号を基にして前記クロ
ック再生及び前記フレーミングコード検出のタイミング
を与える回路とを備え、前記コンパレータは前記ピーク
ホールド回路の出力に基づく電圧を基準電圧とすること
を特徴とするデータ分離回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17456885A JPS6235789A (ja) | 1985-08-08 | 1985-08-08 | デ−タ分離回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17456885A JPS6235789A (ja) | 1985-08-08 | 1985-08-08 | デ−タ分離回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6235789A true JPS6235789A (ja) | 1987-02-16 |
Family
ID=15980833
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17456885A Pending JPS6235789A (ja) | 1985-08-08 | 1985-08-08 | デ−タ分離回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6235789A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5561469A (en) * | 1992-06-01 | 1996-10-01 | Thomson Consumer Electronics, S.A. | Auxiliary video data slicer with multi-mode peak detection for determining sync and data slicing levels |
| US5627595A (en) * | 1990-06-23 | 1997-05-06 | Telefunken | Sdystem for transmitting and decoding biphase data, in particular for VPS |
-
1985
- 1985-08-08 JP JP17456885A patent/JPS6235789A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5627595A (en) * | 1990-06-23 | 1997-05-06 | Telefunken | Sdystem for transmitting and decoding biphase data, in particular for VPS |
| US5561469A (en) * | 1992-06-01 | 1996-10-01 | Thomson Consumer Electronics, S.A. | Auxiliary video data slicer with multi-mode peak detection for determining sync and data slicing levels |
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