JPS62290320A - 電源電圧異常検出回路 - Google Patents
電源電圧異常検出回路Info
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- JPS62290320A JPS62290320A JP13252786A JP13252786A JPS62290320A JP S62290320 A JPS62290320 A JP S62290320A JP 13252786 A JP13252786 A JP 13252786A JP 13252786 A JP13252786 A JP 13252786A JP S62290320 A JPS62290320 A JP S62290320A
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- JP
- Japan
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- circuit
- voltage
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- power supply
- supply voltage
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- 230000005856 abnormality Effects 0.000 title claims description 9
- 238000001514 detection method Methods 0.000 claims description 8
- 238000010586 diagram Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Measurement Of Current Or Voltage (AREA)
- Emergency Protection Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
３、発明の詳細な説明
〔産業上の利用分野〕
本発明は、バイポーラ素子及びＭ ＯＳ Ｆ Ｅ Ｔ素
子を混載するＬＳＩにおいて、ＬＳＩに供給される電源
の電圧異常を検出する回路に関する。
子を混載するＬＳＩにおいて、ＬＳＩに供給される電源
の電圧異常を検出する回路に関する。
従来、バイポーラ素子のみで構成されるＬＳＩにおいて
は、基準電圧発生回路９分圧回路及び、電圧比較回路は
全てバイポーラ素子で構成される。
は、基準電圧発生回路９分圧回路及び、電圧比較回路は
全てバイポーラ素子で構成される。
又、ＭＯＳＦＥＴ素子のみで構成されるＬＳＩにおいて
は、上記回路は全てＭＯＳＦＥＴ素子で構成される。
は、上記回路は全てＭＯＳＦＥＴ素子で構成される。
上述した、従来技術の回路構成においては、全ての回路
がバイポーラ素子あるいは、ＭＯＳＦＥＴ素子のどちら
か一方で構成される。
がバイポーラ素子あるいは、ＭＯＳＦＥＴ素子のどちら
か一方で構成される。
ところが、基準電圧発生回路については、バイポーラ素
子で構成される回路は、出力基準電圧の精度及び安定度
の点でＭＯ８Ｆ″ＥＴ素子で構成される回路に比べて有
利であり、又電圧比較回路については、ＭＯＳＦＥＴ素
子で構成される回路は、その入力インピーダンス、消費
電力及びレイアウト面積の点でバイポーラ素子で構成さ
れる回路に比べて有利である。
子で構成される回路は、出力基準電圧の精度及び安定度
の点でＭＯ８Ｆ″ＥＴ素子で構成される回路に比べて有
利であり、又電圧比較回路については、ＭＯＳＦＥＴ素
子で構成される回路は、その入力インピーダンス、消費
電力及びレイアウト面積の点でバイポーラ素子で構成さ
れる回路に比べて有利である。
以上述べたように、従来技術における本回路構成は各々
一長一短の性格を持っている。
一長一短の性格を持っている。
上述した従来の電源電圧異常検出回路に対し、本発明は
バイポーラ素子、及びＭ ＯＳ Ｆ Ｅ Ｔ素子の各々
の特長を活かした回路構成をとることにより、従来にな
い独創的な電源電圧異常検出回路を提供することが可能
である。
バイポーラ素子、及びＭ ＯＳ Ｆ Ｅ Ｔ素子の各々
の特長を活かした回路構成をとることにより、従来にな
い独創的な電源電圧異常検出回路を提供することが可能
である。
本発明による電源電圧異常検出回路は、基準電圧発生回
路をバイポーラ素子で構成することにより、異常検出電
圧のしきい値を高精度、かつ高安定度で実現し、又電圧
比較回路をＭＯ８ｋ″ＥＴ素子で構成することにより、
消費電力が少く、かつ、レイアウト時の占有面積を小さ
くすることが可能であり、かつ入力インピーダンスが高
いことによって前記基準電圧発生回路の高精度、高安定
度の特長を活かすことが可能であると共に１基準電圧発
生回路及び電源電圧分圧回路の動作電流を小さく設計す
ることができ、前述の２つの回路の消費電力をも少くす
ることが可能である。
路をバイポーラ素子で構成することにより、異常検出電
圧のしきい値を高精度、かつ高安定度で実現し、又電圧
比較回路をＭＯ８ｋ″ＥＴ素子で構成することにより、
消費電力が少く、かつ、レイアウト時の占有面積を小さ
くすることが可能であり、かつ入力インピーダンスが高
いことによって前記基準電圧発生回路の高精度、高安定
度の特長を活かすことが可能であると共に１基準電圧発
生回路及び電源電圧分圧回路の動作電流を小さく設計す
ることができ、前述の２つの回路の消費電力をも少くす
ることが可能である。
次に本発明について図面を参照して説明する。
第１図は本発明の実施例のブロック図である。
１はバイポーラ素子で構成される基準電圧発生回路であ
シ、回路定数によシ決定される基準電圧出力ａを出力す
る。２は抵抗素子、あるいはＭＯ８ｋ″ＥＴ素子により
電源電圧ＶＣＣに比例した分圧電圧すを出力する。３は
ＭＯＳＦＥＴ素子で構成される電圧比較回路であシ、上
述したｌ及び２の出力ａ及びｂを入力信号とし、電源電
圧ＶＣＣが一定電圧ＶＴＲ以上あるいは以下で異った論
理出力Ｃを出力する。
シ、回路定数によシ決定される基準電圧出力ａを出力す
る。２は抵抗素子、あるいはＭＯ８ｋ″ＥＴ素子により
電源電圧ＶＣＣに比例した分圧電圧すを出力する。３は
ＭＯＳＦＥＴ素子で構成される電圧比較回路であシ、上
述したｌ及び２の出力ａ及びｂを入力信号とし、電源電
圧ＶＣＣが一定電圧ＶＴＲ以上あるいは以下で異った論
理出力Ｃを出力する。
第２因は第１図に示すプロ、り図の各部信号電圧を示す
。図に示すように、基準電圧発生回路の出力電圧ａは、
電源電圧ＶＣＣがある電圧以上ではほぼ定電圧を保持す
る。又、電源電圧分圧回路の出力電圧すは常にＶｃｃ
Ｋ比例した電圧を発生する。
。図に示すように、基準電圧発生回路の出力電圧ａは、
電源電圧ＶＣＣがある電圧以上ではほぼ定電圧を保持す
る。又、電源電圧分圧回路の出力電圧すは常にＶｃｃ
Ｋ比例した電圧を発生する。
次に、これらの電圧ａ及びｂを比較する電圧比較回路３
の出力ＣはＶＣＣが異常検出電圧のしきい値ＶＴＲＴＲ
以下状態工ではａ）ｂであるため論理値ゝ０“を出力し
、ＶｃｃがＶＴＲ以上、即ち状態■でではａ （ｂとな
シ論理値１１“を出力する。
の出力ＣはＶＣＣが異常検出電圧のしきい値ＶＴＲＴＲ
以下状態工ではａ）ｂであるため論理値ゝ０“を出力し
、ＶｃｃがＶＴＲ以上、即ち状態■でではａ （ｂとな
シ論理値１１“を出力する。
第３図は本発明の第１の実施例である。基準電圧発生回
路１は抵抗Ｒ１，とツェナーダイオードＤｌ。
路１は抵抗Ｒ１，とツェナーダイオードＤｌ。
によシ構成され電源電圧分圧回路２はＭＯ８ＦＢ’ｒ
Ｑ！ａ及びＱｚｂによシ構成される。又、電圧比較回路
３は、Ｍ ＯＳ ｋ’ Ｅ Ｔ Ｑｌ、〜Ｑｓｈで構成
されるがこの回路は、ＭＯＳＦＥＴＫよシ構成される電
圧比較回路として一般的に知らｎた回路である。
Ｑ！ａ及びＱｚｂによシ構成される。又、電圧比較回路
３は、Ｍ ＯＳ ｋ’ Ｅ Ｔ Ｑｌ、〜Ｑｓｈで構成
されるがこの回路は、ＭＯＳＦＥＴＫよシ構成される電
圧比較回路として一般的に知らｎた回路である。
第４図は本発明の第２の実施例である。本図は第３図に
おける基準電圧発生回路１をＲ１，〜Ｒ，ｄ及びＱ、ａ
％Ｑ１ｃによりｍ成されるバンドギャップ基準電圧回路
に変更したものであシ、発生基準電圧をより高精度、高
安定度を実現するものである。
おける基準電圧発生回路１をＲ１，〜Ｒ，ｄ及びＱ、ａ
％Ｑ１ｃによりｍ成されるバンドギャップ基準電圧回路
に変更したものであシ、発生基準電圧をより高精度、高
安定度を実現するものである。
次に電源電圧分圧回路２は抵抗素子Ｒ１１及びＲ２ｂに
より構成している。又電圧比較回路３は第１の実施例と
同一回路である。
より構成している。又電圧比較回路３は第１の実施例と
同一回路である。
以上説明したように、基準電圧発生回路をバイポーラ素
子で捕成し、電圧比較回路をＭＯＳＦＥＴ素子で構成す
ることにより、高精度、高安定。
子で捕成し、電圧比較回路をＭＯＳＦＥＴ素子で構成す
ることにより、高精度、高安定。
低消費電力、かつよシ高密度である電源電圧異常検出回
路をＬＳＩの中に構成することが可能となる。
路をＬＳＩの中に構成することが可能となる。
第１図は本発明の実施例のブロック図、第２図は第１図
の各部信号電圧、第３図は本発明の第１の実施例、第４
図は本発明の第２の実施例を示す。 図中、１・・・・・・基準電圧発生回路、２・・°・・
・電源電圧分圧回路、３・・・・・・電圧比較回路、ａ
・・・・・・基準電圧発生回路出力、ｂ・・・・・・電
源電圧分圧回路出力、Ｃ・・・・・・電圧比較回路出力
。
の各部信号電圧、第３図は本発明の第１の実施例、第４
図は本発明の第２の実施例を示す。 図中、１・・・・・・基準電圧発生回路、２・・°・・
・電源電圧分圧回路、３・・・・・・電圧比較回路、ａ
・・・・・・基準電圧発生回路出力、ｂ・・・・・・電
源電圧分圧回路出力、Ｃ・・・・・・電圧比較回路出力
。
Claims (1)
- バイポーラ素子で構成される基準電圧発生回路と、抵抗
素子あるいはＭＯＳＦＥＴ素子による電源電圧分圧回路
及び上記回路の出力電圧を正側入力及び負側入力として
動作するＭＯＳＦＥＴ素子により構成される電圧比較回
路とからなる電源電圧異常検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13252786A JPS62290320A (ja) | 1986-06-06 | 1986-06-06 | 電源電圧異常検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13252786A JPS62290320A (ja) | 1986-06-06 | 1986-06-06 | 電源電圧異常検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62290320A true JPS62290320A (ja) | 1987-12-17 |
Family
ID=15083377
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13252786A Pending JPS62290320A (ja) | 1986-06-06 | 1986-06-06 | 電源電圧異常検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62290320A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5748463B2 (ja) * | 1977-08-25 | 1982-10-16 |
-
1986
- 1986-06-06 JP JP13252786A patent/JPS62290320A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5748463B2 (ja) * | 1977-08-25 | 1982-10-16 |
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