JPS62126882A - 速度制御装置 - Google Patents
速度制御装置Info
- Publication number
- JPS62126882A JPS62126882A JP60266022A JP26602285A JPS62126882A JP S62126882 A JPS62126882 A JP S62126882A JP 60266022 A JP60266022 A JP 60266022A JP 26602285 A JP26602285 A JP 26602285A JP S62126882 A JPS62126882 A JP S62126882A
- Authority
- JP
- Japan
- Prior art keywords
- memory
- counter
- speed
- motor
- correction amount
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P23/00—Arrangements or methods for the control of AC motors characterised by a control method other than vector control
- H02P23/18—Controlling the angular speed together with angular position or phase
- H02P23/186—Controlling the angular speed together with angular position or phase of one shaft by controlling the prime mover
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の技術分野］
本発明は、周波数発電４１（ＦＧジェネレータ）を用い
てモータの速度制御を行う周波数制御装置に関する。
てモータの速度制御を行う周波数制御装置に関する。
［発明の技術的背景］
ビデオテープレコーダ（ＶＴＲ）のシリンダやキャプス
タン等を回転させるモータはかなり高い精度で一定回転
を保持しなければならない。このようなモータの駆動制
御には、従来から、周波数発電機より得られるＦＧ倍信
号用いられている。
タン等を回転させるモータはかなり高い精度で一定回転
を保持しなければならない。このようなモータの駆動制
御には、従来から、周波数発電機より得られるＦＧ倍信
号用いられている。
この周波数発電機はモータの外周に設けられているＦＧ
パターンに同期してＦＧ倍信号発生するもので、このＦ
Ｇ倍信号前記モータの回転数に応じた周波数を有する。
パターンに同期してＦＧ倍信号発生するもので、このＦ
Ｇ倍信号前記モータの回転数に応じた周波数を有する。
従って、この周波数が常に一定となるように制御するこ
とによって、モータの回転速度を所定の速度に保持する
。従って、ＦＧパターンの精度の良し悪しはこの速度制
御に大きな影響を及ぼす。
とによって、モータの回転速度を所定の速度に保持する
。従って、ＦＧパターンの精度の良し悪しはこの速度制
御に大きな影響を及ぼす。
［背景技術の問題点コ
上記ＦＧ倍信号用いる従来例のモータ速度制御回路では
、仮りにモータが一定回転で回っていても、周波数発電
機の精度不足により周波数発電別から得られるＦＧ倍信
号周波数にむら（変動分）があると、前記モータの回転
数を決定する速度検波電圧（ＡＦＣ電圧）には前記ＦＧ
むらに応じた成分が現われてしまう。従って、このＡＦ
Ｃ電圧で前記モータの回転をｉＱ御すると、前記むらに
応じてモータの回転が変動してしまう。このような速度
制御回路をＶＴＲ等に使用すると、ジッタ等を起こす要
因となる。そこで、上記周波数発電機の精度不足による
モータの回転むらをなくすには、サーボループの周波数
特性のカットオフ周波数を、モータの回転数より十分低
い所に設定すれば良い。
、仮りにモータが一定回転で回っていても、周波数発電
機の精度不足により周波数発電別から得られるＦＧ倍信
号周波数にむら（変動分）があると、前記モータの回転
数を決定する速度検波電圧（ＡＦＣ電圧）には前記ＦＧ
むらに応じた成分が現われてしまう。従って、このＡＦ
Ｃ電圧で前記モータの回転をｉＱ御すると、前記むらに
応じてモータの回転が変動してしまう。このような速度
制御回路をＶＴＲ等に使用すると、ジッタ等を起こす要
因となる。そこで、上記周波数発電機の精度不足による
モータの回転むらをなくすには、サーボループの周波数
特性のカットオフ周波数を、モータの回転数より十分低
い所に設定すれば良い。
しかし、このようにすると逆にアンチローリング等の外
乱に対するサーボループの抑圧能力が弱くなってしまう
という欠点が生じる。また、ＦＧパターン自体の精度を
高くすればＦＧ倍信号精度不足は解決されるが、これに
は技術的な困難を伴うと共に、コストが高くなるという
欠点がある。
乱に対するサーボループの抑圧能力が弱くなってしまう
という欠点が生じる。また、ＦＧパターン自体の精度を
高くすればＦＧ倍信号精度不足は解決されるが、これに
は技術的な困難を伴うと共に、コストが高くなるという
欠点がある。
［発明の目的］
本発明の目的は上記の欠点に鑑み、周波数発電数の精度
不足からくるＦＧ倍信号らの速度制御に対する影響を、
外乱に対する抑圧能力を弱めることなく取り除いた速度
制御装置を提供することにある。
不足からくるＦＧ倍信号らの速度制御に対する影響を、
外乱に対する抑圧能力を弱めることなく取り除いた速度
制御装置を提供することにある。
［発明の概要］
本発明は、周波数発電機の精度不足による変動分を含む
ＦＧ倍信号検波して得られる速度検波電圧（デジタル量
）から変動分を抽出し、これを補正量としてメモリに記
憶し、モータの速度制御時、得られる速度検波電圧から
前記補正量を減算した修正速度検波電圧にてモータの速
度制御を行うことにより、上記目的を達成するものであ
る。
ＦＧ倍信号検波して得られる速度検波電圧（デジタル量
）から変動分を抽出し、これを補正量としてメモリに記
憶し、モータの速度制御時、得られる速度検波電圧から
前記補正量を減算した修正速度検波電圧にてモータの速
度制御を行うことにより、上記目的を達成するものであ
る。
［発明の実施例］
以下本発明一実施例を図面を参照して説明する。
第１図は本発明の速度制御装置の一実施例を示したブロ
ック図である。１は周波数発電機でＦＧパターンの回転
に同期したＦＧ倍信号出力する。２は波形整形回路で、
入力されたＦＧ倍信号波形を整形してＦＧパルス信号２
００とする。３は読み出しパルス作成回路で、入力され
るＦＧパルス信号２００の立ち下がりで読み出しパルス
３００を出力する。シフトレジスタ４は入力された読み
出しパルス３００を］クロツタ分だけ遅らせてクリアパ
ルス４００を作出する。カウンタ５はカウンタクロック
パルス５００ににつてカラン１〜アツプしてカウント値
（速度検波電圧のデジタル量に相当）６００を出力する
と共に、前記クリアパルス４００によってその方つント
値がクリアされる。６は上限・下限検出回路でカウンタ
５から出力されるカウント値６００が上限値でおるか下
限値であるかを検出し、それぞれの場合に固定値をメモ
リ７に出力する。
ック図である。１は周波数発電機でＦＧパターンの回転
に同期したＦＧ倍信号出力する。２は波形整形回路で、
入力されたＦＧ倍信号波形を整形してＦＧパルス信号２
００とする。３は読み出しパルス作成回路で、入力され
るＦＧパルス信号２００の立ち下がりで読み出しパルス
３００を出力する。シフトレジスタ４は入力された読み
出しパルス３００を］クロツタ分だけ遅らせてクリアパ
ルス４００を作出する。カウンタ５はカウンタクロック
パルス５００ににつてカラン１〜アツプしてカウント値
（速度検波電圧のデジタル量に相当）６００を出力する
と共に、前記クリアパルス４００によってその方つント
値がクリアされる。６は上限・下限検出回路でカウンタ
５から出力されるカウント値６００が上限値でおるか下
限値であるかを検出し、それぞれの場合に固定値をメモ
リ７に出力する。
７はメモリで、読み出しパルス３００によってカウンタ
５のカウント値６００を記憶したり、おるいはこれを減
算器１５に出力すると共に、上限・下限検出回路６から
の固定値を記憶する。８はメモリ（ＲＯＭ＞で、速度検
波電圧の中心値に対応するロック点仮想（伯が入ってい
る。９は減算回路で、カウンタ５から入力されるカウン
ト値６００から前記ロック点仮想値を減算し、その減算
結果をＦＧむら補正用メモリ（ＥＰＲＯＭ＞１１に出力
する。
５のカウント値６００を記憶したり、おるいはこれを減
算器１５に出力すると共に、上限・下限検出回路６から
の固定値を記憶する。８はメモリ（ＲＯＭ＞で、速度検
波電圧の中心値に対応するロック点仮想（伯が入ってい
る。９は減算回路で、カウンタ５から入力されるカウン
ト値６００から前記ロック点仮想値を減算し、その減算
結果をＦＧむら補正用メモリ（ＥＰＲＯＭ＞１１に出力
する。
１０はカウンタで読み出しパルス３００が入力される毎
にカウントアツプし、このカウント（直をアドレスデー
タ８００としてＦＧむら補正用メモリ１１に出力する。
にカウントアツプし、このカウント（直をアドレスデー
タ８００としてＦＧむら補正用メモリ１１に出力する。
なお、カウンタ１０はヘッドスイッチングパルス１００
によってクリアされる。１１はＦＧむら補正用メモリで
、読み出しパルス３００を遅延回路１２によって遅延し
て作出されるｍき込みパルス７００に同期して、減算回
路９から入力される減算結果をカウンタ１０から与えら
れるアドレスデータ８００が指定するアドレスに記憶す
ると共に、このアドレスデータ８００が指定するアドレ
スの記憶内容をラッチ回路１３に出力する。なおＦＧむ
ら補正用メモ１月１はリード／ライトイネーブル信Ｑ９
００によって読み出し状態あるいは書き込み状態可能と
なる。ラッチ回路１３は遅延回路１４により作成された
ラッチ信号１０００によってＦＧむら補正用メモ１月１
から読み出されたデータをラッチし、ラッチ結果を減算
器１５に出力する。１５は減算器でメモリ７から供給さ
れるカウント値６００から、ラッチ回路１３より供給さ
れるデータを減算し、その結果（修正速度検波電圧に相
当）をデユーティ変調回路１６に出力する。
によってクリアされる。１１はＦＧむら補正用メモリで
、読み出しパルス３００を遅延回路１２によって遅延し
て作出されるｍき込みパルス７００に同期して、減算回
路９から入力される減算結果をカウンタ１０から与えら
れるアドレスデータ８００が指定するアドレスに記憶す
ると共に、このアドレスデータ８００が指定するアドレ
スの記憶内容をラッチ回路１３に出力する。なおＦＧむ
ら補正用メモ１月１はリード／ライトイネーブル信Ｑ９
００によって読み出し状態あるいは書き込み状態可能と
なる。ラッチ回路１３は遅延回路１４により作成された
ラッチ信号１０００によってＦＧむら補正用メモ１月１
から読み出されたデータをラッチし、ラッチ結果を減算
器１５に出力する。１５は減算器でメモリ７から供給さ
れるカウント値６００から、ラッチ回路１３より供給さ
れるデータを減算し、その結果（修正速度検波電圧に相
当）をデユーティ変調回路１６に出力する。
次に本実施例の動作について説明する。先ず、周波数発
電機の精度不足から来るＦＧ倍信号らを補正するために
、予めその補正量をＦＧむら補正用メモリ１１に記憶さ
せておく。この場合、ＶＴＲのシリンダは通常３０Ｈ２
で回転するため、第２図に示すような閉ループ特性の回
路で一般的な速度位相制御を外乱の影響をなくすため無
負荷状態にて行ない、ＦＧムラの影響を除いた状態で定
速回転させる。そして、上記補正量をＦＧむら補正用メ
モリ１１に記憶させる動作を以下の如く行う。周波数発
電１Ｆ！１から発生されるＦＧ倍信号波形整形回路２に
よって波形整形したＦＧパルス信＠２００は第３図（Ｂ
）で示したような波形を有し、読み出しパルス作成回路
３はこのＦＧパルス信号２００の立ち下がりで第３図（
Ｃ）に示すような読み出しパルス３００をシフトレジス
タ４、メモリ７、遅延回路１２、カウンタ１０に出力す
る。シフトレジスタ４は入力された読み出しパルス３０
０から第３図（Ｄ＞に示すようなりリアパルス４００を
カウンタ５に出力して、このカウンタ５のカウント値を
クリアする。カウンタ５はこのクリアされた時点から再
びクロック５００をカウントし、第３図（Ｅ）で示す如
くカウント値６００を減桿回路９に供給する。読み出し
パルス作成及びクリアパルス作成用クロックはカウンタ
用クロックよりも高い周波数であり、カウンタ用クロッ
クの１周期内で読み出しパルス、クリアパルスが発生さ
れ、カウンタ値の変化しない状態で読み出し及びクリア
が行なわれる。減算回路９では入力されたカウンタ値か
らメモリ８より読み出されるロック点仮想値をＷ算し、
その減算結果をＦＧむら補正用メモリ１１に供給する。
電機の精度不足から来るＦＧ倍信号らを補正するために
、予めその補正量をＦＧむら補正用メモリ１１に記憶さ
せておく。この場合、ＶＴＲのシリンダは通常３０Ｈ２
で回転するため、第２図に示すような閉ループ特性の回
路で一般的な速度位相制御を外乱の影響をなくすため無
負荷状態にて行ない、ＦＧムラの影響を除いた状態で定
速回転させる。そして、上記補正量をＦＧむら補正用メ
モリ１１に記憶させる動作を以下の如く行う。周波数発
電１Ｆ！１から発生されるＦＧ倍信号波形整形回路２に
よって波形整形したＦＧパルス信＠２００は第３図（Ｂ
）で示したような波形を有し、読み出しパルス作成回路
３はこのＦＧパルス信号２００の立ち下がりで第３図（
Ｃ）に示すような読み出しパルス３００をシフトレジス
タ４、メモリ７、遅延回路１２、カウンタ１０に出力す
る。シフトレジスタ４は入力された読み出しパルス３０
０から第３図（Ｄ＞に示すようなりリアパルス４００を
カウンタ５に出力して、このカウンタ５のカウント値を
クリアする。カウンタ５はこのクリアされた時点から再
びクロック５００をカウントし、第３図（Ｅ）で示す如
くカウント値６００を減桿回路９に供給する。読み出し
パルス作成及びクリアパルス作成用クロックはカウンタ
用クロックよりも高い周波数であり、カウンタ用クロッ
クの１周期内で読み出しパルス、クリアパルスが発生さ
れ、カウンタ値の変化しない状態で読み出し及びクリア
が行なわれる。減算回路９では入力されたカウンタ値か
らメモリ８より読み出されるロック点仮想値をＷ算し、
その減算結果をＦＧむら補正用メモリ１１に供給する。
この時ＦＧむら補正用メモリ１１はライト 。
イネーブル信号９００が入力されており、第３図（Ａ＞
のヘッドスイッチングパルス１００によってクリアされ
た後カウントを開始する。カウンタ１０から供給される
アドレスデータ８００が指定するアドレス部に、遅延回
路１２から供給される書き込みパルス７００に同期して
、減筒回路９より供給される減算結果がこのＦＧむら補
正用メモ１月１に記憶遅延回路にはアドレスデータ８０
０の出力タイミングと書き込みパルス７００の出力タイ
ミングを調整するために挿入されている。その遅延時間
は読み出しパルス幅に比べて十分短かく、カウンタ１ｏ
の動作に要する時間よりも長く選ばれている。また、Ｆ
Ｇムラはシリンダ回転周期で繰り返すものであるため、
上記補正量をＦＧむら補正用メモリ１１に記憶させる動
作はＦＧ倍信号シリンダ回転１回転分について行えば良
い。なお、＋＝ａむら補正用メモリ１１にはカウンタ５
から供給されるカウント値６００のロック点仮想値から
ずれた量が記憶され、ずれていない場合、即ちＦＧむら
がない場合は全て零が記憶される。ここで、ＦＧむら補
正用メモリＨに記憶される補正量を具体的な例で説明す
る。
のヘッドスイッチングパルス１００によってクリアされ
た後カウントを開始する。カウンタ１０から供給される
アドレスデータ８００が指定するアドレス部に、遅延回
路１２から供給される書き込みパルス７００に同期して
、減筒回路９より供給される減算結果がこのＦＧむら補
正用メモ１月１に記憶遅延回路にはアドレスデータ８０
０の出力タイミングと書き込みパルス７００の出力タイ
ミングを調整するために挿入されている。その遅延時間
は読み出しパルス幅に比べて十分短かく、カウンタ１ｏ
の動作に要する時間よりも長く選ばれている。また、Ｆ
Ｇムラはシリンダ回転周期で繰り返すものであるため、
上記補正量をＦＧむら補正用メモリ１１に記憶させる動
作はＦＧ倍信号シリンダ回転１回転分について行えば良
い。なお、＋＝ａむら補正用メモリ１１にはカウンタ５
から供給されるカウント値６００のロック点仮想値から
ずれた量が記憶され、ずれていない場合、即ちＦＧむら
がない場合は全て零が記憶される。ここで、ＦＧむら補
正用メモリＨに記憶される補正量を具体的な例で説明す
る。
速度検波回路のダイナミックレンジを２０４８段階とし
た場合、ロック点仮想値をカウント値６００のセンタ値
の１０２４とした時、スイッチングパルスからのＦＧパ
ルス１個目の実際のカウンタ値が１０１９．２個目のカ
ウンタ１直１０３４．３個目のカウンタ（直は１０４４
だとする。この場合ＦＧむら補正用メモリ１１には−５
、＋１０、＋２０・・・・・・というデジタル禮がモー
タ１回転分記憶される。
た場合、ロック点仮想値をカウント値６００のセンタ値
の１０２４とした時、スイッチングパルスからのＦＧパ
ルス１個目の実際のカウンタ値が１０１９．２個目のカ
ウンタ１直１０３４．３個目のカウンタ（直は１０４４
だとする。この場合ＦＧむら補正用メモリ１１には−５
、＋１０、＋２０・・・・・・というデジタル禮がモー
タ１回転分記憶される。
次に上記補正量記憶動作をした後、モータを速度制御す
る動作について説明する。先ずモータが起動されると周
波数発電機１からＦＧ倍信号波形整形回路２に入力され
、ＦＧパルス２００が読み出しパルス作成回路３に入力
される。これにより、読み出しパルス作成回路３は読み
出しパルス３００をシフトレジスタ４、メモリ７、遅延
回路１２、カウンタ１０に出力する。この時、シフトレ
ジスタ４は入力読み出しパルスを１クロツクずらして作
出したクリアパルス４００をカウンタ５に出力する。
る動作について説明する。先ずモータが起動されると周
波数発電機１からＦＧ倍信号波形整形回路２に入力され
、ＦＧパルス２００が読み出しパルス作成回路３に入力
される。これにより、読み出しパルス作成回路３は読み
出しパルス３００をシフトレジスタ４、メモリ７、遅延
回路１２、カウンタ１０に出力する。この時、シフトレ
ジスタ４は入力読み出しパルスを１クロツクずらして作
出したクリアパルス４００をカウンタ５に出力する。
カウンタ５はこのクリアパルス４００によってクリアさ
れた後、クロック５００によってカウントアツプを行い
、そのカウント値６００を上限・下限検出回路６及びメ
モリ７に供給する。このような状態で、カウンタ５がカ
ウントを続行している状態で、読み出しパルス作成回路
３が次の読み出しパルス３００を出力すると、これによ
りメモリ７は供給されているカウント値６００を記憶す
ると共に、これを読み出して減紳器１５に出力する。な
おこの時カウンタ５から出力されるカウント値６００が
第３図（Ｅ）の傾斜部分以外の値である時には、上限・
下限検出回路６から供給される固定値がメモリ７に記憶
され、この固定値が減算回路１５に出力される。また、
これと同時にカウンタ１０は読み出しパルス３００に対
応したアドレスデータ８００をＦＧむら補正用メモ１月
１に出力する。この時、ＦＧむら補正用メモリ１１には
リードイネーブル信号９００が出力されていて、カウン
タ１０から供給されるアドレスデータのアドレス部に記
憶されている補正量をラッチ回路１３に出力する。ラッ
チ回路１３は上記読み出しパルス３００を遅延回路１２
．１４により遅延して作出されるラッチ信号１０００に
よって、入力される補正量をラッチし、これを減算器１
５に出力する。このため、減算器１５ではメモリ７から
入力されるカウント値６００から補正量が減算され、そ
の結果（修正速度検波電圧に相当）がデユーティ変調回
路１６に入力される。従って、減算器１５からデユーテ
ィ変調回路１６に供給されるデータはＦＧむらが取り除
かれたカラン目角となり、デユーティ変調回路１６は、
これに基づいてモータ制御回路の速度１り御デユーティ
を出力するため、結果として周波数発電機の精度不足に
よるＦＧ倍信号らによる影響をモータは受けないことに
なる。従って、デユーティ変調回路１６は外乱によるＦ
Ｇ倍信号変化に対してのみそのデユーティを変化させて
出力することになる。
れた後、クロック５００によってカウントアツプを行い
、そのカウント値６００を上限・下限検出回路６及びメ
モリ７に供給する。このような状態で、カウンタ５がカ
ウントを続行している状態で、読み出しパルス作成回路
３が次の読み出しパルス３００を出力すると、これによ
りメモリ７は供給されているカウント値６００を記憶す
ると共に、これを読み出して減紳器１５に出力する。な
おこの時カウンタ５から出力されるカウント値６００が
第３図（Ｅ）の傾斜部分以外の値である時には、上限・
下限検出回路６から供給される固定値がメモリ７に記憶
され、この固定値が減算回路１５に出力される。また、
これと同時にカウンタ１０は読み出しパルス３００に対
応したアドレスデータ８００をＦＧむら補正用メモ１月
１に出力する。この時、ＦＧむら補正用メモリ１１には
リードイネーブル信号９００が出力されていて、カウン
タ１０から供給されるアドレスデータのアドレス部に記
憶されている補正量をラッチ回路１３に出力する。ラッ
チ回路１３は上記読み出しパルス３００を遅延回路１２
．１４により遅延して作出されるラッチ信号１０００に
よって、入力される補正量をラッチし、これを減算器１
５に出力する。このため、減算器１５ではメモリ７から
入力されるカウント値６００から補正量が減算され、そ
の結果（修正速度検波電圧に相当）がデユーティ変調回
路１６に入力される。従って、減算器１５からデユーテ
ィ変調回路１６に供給されるデータはＦＧむらが取り除
かれたカラン目角となり、デユーティ変調回路１６は、
これに基づいてモータ制御回路の速度１り御デユーティ
を出力するため、結果として周波数発電機の精度不足に
よるＦＧ倍信号らによる影響をモータは受けないことに
なる。従って、デユーティ変調回路１６は外乱によるＦ
Ｇ倍信号変化に対してのみそのデユーティを変化させて
出力することになる。
ここで速度制御について若干説明を追加すると、カウン
タ５は例えば、１５ビツトのカウンタであり、その下位
１１ビツトが速度データとしてメモリ７に転送される。
タ５は例えば、１５ビツトのカウンタであり、その下位
１１ビツトが速度データとしてメモリ７に転送される。
カウンタ５がクリアされた後、サーボロック点までのク
ロック５００の数を（２０４８Ｘ５＋１０２４） ＝１
１２６４と設定したとすると、上位４ビツトが０１０１
の場合のみカウンタ５の下位１１ビツトがメモリ７に書
き込まれる。上位４ビツト０１０１未満の場合メモリ７
にはＯ（零）が、０１０１以上の場合メモリ７には２０
４７が書き込まれる。そしてこのようにして速度検波の
台形波が作られる。
ロック５００の数を（２０４８Ｘ５＋１０２４） ＝１
１２６４と設定したとすると、上位４ビツトが０１０１
の場合のみカウンタ５の下位１１ビツトがメモリ７に書
き込まれる。上位４ビツト０１０１未満の場合メモリ７
にはＯ（零）が、０１０１以上の場合メモリ７には２０
４７が書き込まれる。そしてこのようにして速度検波の
台形波が作られる。
本実施例によれば、ＦＧむら補正用メモリ１１に予め周
波数発電機の精度不足からくるＦＧ倍信号ずれ量（補正
量）を記憶させておき、速度制御時にモータの速度を決
めるカウント値（デジタル値）から前記ずれｌを減算し
、その結果に基づいてデユーティ変調回路１６のデユー
ティを決めているため、周波数発電機の精度不足がらく
るＦＧ倍信号らのモータ速度制御に対する影響をサーボ
ループの外乱に対する抑圧能力を弱めることなく排除す
ることができる。
波数発電機の精度不足からくるＦＧ倍信号ずれ量（補正
量）を記憶させておき、速度制御時にモータの速度を決
めるカウント値（デジタル値）から前記ずれｌを減算し
、その結果に基づいてデユーティ変調回路１６のデユー
ティを決めているため、周波数発電機の精度不足がらく
るＦＧ倍信号らのモータ速度制御に対する影響をサーボ
ループの外乱に対する抑圧能力を弱めることなく排除す
ることができる。
［発明の効果コ
以上記述した如く本発明の速度制御装置によれＪ 、（
資）波数発電様の精度不足による変動分を含むＦＧ倍信
号検波して得られる速度検波電圧（デジタルｍ）から変
動分を抽出し、これを補正量としてメモリに記憶し、モ
ータの速度制御時、（ｑられる速度検波電圧から前記補
正量を減算した修正速度検波電圧にてモータの速度制御
を行うことにより、周波数発電機の精度不足からくるＦ
Ｇ倍信号らの速度高制御に対する影響を外乱に対する抑
圧能力を弱めることなく排除し得る効果がおる。
資）波数発電様の精度不足による変動分を含むＦＧ倍信
号検波して得られる速度検波電圧（デジタルｍ）から変
動分を抽出し、これを補正量としてメモリに記憶し、モ
ータの速度制御時、（ｑられる速度検波電圧から前記補
正量を減算した修正速度検波電圧にてモータの速度制御
を行うことにより、周波数発電機の精度不足からくるＦ
Ｇ倍信号らの速度高制御に対する影響を外乱に対する抑
圧能力を弱めることなく排除し得る効果がおる。
第１図は本発明の速度制御装置の一実施例を示したブロ
ック図、第２図はＦＧムラの補正値をメモリに書込む場
合の速度制御ループの閉ループ特性例を示した図、第３
図は第１図に示した速度制御Ｉ表装置信号タイミングチ
ャートである。 １・・・周波数発電機、３・・・読み出しパルス作成回
路、４・・・シフトレジスタ、 ５・・・カウ
ンタ、６・・・上限・下限検出回路、 ７，８・・・メ
モリ、９・・・減算回路、 １１・・・ＦＧむら補正
用メモリ、１５・・・減算器 １６・・・デユー
ティ変調回路代理人 弁理士 則 近 憲 佑 同 宇治 弘 第２図 第３図
ック図、第２図はＦＧムラの補正値をメモリに書込む場
合の速度制御ループの閉ループ特性例を示した図、第３
図は第１図に示した速度制御Ｉ表装置信号タイミングチ
ャートである。 １・・・周波数発電機、３・・・読み出しパルス作成回
路、４・・・シフトレジスタ、 ５・・・カウ
ンタ、６・・・上限・下限検出回路、 ７，８・・・メ
モリ、９・・・減算回路、 １１・・・ＦＧむら補正
用メモリ、１５・・・減算器 １６・・・デユー
ティ変調回路代理人 弁理士 則 近 憲 佑 同 宇治 弘 第２図 第３図
Claims (1)
- モータと共に回転する周波数発電機から得られるＦＧ信
号を検波して得られる速度検波電圧に基づいて、前記モ
ータの速度制御を行う速度制御装置において、周波数発
電機の精度不足から発生するＦＧ信号の周波数変動分を
補正量として抽出する補正量抽出手段と、抽出された補
正量を記憶する補正量記憶手段と、モータの速度制御時
、ＦＧ信号を検波して得られる速度検波電圧から前記補
正量記憶手段より前記ＦＧ信号に同期して読み出される
補正量を減算して修正速度検波電圧を作出する補正手段
とを具備し、この修正速度検波電圧に基づいて前記モー
タの速度制御を行うことを特徴とする速度制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60266022A JPS62126882A (ja) | 1985-11-28 | 1985-11-28 | 速度制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60266022A JPS62126882A (ja) | 1985-11-28 | 1985-11-28 | 速度制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62126882A true JPS62126882A (ja) | 1987-06-09 |
Family
ID=17425292
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60266022A Pending JPS62126882A (ja) | 1985-11-28 | 1985-11-28 | 速度制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62126882A (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6426385A (en) * | 1987-07-20 | 1989-01-27 | Sanyo Electric Co | Correction of motor revolution nonuniformity |
| JPH01101721A (ja) * | 1987-10-14 | 1989-04-19 | Matsushita Electric Ind Co Ltd | ディジタルリップルフィルタ |
| JPH01103183A (ja) * | 1987-10-14 | 1989-04-20 | Matsushita Electric Ind Co Ltd | サーボ装置 |
| JPH01218374A (ja) * | 1988-01-15 | 1989-08-31 | Deutsche Thomson Brandt Gmbh | ロータ回転数の制御方法および回路装置 |
| JPH01252187A (ja) * | 1988-03-31 | 1989-10-06 | Canon Inc | 速度制御装置 |
| JPH02246785A (ja) * | 1989-03-17 | 1990-10-02 | Matsushita Electric Ind Co Ltd | 速度制御装置 |
| JPH03101194U (ja) * | 1990-01-29 | 1991-10-22 | ||
| EP0689282A1 (en) * | 1994-06-23 | 1995-12-27 | SANYO ELECTRIC Co., Ltd. | Motor servo system |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5826580A (ja) * | 1981-08-06 | 1983-02-17 | Canon Inc | 周波数発電機補正方法 |
-
1985
- 1985-11-28 JP JP60266022A patent/JPS62126882A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5826580A (ja) * | 1981-08-06 | 1983-02-17 | Canon Inc | 周波数発電機補正方法 |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6426385A (en) * | 1987-07-20 | 1989-01-27 | Sanyo Electric Co | Correction of motor revolution nonuniformity |
| JPH01101721A (ja) * | 1987-10-14 | 1989-04-19 | Matsushita Electric Ind Co Ltd | ディジタルリップルフィルタ |
| JPH01103183A (ja) * | 1987-10-14 | 1989-04-20 | Matsushita Electric Ind Co Ltd | サーボ装置 |
| JPH01218374A (ja) * | 1988-01-15 | 1989-08-31 | Deutsche Thomson Brandt Gmbh | ロータ回転数の制御方法および回路装置 |
| JPH01252187A (ja) * | 1988-03-31 | 1989-10-06 | Canon Inc | 速度制御装置 |
| JPH02246785A (ja) * | 1989-03-17 | 1990-10-02 | Matsushita Electric Ind Co Ltd | 速度制御装置 |
| JPH03101194U (ja) * | 1990-01-29 | 1991-10-22 | ||
| EP0689282A1 (en) * | 1994-06-23 | 1995-12-27 | SANYO ELECTRIC Co., Ltd. | Motor servo system |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP2718311B2 (ja) | 時間軸補正装置 | |
| EP0379212B1 (en) | Jitter compensation circuit for processing jitter components of reproduced video signal | |
| US5572157A (en) | Digital phase-looked loop circuit | |
| US3939438A (en) | Phase locked oscillator | |
| JPS6258196B2 (ja) | ||
| JPS62126882A (ja) | 速度制御装置 | |
| KR100213959B1 (ko) | 회전체의 위상 및 속도 제어용 마이크로 컴퓨터 사용 디지탈 서보시스템 | |
| JPH04270570A (ja) | デジタル位相同期ループ回路 | |
| JPH09130823A (ja) | 映像信号処理装置 | |
| US5065385A (en) | Time base control system with coarse and fine correction for a spindle servo | |
| US4751575A (en) | Method of timing sampling frequency pulses for digitizing and storing color television signals reproduced from magnetic tape | |
| US4688111A (en) | Time base corrector | |
| JPH0311012B2 (ja) | ||
| JPS62110382A (ja) | 時間軸誤差補正装置 | |
| JPS6156585A (ja) | 時間軸補正装置のクロツク発生回路 | |
| JP3024534B2 (ja) | 周波数変換回路 | |
| JP3095853B2 (ja) | 時間軸補正装置 | |
| JPS60182821A (ja) | クロツク信号発生器 | |
| JP2639925B2 (ja) | 位相基準周期自動設定装置 | |
| JP2810263B2 (ja) | 信号発生手段 | |
| JPS6355812B2 (ja) | ||
| JPH10188479A (ja) | ディジタル信号記録装置及び方法 | |
| JP2553795B2 (ja) | ベロシティエラー検出装置 | |
| JPS62229564A (ja) | トラツキングずれ調整装置 | |
| JPH02137594A (ja) | ディジタルタイムベースコレクタのクロック再生方法 |