JPS6148941A - 半導体装置の電極形成方法 - Google Patents

半導体装置の電極形成方法

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JPS6148941A
JPS6148941A JP17068384A JP17068384A JPS6148941A JP S6148941 A JPS6148941 A JP S6148941A JP 17068384 A JP17068384 A JP 17068384A JP 17068384 A JP17068384 A JP 17068384A JP S6148941 A JPS6148941 A JP S6148941A
Authority
JP
Japan
Prior art keywords
wiring
insulating film
film
layer
resin
Prior art date
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Pending
Application number
JP17068384A
Other languages
English (en)
Inventor
Shoichi Nakagawa
正一 中川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
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Filing date
Publication date
Application filed by Matsushita Electronics Corp filed Critical Matsushita Electronics Corp
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Publication of JPS6148941A publication Critical patent/JPS6148941A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/28Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268

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  • Engineering & Computer Science (AREA)
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  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は半導体装置の多層配線形成法、とくに、金属配
線の段切れ防止を考照した多層配線形成法に関するもの
である。
従来例の構成とその問題点 半導体素子の高集積化、高性能化とともにチップ面積を
抑える几めにも、回路設計の自由度を上げるためにも、
多層配線の要求が増々高まりつつある。第1図は従来法
による代表的二層配線形成の断面構造図である。半導体
基板1上に被着し九絶縁膜2にコンタクトホールAを開
孔し、第1層アルミニウム配線3を形成する。次に層間
絶縁膜4を被着したあと、スルホールBをコンタクトホ
ールAの領域からずらせて開孔し、第2層アルミニウム
配線6t−形成している。
スルホールBをコンタクトホールA領域上に開孔しよう
とすると、絶縁膜の段差と交差する部分で配線が段切れ
する危険性がある。開孔径が5〜6ミクロン以下とパタ
ーンが微細化すれば、コンタクトホール真上にスルホー
ルを開孔することすら困難となシ、また開孔できたとし
ても、第2層アルミニウム配線の段差は第1層の配線よ
りきつくなるので、上記通常の方法では配線がほとんど
不可能である。
発明の目的 本発明はコンタクトホール領域上にスルホールをスルホ
ール径が6〜6ミクロン以下と小さくなっても容易に開
孔し、設計の自由度を向上させるとともに、チップ面積
縮少を可能ならしめる半導体装置の電極形成方法を提供
せんとするものである0 発明の構成 この発明の目的を達成するため、コンタクトボールを1
ずアルミニウムで埋め込んで、その上に第1層アルミニ
ウム配線を形成し且つ第1層アルミニウム配線以外の領
域を絶縁膜で埋め込むことにより、第1層の配線の上面
と絶縁膜上面とを同一水準にすることにょシ半導体装置
表面を平坦化し、ついでその上に層間絶縁膜を被着し、
且つコンタクトホール領域上にスルホールを開孔して第
2層のアルミニウム配線を形成する工程をそなえたもの
である。
本発明により、絶縁膜開孔部分のアルミニウム配線を平
坦化し且つ、アルミニウム配線以外の領域には絶縁膜を
埋め込み半導体装置表面全体を平坦化することにより、
コンタクトホール領域上にスルホールを開孔できると同
時に第2層のアルミニウム配線の段切れを防止すること
が出来る。
実施例の説明 以下本発明の実施例について、第2図a % 8の工程
順断面図を参照しながら説明する。
第2図aにおいて、半導体基板1止に絶縁膜2を形成し
、コンタクトホールAを開孔したのち、全面に第1のア
ルミニウム薄膜らを形成する。次に例えばホトレジスト
などの粘性樹脂7を塗布する。このときアルミニウム膜
6の表面の凹凸に比し、樹脂7表面の凹凸を平坦化する
ことができる。
よってコンタクトホール開孔部分の樹脂7の膜厚は、他
の領域に比し厚く形成されている。次に樹脂膜7ととも
に、アルミニウム薄膜6をドライエツチング法などで絶
縁膜2が露呈するまでエツチングして除去する。残存し
ているコンタクトホールA領域上の樹脂を除去すると第
2図すに示すように、表面が平坦化されることになり、
コンタクトホールAにアルミニウムが埋め込まれた状態
となる。そのちと第2図Cに示すように、第1層配線の
主部となる第2のアルミニウム薄膜8を形成する。次に
第2の絶縁膜9を被着し、さらにその上に粘性樹脂10
を全面塗布する。この場合も、凹部に塗布され几樹脂膜
厚は厚くなり、樹脂10の表面は平坦化される。次に樹
脂1oとともに、リアクティブイオンエッチ法などにょ
シ、第2の絶縁膜9を第1層アルミニウム配線が露呈す
るまでエツチングする。そのあと、凹部に樹脂が残存し
ておれば除去することにより、第2図dに示すように、
第1層アルミニウム配線の最上面と第2の絶縁膜9とが
平坦化された状態が実現できる。
次に第2図eに示すように、第3の絶縁膜11を全面被
着したあと、コンタクトホールA領域上にスルホールB
を開孔し、続いて、第2層の配線として、第3のアルミ
ニウム薄膜12を形成シて二層配線が完成する。このと
きスルポールBの開孔は下地が平坦化されているので、
コンタクトポールA領域上でも容易であり、且つ第2層
配線の段切れの危険性は著しるしく軽減され得る。
発明の効果 実施例で明らかなように、コンタクトホール上にスルホ
ールが容易に開孔でき、且つ第1層配線の段切れの心配
はなく、且つ第2層配線の段切れの危険性を著しく軽減
することができる。
【図面の簡単な説明】
第1図は従来の二層配線断面構、遣口、第2図a〜eは
本発明による二層配線形成工程の実施例を示す工程順断
面図である。 1・・・・・・半導体基板、2,4,9.11・・・・
・・絶縁膜、7.io・・・・・・粘性樹脂、3.5.
6 、El、12・・・・・・アルミニウム薄膜、A・
・・・・・コンタクトホールペB・・・・・・スルホー
ル。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 第2図

Claims (1)

    【特許請求の範囲】
  1.  半導体基板表面を覆う第1の絶縁膜に開孔を形成し、
    同開孔を金属薄膜で埋め込み、前記金属薄膜および第1
    の絶縁膜上に第1層の配線を形成し、前記第1層配線以
    外の領域を第2の絶縁膜で埋め込むことにより表面を平
    坦化し、次に第3の絶縁膜を被着してのち、前記第1の
    絶縁膜開孔上の位置に、前記第3の絶縁膜を開孔し、こ
    の上に第2層の金属薄膜配線を形成することを特徴とす
    る半導体装置の電極形成方法。
JP17068384A 1984-08-16 1984-08-16 半導体装置の電極形成方法 Pending JPS6148941A (ja)

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JPS6148941A true JPS6148941A (ja) 1986-03-10

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