JPS61285716A - レジスト塗布方法 - Google Patents
レジスト塗布方法Info
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- JPS61285716A JPS61285716A JP60126133A JP12613385A JPS61285716A JP S61285716 A JPS61285716 A JP S61285716A JP 60126133 A JP60126133 A JP 60126133A JP 12613385 A JP12613385 A JP 12613385A JP S61285716 A JPS61285716 A JP S61285716A
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- 238000000034 method Methods 0.000 claims abstract description 11
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
-
- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F7/00—Photomechanical, e.g. photolithographic, production of textured or patterned surfaces, e.g. printing surfaces; Materials therefor, e.g. comprising photoresists; Apparatus specially adapted therefor
- G03F7/16—Coating processes; Apparatus therefor
- G03F7/162—Coating on a rotating support, e.g. using a whirler or a spinner
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- Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明はレジスト塗布方法に係シ、特に、現像寸法変動
許容範囲が小さい高集積回路素子製造プロセスに好適な
レジスト塗布方法に関する。
許容範囲が小さい高集積回路素子製造プロセスに好適な
レジスト塗布方法に関する。
レジスト塗布方法Fi特開昭59−155925号公S
報に記載されている。ここに示された方法では、レジス
トを塗布する前に感光反応を行なわせるもので、レジス
トの膜厚の最適化については論及されていない。また、
微細パターンの形成方法に関連したレジスト塗布方法I
/cFi、特開昭59−155930号、特開昭59−
155927号、特開昭59−155921号公報など
があるが、レジスト膜厚の最適化についてはいずれも論
及していない。
報に記載されている。ここに示された方法では、レジス
トを塗布する前に感光反応を行なわせるもので、レジス
トの膜厚の最適化については論及されていない。また、
微細パターンの形成方法に関連したレジスト塗布方法I
/cFi、特開昭59−155930号、特開昭59−
155927号、特開昭59−155921号公報など
があるが、レジスト膜厚の最適化についてはいずれも論
及していない。
本発明の目的はシリコン・ウェハ上に形成される高集積
回路素子の現像寸法のばらつきを低減して、素子の製造
歩留シを向上できるレジスト塗布方法を提供することV
Cある。
回路素子の現像寸法のばらつきを低減して、素子の製造
歩留シを向上できるレジスト塗布方法を提供することV
Cある。
レジスト塗布膜厚が厚くなると、光がレジスト膜内部に
入シにくくならて現像後の寸法が変化する、いわゆる、
バルク効果が知られている。しかし、単一波長の光を使
用する縮小投影露光装置では、レジスト膜内での光干渉
により、レジスト表面での反射率が変動する結果、膜厚
の増加に伴い現像寸法が正弦関数的に脈動する干渉効果
も生じることがわかった。このような場合vcハ、レジ
スト塗布膜厚を脈動の極値(現像寸法のレジスト膜厚依
存性を示す曲線の傾きが零となる部分)K相当する値に
設定することによシ、現像寸法のばらつきを極小化でき
ることがわかった。
入シにくくならて現像後の寸法が変化する、いわゆる、
バルク効果が知られている。しかし、単一波長の光を使
用する縮小投影露光装置では、レジスト膜内での光干渉
により、レジスト表面での反射率が変動する結果、膜厚
の増加に伴い現像寸法が正弦関数的に脈動する干渉効果
も生じることがわかった。このような場合vcハ、レジ
スト塗布膜厚を脈動の極値(現像寸法のレジスト膜厚依
存性を示す曲線の傾きが零となる部分)K相当する値に
設定することによシ、現像寸法のばらつきを極小化でき
ることがわかった。
以下、本発明の一実施例を第1図により説明する。レジ
スト膜厚を100m程度づつ増加させると現像後のレジ
スト寸法(第2図のレジストライン6の@trO値で、
この大きさtrがライン部4とスペース部5からなるマ
スクパターンのライン幅tmと等しいことが望ましい)
は第1図の曲線3のように脈動することが明らかになっ
た。シリコン基板7上にレジストライン6を形成するプ
ロセスを第3図を用いて示す。まず、シリコン基板7上
にレジスト10を1μm程度に回転塗布する。
スト膜厚を100m程度づつ増加させると現像後のレジ
スト寸法(第2図のレジストライン6の@trO値で、
この大きさtrがライン部4とスペース部5からなるマ
スクパターンのライン幅tmと等しいことが望ましい)
は第1図の曲線3のように脈動することが明らかになっ
た。シリコン基板7上にレジストライン6を形成するプ
ロセスを第3図を用いて示す。まず、シリコン基板7上
にレジスト10を1μm程度に回転塗布する。
その上にスペース部とライン部からなるマスクパターン
の投影偉を紫外線の光源で照射する。この場合、レジス
ト10上の光強度はライン部に相当する位置では小さく
、スペース部に相当する位置では大きい、曲線9のよう
になる。紫外線照射後現像処理を行うと、強く照射され
たスペース部5に相当する部分のレジストが溶解し、弱
く照射されたライン部4Vc8当する部分のレジストは
溶解せずに残留して第2図のレジストライン6を形成す
る。
の投影偉を紫外線の光源で照射する。この場合、レジス
ト10上の光強度はライン部に相当する位置では小さく
、スペース部に相当する位置では大きい、曲線9のよう
になる。紫外線照射後現像処理を行うと、強く照射され
たスペース部5に相当する部分のレジストが溶解し、弱
く照射されたライン部4Vc8当する部分のレジストは
溶解せずに残留して第2図のレジストライン6を形成す
る。
これは、ポジ型レジストの場合で、ネガ型レジストの場
合[11、逆に、スペース部に相当する部分にレジスト
ラインが形成される。
合[11、逆に、スペース部に相当する部分にレジスト
ラインが形成される。
一般に、シリコンウェハ上にレジストを1μm程度に回
転塗布する場合、膜厚は均一にならずに、200人程鹿
のばらつきが生じる。従って、現像後に形成されるレジ
ストライン幅には、ばらつきが生じる。第1図かられか
るように、このライン幅のばらつきの範囲は、レジスト
塗布膜厚の設定値(レジスト膜厚のばらつきの中心値)
によシ大きく異なる。たとえば、レジスト塗布膜厚をt
。
転塗布する場合、膜厚は均一にならずに、200人程鹿
のばらつきが生じる。従って、現像後に形成されるレジ
ストライン幅には、ばらつきが生じる。第1図かられか
るように、このライン幅のばらつきの範囲は、レジスト
塗布膜厚の設定値(レジスト膜厚のばらつきの中心値)
によシ大きく異なる。たとえば、レジスト塗布膜厚をt
。
とすると、膜厚のばらつきの範囲はΔtであるから、現
像寸法のばらつきはΔ/、、になる。しかし、レジスト
塗布膜厚を曲線3の極小値2に相当する膜厚t、VCす
ると、レジスト膜厚のばらつきが同じΔtでも、現像寸
法のばらつきはΔt、となシ、Δt、の約115 Vc
減少する。レジスト膜厚を曲線3の極大値11C相当す
る膜厚t1にした場合にも現像寸法のばらつきはΔt、
vcなり、Δt、の約115になる。ここで、Δt、
の一般的な値は0.3μmである。この値はレジスト寸
法が1μm程度になると許容できないばらつき範囲であ
る。
像寸法のばらつきはΔ/、、になる。しかし、レジスト
塗布膜厚を曲線3の極小値2に相当する膜厚t、VCす
ると、レジスト膜厚のばらつきが同じΔtでも、現像寸
法のばらつきはΔt、となシ、Δt、の約115 Vc
減少する。レジスト膜厚を曲線3の極大値11C相当す
る膜厚t1にした場合にも現像寸法のばらつきはΔt、
vcなり、Δt、の約115になる。ここで、Δt、
の一般的な値は0.3μmである。この値はレジスト寸
法が1μm程度になると許容できないばらつき範囲であ
る。
半導体素子のホトレジストプロセスにおける現像寸法の
ばらつきの許容値が設計寸法t−に対して±Δtである
とする。もし、誤ってレジスト塗布膜厚の設定値を第1
図におけるt3 とした場合VCは、現像寸法のばらつ
きは大きく、現像寸法に対する半導体素子の個数は曲線
11のように分布する。この時、寸法許容値t−±Δt
からけずれた多くの素子(12,13t/Cあたるもの
)は不良品となる。しかし、レジスト塗布膜厚の設定値
を第1図のtl e Fとした場合VCは、現像寸法
のばらつきが減って曲線14のようになり、不良品も1
5.16に相当する部分のみになり、10チ以下に減少
する。
ばらつきの許容値が設計寸法t−に対して±Δtである
とする。もし、誤ってレジスト塗布膜厚の設定値を第1
図におけるt3 とした場合VCは、現像寸法のばらつ
きは大きく、現像寸法に対する半導体素子の個数は曲線
11のように分布する。この時、寸法許容値t−±Δt
からけずれた多くの素子(12,13t/Cあたるもの
)は不良品となる。しかし、レジスト塗布膜厚の設定値
を第1図のtl e Fとした場合VCは、現像寸法
のばらつきが減って曲線14のようになり、不良品も1
5.16に相当する部分のみになり、10チ以下に減少
する。
これまでは、レジスト膜厚に対するレジスト現像寸法の
脈動、それに伴うばらつきについて述べてきたが、レジ
スト膜厚を直接測定できない場合Kt:t、レジストを
1μm程度に塗布するスピナ(回転塗布装置)の回転数
に対するレジスト現像寸法を測定すると、第5図′の曲
線17のように脈動する。スピナの回転数をNI、Nz
、Ns とすると、tfJ1図と同様にレジスト膜厚の
ばらつきが同じΔtであっても、極値17.18に相当
する回転数1’L 、 Ntの場合VCは、現像寸法の
ばらつきは、ΔtI、Δt2となシ少ない。しかし、極
値に相当しない回転数N、の場合vcは、Δt3となシ
大きくなる。このように、スピナの回転数を適切に設定
することによシ、現像寸法のばらつきを低減することが
できる。
脈動、それに伴うばらつきについて述べてきたが、レジ
スト膜厚を直接測定できない場合Kt:t、レジストを
1μm程度に塗布するスピナ(回転塗布装置)の回転数
に対するレジスト現像寸法を測定すると、第5図′の曲
線17のように脈動する。スピナの回転数をNI、Nz
、Ns とすると、tfJ1図と同様にレジスト膜厚の
ばらつきが同じΔtであっても、極値17.18に相当
する回転数1’L 、 Ntの場合VCは、現像寸法の
ばらつきは、ΔtI、Δt2となシ少ない。しかし、極
値に相当しない回転数N、の場合vcは、Δt3となシ
大きくなる。このように、スピナの回転数を適切に設定
することによシ、現像寸法のばらつきを低減することが
できる。
第4図は現像寸法のばらつきを示す分布図である。
本発明によれば、現像寸法のばらつきを低減でき、高集
積回路素子の製造歩留りを向上することができる。
積回路素子の製造歩留りを向上することができる。
第1図は本発明の一実施例のレジスト現像寸法のレジス
ト膜厚依存性を示す図、第2図はレジストの断面図、#
IJ3図はレジストへのマスクパターン投影の説明図、
第4図は現像寸法のばらつきを示す分布図、第5図はレ
ジスト現像寸法のスピナ回転数依存性を示す図である。 1.2,17.18・・・現像寸法の極値、3,19・
・・現像寸法の脈動、6・・・レジストライン、11゜
14・・・現像寸法の分布曲線。
ト膜厚依存性を示す図、第2図はレジストの断面図、#
IJ3図はレジストへのマスクパターン投影の説明図、
第4図は現像寸法のばらつきを示す分布図、第5図はレ
ジスト現像寸法のスピナ回転数依存性を示す図である。 1.2,17.18・・・現像寸法の極値、3,19・
・・現像寸法の脈動、6・・・レジストライン、11゜
14・・・現像寸法の分布曲線。
Claims (1)
- 【特許請求の範囲】 1、基板にレジストを回転塗布するプロセス、塗布され
たレジスト膜にマスクパターンを転写露光するプロセス
、パターン露光後基板上にパターンを形成する現像プロ
セスから構成されるホトレジストプロセスにおいて、 前記レジストの現像寸法が前記レジスト塗布プロセスに
おけるパラメータの増減に伴つて脈動する特性を示す場
合に、前記パラメータの値を前記脈動の極値に相当する
値に設定することを特徴とするレジスト塗布方法。 2、特許請求の範囲第1項において、 前記レジスト塗布プロセスにおけるパラメータを前記レ
ジストの塗布膜厚とすることを特徴とするレジスト塗布
方法。 3、特許請求の範囲第1項において、 パラメータを前記レジストの塗布時の回転数とすること
を特徴とするレジスト塗布方法。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60126133A JPS61285716A (ja) | 1985-06-12 | 1985-06-12 | レジスト塗布方法 |
KR1019860004552A KR900001665B1 (ko) | 1985-06-12 | 1986-06-09 | 레지스트 도포방법 |
EP86107872A EP0205148B1 (en) | 1985-06-12 | 1986-06-10 | Method of applying a resist |
DE8686107872T DE3678868D1 (de) | 1985-06-12 | 1986-06-10 | Schutzlackbeschichtungsverfahren. |
US06/872,506 US4738910A (en) | 1985-06-12 | 1986-06-10 | Method of applying a resist |
CN86103644A CN86103644B (zh) | 1985-06-12 | 1986-06-11 | 涂敷光刻胶的方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60126133A JPS61285716A (ja) | 1985-06-12 | 1985-06-12 | レジスト塗布方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61285716A true JPS61285716A (ja) | 1986-12-16 |
Family
ID=14927484
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60126133A Pending JPS61285716A (ja) | 1985-06-12 | 1985-06-12 | レジスト塗布方法 |
Country Status (6)
Country | Link |
---|---|
US (1) | US4738910A (ja) |
EP (1) | EP0205148B1 (ja) |
JP (1) | JPS61285716A (ja) |
KR (1) | KR900001665B1 (ja) |
CN (1) | CN86103644B (ja) |
DE (1) | DE3678868D1 (ja) |
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GB9916730D0 (en) | 1999-07-16 | 1999-09-15 | Mitel Semiconductor Ltd | Integrated circuit manufacture |
KR101074952B1 (ko) * | 2004-08-31 | 2011-10-18 | 엘지디스플레이 주식회사 | 포토레지스트 코팅장치 및 코팅방법 |
FR2969772B1 (fr) * | 2010-12-22 | 2012-12-28 | Commissariat Energie Atomique | Procédé de lithographie par nano impression |
KR102212361B1 (ko) | 2019-07-05 | 2021-02-04 | 국방과학연구소 | 레이저음향기기를 이용한 수중표적 공격용 양상태 탐지시스템 및 탐지방법 |
KR102477169B1 (ko) * | 2022-06-10 | 2022-12-14 | 엘아이지넥스원 주식회사 | 해수 유동을 고려한 소화포 제어 방법 및 그를 위한 장치 |
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1985
- 1985-06-12 JP JP60126133A patent/JPS61285716A/ja active Pending
-
1986
- 1986-06-09 KR KR1019860004552A patent/KR900001665B1/ko not_active IP Right Cessation
- 1986-06-10 US US06/872,506 patent/US4738910A/en not_active Expired - Fee Related
- 1986-06-10 DE DE8686107872T patent/DE3678868D1/de not_active Expired - Lifetime
- 1986-06-10 EP EP86107872A patent/EP0205148B1/en not_active Expired - Lifetime
- 1986-06-11 CN CN86103644A patent/CN86103644B/zh not_active Expired
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---|---|---|---|---|
JP2006154245A (ja) * | 2004-11-29 | 2006-06-15 | Toshiba Corp | パタンデータ検証方法、パタンデータ作成方法、露光用マスクの製造方法およびプログラム |
JP4621485B2 (ja) * | 2004-11-29 | 2011-01-26 | 株式会社東芝 | パタンデータ検証方法、パタンデータ作成方法、露光用マスクの製造方法およびプログラム |
Also Published As
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CN86103644A (zh) | 1987-04-29 |
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