JPS6124743B2 - - Google Patents

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JPS6124743B2
JPS6124743B2 JP3696778A JP3696778A JPS6124743B2 JP S6124743 B2 JPS6124743 B2 JP S6124743B2 JP 3696778 A JP3696778 A JP 3696778A JP 3696778 A JP3696778 A JP 3696778A JP S6124743 B2 JPS6124743 B2 JP S6124743B2
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JP
Japan
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card
signal
article
circuit
gate
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JP3696778A
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Jiroo Joruju
Morie Jan
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Original Assignee
SEE II II HANIIUERU BURU
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Publication date
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Publication of JPS53123048A publication Critical patent/JPS53123048A/ja
Publication of JPS6124743B2 publication Critical patent/JPS6124743B2/ja
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Description

【発明の詳細な説明】 本発明は、外部装置によりインプリント（刻
印）されかつ（または）処理される符号化された
情報を保有している（カードの様な）物品を用い
て予め定められた均等な単位の勘定記録を行なう
装置に関する。
さらに具体的には、対象となる装置は、受けた
サービス、品物等の量もしくは額を表わす差引き
残高に関する情報を保有する物品と、物品の初期
金額情報をインプリント（刻印）することができ
る装置と、該物品の保持者が要求または受けるサ
ービスあるいは品物に対応する額で差引き残高を
変更しサービスまたは品物の供給を可能にするこ
とができる装置と、物品、インプリント装置なら
びに変更装置間の接続装置とから構成される。
本発明の目的は、総ての金額単位の数を記録す
ることができる記録もしくは取引き媒介装置を提
供することである。この媒介装置は、例えばカー
ドのような物品の保持者が要求した動作を行なう
前に該動作を行うことが許されるか否かを確証も
しくは検証するために取引において生ずるデータ
をチエツクし記録するのに用いられる。この媒介
装置の用途は多様である。例えば、（時間または
単位）で行なわれた仕事を記録したり、供給また
は受取られた品物あるいはサービスの量等々を記
録して払込みや支払を行なう、要するに容易で信
頼性の高い勘定の記録が挙げられる。
本発明の最も一般的な用途は、現金や換金可能
な証巻を取扱われないで品物やサービスに対し支
払を行なうためのものであるので、以下の説明に
おいては、理解を容易にするために、本発明は、
各個人に対して特定的でない仕方で現金での支払
いに等価な支払いが行われる用途と関連して述べ
ることにする。しかしながら、本発明の対象であ
る媒介装置はまたは、保持者の名前あるいは秘密
コードもしくは符号をインプリントしたりまたア
クセスを許可する目的で秘密コードをチエツクす
るためのキーを用いるなどして、種々な仕方で個
人に対し特定にしたり、或る方向における金銭の
動きを必ずしも含まない用途で使用することも可
能である。
本発明によれば、情報を保有する物品と組合せ
て該情報をインプリントしかつ（または）該情報
を処理する外部装置を用いることにより予め定め
られた均等な単位の勘定記録を行なう装置が提供
される。
物品（例えばカード）は、一時的に外部インプ
リントおよび（または）処理手段に結合される。
該手段は、物品のメモリからデータを読取つたり
データを書込んだりする。
物品にはメモリが設けられ、このメモリは３つ
の種類の符号化された情報を記憶する。即ち、 (1) 物品が企図されている使用もしくは用途の識
別情報、 (2) 行われた動作を記録するために用いられる単
位の識別情報、および (3) 物品の保持者にとつて利用可能な単位の数に
関する情報 インプリントおよび（または）処理手段は、物
品に設けられているメモリに、物品の保持者が要
求または受ける単位の数（但しこの数はメモリ容
量の限界内の数である）を書込んだり、この書込
まれた単位の数から物品の保持者が要求または受
けた単位の数が減少する機能をなす。
例えば、本発明が電話の呼び、郵便切手等々の
ようなサービスや品物の供給に適用される事例に
おいては、使用者は現金または換金可能な証巻
で、所要の品物またはササービスの金額に対応す
る額を支払つてカードのような物品を受取る。こ
のようなカードの給付場所は、所要の物品またサ
ービスの性質に依存して異なる。カードが購入さ
れた場所では購入のために支払つた全金額が、対
応数の同じ体係の個別の単位（これを均等な単位
と称する）としてカード上に符号化された言語で
記録される。
物品（この例ではカード）は、「携帯者専用」
化、即ち個人別化しても良いしあるいはしなくて
も良いが、しかしながらカードは、講入の目的で
設けられている装置と関連してしかも使用するこ
とができない。
カードの使用は非常に簡単である。単にカード
を特定のサービスまたは商品と関連の処理装置に
挿入するだけで良いからである。勿論カードと装
置とは両立し得るものでなければならず、そして
要求されるサービスまたは品物の単位の数は、カ
ードにに記憶されている利用可能に単位の数を越
えることはできない。
上の基準が満された場合には、要求されたとこ
ろのサービスあるいは品物が供給され、その結果
としてカードに記憶されている利用可能な単位の
内から対応数の数の単位が消去される。即ち、カ
ードに与えられているクレジツト、言い換えるな
らばカードに記録されている貸付金額が供給され
たサービススまたは品物の合計額に対応する金額
だけ差し引かれる。カードに与えられているクレ
ジツトもしくは貸付金額が使用し尽された場合に
は、カードは最早や使用することはできず、使用
者は新しいカードを購入する際に返却する。カー
ドのメモリは、一旦完全に減分された場合、即
ち、カードの購入時にインプリントされた利用可
能な総ての単位が完全に使用されてしまつた場合
には再使用不可能となる。
安全の目的で、メモリに記録される情報の総て
もしくは幾つかの情報は、各種の情報がｎ個の２
進ビツトからなるフイールドもしくはゾーンで表
わされる変更不可能なコードもしくは符号に符号
化するのが好ましい。フイールドもしくはゾーン
内のｎ個のビツトの内のｎビツトは最初のインプ
リント後不可逆的に変えることができる。ここで
ｍはｎより小さいかまたはｎに等しく、前以つて
確定されている。
このような符号化によれば不正な変更を試みて
も、その結果得られる２進ビツト構造は、本発明
の処理装置にとつては無意味なものとなる。
本発明の上に述べた目的ならびに他の目的、特
徴および利点は添付図面を参照しての１つの特定
の実施例に関する以下の詳細な説明から明らかに
なろう。
以下、本発明は、その用途の内の１つと関連し
て説明する。その用途とは、量化可能なクレジツ
ト、例えば差引き残高を記録する媒体もしくは物
品（例えばカード）により、与えられた品物また
はサービスに対し支払いを行なうことである。こ
の用途においては、クレジツトカードのような物
品には、物品保持者による予め定められた品物ま
たはサービスの購入を表わす信号が与えられてい
る。物品には物品保持者資源を表わす信号が記憶
されている。購入を表わす関連の金額だけ差引く
信号も物品に供給される。また、現金或いは有価
証券で支払われた関連の金額と交換で、所与の種
類のサービスまたは品物に対する予め定められた
貸付金額を前以つてブランクもしくはもしくは素
材をなす物品（空の物品）に設定する装置が設け
られる。
例として、電話サービスへの装置の適用を想像
されたい。クレジツトが付与されている媒体は、
クレジツトに類以のカードにより形成され、この
カードは、カードを識別する固定のコードと、受
けることができるサービスの性質（通達領域およ
び料金）に関する固定のコードと、カード保持者
に利用可能な支払単位の数に関する変更不可能な
コードを記憶もしくは保持している。
第１図には、本発明によるクレジツトカードの
ような物品上に記憶される情報のフオーマツトが
示してある。この情報は２進符号形態で記憶され
る。カードの上部のゾーン１には、（使用が許さ
れない）ブランクカードであることを示す２進
「０」または使用可能なカードであることを表す
２進「１」のようなイネーブルビツトが記録され
る。ゾーン２には、或る適当な処理装置において
のみカードの使用を可能にするカード識別カード
（符号）が記録される。ゾーン３には、カードの
貸付金額の単位を識別するためのコードが記録さ
れる。最後にゾーン４は、ｎビツトからなる増分
ゾーンであつて、各ビツトは、単位ゾーン３の識
別コードにより識別される値を有している。コー
ドのnUの債務は、カードを取扱う装置に対する
nUの貸付金額に対応する。
ゾーン２および３のコードは変更不可能ではけ
ればならない。即ち、本発明の処理もしくは取扱
に装置によつて認識される所与のコードは、本発
明の装置により同様に認識されるが但し別の種礼
の商品或いはサービスに割当てられている別のコ
ードに変換されるようなことがあつてはならな
い。
この目的で、ゾーン２および３のコードは、各
ビツトの１つの２進状態から他の２進状態への変
換が不可逆であるｎビツトのフイールドを有して
いる。したがつて、例えば、「０」ビツトから
「１」ビツトへの変換だけが可能であるとする
と、各フイールドには、予め定められた最大数の
「１」ビツトをセツトするだけで良い。この最大
数の「１」ビツトが、本発明の装置によつて認識
することができる各コードに割当てられる。
このようにして、ゾーン２および３のコード
は、余分の「１」を加えることにより不法に変更
することができるが、「１」ビツトを「０」ビツ
トに切換えることは不可能である。このように、
余分のビツトを付加すると、上記の予め定められ
た最大数よりも大きい数の「１」ビツトを有する
コードが生ずるが、このようにして改変された新
しいコードは、カードの用いられる装置によつて
認識することができるコード群には属さないこと
になる。このようにビツトの値の変換を不可逆性
にするためには、本来的に不可逆性であるカード
メモリ（例えば破壊接合メモリ）または外部手段
により逆に変更することができないカードメモリ
が要求される。したがつて、カードは、磁気スト
リツプの場合のように単に信号を記憶するだけで
は不十分であつて、上述のような要件を実現する
回路を備えなければならない。
第２図は、本発明で使用するように適応されて
いるクレジツトカード５に設けられる論理回路の
ブロツクダイアグラムである。これら論理回路に
は、PROM型のプログラマブルメモリ６が含ま
れ、このメモリは、（カードの外部に設けられて
いる）クロツクから同期信号を受ける巡回アドレ
ス発生器７によりアドレス指定される。メモリ６
はまたは、データ入／出力端子Ｅ／Ｓを介してカ
ード５の外部に設けられいる信号源と通信するこ
とができる。
メモリ６の読取り／書込み信号は、アドレス発
生器７によつて発生される。このアドレス発生器
７は回路８によつて発生される信号RAZが印加
されると、零にリセツトされる。回路８は、外部
装置に接続することができる３つの端子を有して
いる。回路８の第１の端子９と第２の端子１１と
の間には、カード５の論理回路のための直流電源
電圧V1が印加される。回路８の第３の端子１０
と端子１１との間には、メモリ６をプログラムす
るための別の電圧V2が印加される。回路８はま
た信号△I1を発生する。この信号は、カードに情
報をインプリントしたりその他の仕方でカードを
処理する手段（後述する）によつて検出される。
第３図は第２図に示しアドレス発生器７の回路
略図である。上述のように、このアドレス発生器
７は、11ビツトの入力アドレス（A0ないし
A10）を必要とする2048ビツトメモリである
PROM６を駆動するための回路である。この目的
で、アドレス発生器７は、クロツク信号（Ｈ）に
応答してアドレス信号Ａ０ないしＡ１０を発生す
る３つのカスケード接続された４段シフトレジタ
により構成される計数器を備えている。ジスタ１
２は、信号RAZにより零にリセツトされる。レ
ジスタ１２の12個の出力（Ａ０ないしＡ１１）は
それぞれノアゲート１３およびアンドゲート１４
に接続される。ゲート１３および１４は出力Ａ０
ないしＡ１０に応答する。なお、レジスタ１２の
出力端Ａ１１は直接ノアゲート１３の１つの入力
端に接続されると共に、インバータ１５を介して
アンドゲート１４の１つの入力端に接続されてい
る。
ノアゲート１３の出力端はアンドゲート１６の
１つの入力端に接続されている。このアンドゲー
ト１６は、メモリ６からの出力信号Ｓが印加され
る別の入力端を有している。アンドゲート１６の
出力で、JKフリツプ．フロツプ１７のＪ入力端
が駆動され、その結果、該フリツプ６フロツプ１
７は、計数器１２がアンドレス零に切換わる時に
零ビツト状態を記憶する。
アンドゲート１４の出力端は、オアゲートの１
つの入力端に接続されている。このオアゲート１
８は、アンドゲート１９の出力端に接続された第
２の入力端を有している。オアゲート１８の出力
は、第２のJKフリツプ．フロツプ２０のＪ入力
を駆動するように接続されており、該フリツプ．
フロツプ２０は読出し／書込み信号を発生し、該
信号はメモリ６に供給される。フリツプフロツプ
１７および２０は、インバータ２１を介して信号
RAZにより零にリセツトされ、クロツク信号Ｈ
により制御される。
第３ａ図は、カード５の回路８の詳細な回路図
を示す。回路８は、端子９と１１との間に電圧
V1が印加された時に、零リセツト信号RAZをア
ドレス発生器７に供給する。また、回路８は、カ
ードと対話している外部装置に供給されて該外部
装置により検出される信号をも発生する。この信
号は、外部装置に対して、該外部装置の全対話期
間中電圧V1およびV2がカードにより正しく受け
られていることを該外部回路に報知する。
この目的から、回路８は、（発振を避けるため
の電圧ヒステリシス型の）２つの電圧比較器８ａ
および８ｂを備えており、これら比較器は、それ
ぞれ、端子９と１１との間の電圧V1および端子
１０と１１との間の電圧V2を、ツエナーダイオ
ードZ′1およびZ′2により与えられる基準電圧信号
と比較する。比較器８ａおよび８ｂは、それらの
入力端に印加される信号の相対振幅に依存する２
進信号を発生する。比較器８ａおよび８ｂの出力
信号は、常開コエクタナンド回路８ｃにより結合
される。該ナンド回路８ｃのコレクタには、抵抗
器Ｒを介して電圧V1が印加される。この場合抵
抗器Ｒの値は、 Ｒ＝V1／△I1 となるように選択される。電流△I1の検出は、
電源回路Ｍ２（第８図参照）によつて行われる。
２つの電圧V1およびV2がそれぞれ、ツエナーダ
イオードZ′1およびZ′2により定められる基準電圧
よりも大きくなると、それに応答して、抵抗器Ｒ
を流れる電流はV1／Ｒだけ減少する。
第４図は、カードを最初に購入する時に、カー
ド５の回路に信号をインプリント（刻印）するた
めの装置の回路略図である。カードホルダ２２
は、カードがカードインプリント回路２３とデー
タ交換をすることができる適当な位置でカード５
を受付ける。なお、カードホルダ２２に関しては
第６図を参照し追つて説明する。
インプリント回路２３は、カード５とデータ信
号Ｅ／Ｓを交換し該カードに対してクロツク信号
Ｈを供給するバツフアＭ１と、カードに対し電圧
V1およびV2を供給する電源Ｍ２と、カード５を
試験しチエツクする回路Ｍ３とを備えている。
カード試験／チエツク回路Ｍ３は、後述するよ
うに、信号PT，SVおよびSFを発生することに
より該カード５がホルダ２２内に適切に位置付け
られていることを検証する。オペレータは、選択
スイツチ２５に接続されているキーボード２４を
介してカード５と交信する。選択スイツチ２５
は、カード５にコード識別信号を供給する第１の
シフトレジスタ２６と、カード５に該カードを使
用することができるクレジツトの単位を識別する
信号を供給する第２のシフトレジスタ２７と、カ
ード５に対しカード携帯者に対し所望の貸付金額
を指示する信号を供給する第３のシフトレジスタ
２８に接続されている。各レジスタ２６ないし２
８の内容を表示することができるように、表示装
置もしくはデイスプレイ２９がスイツチ３０を介
して選択的に接続される。なお、インプリント回
路２３は図示されていないが電源を備えている。
第５図は、カードホルダがカード５と交信して
該カードに割当てられている商品またはサービス
を行うための装置を付活する装置３１のブロツク
ダイアグラムである。装置３１は、第４図に示し
た装置の構成要素と同じ複数の構成要素を備えて
おり、これら同じ構成要素には同じ参照記号が付
けられている。これら同じ講成要素は、カードホ
ルダ２２ならびにカード試験／チエツク回路Ｍ３
である。
さらに、装置３１は、カード５と対話するため
のバツフアM′１と、カードの貸付金額をチエツ
クし該カードが要求されているるサービスに対し
使用し得るか否かを決定するための回路Ｍ４を備
えている。第４図に示した装置の場合と同様に、
回路Ｍ４は、カードにインプリントされているコ
ードを識別するための第１のレジスタと、カード
に割当てられているクレジツトの単位を識別する
ための第２のレジスタと、カードに債務を記録す
るための信号を提供する第３おレジスタとを備え
ている。これら３つのレジスタは、第４図に示し
たレジスタ２６，２７および２８と同じ構造のも
のであり、したがつて第５図における図示は割愛
した。さらにまた、図示されていないが、第４図
に示したデイスプレイ２９と同じ表示手段が設け
られている。回路Ｍ４はバツフアM′１に接続さ
れると共に、オペレータと交信するキーボード
（図示せず）に接続されている。装置３１はま
た、種々な回路のための電源（図示せず）を備え
ている。
第６図は、カードホルダ２２の具体例ならびに
カード５のための試験／チエツク回路Ｍ３の一部
分を示す略図である。
第６図を参照するに、フラツプ３２は軸３３を
中心に回動可能に取付けられておつてばね（図示
せず）により開方向に偏寄されている。カード５
は板３４に形成されている開口を介し、（公知の
型の）の存在検出器３５に当接するまでフラツプ
３２の下側に挿入される。該存在検出器３５は、
カード５の存在に応答して、信号PTを試験／チ
エツク回路Ｍ３に供給する。フラツプ３２が閉ざ
された状態で板３２の下側には、カード５に対置
して、回路Ｍ３から供給される鎖錠信号SVに応
答する掴み３６と、フラツプ３２が閉ざされたこ
とを検出するための検出器３７が配設されてい
る。検出器３７は、信号SFを試験／チエツク回
路Ｍ３に供給する。フラツプ３２が閉じた状態
で、カード５の下方には、カードに設けられてい
る適当な接点と接触して該カードと装置２３およ
び３１との間で信号の交換を行うことを可能にす
る５つのピン３９を有するヘツド３８が配置され
ている。なお装置２３および３１は、上述のよう
に、それぞれ、カードにデータをインプリントし
たりカードの使用を行うための装置である。ピン
３９には電源Ｍ２から電圧が供給され、またピン
３９からの信号はバツフアＭ１により読取られ
る。
第７図は、カード試験／チエツク回路Ｍ３の詳
細な回路図である。存在検出器３５は、発光ダイ
オードとホトトランジスタとの間の馬蹄形状の空
間内にカード５の縁が挿入される時に信号PTを
発生する光電検出器である。信号PTはパルス整
形回路４０に供給される。このパルス整形回路４
０は、アンドゲート４１の１つの入力端に接続さ
れている。該アンドゲート４１は、インバータ４
３を介して信号SFを受ける第２の入力端を有し
ている。検出器３７は検出器３５に類似の検出器
であつて、フラツプ３２が開位置にある時に信号
SFを発生する。なお、第７図において、フラツ
プ３２の開位置は検出器３７内の馬蹄形の空間内
に位置するフラツプ３２に取付けられているシー
ト材４４により表わされる。フラツプが閉じる
と、シート材４４は馬蹄形の空間から出る。ゲー
ト４１の出力は、単安定フリツプ．フロツプ４２
に印加される。該フリツプ．フロツプはそこで長
さτ３の負のパルス発生する。掴み３６は、制
御／増幅回路４６を介してJKフリツプ．フロツ
プ４５に供給される２進鎖錠信号SVに応答す
る。
単安定フリツプ．フロツプ４２の出力信号τ３
は、単安定フリツプ．フロツプ４７に入力され、
該安定フリツプ．フロツプ４７は長さτ１のパル
スを発生して単安定フリツプ．フロツプ４８を駆
動し、後者は長さτ２のパルスを発生する。単安
定回路４８の出力はカード５に設けられている端
子もしくは接点９ないし１０の試験を指令するた
めにバツフアＭ１もしくはM′１に伝送される。
単安定回路４８からの信号τ２はまたは、JK
フリツプ．フロツプ４９のトリガ入力端にも供給
される。該フリツプ．フロツプ４９のＪ入力端
は、バツフアＭ１またはM′１から出力されてカ
ード５の端子もしくは接点９ないし１１の試験結
果を表わす出力信号に応答する。フリツプ．フロ
ツプ４９は、電源Ｍ２のイネーブル信号もしくく
は有効化信号を発生する。
フリツプ．フロツプ４５は、アンドゲート５０
の出力によつて零にリセツトされる。
該アンドゲート５０は４つの入力を有する。そ
の内の１つの入力は、零リセツト初期設定（イニ
シアライズ）入力RAZである。RAZ信号は、電
源Ｍ２から供給されるものであつて電源の故障の
結果として動作の終末を表わす信号である。アン
ドゲート５０の別の入力は、動作の正常および異
常停止を表わす信号、バツフアＭ１またはM′１
またはM′１からの信号であり、そして第４の入
力は単安定回路５１によつて発生される接続期間
もしくは長さτ４のパルス信号である。
単安定回路５１は、アンドゲート５２によつて
制御される。このアンドゲート５２は単安定回路
４８の出力に応答する１つの入力端と、インバー
タ５３を介してバツフアＭ１またはM′１からの
試験結果信号を受ける他の入力端を有している。
フリツプ．フロツプ４９は、アンドゲート５４
の出力により零にリセツトされる。このアンドゲ
ート５４は、アンドゲート５０の上述の第１番目
の入力ないし第３番目の入力に共通の３つの入力
信号を受ける。
第８図は、カード５のための電源Ｍ２の回路図
である。電源回路Ｍ２は２つの直流電源５５およ
び５６を備えており、これら電源は、試験回路Ｍ
３からの２進「１」の有効化信号もしくはイネー
ブル信号により有効化された時に、それぞれ、共
通の電源（図示せず）から電圧V1およびV2を導
出する。電圧V1およびV2の存在および値はま
た、電源回路Ｍ２によつて検出される。
上述の機能を行なうために、電圧比較器５７お
よび５８はそれぞれ、DC電圧V1およびV2の存在
を検出する。比較器５７および５８にはツエナー
ダイオードZ1およびZ2を所要の基準電位にバイア
スする直流電圧Vccを供給される。電圧V1および
V2がツエナーダイオードZ1およびZ2の基準電位よ
りも大きい場合には、それに応答して、比較器５
７および５８はそれぞれ２進「１」信号をアンド
ゲート５９に供給し、その結果アンドゲート６０
が電圧比較器６１の出力信号に応答する。なお、
該比較器６１は正しい条件の下で、カード５の回
路８により抵抗R2に供給される電流変化△I1を検
出する働きをなす。電位差△I1×R2は、２つの抵
抗分圧器をゲート６０がゲート５９の出力により
有効化され、他方比較器６１が△I1を検知するこ
とに応答して、ゲート６０は２進「１」信号をバ
ツフアＭ１またはM′１に供給する。
電源回路Ｍ２は、供給電力の消耗で動作が停止
した場合に信号を発生する。具体的には、単安定
回路６２によつて発生されるこの信号は、接続期
間τ６のパルスであつて、試験回路Ｍ３に供給さ
れる。単安定回路６２は、アンドゲート６３によ
りトリガされる。該アンドゲート６３は、比較器
６１の出力に応答する入力を有する。他方単安定
回路６４は、試験回路Ｍ３からの有効化（イネー
ブル）信号に応答し接続期間τ５のパルスを発生
する。
第９図は、回路Ｍ４とカード５との間の対話を
制御するバツフアＭ１の回路図である。バツフア
Ｍ１において、電圧V1およびV2が正常の範囲内
にあり且つ電流△I1が所要の値を有していること
を表わす電源回路Ｍ２からの信号Vcstならびに
接触要求が実施されたことを表わす伝源回路Ｍ２
からの信号ならびにクロツク信号Hiに応答し、
チエツク回路６６によりクロツク信号Ｈが発生さ
れる。
チエツク回路６６の１つの例が、フランス国特
許願第7703317号明細書に開示されているので必
要ならば参照されたい。
バツフアＭ１は、回路６６と同じ構成の回路６
７によつて発生される信号Ｅ／Ｓを介してカード
５と交信する。回路６６および６７は、それぞ
れ、オアゲート６８および６９からの出力信号に
よつて有効化（イネーブル）される。２つのオア
ゲート６８および６９は、試験／チエツク回路Ｍ
３からの「接続試験要求」信号に応答する。オア
ゲート６８の他の入力端は、電源回路Ｍ２からの
信号Vcstを受け、他方、オアゲート６９の他の
入力端は、後述する位相信号φ′１，φ′５，φ′
７およびφ′６を受ける。
回路６６および６７はそれぞれ、オアゲート７
０および７１の出力信号に応答する。該オアゲー
トはまた、それぞれ、インバータ７２および７３
を介して回路６６および６７に供給されるイネー
ブル信号もしくは有効化信号を発生する。オアゲ
ート７０および７１は、電源回路Ｍ２から発生さ
れる「接触試験要求」信号に応答する。オアゲー
ト７０はまた、回路７７からのクロツク信号Hi
に応答し、他方、ゲート７１は、４入力オアゲー
ト７４から出力されるデータ書込み信号に応答す
る。クロツク信号Hiは、クロツク源７７が、（レ
ジスタ２６，２７および２８が既にロードされて
いることを表わす）信号RCおよび電源回路Ｍ２
から発生される信号Vcstにより有効化された時
に該クロツク源７７から発生される。
オアゲート７４の第１および第２の入力端は、
アンドゲート７２および７６が移相されたタイミ
ング信号φ２およびφ３それぞれにより有効化も
しくはイネーブルされた時にレジスタ２６および
２７（第４図参照）の出力端に結合される。オア
ゲート７４の第３および第４の入力はそれぞれ、
移相されたタイミング信号φ４およびφ６を受け
る。後述するように、それぞれクロツク源Hiの
約数である同じ周波数を有する７つの移相された
信号φ１ないしφ７が用いられる。
回路６６および６７の各々は、それぞれ個別に
「接触良好」信号BCを発生する。これら２つの信
号BCは、接触もしくは接点の試験を要求してい
る電源回路Ｍ２からの信号によりイネーブルされ
ているアンドゲート７６′に供給される。
回路６７は、ゲート７１，７３，７４，７５お
よび７６を介して供給されるレジスタ２６および
２７の内容に応答し、メモリ６の内容を表わす信
号SLを発生し、この信号は、並列にアンドゲー
ト７９および排他的オアゲート８０に供給され
る。アンドゲート７９は位相φ１のタイミング信
号により有効化されると、信号をJKフリツプ．
フロツプ８１のＪ入力端に供給する。このJKフ
リツプフロツプ８１は、第２のJKフリツプ．フ
ロツプ８２のＪ入力を駆動する直接Ｑ出力を有し
ている。また、JKフリツプ．フロツプ８２は、
インバータ８４を介して発光ダイオード８３を選
択的に付勢する直接Ｑ出力を有す。
排他的オアゲート８０は、回路６７のSL出力
をオアゲート７４の出力信号と比較して、位相φ
５およびφ７のタイミング信号によりそれぞれ有
効化（イネーブル）されているアンドゲート８５
および８６を駆動する。アンドゲート８５の出力
はJKフリツプ．フロツプ８７のＪ入力端に印加
される。該フリツプ．フロツプ８７は、JKフリ
ツプ．フロツプ８８のＪ入力を駆動するＱ出力を
有する。またJKフリツプ．フロツプ８８は、イ
ンバータ９０を介して発光ダイオード８９を駆動
するＱ出力を有する。アンドゲート８６はJKフ
リツプ．フロツプ９１のＪ入力を駆動し、そして
該フリツプ．フロツプ７１のＱおよび出力はそ
れぞれ、JKフリツプ．フロツプ９２のＪ入力お
よびJKフリツプ．フロツプ９２のＱ出力はイン
バータ９５を介して発光ダイオード７４に供給さ
れる。JKフリツプ．フロツプ９３のＱ出力は信
号FINNを発生する。この信号は、動作の正常の
停止を表わす信号であつて、、インバータ９７を
介し発光ダオード９６に供給される。
JKフリツプ．フロツプ８２，８８および９２
の補強出力は、アンドゲート９８で結合され、
そして該アンドゲート９８の出力は並列にアンド
ゲート９９およびインバータ１００に供給され
る。該インバータ１００は、動作の異常な停止を
表わす信号FINAを発生する。アンドゲート９９
はまた、JKフリツプ．フロツプ９３の出力に
応答して、信号FINを発生する。この信号FIN
は、電源回路Ｍ３にデイスエーブル信号（無効化
もしくは禁止信号）として供給される。
JKフリツプ．フロツプ８１，８２，８７，８
８，９１，９２および９３は、電源が投入された
時に信号RAZにより零にリセツトされる。信号
RAZは、手動制御されるプツシユボタン１０２
により有効化されるアンドゲート１０１を介して
これらフリツプ．フロツプのリセツト入力端に供
給される。移相されたタイミングφ１ないしφ７
がクロツク信号Hiに応答し信号Vcstによ有効化
されるシフトレジスタ１０４の出力１０３に発生
される。
レジスタ２８（第４図参照、第９図には示され
ていない）は、シフトレジスタ１０５を駆動す
る。シフトレジスタ１０５は、クロツク信号Hi
および信号φ３により有効化もしくはイネーブル
されるアンドゲート１０６により駆動される順方
向計数器として動作する。また、レジスタ１０５
は、信号Hiおよびφ４により駆動されるアンド
ゲート１０７によりイネーブルされて逆方向計数
器として動作する。レジタ１０５は、該レジスタ
の信号に応答してレジスタ１０５から位相φ４の
タイミング信号が発生されるようにレジスタ１０
４をセツトする。
第１０には、第５図に示した装置とカード５と
の間における通信回路が示してある。これら回路
の内の幾つかのもの即ち、回路６６および７なら
びに関連のゲート回路は第９図に示したようにカ
ードに初期設定信号を供給するバツフアＭ１の対
応の回路と同じであり、これら回路には第９図の
場合と同じ参照数字が用いられている。試験回路
Ｍ３からの接触試験要求信号VEに応答して回路
６７（第９図）から発生JKフリツプ．フロツプ
１０８のＪ入力端に伝されると共に排他的オアゲ
ート１１０に供給される。該アンドゲート１１０
の出力はJKフリツプ．フロツプ１１１のＪ入力
端に印加される。該フリツプ．フロツプ１１１の
Ｑおよび出力はそれぞれJKフリツプ．フロツ
プ１１２および１１３のＪ入力端に印加される。
フリツプ．フロツプ１０８，１１２および１１３
のＱ出力は、それぞれ、発光ダイオード１１４，
１１５および１１６をそれぞれインバータ１１
７，１１８および１１９を介して付勢する。
第１０図の回路は、アンド．ゲート１２４によ
りイネーブルされるクロツク信号発生器１２３を
備えており、一方、該アンドゲート１２４は、レ
ジスタ２６ないし２８がロードされていることを
表わす信号RCおよび信号Vcstに応答して有効化
される。発生器１２３は、クロツク信号Hiなら
びに該クロツク信号パルスHiの前縁および後縁
とそれぞれ同期したクロツク信号Ha，Hbを発生
すする。位相発生器１２５は、クロツク信号Hi
および信号Vcsstに応答するシフトレジスタによ
り構成されている。位相発生器１２５は、移相さ
れたタイミング信号φ′１ないしφ′６，φ′８，
φ′９ならびにアドレス信号A40を発生する。こ
れら信号は総て同じ周波数を有する。排他的オア
ゲート１１０の第２の入力端は、アンドゲート１
２１および１２２によつて駆動されるオアゲート
１２０の出力端に接続されている。ゲート１２１
は、信号φ′２およびレジスタ２６の出力信号に
応答し、他方、ゲート１２２は、信号φ′３およ
びレジスタ２７の出力信号に応答する。
レジスタ２８によつて指示されるカード５のメ
モリ６内の変更すべきビツトの数Ｎは、該レジス
タ２８から、アンドゲート１２７およびオアゲー
ト１２８を介して計数数器１２６に伝送される。
ゲート１２７は、信号φ′４およびHbに応答し、
他方、ゲート１２８はアンドゲート１２９からの
信号に応答し、一方、該アンドゲート１２９は信
号φ′４，Ha，SLに応答する。
計数器１２６の内容は、計数器１３０がアンド
ゲート１２９かまたはオアゲート１３１からの入
力信号によりイネーブルされた時に計数器１３０
に選択的に並列に供給される。オアゲート１３１
は、アンドゲート１３２および１３３に応答す
る。また、アンドゲート１３２は信号Hiおよび
φ′６に応答し、他方、ゲート１３３には信号
φ′９，HiおよびSLが供給される。計数器１２６
の滲れ出力信号は、JKフリツプ．フロツプ１３
４のトグル入力端に印加される。該フリツプ．フ
ロツプ１３４、インバータ１３６を介して発光ダ
イオードもしくはLED１３５を駆動するＱ出力
を有しており、ダイオードの発光で計数器１２６
の滲れが表示される。フリツプ．フロツプ１３４
のＪおよびＫ入力はそれぞれ信号φ′４および
φ′６に応答し、他方、このフリツプ．フロツプ
のセツト入力は信号φ′６に応答する。計数器１
３０の滲れ出力信号はJKフリツプ．フロツプ１
３７のＫ入力端に印加され、そして該フリツプ．
フロツプ１３７の出力信号はインバータ１３９を
介してLED１３８に供給される。フリツプ．フ
ロツプ１３７のセツト入力は、φ′６に応答す
る。
計数器１３６の滲れ出力信号はまた、インバー
１４１およびナンドゲート１４２を介してJKフ
リツプ．フロツプ１４０のＫ入力端に印加され
る。該ナンドゲート１４２は、φ′５が印加され
る第２の入力端を有する。フリツプ．フロツプ１
４０のＪ入力端にはアンドゲート１４３の出力信
号が印加され、そして該アンドゲート１４３は信
号φ′５およびA40を受ける。フリツプ．フロツ
プ１４０のＱ出力端には、位相信号φ′７が発生
する。フリツプ．フロツプ１４０のトリガ入力端
にはクロツク信号Hiが印加される。インバータ
１４１の出力端はまた、ナンドゲート１４５のを
介してJKフリツプ．フロツプ１４４のセツト入
力端に接続されている。該ナンドゲート１４５
は、信号φ′９が印加される別の入力端を備えて
いる。フリツプ．フロツプ１４４のＱ出力は、そ
れぞれインバータ１５４および回路６７から発生
される信号およびSLに応答するアンドゲート
１４８および１４９を介してJKフリツプ．フロ
ツプ１４６および１４７のＪ入力端に印加され
る。インバータ１５４は、回路６７のSL出力信
号に応答する。フリツプ．フロツプ１４６および
１４７のＱ出力は、それぞれインバータ１５１お
よび１５３を介して発光ダイオード１５０および
１５２に供給される。
回路６７からのSL信号はまた、それぞれ信号
φ′６およびアンドゲート１５６の出力信号に応
答するセツトおよびトグル入力端を有するJKフ
リツプ．フロツプ１５５のＪ入力端およびＫ入力
端にも供給される。アンドゲート１５６は、信号
Hiおよびφ′９に応答する。フリツプ．フロツプ
１５５の出力端は、JKフリツプ．フロツプ１
５７のトグル入力端に接続されており、このフリ
ツプ．フロツプは、インバータ１５９を介して発
光ダイオード１５８を駆動するＱ出力端を備えて
いる。信号RAZが発生され、接点１０２が閉じ
ている時には、フリツプ．フロツプ１３４，１３
７，１４０，１４４，１４６，１４７，１５５お
よび１５７は総て、２進「１」入力を受けるアン
ドゲート１０１に応答して零状態にリセツトされ
る。
最後に、アンドゲート１６０は、フリツプ．フ
ロツプ１０８，１１２，１３４，１３７，１４７
および１５７の出力を結合する。アンドゲート
１６０の出力信号は、異常停止を表わす信号
FINAを発生するインバータ１６１ならびにアン
ドゲート１６２に供給される。該アンドゲート１
６２はフリツプ．フロツプ１４６の出力が印加
される第２の入力端を有している。ゲート１６２
は、正常停止信号および異常停止信号を発生し、
これら信号は試験／チエツク回路Ｍ３に供給され
る。
次に、第１図ないし第１０図ならびに装置で用
いられる種々な信号の波形図である第１１図ない
し第１８図を参照し上述の装置の動作態様を説明
する。なお、カード５に情報をインプリントする
ための装置の動作に関しては、電話システムと関
連する既述の例に関して説明することにある。
装置の使用者にとつて行なわれる作用もしくは
行為は次の通りである。
(1) 郵便局のような適当な販売店でカード５を購
入する。この購入の際に、カードには購入者の
要求に従がいｎ単位の貸付け金額もしくはクレ
ジツトがイソプリントされる（ここでｎはカー
ドのメモリの容量に等しいかまたはそれにより
小さい数である）。イソプリントは通常カード
５の販売者によつて行なわれ、次のような動作
が含まれる。
(a) カードをイソプリント装置（第４図および
第９図）に挿入する。
(b) カードが存在し正しい位置にあることを判
定する。
(c) カード受け装置を鎖錠する。
(d) カードの回路と装置の回路との間における
良好な電気接触に関してチエツクする。
(e) カードがブランクであることを確認する。
(f) カード識別コード（符号）、消費単位識別
コードおよびカードに挿入すべき単位の数を
イソプリントし表示する。
(g) (f)で述べたデータをカードに転送する。
(h) 転送のチエツクを行う。
(2) カードの使用（但し適切な装置における使用
のみに限る） (a) カード装置（第５図および第１０図）のカ
ード受け部に挿入し、 (b) キーボードにより装置に所要数の消費単位
をロードする。
カードを使用しつつある時には、購入と関連し
て上に述べた相(b)，(c)および(d)と同じ相が実行さ
れる。いでカードのメモリの内容が、装置に表示
された単位の数に対応する量だけ減分される。こ
の減分は、メモリ内に格納されている利用可能な
単位が数が表示されている単位の数より大きいか
または等しいかをチエツクした後に行なわれる。
次に、これらの動作に関しさらに詳細に説明す
る。イソプリント装置（第４図）と関連のカード
受け装置（第６図）にブランクカード（素材カー
ド）５を挿入する。
フラツプ３２を開いて、第５図に示すように、
該カードの１つの緑が検出器３５と係合する位置
にカードを滑り入れる。カードは、釘（図示せ
ず）により読取りヘツド３８に対し正しい位置に
位置付けられる。フラツプ３２を閉じて、部材４
４を検出器３７（第７図）およびピン３９から引
込めてカード５に設けられている関連の接点に対
向する位置に設定する。
カード５の存在は検出器３５によつて検出さ
れ、該検出器は信号PT（第１１図）を発生す
る。パルス整形回路４０の出力端には「１」ビツ
トが現われてアンドゲート４１をイネーブル（有
効化もしくは可能化）する。フラツプを閉じる
と、検出器３７の出力端には「０」ビツト（信号
SF）が現われる。インバータ４３は「１」ビツ
トを発生し、このビツトは、有効化もしくはイネ
ーブルされたアンンバゲート４１を介して供給さ
れて単安定回路４２をトリガする。この単安定回
路４２は、接続期間τ３の負のパルスを発生し
て、フラツプ３２の鎖錠を命令する。このパルス
で、鎖錠フリツプ．フロツプ４５がトリガされ、
該フリツプ．フロツプ４５は、回路４６を介して
掴み３６（信号SV参照）を作動し、フラツプを
その閉位置に鎖錠する。
フラツプが適切に鎖錠されることを保証する長
さを有する（単安定回路４７によつて決定され
る）期間τ１の経過後に、単安定回路４８はカー
ドに設けられている接点の試験を指令する長さτ
２の信号を発生する。この信号は、バツフアＭ１
に供給される。試験の結果として接点が正しい位
置にあること（第１１図）が示されると、鎖錠さ
れた状態が維持され有効化信号がフリツプ．フロ
ツプ４９により電源回路Ｍ２に伝送される。試験
の結果接点が正しい位置にないことが示された場
合（第１２図）には、長さもしくは持続期間τ４
のパルスが、単安定回路４８により発生される信
号の終時に単安定回路５１によつて発生される。
長さτ４のパルスはフリツプ．フロツプ４５を零
にリセツトし、その結果、フラツプ３２は解錠さ
れる。フラツプ３２が鎖錠されていないかまたは
オペレータによつて保持されていない場合には、
該フラツプ３２はばねによつて開かれる。
電源回路Ｍ２の電源５３および５６（第８図）
は、試験／チエツク回路Ｍ３からの信号により有
効化される。回路５７および５８は電圧V1およ
びV2を検出する。これら２つの電圧が正しい値
を有している場合には、アンドゲート５９は２進
「１」信号（第１３図）を発生する。この２進
「１」信号に応答して、アンドゲート６０は比較
器６１により発生される信号をゲートする。この
信号は所要の状態にあるカードにより惹起される
電流変化△I1を比較器６１が検出した場合に発生
される信号である。
上記試験／チエツク回路Ｍ３からの信号は単安
定回路６４を付活する。この単安定回路は、長さ
τ５のパルスを発生する。パルスτ５の後縁に応
答して、アンドゲート６３は、比較器６１の出力
が正の電圧であるか否かを決定する。比較器６１
の出力が正の電圧でない場合（即ちカード５から
電圧が得られない場合）には、単安定回路６２
は、長さもしくはパルス幅τ６の負のパルスを発
生し、このパルスで動作は終了せしめられる。即
ち、フラツプが解錠されて、電源５５および５６
は減勢される（第１４図参照）。
試験回路Ｍ３からの「接触試験要求」信号に応
答して、オアゲート６８および６９（第９図）は
信号VEを発生し、インバータ７２および７３は
信号SEを発生する。信号VEは回路６６および６
７を付活し、その結果、カード５の接点がピン３
９と適切に係合している場合には、回路６６およ
び６７のＨおよびＥ／Ｓ出力端からそれぞれ信号
SEが発生される。また、この適切な接触に応答
し、回路６６および６７は２進「１」BC信号を
発生する。２進「１」BC信号はアンドゲート７
６′により結合され、該アンドゲートは「試験結
果」信号を発生し、この信号は試験回路Ｍ３に印
加される。電源回路Ｍ２からの信号Vcst（第１
５図）は、（「レジスタがロードされている」こと
を表す信号RC「１」である場合）、クロツク７７
を起動すると共にレジスタ１０４を付活し、その
結果該レジスタ１０４は相続く位相信号′１な
いし′７を発生する。レジスタ２６，２７およ
び２８（第４図）のうちの何れかが、カードにイ
ソプリントもしくは刻印したい金額をロードされ
ると当該レジスタにより信号RCが発生される。
なおこれら金額を表す信号は、オペレータによる
キーボード２６の操作に応答して上記レジスタに
供給される。
位相′１（第１８図）中、カード５のメモリ
６はフリツプ．フロツプ２０（第３図）のＱ出力
により読出し状態に付勢され、それにより、メモ
リ６の2048個のアドレスの内容は（回路６７の出
力に現われる）信号SLに応答しフリツプ．フロ
ツプ８１（第９図）のＪ入力に伝送される。カー
ド５のメモリ６が空きもしくはブランクでない場
合、即ちメモリのビツド零が２進「１」である場
合には、フリツプ．フロツプ８１は、信号SL
「１」にセツトされる。位相′１の終時に、フリ
ツプ．フロツプ８２は、該フリツプ．フロツプの
クロツク入力端に印加される「１」パルスの後縁
に応答して「１」にセツトされる。フリツプ．フ
ロツプ８３が「１」にセツトされると、発光ダイ
オード８３が励起されてオペレータにはカードが
利用不可能である旨の警報が与えられる。そこで
オペレータはボタン１０２を押して装置をイニシ
アライズもしくは初期設定（零リセツト）しさら
に使用することを可能にする。
カードのメモリが空きもしくはブランク（ビツ
ト零＝「０」である場合には、フリツプ．フロツ
プ８１は状態零に留まる。と言うのは、ゲート７
９を介して該フリツプ．フロツプ８１のＪ入力端
にSL信号が供給されないからである。その場合
には、種々な位相′１ないし′７は通常の仕方
で進行する（第１５図および第１８図参照）。位
相′２ の初めに、フリツプ．フロツプ２０
（第３図）は計数器１２の出力端にアドレス
「2047」を検出することによりメモリ６を書込み
状態に付活する。メモリ６は、計数器１２に滲れ
が生ずるまで、′２，′３および′４の全期
間に渡り書込み状態に留まる。
位相′２中、レジスタ２６の内容（カードの
使用を識別するコード）は、ゲート７５，７４，
７１および回路６７を介してカード５のメモリ６
に転送される。レジスタ２６の内容は、循環もし
くはループシフトにより保存される。
位相′３中、レジスタ２７の内容（サービス
または品物が供給される単位を識別するコード）
がゲート７６，７４，７１および回路６７を介し
てカード５のメモリ６に転送される。レジスタ２
７の内容は、循環シフトにより保存される。この
位相′３中、レジスタ２８の内容（カードにイ
ンプリントすべき単位の数）がレジスタ１０５に
供給される。
位相′４中、レジスタ１０５からのＮ１個の
ビツトは、回路６７によりゲート７１および７４
を介してカードのメモリ６に転送され。。位相
′４は、計数器１０４が零に達した時に終末す
る。計数器１０４が4096まで計数した時には、信
号φ′５（第１８図参照）がメモリ６に予めイン
プリントされている情報がチエツクされる。この
目的で、位相′４中、メモリ６の内容（信号
SL）は排他的オアゲート８０でレジスタ２６お
よび２７の内容と比較される。この比較の結果と
してインプリントされた情報とレジスタ７６およ
び７７内の情報との間に相異があることが検出さ
れた場合には、フリツプ．フロツプ８７は「１」
にセツトされる。この比較の終時に、フリツプ．
フロツプ８８は「１」にセツトされ、発光ダイオ
ード８９が付勢されて、カードにインプリントさ
れた情報が正しくない旨の警報がオペレータに与
えられる。そこで一連の動作は停止し、オペレー
タはボタン１０２を押して装置を初期設定する。
比較の結果、上述のような相異がないことが明ら
かになつた場合には、フリツプ．フロツプ８７は
零状態に留まり、装置は位相′６に進むこの期
間中、カードのメモリ６のイネーブルビツト（第
１図）は「１」にセツトされている。
位相′７中、零ゾーンビツト１（第１図）が
正しく「１」をインプリントされる。カードのビ
ツトないし４０が読出されてゲート８０で、レジ
スタ２６および２７の対応の段ビツトと比較され
る。この期間の終りに、比較結果が満足すべきも
のであれば、LED９６が付勢されて、零ビツト
が正しくインプリントされたことの表示が与えら
れる。比較結果が不満足である場合には、LED
９４が付勢されて、零ビツトが正しくインプリン
トされなかつたことを表す警報が発生される。
正常および異常な動作が終末したことを表わす
信号（信号FINNおよびFINA）は、外部装置に
供給される。信号FINNは、取引を許可もしくは
有効化する。信号FINNおよびFINAはそれぞ
れ、フリツプ．フロツプ９３およびインバータ１
００から発生される。動作の正常および異常な停
止は、アンドゲート９９により試験回路Ｍ３に報
知され、それによりカードを回収することができ
る。
カードの使用を可能にする回路M′１（第１０
図）は第５図の装置で用いられる。この装置もし
くはマシンは、減分すべき（即ち支払いを行うべ
き）カードを受けるための装置を備えている。第
５図の装置の多くの部分は、カードにインプリン
トを行うための第４図に示した装置の部分と同じ
であり、詳細な回路構成は第１０図に示してあ
る。なお、第９図および第１０図の回路の対応の
要素には、便宜上同じ参照数字を付した。
カード５が第５図のカード受け装置に挿入され
ると、試験回路Ｍ３からの「接触試験」信号で回
路６６および６７（第１０図）が有効化されて、
信号SEが出力端ＨおよびＥ／Ｓに発生される。
接触が良好である場合には、回路６６および６７
からの信号BCは「１」レベルとなり、アンドゲ
ート７６′で結合される。２進「１」のBC信号に
応答して、ゲート７６′は「試験結果」信号を発
生し、この信号はチエツク回路Ｍ３に伝送され
る。信号RCが「１」の値を有しておつて、全て
のレジスタ２６，２７および２８がロードされて
いることを表す。即ち、使用者が所要の情報（カ
ードの識偏コード、単位の識別コードおよび減分
すべき単位の数）をキーボード２４により上記レ
ジスタに供給した時には、電源回路Ｍ２からの信
号Vcstがクロツク１２３を起動する。
信号Hiに加え、クロツク１２３は、信号Haお
よびHb（第１６図）を発生する。信号Hi，Haお
よびHbは全て同じ周波数を有しているが、信号
HaおよびHbのパルスはパルスHiのパルス幅の半
分のパルス幅を有している。パルスHiの前縁お
よび後縁は、それぞれ、パルスHaおよびHbの前
縁と同期している。種々な位相′１ないし′９
の遷移は第１７図に示されている。
信号Vcstが現れると直ちに位相′１が開始す
る。この位相′１中、アドレス１のメモリ６の
零ビツトが、計数器１２がアドレス１に駆動され
ることにより検出される。この検出された零ビツ
トは、フリツプ．フロツプ１７（第３図）のＱ出
力を「１」状態にセツトする。位相′１ないし
′５中、メモリ６は、フリツプ．フロツプ２０
により読出し状態にセツトされて、アンドゲート
１９の入力にＡ３，Ａ５，Ａ１１の組合せが現
れ、該ゲート１９がフリツプ．フロツプ１７のＱ
出力により有効化されるまでこの読出し状態に留
まる。
位相′２の初めに、カードのメモリ６の零ア
ドレスのデータが検査され、回路６７からの出力
信号SLの反転信号がフリツプ・フロツプ１０８
に印加される。アドレス零のデータが「０」であ
る場合には、フリツプ・フロツプ１０８は「１」
にセツトされ、発光ダイオード１１４が点燈す
る。信号FINA（異常停止）がインバータ１６１
を介して、品物またはサービスを供給する装置に
伝送される。オアゲート１６２により「正常また
は異常動作停止」信号が試験／チエツク回路Ｍ３
に伝送されて、カードは回収され、一連の動作は
中断する。装置は、オペレータがボタン１０２を
押すことによりイニシアライズされる。アドレス
零のデータが「１」である場合には、フリツプ・
フロツプ１０８は「０」状態に留まり、相続く動
作は、中断無く行われる。
位相′２および位相′３中、カード５のフイ
ールドもしくはゾーン２および３（カード識別コ
ードおよび単位識別コード）５は、排他的オアゲ
ート１１０（第１０図）で、ゲート１２０ないし
１２２を介してゲート１１０に供給されるレジス
タ２６および２７の内容と比較される。レジスタ
２６および２７の内容が異なる場合には、フリツ
プ・フロツプ１１１はゲート１１０の出力により
「１」にセツトされる。位相′４の開始点で、フ
リツプ・フロツプ１１１の出力はフリツプ・フロ
ツプ１１２を「１」にセツトし、ダイオード１１
５を点燈せしめる。信号FINA（異常停止）が発
生され、そして「正常または異常停止」信号がチ
エツク回路Ｍ３に伝送されて、動作の続行を阻止
する。装置は、そこで、オペレータがボタン１０
２を押すのに応答してイニシアライズもしくはリ
セツトされる。レジスタ２６および２７の内容が
同じである場合には、フリツプ・フロツプ１１１
「０」にセツトされた状態に留まり、フリツプ・
フロツプ１１１ないし１１３のカスケード接続
は、位相′４の開始時にフリツプ・フロツプ１
１３を「１」にセツトせしめる。そこでダイオー
ド１１６が点燈し、一連の動作が続けられる。
位相′４中は、カード５は読出されつつある
状態にある。フイールドもしくはゾーン２および
３内の「１」ビツトの数が計数器１３０で計数さ
れる。計数器１３０内の「１」ビツトの数ＮがＮ
nax（カードのメモリ内で利用可能な記憶場所の
数）に等しくなると、計数器１３０は滲れ、それ
によりフリツプ・フロツプ１３７はセツトされ
る。ダイオード１３８が点燈し、全てのカード内
容が使用し尽くされたことを表示し、そして動作
は、「異常停止」信号によつて停止される。数Ｎn
ａｘより小さい場合には動作は続行する。さらに、
位相′４中カード５の「１」ビツトの数Ｎなら
びに変更すべき（「０」から「１」に切換えるべ
き）ビツトの数Ｐが計数器１２６で計数されて、
加算し合され、（Ｎ＋Ｐ）の計数が発生される。
ＮおよびＰ信号は、ゲート１２７ないし１２９を
介して計数器１２６に供給され、その結果、レジ
スタ２６の各ビツトは、信号HaおよびHb（第１
６図）と同期してカードのメモリ６の各ビツトと
インターリーブされる（Ｎ＋Ｐ）がＮnaxに等し
くなつた時には、計数器１２６が滲れてフリツ
プ・フロツプ１３４をセツトする。ダイオード１
３５がそこで点燈して、カードで利用可能な記憶
場所の数が、Ｐ個の単位を記憶するのに不十分で
あることの表示を行う。そこで、「正常停止」信
号により動作は停止せしめられる。（Ｎ＋Ｐ）が
Ｎnaxよりも小さい場合には、動作は続行する。
位相′５中計数器１２６の内容（Ｎ＋Ｐ）は計
数器１３０に転送され、該計数器１３０は「０」
から「１」に切換えられるべきカード上のビツト
の数の計数を格納する。
位相′５の終時に、装置は順位位相′６，
′７に進み、この位相中フリツプ・フロツプ
１４０は「１」にセツトされる。位相′６およ
び′７中、カード５のメモリ６にデータが書込
まれる。この時点で、フリツプ・フロツプ２０の
Ｑ出力は「０」状態に切換わり、回路６７は有効
化され、その結果該回路６７から出力が発生さ
れ、（Ｎ＋Ｐ）を格納している計数器１３０は減
分される。計数器１３０の計数が零に達すると、
それに応答してフリツプ・フロツプ１４０は
「０」にセツトされる。フリツプ・フロツプ１４
０が信号′７を発生している全期間中、カード
５のメモリ６には「１」がイソプリントされる。
位相′７が終結した後、位相′６の終末まで、
カード５のメモリ６には「０」が記憶される。即
ち、カードのメモリの内容には変化は生じない。
位相′８中、計数器１２６の（Ｎ−Ｐ）計数
は再び計数器１３０に転送される。この位相中、
カードのメモリ６は再び読出し状態になる。
位相′９中、カード５は依然として読出され
ており、そして計数器１３０は減分されている。
３つの可能な場合があり得る。即ち、 (a) 正常の場合、即ちカードのメモリ内「１」ビ
ツトの数が（Ｎ＋Ｐ）に等しい場合。この場合
には、計数器１３０の滲れは回路６７からの
SL＝「０」に対応する。計数器１３０の滲れ
で、フリツプ・フロツプ１４４はセツトされる
ので、カードのメモリ６内の次の記憶場所が
「０」である場合にはフリツプ・フロツプ１４
６がセツトされる。フリツプ・フロツプ１４６
のセツトされる。フリツプ・フロツプ１４６の
セツトでダイオード１５０が点燈する。そこで
動作は、ゲート１６２から発生される正常停止
信号で終末せしめられて、回路Ｍ４には正常停
止信号FUNNが供給される。
(b) 第１の異常な場合、即ちカード５に格納され
ている「１」ビツトの数が（Ｎ＋Ｐ＋ａ）であ
つてａ１である場合。計数器１３０の滲れで
回路６７からSL＝「１」が発生される。計数器
１３０の滲れでフリツプ・フロツプ１４４がセ
ツトされ、それにより次のカードの記憶場所が
「１」である時にはフリツプ・フロツプ１４６
がセツトされる。フリツプ・フロツプ１４６の
セツトでダイオード１５２が点燈し、動作はア
ンドゲート１６０およびインバータ１６１を介
して発生される異常停止信号FINAにより終末
させられる。
(c) 第２の異常な場合、即ちカードに格納されて
いる「１」ビツトの数が（Ｎ＋Ｐ−ａ）であつ
て、ａ１である場合。この場合には、位相
′９の開始時に「１」にセツトされたフリツ
プ・フロツプ１５５は、フリツプ・フロツプ１
４４が「１に切換わる前に「０」に切換わる。
斯くしてフリツプ・フロツプ１５７は「１」に
セツトされ発光ダイオード１５８が付勢され、
動作は異常停止信号により終末せしめられる。
以上本発明は、或る種の取引きに対する１つの
適用例、即ち或る金額の代償としての或るのサー
ビスの提供と関連して説明した。この種の応用用
途には国営であれ、私営であれ会社もしくは企業
と個人との間における多数の取引きが含まれる。
したがつて本発明の装置は上に述べたような公衆
または私設電話からの電話呼に対する支払いまた
は切手の購入等に適用できるばかりではなく、例
えば電気料金支払、ガソリン、食料品購入その他
ホテルのサービスに対する支払い等のような多数
の他のサービスを受けたり、それに対する支払い
に適用することができよう。なおホテルのサービ
スの場合には本発明のカードを用いて食費代、部
屋代等の支払いを行うことができる。
尤もこのような用途には問題となるサービスを
供給したり記録したりする特殊な形態の装置が必
要とされるであろう。或る種の事例においては対
応の債務がカードに記録されてしまうまでサービ
スが行われない場合がある。また、カードの記録
が支払いおよび（または）金額登録の目的でのみ
行われる場合がある。しかしながら本発明は単に
取引を単純化することだけを企むものではなく
て、一般に本発明によるカードに保持者に対し、
或いはまた該保持者から消費または使用小切手、
違約金等を表す金額を貸し付けたり、支払わせた
りする動作に一般に適用可能である。
以上本発明を１実施例と関連して説明したが、
開示内容に関しては本発明の範囲を逸脱すること
なく、多数の変更が可能である。
【図面の簡単な説明】
第１図は本発明による物品の情報の内容のレイ
アウトを示すダイヤグラム、第２図は物品に設け
られた回路のブロツク・ダイヤグラム、第３図は
第２図の回路の一部を示す詳細なブロツク・ダイ
ヤグラム、第３ａ図は第２図の回路の一を示す詳
細なブロツク・ダイヤグラム、第４図は物品にデ
ータのインプリントを行うための手段の論理ダイ
ヤグラム、第５図は物品を使用する装置の論理ダ
イヤグラム、第６図は物品にインプリントを行な
う且つ該物品を使用するための装置の一部を示す
略図、第７図は物品チエツクするための装置の論
理ダイヤグラム、第８図は物品に電力を供給する
ための装置のダイヤグラム、第９図は第４図の装
置と物品との間で対話を行なわせるための装置の
論理ダイヤグラム、第１０図は第５図の装置と物
品との間で対話を行なわせるための装置の論理ダ
イヤグラム、第１１図は接触が良好な場合に接触
試験中生ずる信号の波形図、第１２図は接触不良
の場合に接触試験中生ずる信号の波形図、第１３
図は電圧V1およびV2が印加された時に生ずる信
号を示すタイミング・ダイヤグラム、第１４図は
電圧V1およびV2が印加されたけれども物品によ
つて受電されない場合に生ずる信号のタイミン
グ・ダイヤグラム、第１５図は書込み位相信号の
タイミングダイヤグラム、第１６図はクロツク信
号のタイミング・ダイヤグラム、第１７図は処理
演算相の信号の波形を示すタイミング・ダイヤグ
ラム、そして第１８図はメモリの読出し／書込み
信号のタイミング・ダイヤグラムでる。 Ｍ１……バツフア、Ｍ２……電源回路、Ｍ３…
…試験／チエツク回路、Ｒ……抵抗器、Ｅ／Ｓ…
…データ入／出力端子、Ｚ……ツエナーダイオー
ド、５……カード、６……メモリ、７……アドレ
ス発生器、８……論理回路、８ａ，８ｂ……比較
器、８ｃ……常開コレクタナンド回路、１０……
入力アドレスＡ、１２……レジスタ、１３……ノ
アゲート、１４，１６，１９，４１，５０，５
２，５４，５９，６０，６３，７５，７６，７
９，８５，８６，９８，９９，１０１，１０６，
１０７，１２１，１２２，１２４，１２７，１２
９，１３２，１３３，１４３，１４８，１４９，
１５６，１６０，１６２……アンドゲート、１
５，４３，５３，７２，７３，８４，９０，９
５，９７，１００，１０９，１７７，１１８，１
１９，１３９，１４１，１５１，１５３，１５
４，１５９，１６１……インバータ、１７，２
０，４５，４９，８１，８２，８７，８８，９
１，９２，９３，１０８，１１１，１１２，１１
３，１３４，１３７，１４０，１４４，１４６，
１４７，１５５，１５７……JKフリツプ・フロ
ツプ、２２……カードホルダ、２３……カードイ
ンプリント回路、２４……キーボード、２５……
選択スイツチ、２６，２７，２８，１０４，１０
５，２２５……シフトレジスタ、２９……デイス
プレイ、３０……スイツチ、３２……フラツプ、
３３……軸、３４……板、３５……存在検出器、
３６……掴み、３７……検出器、３８……読取り
ヘツド、３９……ピン、４０……パルス整形回
路、４６……制御／増幅回路、４２，４７，４
８，５１，６２，６４……単安定フリツプ・フロ
ツプ、５５，５６……直流電源、５６，５８，６
１……電圧比較器、６６，６７……チエツク回
路、１８，６８，６９，７０，７１，７４，７
６，８０，１２０，１２８，１３１……オアゲー
ト、７７……クロツク源、８３，８９，９４，９
６，１１４，１１５，１１６，１３５，１３８，
１５０，１５２，１５８……発行ダイオード、１
０２……プツシユボタン、１１０……排他的オア
ゲート、１２３……クロツク信号発生器、１２５
……位相発生器、１２６，１３０，１３６……計
数器、１４２，１４５，ナンドゲート。

Claims (1)

  1. 【特許請求の範囲】 １ 情報を有する物品５と該物品５に前記情報を
    インプリントしかつ（または）該情報を処理する
    ための外部手段２３，３１とを備え、 前記物品は、第１，第２および第３フイールド
    ２，３，４第１図内に符号化されたビツトを記憶
    するためのメモリ６を有し、前記第１のフイール
    ド２は、前記物品が企図されている使用を識別す
    る変更不可能な複数ビツドを有し、前記第２のフ
    イールド３は、貸付価値の単位を識別する変更不
    可能な複数ビツトを有し、前記第３のフイールド
    ４は、前記物品５の保持者に利用可能である貸付
    価値の単位の数を表わす変更可能な複数ビツトを
    有し、 前記物品はまた、 前記メモリ６を制御するための回路７，８と、 前記物品を前記インプリントしかつ（または）
    処理するための外部手段２３，３１に一時的に結
    合するための手段９，１０，１１，３８，３９と
    を備え、 前記インプリントしかつ（または）処理するた
    めの外部手段２３，３１は、前記物品のメモリに
    対してデータの読出しおよび書込みを行なう手段
    Ｍ１，M′１，Ｍ２，Ｍ４，２４，２６，２７，
    ２８を備えており、 前記外部手段か前記物品のメモリ６に、以下の
    パラメータ、即ち、 (a) 前記メモリの容量の限界内で前記物品５の保
    持者が要求または受取つた単位の数、および、 (b) 前記物品のメモリの利用可能な単位の数から
    物品の保持者が要求または受けた差引かれるべ
    き単位の数、 の少なくとも１つを表わす情報を書込むための手
    段M′１，Ｍ４を含んでいる。予め定められた均
    等な単位の勘定記録を行なう装置。 ２ 前記メモリ内にインプリントされた情報の総
    てもしくは一部分を、情報の各項目をｎビツトの
    フイールド内に表現した変更不可能なコードとし
    て符号化し、そしてインプリント後は１つの状態
    から他の状態への切換を不可逆性となし、用いら
    れる各フイールド内の不可逆状態にあるビツドの
    数ｍを予め定ておいてｎよりも小さいかまたはそ
    れに等しくした特許請求の範囲第１項記載の予め
    定められた均等な単位の勘定記録を行なう装置。 ３ 利用可能な項目に対し使用された項目の勘定
    を記録するメモリ６に対するデータ項目の書込み
    をメモリの１つまたは多数のミクロ要素の物理的
    状態における不可逆的変化によつて行う特許請求
    の範囲第１項または第２項記載の予め定められた
    均等な単位の勘定記録を行なう装置。 ４ 物品の外部にアクセス可能な結合手段が、情
    報が物品のメモリ内にインプリントされつつある
    時または該情報が使用されつつある時に、インプ
    リント手段（第４図）および（または）処理手段
    （第５図）に設けられ物品に固定された接点９，
    １０，１１，Ｅ／Ｓ，Ｈ）と協働する多ピン読出
    しヘツド３８を含み、前記インプリントおよび
    （または）処理手段の回路と前記物品の回路との
    間の接続を行なうようにした特許請求の範囲第１
    項ないし第３項のいずれかに記載の予め定められ
    た均等な単位の勘定記録を行なう装置。 ５ 前記物品５およびそれにインプリントおよび
    （または）処理を行う外部手段２３，３１の両方
    に対し、論理回路およびプログラム回路に給電が
    連続的に行われているか否かをモニタするための
    手段Ｍ２を備えておつて、該モニタ手段は前記物
    品においては前記論理回路６およびプログラム回
    路７に対する給電を検出して、抵抗器Ｒを介し前
    記論理回路の給電部９，１１に接続されている開
    コレクタナンド回路８ｃで結合される２つの信号
    を発生し、それにより前記論理回路６に対して給
    電を行う導体の電流に変化△I1を生ぜしめる２つ
    の電圧比較器８ａ，８ｂにより構成された回路を
    含み、そして前記外部手段においては、前記プロ
    グラムおよび論理回路に対する前記給電の局部的
    存在を検出するための２つの比較器５７，５８
    と、前記２つの比較器から有効化されると共に前
    記論理回路に対して給電を行う導体の電流の前記
    物品によつて生ぜしめられる変動を検出する第３
    の電圧比較器６１によつて有効化されるアンドゲ
    ート６０を備えており、前記アンドゲートは前記
    物品との対話を制御する回路M1に伝送される有
    効化信号（Vcst）を発生するようにした特許請
    求の範囲第１項ないし第４項のいずれかに記載の
    予め定められた均等な単位の勘定記録を行なう装
    置。
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