JPS61111526A - マスクパタ−ンの欠陥修正方法 - Google Patents

マスクパタ−ンの欠陥修正方法

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Publication number
JPS61111526A
JPS61111526A JP59213796A JP21379684A JPS61111526A JP S61111526 A JPS61111526 A JP S61111526A JP 59213796 A JP59213796 A JP 59213796A JP 21379684 A JP21379684 A JP 21379684A JP S61111526 A JPS61111526 A JP S61111526A
Authority
JP
Japan
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defect
white defect
resist
white
defects
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Pending
Application number
JP59213796A
Other languages
English (en)
Inventor
Yukihiro Koyama
小山 幸宏
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sharp Corp
Original Assignee
Sharp Corp
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Filing date
Publication date
Application filed by Sharp Corp filed Critical Sharp Corp
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Publication of JPS61111526A publication Critical patent/JPS61111526A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
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  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Preparing Plates And Mask In Photomechanical Process (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 く技術分野〉 本発明は半導体装置の製造に利用するマスクパターンの
欠陥修正方法に関し、マスク材料の被着が欠除した白系
欠陥を修正する方法に関するものである。
〈従来技術〉 IC,LSI 等の半導体装置を製造する工程では、不
純物の拡散、絶縁膜のエツチング、配線等の際に、対応
するパターンが形成されたマスクが用いられる。この種
のマスクはガラス等の透明基板上に、クロム等の遮光性
をもつ金属膜が蒸着等によって被着され、該被着された
金属膜を所望パターンにエツチングすることによって作
成されている。
このようなマスクの作成において、原パターンの欠陥、
塵埃の付着或いはエツチング不良等のためにクロム膜の
パターンにしばしば欠陥が生じる。
第3図はマスクパターンに通常出現し易い欠陥を例示す
るもので、ガラス基板l上に被着したクロム膜2はエツ
チングすることによってパターン化されているが、クロ
ム残りによって生じる黒糸欠陥81+32及びクロム膜
が欠除した白系欠陥41゜42 + 43がある。上記
各種の欠陥の内特に上記黒糸欠陥31.32を修正する
方法として、レーザ光を照射してクロムを焼き切る方法
が、白系欠陥41゜42+43を修正する方法として、
クロム蒸着により白系部を埋めるリフトオフ法が用いら
れている。
本考案は後者の白系欠陥を修正する方法に関するもので
あるが、従来から行われているリフトオフ法を利用して
修正する場合次に説明するように新たな黒欠陥が発生す
る慣れがある。
即ち第4図(a)に示す如く、クロム膜2が所望パター
ンで形成されたガラス基板lに対して、リフトオフ法に
よって欠陥を修正するべくレジスト5が塗布され、白系
欠陥部分を露出させるために上記レジスト5にスポット
露光が施こされ、修正のためのクロム膜を蒸着するため
の開口が形成される。
上記リフトオフ工程中のレジスト塗布工程において、レ
ジスト中に含まれる異物、ゲル状物質。
気泡等によりレジスト5にピンホール6が発生したり、
或いはレジストを塗布する基板の汚れ、異物等によって
もピンホール6が発生する。このようにピンホール6が
発生したレジスト5上に第4図(b)の如くクロム膜7
を蒸着した場合、本来の白系欠陥部以外の部分、即ちピ
ンホール6にまでもクロム膜τが付着することになり、
クロム膜7′は第4図(C)に示す如く新たな熱系欠陥
を発生する。
従ってマスク利用に際しては上記のような熱系欠陥を更
に修正する必要があり、マスク製造の作業工数が増え、
作業能率が著しく損われるという欠点があった。
〈発明の目的〉 本発明は、上記従来のホトマスクにおける白系欠陥を修
正する方法の問題点に鑑みてなされたもので、リフトオ
フ法で修正する過程に新たに生じる熱系欠陥を最小限に
留めた修正方法を提供する。
〈実施例〉 第1図(a)において、従来のホトマスク製造工程と同
様の工程を経て透明なガラス基板lの表面にクロム等の
金属膜2が被着され、エツチング等によって所望形状に
加工される。所望パターンにエツチングされたガラス基
板1面の金属膜2は、パターン読み取り装置や顕微鏡観
察等によってパターンの点検が実行され、欠陥部分特に
本実施例では白系欠陥8の位置が検出される。検出され
た欠陥位置情報は磁気カード等のメモリ手段に記憶保持
され、次に述べるレジストのスポット露光や遮光板を加
工するための位置情報等として利用される。
第1図(b)において白系欠陥8が検出されたガラス基
板1に対して、該白系欠陥8を修正するためにまず金属
膜2が被着されたガラス板全面にポジレジスト5が塗布
される。続いて白系欠陥8の部分のガラス面を露出させ
るため、上記検出された欠陥部の位置情報に基いて白系
欠陥8にスポット露光9が施こされ(第1図(c) )
 、現像処理によってレジストの一部が除去される(第
1図(d))。露出した白系欠陥8の部分に遮蔽板+1
を利用してマスク材料と同一のクロム等による金属膜1
0が第4図(e)の如く蒸着される。上記遮蔽板11は
、金属膜10の蒸着作業に先立って、第2図に示す如く
上記白系欠陥8の位置検出結果に基いて作製される。即
ちレジスト5の白系欠陥を含んでその近傍を開口し、他
の領域を蒸着から遮蔽するために、欠陥検出工程で検出
され、磁気カード13等に記憶させた欠陥位置情報を利
用して遮蔽板11に開口12が形成される。
第2図において、欠陥位置の検出は、自動欠陥検査装置
14或いは顕微鏡15による欠陥検査により行ない、磁
気カード13やその他の記憶装置16により座標データ
として記憶保持させ、該座標データを上記スポット露光
のための情報或いは遮蔽板11を作製するための情報と
して活用する。
上記所定位置に開口12が作製された遮蔽板10で金属
膜が被着されたガラス板1を覆って修正用金属膜を蒸着
することにより、レジストに生じたピンホール等に金属
膜か被着されず、レジスト剥離後には白系欠陥8の部分
のみに金属膜が被着され、第1図(f)に示す如く欠陥
が修正される。
上記修正工程において、レジストにピンホールが生じて
いるとしても金属膜蒸着時にはレジストは遮蔽板11で
覆われているため、新たな黒欠陥となる惧れはない。
く効果〉 以上本発明によれば、新たな欠陥を発生させることなく
ホトマスクの欠陥を修正することができ、ホトマスク製
造工程の負担を著しく軽減することができ、また修正し
たホトマスクの再検査においても、蒸着された部分のみ
を検査すれば済み、短時間で効率的に処理することかで
きる。
【図面の簡単な説明】
第1図(a)乃至(f)は本発明tこよる一実施例を説
明するための断面図、第2図は本発明1こよる遮蔽板の
作製工程を説明するためのブロック図、第3図はホトマ
スクに生じる欠陥の種類を示す図、第4図(a)乃至(
c)は従来のリフトオフ法による欠陥修正方法を説明す
るための断面図である。 Iニガラス基板、2:金属膜、5ニレジスト、6:ピン
ホール、8:白系欠陥、IO:修正用金属膜、11:遮
蔽板、I2:開口。 代理人 弁理士 福 士 愛 彦(他2名)ゝl 第 /I1m

Claims (1)

    【特許請求の範囲】
  1. 1)透明基板上に金属膜を被着して所望パターンのマス
    クを作成する工程と、該マスクパターンに対してマスク
    材料が欠陥した白系欠陥を検出する工程と、上記白系欠
    陥を除いてマスクパターン上をレジストで被う工程と、
    白系欠陥部近傍を露出させてレジスト面を遮蔽板で被つ
    てマスク材料を蒸着する工程と、上記遮蔽板及びレジス
    トを除去する工程とからなることを特徴とするマスクパ
    ターンの欠陥修正方法。
JP59213796A 1984-10-11 1984-10-11 マスクパタ−ンの欠陥修正方法 Pending JPS61111526A (ja)

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JP59213796A JPS61111526A (ja) 1984-10-11 1984-10-11 マスクパタ−ンの欠陥修正方法

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JP59213796A JPS61111526A (ja) 1984-10-11 1984-10-11 マスクパタ−ンの欠陥修正方法

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JPS61111526A true JPS61111526A (ja) 1986-05-29

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ID=16645189

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JP59213796A Pending JPS61111526A (ja) 1984-10-11 1984-10-11 マスクパタ−ンの欠陥修正方法

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JP (1) JPS61111526A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63210845A (ja) * 1987-02-27 1988-09-01 Hitachi Ltd 欠陥修正方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63210845A (ja) * 1987-02-27 1988-09-01 Hitachi Ltd 欠陥修正方法

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