JPS6047515A - 同期引込判別回路 - Google Patents

同期引込判別回路

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JPS6047515A
JPS6047515A JP58155774A JP15577483A JPS6047515A JP S6047515 A JPS6047515 A JP S6047515A JP 58155774 A JP58155774 A JP 58155774A JP 15577483 A JP15577483 A JP 15577483A JP S6047515 A JPS6047515 A JP S6047515A
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JP
Japan
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signal
output
level
phase difference
counter
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JP58155774A
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Takeshi Enami
江波　健
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Victor Company of Japan Ltd
Nippon Victor KK
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Victor Company of Japan Ltd
Nippon Victor KK
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    • H03—ELECTRONIC CIRCUITRY
    • H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
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    • H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08—Details of the phase-locked loop
    • H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
    • H03L7/095—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal using a lock detector
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01P—MEASURING LINEAR OR ANGULAR SPEED, ACCELERATION, DECELERATION, OR SHOCK; INDICATING PRESENCE, ABSENCE, OR DIRECTION, OF MOVEMENT
    • G01P3/00—Measuring linear or angular speed; Measuring differences of linear or angular speeds
    • G01P3/42—Devices characterised by the use of electric or magnetic means
    • G01P3/56—Devices characterised by the use of electric or magnetic means for comparing two speeds
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    • G—PHYSICS
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は同期引込判別回路に係り、２つのパルス信号が
同期がとれていることを確実に判別し得る同期引込判別
回路に関する。
従来技術 第１図は従来の同期引込判別回路の一例の回路図を示す
。端子１に入来した基準信号Ｓ＋　（第２図（Ａ））及
び端子２に入来した基準信号Ｓ１と位相比較される信号
Ｓ２　（同図（Ｂ））は位相誤差信号出力回路３に供給
されて位相比較され、信号Ｓ＋　、Ｓ２の位相差に応じ
たパルス幅をもつ信号ａ　〈同図（Ｃ））が取出されて
Ｄフリップフロップ４のデータ端子りに供給される。
一方、基準信号Ｓ１は単安定マルチバイブレータ５．イ
ンバータ６を介１ノで所定パルス幅の信号ｂ　（同図（
Ｄ））どされ、Ｄフリップ７０ツブ４のクロック端子Ｃ
Ｉ−に供給される。
ここで、Ｄフリップフロップ４からは信’３０　＋　＋
８２の位相差が単安定マルチバイブレータ５にて定めら
れている範囲内にある場合はｌ−ルベル、そうでない場
合は１−レベルの同期引込判別信号Ｑ（同図（Ｅ））が
取出され、出力端子７より取出されて後続の回路に供給
される。
ところで、第３図に示す如く、電動機８を位相制御して
回転せしめる回路がある。このものは、電動機８の回転
周波数に応じた信号を周波数発電機９にて検出して信号
Ｓ２とし、位相比較器１０にて基準信号Ｓ１と位相比較
して位相誤差信＠ａを得、位相補償回路１１にて位相補
償した後駆動回路１２にて駆動信号として電動機８を一
定の回転速度で回転するように位相制御する。
一方、同期引込検知装置１３では位相比較器１０の出力
を供給されて信号Ｓ＋　、８２の位相が同期引込みされ
たことを検出し、後続の回路に供給する。
ここで、電動機８の起動時では、周波数発電機９からの
信号Ｓ２は第４図（Ｂ）に示す如く基準信号Ｓ＋　（同
図（Ａ））に比して周期が大であるので、信号Ｓ＋　、
Ｓ２の位相は大ぎく異なり、この状態では勿論同期はと
れていない。
発明が解決しようとする問題点 ところが、第３図に示す位相比較器１０、同期引込検知
装置１３に第１図示の従来回路を適用すると、同期がと
れていないにも拘らずフリップフロップ４の出力Ｑは第
４図（Ｅ）に示す如く所々１−ルベルになる期間を生じ
て同期引込みを判別してしまい、同期引込みを正確に判
別し得ない問題点があった。
問題点を解決するための手段 本発明は、２つのパルス信号の位相差が基準時間に対し
て小であることを検出し、この検出が検出周期の少なく
ども２周期以上の周期連続して行なわれたことを検出し
て同期引込判別信号を取出すＪ：うに構成して上記問題
点を解決したものであり、以下、図面と共にその一実施
例について説明する。
実施例 第５図は本発明になる同期引込回路の一実施例のブロッ
ク系統図を示し、同図中、第１図と同一構成部分には同
一符号を付す。同図中、１４は例えば８分周のバイナリ
カウンタで、クロック端子ＣＬは端子１に接続されてい
る一方、リセット端子ＲはＤフリップ７０ツブ４の出力
端子δに接続されている。このものは、リセットにより
端子１からの基準信号Ｓ１を例えば２３−１．、＝４カ
ウントするど１」レベルになり、これから再び４カウン
トすると再び［−レベルになる（即ち３段目のカウンタ
素子の出力を最終出力とする）カウンタである。
１５はフリップフロップで、その一方の入力端子はカウ
ンタ１４の出力端子に接続されている一方、その他方の
入力端子はＤフリップ７０ツブ４の出力端子乙に接続さ
れている。
信号Ｓ２が基準信号Ｓ１と同期がとれた場合、フリップ
フロップ４の出力Ｑは第２図（Ｅ）に示５− すようにトルベル、出力６は同図（Ｆ）に示すようにト
ルベルとなり、これにより、カウンタ１４は基準信号Ｓ
１をカウント開始する。カウンタ１４において基準信号
Ｓ１が４カウントされるとその出力Ｏｎは同図（Ｇ）に
示すようにトルベルとされ、これにより、フリップフロ
ップ１５はセットされてその出力は同図（Ｈ）に示すよ
うにトルベルとされ、出力端子１６より取出される。出
力端子１６のトルベル出力により、信号Ｓ２が信号Ｓ１
に同期していることを確認し得る。
カウンタ１４の出力Ｑｎがトルベルになった後ここにお
いて信号Ｓ１が更に４カウントされると、その出力Ｏｎ
はトルベルとされる。しかる後、信号Ｓ２が信号Ｓ１に
同期がとれなくなると、フリップフロップ４の出力６は
トルベルになり、これにより、フリップフロップ１５は
リセットされてその出力は１−レベルとされ、出力端子
１６より取出される。出力端子１６のトルベル出力によ
り、信号Ｓ２が信号Ｓ１に同期がとれなくなったことを
確認し得る。
６− 一方、電動機が起動時であって末だ所定回転数に達して
おらず、第４図（Ｂ）に示す如く、信８Ｓ、が信号８１
と同期がとれていない場合、フリップフロップ４の出力
Ｑは同図（Ｅ）に示す如く比較的短期間１ルベル、］−
レベルの繰返し、出力６は同図（Ｆ）に示す如く、比較
的短期間１−レベル、１ルベルの繰返しどなり、カウン
タ１４はノリツブフロップ４の出力δの１−レベルでリ
セットされる。
ここで、カウンタ１４はリセットされてから信号Ｓ１を
４カウントした後にその出力が１４レベルになるように
構成されているので、このように７リツプフロツプ４の
出力６の１−レベルが短期間である場合は信号８１を４
カウントすることはできず、これにより、その出力Ｑｎ
はＬレベルのままである。カウンタ１４の１−レベルに
よりフリップフロップ１５はＬレベルのままであり、出
力端子１６より取出される。出力端子１６の１−レベル
出力により、信号Ｓ２が信号Ｓ１に同期していないこと
を確認し得る。
応用例 なお、カウンタ１４の分周比を適宜選定することにより
、上記実施例の場合Ｊ：りも信号＄２が信号Ｓ＋に略完
全に同期引込みがなされた時点で出力Ｏｎを１ルベルに
することができる。
又、単安定マルチバイブレータ５に限定されるものでは
なく、信号Ｓ１に同期して時間設定できるものならば伯
の回路でもよい。
効果 上述の如く、本発明になる同期引込判別回路は、２つの
パルス信号のうちいずれか一方のパルス信号の所定周期
毎に２つのパルス信号の位相差が予め設定された基準時
間に対して小であることを検出する位相差検出回路と、
この位相差検出回路による位相差小であることの検出が
検出周期の少なくとも２周期以上の周期連続して行なわ
れていることをカウントしてパルス状の同期引込判別信
号を出力するカウンタとにて構成したため、特に、同期
がとれていない場合つまり２つのパルス信号の位相差が
大である時及び位相差が小であってもこれがパルス信号
の２周期以上の周期連続して行なわれていない時、カウ
ンタより同期引込判別信号が取出されることはなく、こ
れにＪ：す、例えば電動機を位相制御する装置において
電動機の起動時つまり未だ同期引込みが行なわれていな
い時、従来回路のように誤って同期引込判別がなされる
如き誤動作をすることがなく、従来回路に比して動作信
頼性が高く、又更にカウンタの出力によりセット（リセ
ット）、位相差検出回路の出力によりリセット（セット
）されるＲＳフリップ７０ツブを設けたため、同期引込
の有無に応じて後続の回路を制御する装置に有効である
等の特長を有する。
【図面の簡単な説明】
第１図は従来回路の一例の回路図、第２図（八）〜（Ｈ
）は従来回路及び本発明回路における同期引込状態を説
明する信号波形図、第３図は一般の電動機の位相制御回
路のブロック系統図、第４図（△）〜（Ｇ）は従来回路
及び本発明回路におりる同期引込みでない状態を説明Ｍ
−る信号波形図、−〇− 第５図は本発明回路の一実施例の回路図である。 １・・・基準信号入力端子、２・・・被制御信号入力端
子、３・・・位相誤差信号出力回路、４・・・Ｄフリッ
プフロップ、５・・・単安定マルチバイブレータ、６・
・・インバータ、１４・・・バイナリカウンタ、１５・
・・Ｒ８７リツプ７０ツブ、１６・・・同期引込判別出
力端子。 １０− 手続補正書（方鋼 昭和５８年１２月２日 （特許庁審査官　殿） １、事件の表示 昭和５８年　特　許　願第　１５５７７４　号２、発明
の名称 同期引込判別回路 ３、補正をする者 特　許　出願人 住　所　曇２２１　神奈川県横浜市神奈用区守屋町３丁
目１２番地名称　（４３２）　日本ビクター株式会社代
表者　取締役社長　宍道　−部 ４、代理人 ５、補正命令の日付 昭和５８年１１月２９日　（発送日） ６、　補正の対象 明細出の図面の簡単な説明の欄。 ７、　補正内容 明４１１１！中、第９頁第１５行乃至第１６行記載の１
第２図（Ａ）〜（Ｈ）」を「第２図」と補正する。 ２−

Claims (2)

    【特許請求の範囲】
  1. （１）２つのパルス信号のうちいずれか一方のパルス信
    号の所定周期毎に該２つのパルス信号の位相差が予め設
    定された基準時間に対して小であることを検出する位相
    差検出回路と、該位相差検出回路による位相差小である
    ことの検出が検出周期の少なくとも２１？；１）ＩＩＩ
    以上の周期連続して行なわれていることをカウントして
    パルス状の同期引込判別信号を出力するカウンタとより
    なることを特徴とする同期引込判別回路。
  2. （２）　２つのパルス信号のうちいずれか一方のパルス
    信号の所定周期毎に該２つのパルス信号の位相差が予め
    設定された基準時間に対して小であることを検出する位
    相差検出回路ど、該位相差検出回路による位相差小であ
    ることの検出が検出周期の少なくとも２周期以上の周期
    連続して行なわれていることをカウントしてパルス状の
    同期引込判別信号を出力するカウンタと、該カウンタの
    出力によりセラ１〜（リセット）、該位相差検出回路の
    該位相差が大である場合の出力によりリセット（セット
    ）されるＲＳフリップ７０ツブとＪ：りなることを特徴
    とする同期引込判別回路。
JP58155774A 1983-08-26 1983-08-26 同期引込判別回路 Pending JPS6047515A (ja)

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