JPS604220A - フオトエツチング方法 - Google Patents

フオトエツチング方法

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Publication number
JPS604220A
JPS604220A JP11200383A JP11200383A JPS604220A JP S604220 A JPS604220 A JP S604220A JP 11200383 A JP11200383 A JP 11200383A JP 11200383 A JP11200383 A JP 11200383A JP S604220 A JPS604220 A JP S604220A
Authority
JP
Japan
Prior art keywords
film
pattern
photoresist
metal
mask
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP11200383A
Other languages
English (en)
Inventor
Haruo Amano
天野 陽夫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP11200383A priority Critical patent/JPS604220A/ja
Publication of JPS604220A publication Critical patent/JPS604220A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306Chemical or electrical treatment, e.g. electrolytic etching

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Weting (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明はフォトエツチング方法に関し、特に段差を有す
る半導体基鈑上の金属を精度よくパターニングするフォ
トエツチング方法に関する。
現在、各種電極材料、配線材料、およびイオン注入のマ
スク材として各種金属が多く使用されそのパターニング
技術は半導体装置の数組化に不可欠である。しかし力か
ら半ま体基板上に設けられた金属のパターニングは、通
常は段差がある状態で行なわれる為に、そのパターニン
グ精度には限界があった。
以下第1図を用いて加工段差上の金属をパターニングす
る従来のフォトエツチング方法について説明し、その間
順点ケ指摘する。
半導体基板1上の第1の絶縁膜2上にはポリシリコン配
w1.43がありその上には第2の絶糾肘・4を介して
、全面に金属例えばアルミニウム(A−g )膜5が真
空蒸着法によって被着されて(・る。全面に被着された
A2膜5の上にフォトレジスト膜6として例えば商品名
AZ−1350J(シップレイ社製)のよう々ポジ系フ
ォトレジストを塗布し、露光用マスク7によって勧光用
マスクの暗部7a以夕(を露光する。この場合、Alは
光反射牢が太き(・ため先回を照射した時AJ膜の傾斜
に爪じて反射し、ポリシリコン配線層3による段差部の
光AM + A4 s 4の反射光As’ 、A4膜 
、A、’はフォトレジス) 月di 6の側面にJif
t射される(第1図(a))。
そのギ蛯1’=雌(をイ”11うことにより、フォトし
・シストパターン6aを得るが、このフォトレジストパ
ターンは露光時に(ti!+面よりのう1つを受りた為
、マスクパターン7aと同じ形にはならず、形状のくす
れたパターンとなる(第1回出))。
その後、この形状のくずれたし′シストパターン6aを
マスクにして、例えばウエットエツチング方法により腔
′出されたA/3M5を除去するのであるが、レジスト
パターン6aの形がくずれて(・乙ので、所望の配船パ
ターンがイ(tられ万い、肴の上、レジストパターン6
aと、Apル′−t5とけ冨曹がF゛(・為、エッグ°
ンダ液中でレジストパターン6aがはがれることがあり
、その結果、エツチング工程における歩留りを著しく低
下させる。
このように、従来のフォトエツチング方法は、正確な金
属パターンを形成する上で大きな問題があったO 本発明はかかる従来の欠点のない正確な金属パターンを
形成するに適したフォトエツチング方法を提供すること
を目的とする。
本発明の特徴は、段差のある半縛体基板−ヒに、金属膜
を形成する工程と、この金か月への表面に、金属酸化膜
を形成する工程と、この全島酸化膜上に選択的にフォ)
 L/レジストパターン形成する工程と、このフォトレ
ジストパターンをマスクにして金属酸化膜\:16よび
その下にある金納ポきを除去する工程と、残存するフォ
トレジストを除去すZ、工程とを含むフォトエツチング
方法にある。そして金属酸化膜(廿陽極酸化法により形
成された多孔質金属酸化膜でt]ることか好ましく・。
以下本発明の実施例を図面に従っ゛〔管、四す/、。
第2図(a)、〜)は名々木兄明火飾例を説明するため
の半導体装置の工智順部分断面図である。
第1図と同様に全面にA/!膜5を被着した後、例えば
陽@、#、化法によりA1膜5の麦−面にアルミナ膜1
0を形成した彼、その上に7オトレジスト膜6を形成し
て従来の露光方式により先回を照射する。この場合、ア
ルミナ膜lOは多孔質でかつ反射率が低い為、先回の反
射光は、乱反射あるいは吸収される為A1膜の傾斜に応
じて反射することはない(第2図(a))。
その後現像を行なうことによりフォトレジストパターン
106aを得る。このフォトレジストパターンは露光時
に側面よりの光を受けない為、マスクパターン7aを反
映し、形状の良好なパターンをなる(第2図(b))。
その後、このレジストパターンをマスクに露出されたア
ルミナ膜10およびその下のAffl膜5矛膜去する。
レジストパターン106aとアルミナ膜lOとは、非常
に密着がよ(・為、レジストパターンがはがれることは
少々くその結果、所望のりパターンが精度よく形成され
る。
以上説明した如く本発明のフォトエツチング方法に従え
ば、従来のフォトエツチング方法に比べて段差上の金属
膜を精度よくパターニングすることができ、将来のさら
に微細化されたLSIのフォトエツチング方法としても
優れて(・る。
なお、本発明は、実施例のように金属配線のパターニン
グのみならず、イオン注入のマスク材としての金属膜、
その他のパターニングにも適用できることは(・うまで
もない。
【図面の簡単な説明】
第1図(a) 、 ()))は各々従来のフォトエツチ
ング方法を工87mに示す断面図、第2図(1) 、 
(blけ各り本発明の実施例のフォトエツチング方法を
工程111t’+に示す断面図、である。 なお図にお(・て、1・・・・・・半導体基板、2・・
・・・・第1の絶縁膜、3・・・・・・加工段差を有す
る配線層、4・・・・・・第2の絶縁月ケ、5・・・・
・・アルミニウム(Al膜、6・・・・・・フォトレジ
ストs 6at106a・・・・・・現e後のフォトレ
ジストパターン、7・・・・・・露光用マスク、7a・
・・・・・露光用マスクの暗部、10・・・・・・アル
ミナ膜、 A、〜、・・・・・・照射光、A、’−A、/・・・・
・・反射光、である。

Claims (2)

    【特許請求の範囲】
  1. (1)基板上に金pA股を形成する工程と、前記金Lk
    の表面に金属酸化膜1・形成する工f2と、前記合札酸
    化膜上に選択的にフォトレジスト膜を形成する工程と、
    fJijt+己ンオトし′シストB1>1マスクにして
    前記金属酸化膜および前記金属膜を除去する工程と、残
    存する前記フォトレジスト膜を除去する工程とを含むこ
    と’c q’J ’4k ;1するフォトエツチング方
    法。
  2. (2)前記金属酸化膜は陽待酸化法により形成されたこ
    とを特徴とする特許請求の範囲第(1)項記載のフォト
    エツチング方法。
JP11200383A 1983-06-22 1983-06-22 フオトエツチング方法 Pending JPS604220A (ja)

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JP11200383A JPS604220A (ja) 1983-06-22 1983-06-22 フオトエツチング方法

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JP11200383A JPS604220A (ja) 1983-06-22 1983-06-22 フオトエツチング方法

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JPS604220A true JPS604220A (ja) 1985-01-10

Family

ID=14575519

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JP (1) JPS604220A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62160302A (ja) * 1985-12-30 1987-07-16 日瀝化学工業株式会社 凍結防止舗装工法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62160302A (ja) * 1985-12-30 1987-07-16 日瀝化学工業株式会社 凍結防止舗装工法

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