JPS6036894Y2 - 増幅回路 - Google Patents
増幅回路Info
- Publication number
- JPS6036894Y2 JPS6036894Y2 JP1065979U JP1065979U JPS6036894Y2 JP S6036894 Y2 JPS6036894 Y2 JP S6036894Y2 JP 1065979 U JP1065979 U JP 1065979U JP 1065979 U JP1065979 U JP 1065979U JP S6036894 Y2 JPS6036894 Y2 JP S6036894Y2
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- collector
- base
- emitter
- conductivity type
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Description
【考案の詳細な説明】
この考案は増幅回路に係り、特にＡＢ級増幅回路のドラ
イブ回路の改良に関するものである。
イブ回路の改良に関するものである。
第１図は従来の回路構成を示す回路図で、図において、
Ａは前置増幅器、Ｑｌは前置増幅器Ａの出力がベースに
供給される第１のトランジスタ、Ｑ２はベースが第１の
トランジスタＱ１のエミッタに接続され、エミッタが電
源Ｖｃｃの負端子に接続された第２のトランジスタ、Ｑ
３はベースとコレクタとが短絡され、そのコレクタおよ
びエミッタがそれぞれ後述の第４のトランジスタＱのコ
レクタおよびベースへ接続された第３のトランジスタ、
Ｑ、はエミッタが第２のトランジスタＱ２のコレクタに
接続された第４のトランジスタ、Ｑはコレクタが電源Ｖ
ｃｃの正端子に接続され、ベースが第４のトランジスタ
Ｑ４のコレクタに接続された第５のトランジスタ、Ｑは
ベースが第２のトランジスタＱ２のコレクタに、コレク
タが電源Ｖｃｃの負端子に接続され、第５のトランジス
タのエミッタとともに接続されたエミッタから出力端子
Ｔがでている第６のトランジスタ、■□？ ■２はそれ
ぞれ第１のトランジスタＱ１、第４のトランジスタＱの
コレクタと電源Ｖｃｃの正端子との間に接続された定電
流源である。
Ａは前置増幅器、Ｑｌは前置増幅器Ａの出力がベースに
供給される第１のトランジスタ、Ｑ２はベースが第１の
トランジスタＱ１のエミッタに接続され、エミッタが電
源Ｖｃｃの負端子に接続された第２のトランジスタ、Ｑ
３はベースとコレクタとが短絡され、そのコレクタおよ
びエミッタがそれぞれ後述の第４のトランジスタＱのコ
レクタおよびベースへ接続された第３のトランジスタ、
Ｑ、はエミッタが第２のトランジスタＱ２のコレクタに
接続された第４のトランジスタ、Ｑはコレクタが電源Ｖ
ｃｃの正端子に接続され、ベースが第４のトランジスタ
Ｑ４のコレクタに接続された第５のトランジスタ、Ｑは
ベースが第２のトランジスタＱ２のコレクタに、コレク
タが電源Ｖｃｃの負端子に接続され、第５のトランジス
タのエミッタとともに接続されたエミッタから出力端子
Ｔがでている第６のトランジスタ、■□？ ■２はそれ
ぞれ第１のトランジスタＱ１、第４のトランジスタＱの
コレクタと電源Ｖｃｃの正端子との間に接続された定電
流源である。
そして、第１〜第５のトランジスタＱ□〜Ｑ５はｎｐｎ
トランジスタ、第６のトランジスタはｐｎｐ トランジ
スタである。
トランジスタ、第６のトランジスタはｐｎｐ トランジ
スタである。
この回路では第５のトランジスタＱ、のベースと、第６
のトランジスタＱのベースとの間の電位差は、第３のト
ランジスタＱ３のベース・エミッタ間電圧Ｖ Ｂ Ｅ３
と、第４のトランジスタＱ、のベース・エミッタ間電圧
ＶＢＥ４との和であり、この電位差により第５のトラン
ジスタｑのエミッタから、第６のトランジスタＱ６のエ
ミッタへ無信号電流が流れ、第５のトランジスタＱ５の
動作範囲から第６のトランジスタＱ６の動作範囲へ切り
替わる時に生じるクロスオーバ歪を軽減している。
のトランジスタＱのベースとの間の電位差は、第３のト
ランジスタＱ３のベース・エミッタ間電圧Ｖ Ｂ Ｅ３
と、第４のトランジスタＱ、のベース・エミッタ間電圧
ＶＢＥ４との和であり、この電位差により第５のトラン
ジスタｑのエミッタから、第６のトランジスタＱ６のエ
ミッタへ無信号電流が流れ、第５のトランジスタＱ５の
動作範囲から第６のトランジスタＱ６の動作範囲へ切り
替わる時に生じるクロスオーバ歪を軽減している。
さて、この回路構成では、出力ドライブ用の第２のトラ
ンジスタＱ２の負荷となる定電流源１１の他に、この第
２のトランジスタＱ２をドライブする第１のトランジス
タＱ１のオーバドライブを防ぐ定電流源Ｉ２が必要であ
った。
ンジスタＱ２の負荷となる定電流源１１の他に、この第
２のトランジスタＱ２をドライブする第１のトランジス
タＱ１のオーバドライブを防ぐ定電流源Ｉ２が必要であ
った。
このことは、この回路を集積回路化するに当って、回路
構成が複雑となり、チップサイズが大きくなる傾向があ
った。
構成が複雑となり、チップサイズが大きくなる傾向があ
った。
この考案は上述の定電流源Ｉ２の不要な回路構成にする
ことによって従来回路の欠点を除去することを目的とす
る。
ことによって従来回路の欠点を除去することを目的とす
る。
第２図はこの考案の一実施例を示す回路構成図で、第１
図と同一もしくは相当部分は同一符号で示し、その説明
を省略する。
図と同一もしくは相当部分は同一符号で示し、その説明
を省略する。
この回路においては第２のトランジスタＱ２をドライブ
する第１のトランジスタＱ１のコレクタは定電流源１１
に接続されており、従来回路におけるような第１のトラ
ンジスタＱ１のオーバドライブを防ぐための特別の定電
流源Ｉ２を必要としない。
する第１のトランジスタＱ１のコレクタは定電流源１１
に接続されており、従来回路におけるような第１のトラ
ンジスタＱ１のオーバドライブを防ぐための特別の定電
流源Ｉ２を必要としない。
そして、クロスオーバ歪を軽減する動作は第１図の従来
回路と全く同様である。
回路と全く同様である。
さらに、第１のトランジスタＱ１、第３のトランジスタ
Ｑ３および第４のトランジスタＱ４のコレクタは共通に
接続されているので、この回路を集積回路化したとき、
これらのトランジスタＱ１．Ｑ３およびＱは同一の島の
中へ入れることができ、チップサイズを小さくすること
ができる。
Ｑ３および第４のトランジスタＱ４のコレクタは共通に
接続されているので、この回路を集積回路化したとき、
これらのトランジスタＱ１．Ｑ３およびＱは同一の島の
中へ入れることができ、チップサイズを小さくすること
ができる。
なお、第１のトランジスタＱ１はターリントン接続され
たトランジスタ群で置き換えてもよい。
たトランジスタ群で置き換えてもよい。
超級増幅回路は演算増幅器などに広く用いられており、
特に、近年リニア集積回路が大規模化する中にあって、
１チツプ内に数多くの超級増幅回路を組込むことが多い
。
特に、近年リニア集積回路が大規模化する中にあって、
１チツプ内に数多くの超級増幅回路を組込むことが多い
。
この考案では定電流源を１つ省略し、３つのトランジス
タのコレクタを共通接続できる構成をとっているので、
これによって個々の蔀級増幅回路が占めるチップサイズ
を減少できることは意味が大きい。
タのコレクタを共通接続できる構成をとっているので、
これによって個々の蔀級増幅回路が占めるチップサイズ
を減少できることは意味が大きい。
第１図は従来のＡＢ級増幅回路の回路構成図、第２図は
この考案の一実施例を示す回路構成図である。 図において、Ｑｌ、Ｑ２．Ｑ３．Ｑ４．Ｑ５およびＱ６
はそれぞれ第１、第２、第３、第４、第５および第６の
トランジスタ、１１は定電流源、Ａは前置増幅器、Ｖｃ
ｃは電源、Ｔは出力端子である。 なお、図中同一符号は同一または相当部分を示す。
この考案の一実施例を示す回路構成図である。 図において、Ｑｌ、Ｑ２．Ｑ３．Ｑ４．Ｑ５およびＱ６
はそれぞれ第１、第２、第３、第４、第５および第６の
トランジスタ、１１は定電流源、Ａは前置増幅器、Ｖｃ
ｃは電源、Ｔは出力端子である。 なお、図中同一符号は同一または相当部分を示す。
Claims (2)
- （１）前置増幅器の出力がベースに接続された第１伝導
形の第１のトランジスタ、この第１のトランジスタのエ
ミッタがベースに接続された第１伝導形の第２のトラン
ジスタ、ベースとコレクタとが接続されてこの接続点に
上記第１のトランジスタのコレクタが接続された第１伝
導形の第３のトランジスタ、この第３のトランジスタの
エミッタおよびコレクタがそれぞれベースおよびコレク
タへ接続され上記第２のトランジスタのコレクタがエミ
ッタに接続された第１伝導形の第４のトランジスタ、こ
の第４のトランジスタのコレクタと電源の一方の端子と
の間に接続された定電流源、上記第４のトランジスタの
コレクタにベースが接続され上記電源の一方の端子にコ
レクタが接続された第１伝導形の第５のトランジスタ及
び上記第２のトランジスタのコレクタにベースが接続さ
れコレクタが上記第２のトランジスタのエミッタととも
に上記電源の他方の端子に接続され、かつエミッタが上
記第５のトランジスタのエミッタとともに出力端子に接
続された第２伝導形の第６のトランジスタを備えた増幅
回路。 - （２）第１のトランジスタがダーリントン接続された複
合のトランジスタからなる実用新案登録請求の範囲第１
項に記載の増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1065979U JPS6036894Y2 (ja) | 1979-01-29 | 1979-01-29 | 増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1065979U JPS6036894Y2 (ja) | 1979-01-29 | 1979-01-29 | 増幅回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55109914U JPS55109914U (ja) | 1980-08-01 |
| JPS6036894Y2 true JPS6036894Y2 (ja) | 1985-11-01 |
Family
ID=28823665
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1065979U Expired JPS6036894Y2 (ja) | 1979-01-29 | 1979-01-29 | 増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6036894Y2 (ja) |
-
1979
- 1979-01-29 JP JP1065979U patent/JPS6036894Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55109914U (ja) | 1980-08-01 |
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