JPS6035988A - モ−タの制御装置 - Google Patents
モ−タの制御装置Info
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- JPS6035988A JPS6035988A JP58141831A JP14183183A JPS6035988A JP S6035988 A JPS6035988 A JP S6035988A JP 58141831 A JP58141831 A JP 58141831A JP 14183183 A JP14183183 A JP 14183183A JP S6035988 A JPS6035988 A JP S6035988A
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- Japan
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- signal
- motor
- microcomputer
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- control signal
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P7/00—Arrangements for regulating or controlling the speed or torque of electric DC motors
- H02P7/06—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual dc dynamo-electric motor by varying field or armature current
- H02P7/18—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual dc dynamo-electric motor by varying field or armature current by master control with auxiliary power
- H02P7/24—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual dc dynamo-electric motor by varying field or armature current by master control with auxiliary power using discharge tubes or semiconductor devices
- H02P7/28—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual dc dynamo-electric motor by varying field or armature current by master control with auxiliary power using discharge tubes or semiconductor devices using semiconductor devices
- H02P7/285—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual dc dynamo-electric motor by varying field or armature current by master control with auxiliary power using discharge tubes or semiconductor devices using semiconductor devices controlling armature supply only
- H02P7/292—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual dc dynamo-electric motor by varying field or armature current by master control with auxiliary power using discharge tubes or semiconductor devices using semiconductor devices controlling armature supply only using static converters, e.g. AC to DC
- H02P7/293—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual dc dynamo-electric motor by varying field or armature current by master control with auxiliary power using discharge tubes or semiconductor devices using semiconductor devices controlling armature supply only using static converters, e.g. AC to DC using phase control
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、複写機等に用いられるモータの制御装置に
係り、特に駆動用のモータの速度の連続変倍を行うため
に光学系の速度を連続的に制御するに好適なＰＬＬ速度
制御装置に関するものである。
係り、特に駆動用のモータの速度の連続変倍を行うため
に光学系の速度を連続的に制御するに好適なＰＬＬ速度
制御装置に関するものである。
従来、この種の装置はハードウェアで構成され、連続的
に速度を変化させるために分周器を使って基準周波数や
駆動用のモータのエンコーダからの帰還周波数を分周し
たり基準周波数を切り換えることによって行われており
、さらには制御範囲が広いため、フィルタなどの各要素
を調整して切り換えることが必要であり、そのため装置
が大きくなるという欠点があった。
に速度を変化させるために分周器を使って基準周波数や
駆動用のモータのエンコーダからの帰還周波数を分周し
たり基準周波数を切り換えることによって行われており
、さらには制御範囲が広いため、フィルタなどの各要素
を調整して切り換えることが必要であり、そのため装置
が大きくなるという欠点があった。
この発明は、上述欠点を除去するためになされたもので
、マイクロコンピュータを用いることにより装置の小型
化をはかること、ならびにマイクロコンピュータによる
高精度、広範囲のＰＬＬ速度制御を実行することを目的
とする。
、マイクロコンピュータを用いることにより装置の小型
化をはかること、ならびにマイクロコンピュータによる
高精度、広範囲のＰＬＬ速度制御を実行することを目的
とする。
第１図はこの発明の一実施例の回路図である。
この図で、１はモータの速度を指定するテンキー、２は
マイクロコンピュータの内部のカウンタを駆動する発振
器、３は速度制御を行うマイクロコンピュータ（以下マ
イコンという）で、第１カウンタ３Ａと第２カウンタ３
Ｂとを有しており、この第１カウンタ３Ａは発振器２の
クロックをカウントしてテンキー１からのモータ速度指
定に従って位相比較のための基準周波数信号ＦＳを発生
する。第２カウンタ３Ｂは後述するエンコーダからの帰
還信号ＦＧに同期し、モータの速度指定に従って一定幅
のパルスの速度制御信号ＦＶを発生する。４．５は出力
線、６は前記位相比較信号ＰＣと速度制御信号ＦＶの加
算回路、７はパルス幅変調（ＰＷＭ）を行うコンパレー
タ、８はモータを駆動するドライバ、９はモータ、１ｏ
は前記モータ９の回転を検出するエンコーダで、帰還信
号ＦＧを発生し、マイコン３へ入力する。１１〜１４は
電子ボリューム、１５はコンデンサである。また、１６
はＰＣ利得制御信号、１７はＦＶ利得制御信号、１８は
フィルタ制御信号、１９はスレッショルドレベル制御信
号であり、それぞれ電子ボリューム１１〜１４の値を変
、化させて調整を行うものである。
マイクロコンピュータの内部のカウンタを駆動する発振
器、３は速度制御を行うマイクロコンピュータ（以下マ
イコンという）で、第１カウンタ３Ａと第２カウンタ３
Ｂとを有しており、この第１カウンタ３Ａは発振器２の
クロックをカウントしてテンキー１からのモータ速度指
定に従って位相比較のための基準周波数信号ＦＳを発生
する。第２カウンタ３Ｂは後述するエンコーダからの帰
還信号ＦＧに同期し、モータの速度指定に従って一定幅
のパルスの速度制御信号ＦＶを発生する。４．５は出力
線、６は前記位相比較信号ＰＣと速度制御信号ＦＶの加
算回路、７はパルス幅変調（ＰＷＭ）を行うコンパレー
タ、８はモータを駆動するドライバ、９はモータ、１ｏ
は前記モータ９の回転を検出するエンコーダで、帰還信
号ＦＧを発生し、マイコン３へ入力する。１１〜１４は
電子ボリューム、１５はコンデンサである。また、１６
はＰＣ利得制御信号、１７はＦＶ利得制御信号、１８は
フィルタ制御信号、１９はスレッショルドレベル制御信
号であり、それぞれ電子ボリューム１１〜１４の値を変
、化させて調整を行うものである。
ところで、モータ９の連続変倍はドラム速度一定のとき
光学系のスキャンニング速度を連続的に変化させること
によって実現できる。等倍コピーのとき光学系駆動用の
モータ９のエンコーダ１０の帰還信号ＦＧの周波数をＩ
ＫＨｚ （周期Ｔ＝１ｍｓ）とし、倍率１％刻みで変化
させた場合、周期ＴはＯ，０１ｍ５ごとに変化する。第
１カウンタ３Ａがカウントアツプを繰り返すごとに周期
Ｔで内部割込を繰り返すため、発振器２をＴ（１００’
ＫＨｚ ）で発振させ、第１カウンタ３Ａに倍率に対応
したカウント値をセ・ン卜することによって基準周波数
ＦＳを作り出している。
光学系のスキャンニング速度を連続的に変化させること
によって実現できる。等倍コピーのとき光学系駆動用の
モータ９のエンコーダ１０の帰還信号ＦＧの周波数をＩ
ＫＨｚ （周期Ｔ＝１ｍｓ）とし、倍率１％刻みで変化
させた場合、周期ＴはＯ，０１ｍ５ごとに変化する。第
１カウンタ３Ａがカウントアツプを繰り返すごとに周期
Ｔで内部割込を繰り返すため、発振器２をＴ（１００’
ＫＨｚ ）で発振させ、第１カウンタ３Ａに倍率に対応
したカウント値をセ・ン卜することによって基準周波数
ＦＳを作り出している。
次に、第１図の実施例の動作の概略を説明する。
加算回路６はマイコン３から出力された速度制御信号Ｆ
Ｖと位相比較信号ＰＣを加算し、その出力は、電子ボリ
ューム１３とコンデンサー５からなるフィルタで積分さ
れた後に、コンパレータ７の電子ボリューム１４で定ま
るスレッショルドレベルによってＰＷＭされ、ドライバ
８によってモータ９を駆動し、テンキー１からのモータ
速度指令に従った基準周波数信号ＦＳと一定の位相差と
なるように制御される。さらに、指定倍率に従っＩてあ
らかじめ定められた値に電子ボリューム１１〜１４の値
をマイコン３によって設定し、位相比較信号ＰＣと速度
制御信号ＦＶとの加算利得比、フィルタ特性、スレッシ
ョルドレベルを制御している。そして、マイコン３の内
部で判断している位相比較によって位相がロックしてい
ない場合、スレッショルドレベルの制御も行う。
Ｖと位相比較信号ＰＣを加算し、その出力は、電子ボリ
ューム１３とコンデンサー５からなるフィルタで積分さ
れた後に、コンパレータ７の電子ボリューム１４で定ま
るスレッショルドレベルによってＰＷＭされ、ドライバ
８によってモータ９を駆動し、テンキー１からのモータ
速度指令に従った基準周波数信号ＦＳと一定の位相差と
なるように制御される。さらに、指定倍率に従っＩてあ
らかじめ定められた値に電子ボリューム１１〜１４の値
をマイコン３によって設定し、位相比較信号ＰＣと速度
制御信号ＦＶとの加算利得比、フィルタ特性、スレッシ
ョルドレベルを制御している。そして、マイコン３の内
部で判断している位相比較によって位相がロックしてい
ない場合、スレッショルドレベルの制御も行う。
位相比較および速度の制御方法を第２図のフロ−にりつ
一チャー１・および第３図の波形図に従って説明する。
なお、第２図で（＋）、（２）、・旧・・はステップを
表わす。
表わす。
テンキー１よりモータ９の速度設定（倍率）を入力する
（１）。設定値に変化があった場合（２）、第１カウン
タ３Ａに設定値（データ）をセットしく３）、カウント
ダウンをスタートさせる。ここで第１カウンタ３Ａのカ
ウントダウンが終了後割込信号が発生し、自動的に設定
値を再セットし、カウントダウンすることを繰り返す。
（１）。設定値に変化があった場合（２）、第１カウン
タ３Ａに設定値（データ）をセットしく３）、カウント
ダウンをスタートさせる。ここで第１カウンタ３Ａのカ
ウントダウンが終了後割込信号が発生し、自動的に設定
値を再セットし、カウントダウンすることを繰り返す。
これにより基準周波数信号ＦＳが発生する。さらに、倍
率に対応した値に各電子ボリューム１１〜１４の値を設
定する（４）。
率に対応した値に各電子ボリューム１１〜１４の値を設
定する（４）。
次に速度制御信号ＦＶについて述べる。モータ９のエン
コーダ１０からの帰還信号ＦＧの立下りでＦＧ割込みに
入り、レジスタを退避した後（３１）、速度制御信号Ｆ
Ｖをリセットしく３２）、倍率に対応した基準周波数信
号ＦＳのｌ／２ＦＳとなるタイマ値を第２カウンタ３Ｂ
にセットしてスタートさせ（３３）、第２カウンタ３Ｂ
のカウントダウン終了後、ＦＶ割込みが発生し、レジス
タを退避した後（５１）、速度制御信号ＦＶをセットす
ることによって（５２）、第３図の速度制御信号ＦＶを
発生さぜ、レジスタ復帰後（５３）、リターンする。
コーダ１０からの帰還信号ＦＧの立下りでＦＧ割込みに
入り、レジスタを退避した後（３１）、速度制御信号Ｆ
Ｖをリセットしく３２）、倍率に対応した基準周波数信
号ＦＳのｌ／２ＦＳとなるタイマ値を第２カウンタ３Ｂ
にセットしてスタートさせ（３３）、第２カウンタ３Ｂ
のカウントダウン終了後、ＦＶ割込みが発生し、レジス
タを退避した後（５１）、速度制御信号ＦＶをセットす
ることによって（５２）、第３図の速度制御信号ＦＶを
発生さぜ、レジスタ復帰後（５３）、リターンする。
位相比較信号ＰＣは、第３図に示すように位相差Ｏ〜２
πのときはノ１（半周波数信号ＦＳ、帰還信号ＦＧの立
下りで位相比較信号ＰＣのセット、リセッＩ・を繰り返
し、帰還信号ＦＧの位相が２π以−１−遅れた場合は、
位相比較信号ＰＣはセラＩ・状態を維持し、基準周波数
信号ＦＳの一周期の間に帰還信号ＦＧの立下りが２回来
たことを検知した後に、前述の位相差Ｏ〜２πの動作を
繰り返す。また逆に帰還信号ＦＧの位相が進んだ場合、
すなわち位相差がＯ以下となった場合は、位相比較信号
ＰＣはリセット状態を維持し帰還信号ＦＧの一周期の間
に基準周波数信号ＦＳの立下りが２回来たことを検知し
た後に、前述の位相差Ｏ〜２πの動作を繰り返すもので
ある。
πのときはノ１（半周波数信号ＦＳ、帰還信号ＦＧの立
下りで位相比較信号ＰＣのセット、リセッＩ・を繰り返
し、帰還信号ＦＧの位相が２π以−１−遅れた場合は、
位相比較信号ＰＣはセラＩ・状態を維持し、基準周波数
信号ＦＳの一周期の間に帰還信号ＦＧの立下りが２回来
たことを検知した後に、前述の位相差Ｏ〜２πの動作を
繰り返す。また逆に帰還信号ＦＧの位相が進んだ場合、
すなわち位相差がＯ以下となった場合は、位相比較信号
ＰＣはリセット状態を維持し帰還信号ＦＧの一周期の間
に基準周波数信号ＦＳの立下りが２回来たことを検知し
た後に、前述の位相差Ｏ〜２πの動作を繰り返すもので
ある。
これをさらに第２図に基づいて説明する。
位相比較信号ＰＣは、第３図に示すように位相差０〜２
πの状態のときは、常にＦＳ訂可、ＦＧ入カカウンタ＝
１の状態であるためＦＳ割込信号によって（１１）、（
＋２）、（１３）、（２０）を通って、マイコン３のＰ
ＣＣポートをセラ１−Ｌ（２１）、ＦＧ割込の回数をカ
ウントするカウンタをクリアしく１７）、次いでＦＳ割
込みの回数をカウントするカウンタをカウントアツプし
く１８）、レジスタ復帰と同時に割込み許可を行い（１
９）、リターンする。この一連のステップによりＦＧ割
込信号を許可する。
πの状態のときは、常にＦＳ訂可、ＦＧ入カカウンタ＝
１の状態であるためＦＳ割込信号によって（１１）、（
＋２）、（１３）、（２０）を通って、マイコン３のＰ
ＣＣポートをセラ１−Ｌ（２１）、ＦＧ割込の回数をカ
ウントするカウンタをクリアしく１７）、次いでＦＳ割
込みの回数をカウントするカウンタをカウントアツプし
く１８）、レジスタ復帰と同時に割込み許可を行い（１
９）、リターンする。この一連のステップによりＦＧ割
込信号を許可する。
次に、」二連と同様にＦＧ許可、ＦＳ入カカウンタ＝１
の状態であるためＦＧ割込信号によって（３４）、（３
５）、（４２）を通ッテ、ＰＣボートをリセットしく４
３）、ＦＳ割込みの回数をカウントするカウンタをクリ
アしく３９）、ＦＧ割込みの回数をカウントするカウン
タをカウントアツプしく４ｏ）、レジスタ復帰と同時に
割込み許可を行い（４１）、リターンする。この一連の
ステップによりＦＳ割込信号を許可する。
の状態であるためＦＧ割込信号によって（３４）、（３
５）、（４２）を通ッテ、ＰＣボートをリセットしく４
３）、ＦＳ割込みの回数をカウントするカウンタをクリ
アしく３９）、ＦＧ割込みの回数をカウントするカウン
タをカウントアツプしく４ｏ）、レジスタ復帰と同時に
割込み許可を行い（４１）、リターンする。この一連の
ステップによりＦＳ割込信号を許可する。
すなわち、上記ＦＧ割込信号と上記ＦＳ割込信号を交互
に発生させる。
に発生させる。
第３図の位相差２π以」二の場合には、最初はＦＳ許可
、ＦＧ入カカウンタ＝０の状態であるため前述と同様に
（１１）、（１２）、（１３）、（２０）を通って、Ｐ
Ｃポートなセ・ントしく２１）、ＦＧ割込みの回数をカ
ウントするカウンタをクリアしく１６）、ＦＳ割込みの
回数をカウントするカウンタをカウントアツプしく１８
）、レジスタ復帰と同時に割込み許可を行い（１９）、
リターンした後、もう１度ＦＳ割込信号が入るため、Ｆ
Ｇ入力カウンタが“０゛′状態（１３）で、ＰＣポート
をセットしく１４）、ＦＧＭ止フラフラグットして（１
５）、スレッショルドレベルのアップを行い（１８）、
ＦＧ割込みの回数をカウントするカウンタをクリアしく
１７）、ＦＳ割込みの回数をカウントするカウンタをカ
ウントアツプしく１８）、レジスタ復帰と同時に割込み
許可を行い（１９）、リターンする。この状態ではＦＧ
禁止、ＦＳ入カカウンタ洪Ｏ状態のため（３４）、（４
４）、（３８）、（４０）、（４１）を通り、ドライバ
８にモータ９の位相を進めようとするＰＷＭが駆動され
る。帰還信号ＦＧの位相が進んできてＦＧ割込信号が入
力され、ＦＧ割込み回数が０°゛のとき、ステップ（３
４）、 （４４）の判断を通ってＰＣＣホートリセラ
Ｌ （４５）、ＦＳ。
、ＦＧ入カカウンタ＝０の状態であるため前述と同様に
（１１）、（１２）、（１３）、（２０）を通って、Ｐ
Ｃポートなセ・ントしく２１）、ＦＧ割込みの回数をカ
ウントするカウンタをクリアしく１６）、ＦＳ割込みの
回数をカウントするカウンタをカウントアツプしく１８
）、レジスタ復帰と同時に割込み許可を行い（１９）、
リターンした後、もう１度ＦＳ割込信号が入るため、Ｆ
Ｇ入力カウンタが“０゛′状態（１３）で、ＰＣポート
をセットしく１４）、ＦＧＭ止フラフラグットして（１
５）、スレッショルドレベルのアップを行い（１８）、
ＦＧ割込みの回数をカウントするカウンタをクリアしく
１７）、ＦＳ割込みの回数をカウントするカウンタをカ
ウントアツプしく１８）、レジスタ復帰と同時に割込み
許可を行い（１９）、リターンする。この状態ではＦＧ
禁止、ＦＳ入カカウンタ洪Ｏ状態のため（３４）、（４
４）、（３８）、（４０）、（４１）を通り、ドライバ
８にモータ９の位相を進めようとするＰＷＭが駆動され
る。帰還信号ＦＧの位相が進んできてＦＧ割込信号が入
力され、ＦＧ割込み回数が０°゛のとき、ステップ（３
４）、 （４４）の判断を通ってＰＣＣホートリセラ
Ｌ （４５）、ＦＳ。
ＦＧ割込みを許可するためにフラグをリセット状態（４
６）、ステップ（４０） 、 （４１）を経てリターン
する。
６）、ステップ（４０） 、 （４１）を経てリターン
する。
この後は前述の位相差０〜２πの状態を繰り返すことに
なる。
なる。
また、逆に帰還信号ＦＧの位相が進んだときは、前述の
位相が遅れたときとＦＳ 、ＦＧの関係が入れ変わるだ
けで同様な動作をし、（３６）〜（３８） 、 （２２
）〜（２４）を通ってモータ９を遅らせるようドライバ
８にＰＷＭが駆動され、位相差０〜２πになるよう制御
される。
位相が遅れたときとＦＳ 、ＦＧの関係が入れ変わるだ
けで同様な動作をし、（３６）〜（３８） 、 （２２
）〜（２４）を通ってモータ９を遅らせるようドライバ
８にＰＷＭが駆動され、位相差０〜２πになるよう制御
される。
゛なお、上記実施例では外部の発振器２によって第１カ
ウンタ３Ａの基準クロックを作っているが、マイコン３
内の発振器を内部でタイマ基準クロックとして使うこと
も可能であり、また、モータ９のドライブをＰＷＭで行
っているが、これは直流レベルで行ってもよい。また、
フィルタの特性を調整するのに電子ボリューム１３に代
えてコンデンサ１５を切り換えてもよい。また、スレッ
ショルドレベルのアップ、ダウンのステップ（１８）
、 （３８）では、スレッショルドレベル制御信号１９
を調整する代わりに他の制御信号１６〜１８を調整する
ようにしてもよい。
ウンタ３Ａの基準クロックを作っているが、マイコン３
内の発振器を内部でタイマ基準クロックとして使うこと
も可能であり、また、モータ９のドライブをＰＷＭで行
っているが、これは直流レベルで行ってもよい。また、
フィルタの特性を調整するのに電子ボリューム１３に代
えてコンデンサ１５を切り換えてもよい。また、スレッ
ショルドレベルのアップ、ダウンのステップ（１８）
、 （３８）では、スレッショルドレベル制御信号１９
を調整する代わりに他の制御信号１６〜１８を調整する
ようにしてもよい。
以上詳細に説明したように、この発明はマイクロコンピ
ュータ内部のカウンタを利用し、かつ各調整部分を指定
倍率に従った値に設定し調整部分を位相差がロックされ
ていないとき、マイクロコンピュータで制御するように
したことによって簡易な構成で高精度のＰＬＬ速度制御
を広範囲に亘って行うことができる。また、マイコンを
導入したことにより外部周辺機器の小型化がはかれ装置
全体を小型化できる利点を有する。
ュータ内部のカウンタを利用し、かつ各調整部分を指定
倍率に従った値に設定し調整部分を位相差がロックされ
ていないとき、マイクロコンピュータで制御するように
したことによって簡易な構成で高精度のＰＬＬ速度制御
を広範囲に亘って行うことができる。また、マイコンを
導入したことにより外部周辺機器の小型化がはかれ装置
全体を小型化できる利点を有する。
第１図はこの発明の一実施例を示す回路図、第２図は第
１図の動作説明のフローチャート、第３図は同じく要部
の波形図である。 図中、１はテンキー、２は発振器、３はマイコン、３Ａ
はカウンタ、４，５は出力線、６は加算回路、７はコン
パレータ、８はドライバ、９はモータ、１０はエンコー
ダ、１１〜１４は電子ボリューム、１５はコンデンサ、
１６はＰＣ利得制御信号、１７はＦＶ利得制御信号、１
８はフィルタ制御信号、１９はスレッショルドレベル制
御信号である。 第２図 ＦＧ ｆＩＪ 込 匹スタ退＠ （３１） ＦＶ庄、°→・ソでット （３２） １２／Ｊ’Ｃり＋；ｙ°−タ （３３）ビット ηつ；
ト韻始 （３４） ＦＧ葉止。 ＹＥＳ ０ （３５） （４２） （４４） １’Ｏ？１．ｚり ＝Ｏ？ ＝１？ ＹＥＳ （３６） ＹＥ （４３） ｙＥｓ （４５）
ＰＣホ・→すＺット ＰＣＰＣ （３７） （４６） Ｆ５Ｅｆ９ ＦＳ４’ｉ！午可 ＦＧＩ’盲午可 スＬｙシルドトベ゛ル （３８） り゛ラン ＦＳ入力カウニタ （３９） クリ ＦＧ入入力カシタ （４ｏ） 々つ〉ドアシフ２ トジスタ糧１畢 （４１） 四二乎二一
１図の動作説明のフローチャート、第３図は同じく要部
の波形図である。 図中、１はテンキー、２は発振器、３はマイコン、３Ａ
はカウンタ、４，５は出力線、６は加算回路、７はコン
パレータ、８はドライバ、９はモータ、１０はエンコー
ダ、１１〜１４は電子ボリューム、１５はコンデンサ、
１６はＰＣ利得制御信号、１７はＦＶ利得制御信号、１
８はフィルタ制御信号、１９はスレッショルドレベル制
御信号である。 第２図 ＦＧ ｆＩＪ 込 匹スタ退＠ （３１） ＦＶ庄、°→・ソでット （３２） １２／Ｊ’Ｃり＋；ｙ°−タ （３３）ビット ηつ；
ト韻始 （３４） ＦＧ葉止。 ＹＥＳ ０ （３５） （４２） （４４） １’Ｏ？１．ｚり ＝Ｏ？ ＝１？ ＹＥＳ （３６） ＹＥ （４３） ｙＥｓ （４５）
ＰＣホ・→すＺット ＰＣＰＣ （３７） （４６） Ｆ５Ｅｆ９ ＦＳ４’ｉ！午可 ＦＧＩ’盲午可 スＬｙシルドトベ゛ル （３８） り゛ラン ＦＳ入力カウニタ （３９） クリ ＦＧ入入力カシタ （４ｏ） 々つ〉ドアシフ２ トジスタ糧１畢 （４１） 四二乎二一
Claims (1)
- モータの所望回転数を入力する入力手段と、この入力手
段からの入力に応じてカウント値が設定される第１カウ
ンタにより内部割込信号を発生させ基準周波数信号を作
成する手段、前記入力手段からの入力に応じて一定のパ
ルス幅の速度制御信号を出力する第２カウンタ、および
前記基準周波数信号と前記モータの回転数を検知するエ
ンコーダからの帰還信号による外部割込信号によって位
相差を検知し位相比較信号を出力する手段とを備えたマ
イクロコンピュータと、前記位相比較信号と前記速度制
御信号とを用い前記モータを前記所望回転数に制御する
手段と、前記マイクロコンピュータの出力によって前記
制御する手段に含まれる調整部分のうち少なくとも１つ
を調整する手段と、この調整する手段を前記マイクロコ
ンピュータにより前記位相差がロックされないときに制
御する手段とを備えたことを特徴とするモータの制御装
置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58141831A JPS6035988A (ja) | 1983-08-04 | 1983-08-04 | モ−タの制御装置 |
| GB08419711A GB2147123B (en) | 1983-08-04 | 1984-08-02 | Motor control device |
| DE19843428719 DE3428719A1 (de) | 1983-08-04 | 1984-08-03 | Motorregeleinrichtung |
| US07/172,933 US4897778A (en) | 1983-08-04 | 1988-03-25 | Motor control device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58141831A JPS6035988A (ja) | 1983-08-04 | 1983-08-04 | モ−タの制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6035988A true JPS6035988A (ja) | 1985-02-23 |
Family
ID=15301141
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58141831A Pending JPS6035988A (ja) | 1983-08-04 | 1983-08-04 | モ−タの制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6035988A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62244288A (ja) * | 1986-04-16 | 1987-10-24 | Hitachi Ltd | エンコ−ダ入力方式ｄｃサ−ボモ−タおよびその運転方法 |
| US5015813A (en) * | 1988-12-14 | 1991-05-14 | Mitsubishi Denki Kabushiki Kaisha | Power feeding port arrangement for a microwave heating apparatus |
| US5770273A (en) * | 1995-02-14 | 1998-06-23 | General Electric Company | Plasma coating process for improved bonding of coatings on substrates |
-
1983
- 1983-08-04 JP JP58141831A patent/JPS6035988A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62244288A (ja) * | 1986-04-16 | 1987-10-24 | Hitachi Ltd | エンコ−ダ入力方式ｄｃサ−ボモ−タおよびその運転方法 |
| US5015813A (en) * | 1988-12-14 | 1991-05-14 | Mitsubishi Denki Kabushiki Kaisha | Power feeding port arrangement for a microwave heating apparatus |
| US5770273A (en) * | 1995-02-14 | 1998-06-23 | General Electric Company | Plasma coating process for improved bonding of coatings on substrates |
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