JPS60154545A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPS60154545A
JPS60154545A JP1045784A JP1045784A JPS60154545A JP S60154545 A JPS60154545 A JP S60154545A JP 1045784 A JP1045784 A JP 1045784A JP 1045784 A JP1045784 A JP 1045784A JP S60154545 A JPS60154545 A JP S60154545A
Authority
JP
Japan
Prior art keywords
segments
chip
metal
plated
vessel
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1045784A
Other languages
English (en)
Inventor
Kazuo Fujii
和夫 藤井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP1045784A priority Critical patent/JPS60154545A/ja
Publication of JPS60154545A publication Critical patent/JPS60154545A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49579Lead-frames or other flat leads characterised by the materials of the lead frames or layers thereon
    • H01L23/49582Metallic layers on lead frames
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/58Structural electrical arrangements for semiconductor devices not otherwise provided for, e.g. in combination with batteries
    • H01L23/60Protection against electrostatic charges or discharges, e.g. Faraday shields
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (発明の技術分野) 本発明rr、 !t!−導体装置の外部リードの形状に
関するものでらる〇 (従米枝術ン 近年、Tr、 lc、 LSI等の″+導体チップの微
細化が急速に進行しており、それにともない、半導体チ
ップの微細化に反比例し、これら半導体チップ管収納し
た半導体装置の取り扱いrc関連する静電気等各種ブー
ツに対する破壊強度も一般的rcr[低下する方間にあ
る。
この為、!P4体チップ設計においてalその破壊強度
同上°九対する対策%種々計られているが特注面での劣
化管生じないようにする為rca、必ずしも充分とa言
えない。
又、製造者側での配慮と同時に#?導体装置使用者側で
の実装工程での取り扱いfcよる破壊も常々問題になる
所である。従米使用考側での一般的配慮として使用設備
類の確実なアース、各棟靜篭防止用具(導電性容器、マ
ット、アースバンド等ンの使用が行わわて;9、qFp
rc破壊強度の小さな半導体装置の実装についてa金属
M線會全ての外部啜続用す−ド端frc巻き付けた状態
で行い、実装工程終了後その金属細線を取り去る方法が
採用されている。
しかしながら、第1図に示す如き従来のフラットパッケ
ージで汀、この工うな金属細線の巻き付けば不可能であ
る0すなわち、従来の7ラツトパツケ一ジa半尋体累子
管樹脂又aセラミックの容器lに封入し、この容器tq
)@面から水平方向に多数のリード2vI7導出し、こ
のリード2に半田とのヌレ注の良い金属の外装メッキ倉
施していた。
かかるフラットパッケージにリードが水平に広がってお
り、金属細線の巻き付けrcよるリード2間の短絡に事
実上不可能であった。
(発明の目的) 本発明の目的a、静電気等各種サージだよる破壊のない
フラットパッケージ形手導体装R?提供することにある
(発明の構成) 本発明rcよれば、半導体装すを収容する容器と、この
容器から外部17尋出される複数のリードと、こわら複
数のリードの先ym全共通に阪続する金属の枠体とvL
7vし、複数のリードa手田とのヌレ注の悪い金属を集
成として形成されており、容器から所定の長さ【わたっ
て半田とのヌレ注の良し金属のメッキ層を有し、枠体部
近傍でに素体が露出している半導体装置を得る。
(発明の実施例) 以下に、本発明の実施例を示す。
第2図a本発明の一実施例警示すものであり、従来の半
導体装置と同様に半得体チップ會収納した樹脂又σセラ
ミックの容器11から外部阪続用リード端子12が複数
導出されており、その全ての外部隈続用リード端子12
の先端a遠吠の金楓枠部(以下タイバーと称す)13で
連結されて−る。こわら外部阪続用リード端子12rJ
外装メッキ部14が千尋体チップ収納容器1lrc近い
部分のみ施さねており、タイバー13近傍でa IJ−
ド端す12の木材である半田とのヌレ注の悪い金属が露
出している。
本#P4体装置の実装においてに1使用者側の央 1装
工程において第2図図示の状態で回路基板rc!l!−
田等の咲着用材料を使用し、外部啜続用リード端子12
の外装メッキ部14を吸着する事rcエク行われる。こ
の時外装メッキ部14以外に半田が付くこと汀ない。そ
の後タイバー13’に切断し、電気的ll!1作が可能
となる。
本半導体装置a冥装工程において、全ての外部接続用リ
ード端子12が同電位に保たれる為、静電気等の外部サ
ージに対して充分な保護が可能となる0又、回路基板に
実装する際【r[外装メッキ部14が半専体チップ収納
容器ii近傍に限定されている為、外部両統用リード端
子12のうち、外装メッキ部4を有しない部分及びタイ
バ一部131回路基板rc吸着される事がない0このた
め、半田付後答易に外装メッキを有しない部分を切断除
去することが可能となる。
【図面の簡単な説明】
第1図0従米の′+尋体装置tを示す平面図である。 第2図a本発明の一実施例による半導体装置倉ボ丁平面
図である。 t、it・・°容器、2.12・・・リード、13・・
・タイバー、14川外装メッキ部 第1図 千2図

Claims (1)

    【特許請求の範囲】
  1. 午尋体素す全収容する容器と、該容器から外部[4出さ
    れた4!注でaあるが手出とのヌレ注の悪い複数のリー
    ドと、該複数のリードの先端同志全連結する金属の枠部
    とを有し、前記リードa前記容器近傍で半田付性の良好
    な金属(よる外装メッキが施されており、前記枠部近傍
    でa前記平田とのヌレ注の悪いリード素体が絽出してい
    る事を特徴とする’r−導体装置。
JP1045784A 1984-01-23 1984-01-23 半導体装置 Pending JPS60154545A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP1045784A JPS60154545A (ja) 1984-01-23 1984-01-23 半導体装置

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Application Number Priority Date Filing Date Title
JP1045784A JPS60154545A (ja) 1984-01-23 1984-01-23 半導体装置

Publications (1)

Publication Number Publication Date
JPS60154545A true JPS60154545A (ja) 1985-08-14

Family

ID=11750667

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1045784A Pending JPS60154545A (ja) 1984-01-23 1984-01-23 半導体装置

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JP (1) JPS60154545A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6413152U (ja) * 1987-07-14 1989-01-24

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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