JPS60140926U - 表示装置 - Google Patents

表示装置

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JPS60140926U
JPS60140926U JP2650684U JP2650684U JPS60140926U JP S60140926 U JPS60140926 U JP S60140926U JP 2650684 U JP2650684 U JP 2650684U JP 2650684 U JP2650684 U JP 2650684U JP S60140926 U JPS60140926 U JP S60140926U
Authority
JP
Japan
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line
drain
display device
gate
insulating film
Prior art date
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Application number
JP2650684U
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JPH058585Y2 (ja
Inventor
妹尾　豊
Original Assignee
三洋電機株式会社
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Publication date
Application filed by 三洋電機株式会社 filed Critical 三洋電機株式会社
Priority to JP2650684U priority Critical patent/JPS60140926U/ja
Publication of JPS60140926U publication Critical patent/JPS60140926U/ja
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Publication of JPH058585Y2 publication Critical patent/JPH058585Y2/ja
Granted legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図ａ、　ｂは従来の表示装置の部分平面図、及び断
面図、第２図ａ、　ｂは本考案の表示装置の一実施例の
部分平面図、及び断面図、第３図は第２図ａの要部平面
図である。 １１・・・・・−透［極、１３・・・・・・アモルファ
スシリコン膜、１３．　１４−−−−−−ドレインライ
ン、１５・・・・・・ソース’！極、１６・・・・・・
ゲートライン、１７・・・・・・ゲート電極、−１９・
・・・・・バイパスライン。 第２図 第３図

Claims (1)

    【実用新案登録請求の範囲】
  1. 並列配置された複数本のゲートラインと、該ゲートライ
    ン上に層間絶縁膜を介して並列配置された複数本のドレ
    インラインとが交差し、このマトリクス状の各交差点に
    てＦＥＴからなるスイッチングトランジスタを構成して
    なり、該各トランジスタのソース側に表示セグメント電
    極を結合した表示装置に於いて、上記□ドレインライシ
    直下のゲートラインと同層箇所に、このゲートラインと
    は独立した状態で上記ドレインラインに沿って潜在した
    短冊状のバイパスラインを備え、上記ドレインラインが
    断線した場合にこの断線箇所を跨ぐ２箇所を夫々層間絶
    縁膜を介して上記バイパスラインに結合する事を特徴と
    した表示装置。
JP2650684U 1984-02-24 1984-02-24 表示装置 Granted JPS60140926U (ja)

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JP2650684U JPS60140926U (ja) 1984-02-24 1984-02-24 表示装置

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JP2650684U JPS60140926U (ja) 1984-02-24 1984-02-24 表示装置

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Publication Number Publication Date
JPS60140926U true JPS60140926U (ja) 1985-09-18
JPH058585Y2 JPH058585Y2 (ja) 1993-03-03

Family

ID=30522573

Family Applications (1)

Application Number Title Priority Date Filing Date
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Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60216377A (ja) * 1984-04-11 1985-10-29 ホシデン株式会社 液晶表示器
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JPH058585Y2 (ja) 1993-03-03

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