JPS60134685A - 復号器 - Google Patents
復号器Info
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- JPS60134685A JPS60134685A JP59252805A JP25280584A JPS60134685A JP S60134685 A JPS60134685 A JP S60134685A JP 59252805 A JP59252805 A JP 59252805A JP 25280584 A JP25280584 A JP 25280584A JP S60134685 A JPS60134685 A JP S60134685A
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- Japan
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- data
- storage device
- processor
- display
- microcomputer
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/36—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of a graphic pattern, e.g. using an all-points-addressable [APA] memory
- G09G5/363—Graphics controllers
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/36—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of a graphic pattern, e.g. using an all-points-addressable [APA] memory
- G09G5/39—Control of the bit-mapped memory
- G09G5/395—Arrangements specially adapted for transferring the contents of the bit-mapped memory to the screen
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
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- Signal Processing (AREA)
- Television Systems (AREA)
- Memory System (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明はテレテキスト信号用の復号器に関する。
テレテキストまたはビデオテックスは文字または図形の
原稿の情報をデジタル符号化することにより伝送する手
段である。この符号化の態様は使用する方式や標準によ
って若干変ることがあり、テレテキストデジタル伝送で
はテレビジョン信号中にデジタルコードが編入され、ビ
デオテックス伝送では公用切換式電話回線により伝送さ
れる信号にデジタルコードが編入される。この明細書お
よび請求範囲において用いる「テレテキスト状」という
語は、テレテキストおよびビデオテックスの一般化用語
である。
原稿の情報をデジタル符号化することにより伝送する手
段である。この符号化の態様は使用する方式や標準によ
って若干変ることがあり、テレテキストデジタル伝送で
はテレビジョン信号中にデジタルコードが編入され、ビ
デオテックス伝送では公用切換式電話回線により伝送さ
れる信号にデジタルコードが編入される。この明細書お
よび請求範囲において用いる「テレテキスト状」という
語は、テレテキストおよびビデオテックスの一般化用語
である。
テレテキストでは、デジタル2進表示で符号化された文
字や図形の情報を放送するためにテレビジョン走査線を
用いる。テレテキストは他の画像情報が送られていない
ときは垂直ブランキング期間中に送ればよい。テレテキ
ストの2進情報はデ−タブロツクに直列的に組織された
制御および表示用のデジタル情報を含んでいるが、放送
信号中のこの2進情報の組織は放送局の用いる標準によ
って決まる。以下の説明では、例としてアール・シー−
x −−エンジニアリング(RCA Engineer
−ing ) 1983年9−10月号掲載ノアスト/
l/(B。
字や図形の情報を放送するためにテレビジョン走査線を
用いる。テレテキストは他の画像情報が送られていない
ときは垂直ブランキング期間中に送ればよい。テレテキ
ストの2進情報はデ−タブロツクに直列的に組織された
制御および表示用のデジタル情報を含んでいるが、放送
信号中のこの2進情報の組織は放送局の用いる標準によ
って決まる。以下の説明では、例としてアール・シー−
x −−エンジニアリング(RCA Engineer
−ing ) 1983年9−10月号掲載ノアスト/
l/(B。
Astle )の論文[北米におけるテレテキスト標準
(Te1etext 5tanclard in No
rth America ) J記載の北米放送テレテ
キスト仕様書(以下NABTSと呼ぶ)を引用する。
(Te1etext 5tanclard in No
rth America ) J記載の北米放送テレテ
キスト仕様書(以下NABTSと呼ぶ)を引用する。
NABTSではテレテキストデータを含む各水平線はデ
ータ線と呼ばれ、データパケットを含んでいる。このパ
ケット中の2進データはそれぞれ8つの2進単位(ビッ
ト)を含むバイトに分割され、各パケットの最初8つの
バイトを一纒めにしてパケットヘッダと呼ぶ。このパケ
ットヘッダの3つのバイトがチャンネル番号を定め、各
チャンネルがいくつかのページに組織され、各ページが
多数のパケットで構成される。
ータ線と呼ばれ、データパケットを含んでいる。このパ
ケット中の2進データはそれぞれ8つの2進単位(ビッ
ト)を含むバイトに分割され、各パケットの最初8つの
バイトを一纒めにしてパケットヘッダと呼ぶ。このパケ
ットヘッダの3つのバイトがチャンネル番号を定め、各
チャンネルがいくつかのページに組織され、各ページが
多数のパケットで構成される。
ビデオデータに含まれるデジタルデータはテレビジョン
受像機で受信された後、テレテキスト復号器で処理され
る。このときデジタルデータはデータスライサにより映
像信号から抽出され、データプロセッサ(接頭辞プロセ
ッサと呼ぶこともある)にビットの流れを供給する。デ
ータプロセッサは表示すべき情報を指定する利用者から
の指令を受け、表示のため選ばれたテレテキストチャン
ネルに含まれるデータをバッファメモリに記憶する。緩
衝されたデータは処理されて表示用信号を出力する表示
プロセッサに供給される。画像表示装置としてテレビジ
ョン映像管(CRT)を用いるときは、表示プロセッサ
は周期的に表示用信号を出力し、テレビジョン表示面上
の画像を維持する必要がある。
受像機で受信された後、テレテキスト復号器で処理され
る。このときデジタルデータはデータスライサにより映
像信号から抽出され、データプロセッサ(接頭辞プロセ
ッサと呼ぶこともある)にビットの流れを供給する。デ
ータプロセッサは表示すべき情報を指定する利用者から
の指令を受け、表示のため選ばれたテレテキストチャン
ネルに含まれるデータをバッファメモリに記憶する。緩
衝されたデータは処理されて表示用信号を出力する表示
プロセッサに供給される。画像表示装置としてテレビジ
ョン映像管(CRT)を用いるときは、表示プロセッサ
は周期的に表示用信号を出力し、テレビジョン表示面上
の画像を維持する必要がある。
この発明によれば、表示装置により表示するための制御
情報を表示可能の情報を表わす2進データを含むテキス
ト状信号の復号器で、2進データを記憶する共通の記憶
装置と、この記憶装置に記憶するため予め選択されたデ
ータをテレテキスト状信号から取出す手段と、その記憶
された予め選択されたデータを処理してその記憶装置に
記憶するために処理済データを生成する処理手段と、そ
の記憶された処理済データに応じて上記表示可能の情報
を表示器に表示する表示プロセッサと、上記取出し手段
、処理手段および表示プロセッサを選択的に共通の記憶
装置に結合する切換手段と、その取出し手段、処理手段
および表示プロセッサが所定の時間区間列の各時間区間
中記憶装置に結合されるように切換手段を制御するタイ
ミング手段とを含むものが提供される。
情報を表示可能の情報を表わす2進データを含むテキス
ト状信号の復号器で、2進データを記憶する共通の記憶
装置と、この記憶装置に記憶するため予め選択されたデ
ータをテレテキスト状信号から取出す手段と、その記憶
された予め選択されたデータを処理してその記憶装置に
記憶するために処理済データを生成する処理手段と、そ
の記憶された処理済データに応じて上記表示可能の情報
を表示器に表示する表示プロセッサと、上記取出し手段
、処理手段および表示プロセッサを選択的に共通の記憶
装置に結合する切換手段と、その取出し手段、処理手段
および表示プロセッサが所定の時間区間列の各時間区間
中記憶装置に結合されるように切換手段を制御するタイ
ミング手段とを含むものが提供される。
また1実施例としてテレテキスト状信号から受信された
デジタル通報を得るためのデータプロセッサを含むテレ
テキスト状信号の復号器が提供される。このデジタル通
報を共通の記憶装置で記憶してさらにマイクロコンピュ
ータで処理するが、そのマイクロコンピュータは記憶し
たデータを読取り、処理してこれを共通の記憶装置に記
憶する。
デジタル通報を得るためのデータプロセッサを含むテレ
テキスト状信号の復号器が提供される。このデジタル通
報を共通の記憶装置で記憶してさらにマイクロコンピュ
ータで処理するが、そのマイクロコンピュータは記憶し
たデータを読取り、処理してこれを共通の記憶装置に記
憶する。
この処理されたデータは表示プロセッサにより共通の記
憶装置から読取られ、その表示プロセッサは表示装置用
の駆動信号を発生する。データはスイッチにより共通の
記憶装置からマイクロコンピュータ、データプロセッサ
および表示プロセッサのそれぞれに結合される。このス
イッチはタイミング装置の制御の下に動作し、そのタイ
ミング装置によりマイクロコンピュータ、データプロセ
ッサおよび表示プロセッサの要求に応じて記憶装置が呼
び出される。
憶装置から読取られ、その表示プロセッサは表示装置用
の駆動信号を発生する。データはスイッチにより共通の
記憶装置からマイクロコンピュータ、データプロセッサ
および表示プロセッサのそれぞれに結合される。このス
イッチはタイミング装置の制御の下に動作し、そのタイ
ミング装置によりマイクロコンピュータ、データプロセ
ッサおよび表示プロセッサの要求に応じて記憶装置が呼
び出される。
次にこの発明を図面を参照しつつその実施例によって詳
細に説明する。
細に説明する。
第1図のテレテキスト復号器はテレビジョンプロセッサ
21の入力20に映像変調信号を受ける。プロセッサ2
1は同調器、中間周波数増幅器、映像検波器のような公
知のテレビジョン受像機段を含んでいる。データスライ
サ22はこのテレビジョンプロセッサ21から検波され
た映像信号を受信してテレテキスト2進データの険知分
離を行う。データスライサ22は信号線路H1■にそれ
ぞれ入来合成映像信号に同期された水平、垂直の同期信
号を発生する。データスライサ22はまた線路7Oを介
してテレテキスト復号器の通常の接頭辞プロセッサのよ
うなデータプロセッサ24に直列のデータ流と再構成さ
れたクロック信号を供給する。再構成りロック信号はデ
ータプロセッサ24により生成された復号器内の各段に
分配されるテレテキスト系のクロックの同期に用いられ
る。
21の入力20に映像変調信号を受ける。プロセッサ2
1は同調器、中間周波数増幅器、映像検波器のような公
知のテレビジョン受像機段を含んでいる。データスライ
サ22はこのテレビジョンプロセッサ21から検波され
た映像信号を受信してテレテキスト2進データの険知分
離を行う。データスライサ22は信号線路H1■にそれ
ぞれ入来合成映像信号に同期された水平、垂直の同期信
号を発生する。データスライサ22はまた線路7Oを介
してテレテキスト復号器の通常の接頭辞プロセッサのよ
うなデータプロセッサ24に直列のデータ流と再構成さ
れたクロック信号を供給する。再構成りロック信号はデ
ータプロセッサ24により生成された復号器内の各段に
分配されるテレテキスト系のクロックの同期に用いられ
る。
利用者の発した指令はマイクロコンピュータ25を介し
てデータプロセッサ24に印加される。利用者はキーボ
ード26を操作して表示すべき雑誌とページ番号を選択
する。マイクロコンピュータ25はキーボード26から
信号線路24を介して利用者の選択したデータを受信し
、選択線路47を介してデータプロセッサ24に12ビ
ツトワードを供給する。このワードは所要のNABTS
規定のパケットアドレスを表わす。
てデータプロセッサ24に印加される。利用者はキーボ
ード26を操作して表示すべき雑誌とページ番号を選択
する。マイクロコンピュータ25はキーボード26から
信号線路24を介して利用者の選択したデータを受信し
、選択線路47を介してデータプロセッサ24に12ビ
ツトワードを供給する。このワードは所要のNABTS
規定のパケットアドレスを表わす。
水平同期信号の発生後、データプロセッサはデータスラ
イサ22から受信した直列データ流中のNABTS規定
のフレーミングコードの有無を探査し、有効なフレーミ
ングコードが生じると、直列データ流をバイトと呼ぶ8
ビット単位に区切り始める。データプロセッサ24は次
の3バイトを処理してパケットアドレスを得る。マイク
ロコンピュータ25は線路47を介してデータプロセッ
サに12ビツトワードを供給し、所要のパケットアドレ
スを指定する。所要のパケットアドレスと入来テレテキ
ストデータのパケットアドレスが一致すると、データプ
ロセッサ24はNABTS規定のデータパケットに含ま
れる後続バイト全部を、タイミング装置2つによって制
御される時間区間においてテレテキスト復号器の共通の
記憶装置28に転送し始める。
イサ22から受信した直列データ流中のNABTS規定
のフレーミングコードの有無を探査し、有効なフレーミ
ングコードが生じると、直列データ流をバイトと呼ぶ8
ビット単位に区切り始める。データプロセッサ24は次
の3バイトを処理してパケットアドレスを得る。マイク
ロコンピュータ25は線路47を介してデータプロセッ
サに12ビツトワードを供給し、所要のパケットアドレ
スを指定する。所要のパケットアドレスと入来テレテキ
ストデータのパケットアドレスが一致すると、データプ
ロセッサ24はNABTS規定のデータパケットに含ま
れる後続バイト全部を、タイミング装置2つによって制
御される時間区間においてテレテキスト復号器の共通の
記憶装置28に転送し始める。
データワードは2段過程を用いてデータプロセッサ24
から記憶装置28に転送される。第1段階でアドレスワ
ードがデータプロセッサ24のアドレス出力30から線
路31を介してスイッチ32の端子Eに転送される。タ
イミング装置29はこの制御スイッチ32にタイミング
信号を供給してスイッチ線路Sを端子Eに接続し、アド
レスワードを端子Gから母線33に転送する。母線33
は16ビツ)EilJ線を構成する16本の線路から成
り、この母線33からアドレスワード線路36を介して
アドレスラッチ35の入力端子34に転送される。アド
レスワードはアドレスラッチ35に記憶されると共に、
出力端子37から記憶装置28のアドレス入力38に転
送されて、テレテキストワードを転送すべき記憶装置2
8の記憶位置を選択する。
から記憶装置28に転送される。第1段階でアドレスワ
ードがデータプロセッサ24のアドレス出力30から線
路31を介してスイッチ32の端子Eに転送される。タ
イミング装置29はこの制御スイッチ32にタイミング
信号を供給してスイッチ線路Sを端子Eに接続し、アド
レスワードを端子Gから母線33に転送する。母線33
は16ビツ)EilJ線を構成する16本の線路から成
り、この母線33からアドレスワード線路36を介して
アドレスラッチ35の入力端子34に転送される。アド
レスワードはアドレスラッチ35に記憶されると共に、
出力端子37から記憶装置28のアドレス入力38に転
送されて、テレテキストワードを転送すべき記憶装置2
8の記憶位置を選択する。
第2段階では、データワードがデータプロセッサ24の
出力39から線路4Oを介してスイッチ32の端子Fに
転送される。タイミング装置29はスイッチ線路Sを制
御してデータを同じ母線33に転送し、〜母線33はそ
のデータを記憶装置のデータ人力41に送る。ここでデ
ータワードはアドレスラッチ35に記憶されたアドレス
ワードにより選択された記憶装置28の記憶位置に記憶
される。
出力39から線路4Oを介してスイッチ32の端子Fに
転送される。タイミング装置29はスイッチ線路Sを制
御してデータを同じ母線33に転送し、〜母線33はそ
のデータを記憶装置のデータ人力41に送る。ここでデ
ータワードはアドレスラッチ35に記憶されたアドレス
ワードにより選択された記憶装置28の記憶位置に記憶
される。
ある記憶アドレスを用いである記憶位置に転送されたデ
ータワードは、後刻同じアドレスを用いて同じ位置から
転送することもできる。
ータワードは、後刻同じアドレスを用いて同じ位置から
転送することもできる。
共通の記憶装置28はマイクロコンピュータ25、デー
タプロセッサ24、表示プロセッサ43により時分割さ
れており、この時分割はタイミング装置2つ(crl により制御される。タイミング装置2つは共通の記憶装
置28に対するそれぞれの呼出しの時間区間を割当てる
。第3a図および第3b図は第1図に示された復号器に
対する時間区間の割当てを示す。第1図の復号器に対す
る各時間区間は349n秒の長さを持つ。
タプロセッサ24、表示プロセッサ43により時分割さ
れており、この時分割はタイミング装置2つ(crl により制御される。タイミング装置2つは共通の記憶装
置28に対するそれぞれの呼出しの時間区間を割当てる
。第3a図および第3b図は第1図に示された復号器に
対する時間区間の割当てを示す。第1図の復号器に対す
る各時間区間は349n秒の長さを持つ。
データワードをスイッチ32を介して転送するこの2段
過程は1つの時間区間で行われる。データプロセッサ2
4による共通の記憶装置28の呼出しによりデータプロ
セッサの呼出し時間区間が決まる。
過程は1つの時間区間で行われる。データプロセッサ2
4による共通の記憶装置28の呼出しによりデータプロ
セッサの呼出し時間区間が決まる。
同様にして、表示データプロセッサ43による同様の呼
出しで表示データプロセッサの呼出し時間区間が決まり
、マイクロコンピュータ25による呼出しでマイクロコ
ンピュータの呼出し時間区間が決まる。この時間区間は
マイクロコンピュータ25、表示プロセッサ43、デー
タプロセッサ24の中の1つだけがどれかの時間区間中
に共通の記憶装置28を呼出し得るように重ならないよ
うに配置している。共通の記憶装置28の呼出しはスイ
ッチ32を介してデジタ□ルワードを転送することによ
り行われ(10) る。デジタルプロセッサ24、マイクロコンピュータ2
5、表示プロセッサ43の中の1つに対してスイッチ3
2が記憶装置28を呼出すときは、他の2つに対する記
憶装置28の呼出しは行わない。
出しで表示データプロセッサの呼出し時間区間が決まり
、マイクロコンピュータ25による呼出しでマイクロコ
ンピュータの呼出し時間区間が決まる。この時間区間は
マイクロコンピュータ25、表示プロセッサ43、デー
タプロセッサ24の中の1つだけがどれかの時間区間中
に共通の記憶装置28を呼出し得るように重ならないよ
うに配置している。共通の記憶装置28の呼出しはスイ
ッチ32を介してデジタ□ルワードを転送することによ
り行われ(10) る。デジタルプロセッサ24、マイクロコンピュータ2
5、表示プロセッサ43の中の1つに対してスイッチ3
2が記憶装置28を呼出すときは、他の2つに対する記
憶装置28の呼出しは行わない。
タイミング装置2つはスイッチ32を制御するタイミン
グ信号54と、マイクロコンピュータ25のタイミング
を制御するタイミング信号55と、表示プロセッサ43
のタイミングを制御するタイミング信号56に供給する
。これらのタイミング信号により、タイミング装置2つ
は表示プロセッサ43による記憶装置28の呼出し用に
時間区間を1つおきに割当て、この呼出し用に割当てら
れなかったその間の時間区間をマイクロコンピュータ2
5かデータプロセッサ24かに割当てる。時間区間をマ
イクロコンピュータ25とデータプロセッサ24のどち
らに割当てるかはタイミング装置2つにより決められた
時点の両者の状態に依存し、もしデータプロセッサ24
が表示プロセッサ43に割当てられなかった時間区間に
共通の記憶装置28へのデータ転送の準備を完了してお
れば、タイミング装置29はこの時間区間をデ(11) −タプロセツサ24に与えて共通記憶装置28を呼出し
得るようにし、データプロセッサ24が表示プロセッサ
43に割当てられなかった時間区間に共通記憶装置28
へのデータ転送の準備を完了していなければ、タイミン
グ装置2つは、マイクロコンピュータ25がその時間区
間における転送の準備を終っている限り、この時間区間
をマイクロコンピュータ25に与えて記憶装置28を呼
出すようにすることができる。リクエスト線路59.5
Bはそれぞれタイミング装置2つにデータプロセッサ2
4とマイクロコンピュータ25が共通記憶装置28の呼
出しを要求していることを示す。
グ信号54と、マイクロコンピュータ25のタイミング
を制御するタイミング信号55と、表示プロセッサ43
のタイミングを制御するタイミング信号56に供給する
。これらのタイミング信号により、タイミング装置2つ
は表示プロセッサ43による記憶装置28の呼出し用に
時間区間を1つおきに割当て、この呼出し用に割当てら
れなかったその間の時間区間をマイクロコンピュータ2
5かデータプロセッサ24かに割当てる。時間区間をマ
イクロコンピュータ25とデータプロセッサ24のどち
らに割当てるかはタイミング装置2つにより決められた
時点の両者の状態に依存し、もしデータプロセッサ24
が表示プロセッサ43に割当てられなかった時間区間に
共通の記憶装置28へのデータ転送の準備を完了してお
れば、タイミング装置29はこの時間区間をデ(11) −タプロセツサ24に与えて共通記憶装置28を呼出し
得るようにし、データプロセッサ24が表示プロセッサ
43に割当てられなかった時間区間に共通記憶装置28
へのデータ転送の準備を完了していなければ、タイミン
グ装置2つは、マイクロコンピュータ25がその時間区
間における転送の準備を終っている限り、この時間区間
をマイクロコンピュータ25に与えて記憶装置28を呼
出すようにすることができる。リクエスト線路59.5
Bはそれぞれタイミング装置2つにデータプロセッサ2
4とマイクロコンピュータ25が共通記憶装置28の呼
出しを要求していることを示す。
予め定められた時間区間を用いることにより共通の記憶
装置28の呼出しを効率よく行うことができる。各時間
区間は2段過程を用いて共通記憶装置28を呼出すに充
分な長さがある。表示プロセッサ43は時間区間2つに
1回ずつ記憶装置28を呼出すことができるから、それ
が所要の表示情報を充分速い割合で受信して各画素を走
査線上の適当位置に表示することが保証される。
装置28の呼出しを効率よく行うことができる。各時間
区間は2段過程を用いて共通記憶装置28を呼出すに充
分な長さがある。表示プロセッサ43は時間区間2つに
1回ずつ記憶装置28を呼出すことができるから、それ
が所要の表示情報を充分速い割合で受信して各画素を走
査線上の適当位置に表示することが保証される。
(12)
テレテキストデータの2段過程を第3b図に時点Tn+
□とTn+。の間の呼出し時間区間と時点Tn+9とT
n−1−10の間の呼出し時間区間に行われたものとし
て示す。データプロセッサ24は入来テレテキストデー
タの2バイトを集めてこれを記憶装置28に記憶する。
□とTn+。の間の呼出し時間区間と時点Tn+9とT
n−1−10の間の呼出し時間区間に行われたものとし
て示す。データプロセッサ24は入来テレテキストデー
タの2バイトを集めてこれを記憶装置28に記憶する。
第3b図に示すように、これは呼出し時間区間8つに1
回ずつ起るため、データの2バイトが2.8μ秒ごとに
記憶装置28に書込まれ、これがNABTS方式で受信
されるデータの周期となる。
回ずつ起るため、データの2バイトが2.8μ秒ごとに
記憶装置28に書込まれ、これがNABTS方式で受信
されるデータの周期となる。
データプロセッサ24がテレテキストデータの2バイト
を集めて1つのデータを共通記憶装置28に記憶してか
ら次のバイトが得られるまで、第3b図から判るように
、データプロセッサの呼出し時間区間が起ることが確実
であり、このためデータプロセッサ24は1デ一タワー
ド以上緩衝する必要がない。このデータプロセッサ24
の特徴はその設計を簡単にするものである。
を集めて1つのデータを共通記憶装置28に記憶してか
ら次のバイトが得られるまで、第3b図から判るように
、データプロセッサの呼出し時間区間が起ることが確実
であり、このためデータプロセッサ24は1デ一タワー
ド以上緩衝する必要がない。このデータプロセッサ24
の特徴はその設計を簡単にするものである。
データプロセッサ24はそれぞれ後続のデータワードを
連続する記憶アドレスに記憶する。これにより第1図の
共通記憶装置28の第2図の概要構成(13) 図に示すようなデータプロセッサ緩衝器201が生成す
る。このデータ緩衝器は後述のようにマイクロコンピュ
ータ25により読取ってさらに処理することもできる。
連続する記憶アドレスに記憶する。これにより第1図の
共通記憶装置28の第2図の概要構成(13) 図に示すようなデータプロセッサ緩衝器201が生成す
る。このデータ緩衝器は後述のようにマイクロコンピュ
ータ25により読取ってさらに処理することもできる。
マイクロプロセッサ25は読取り線路47により、デー
タプロセッサ24が共通記憶装置28に転送するデータ
ワードの数を確認することができる。線路44はデータ
プロセッサ24に対して線路47を介するデータの出入
の選択に用いられる。
タプロセッサ24が共通記憶装置28に転送するデータ
ワードの数を確認することができる。線路44はデータ
プロセッサ24に対して線路47を介するデータの出入
の選択に用いられる。
第3a図および第3b図に示すように、マイクロプロセ
ッサ25の記憶装置28の呼出しは、データプロセッサ
24も表示プロセッサ43も占めない時間区間に生ずる
。マイクロプロセッサ25は記憶装置28内のデータプ
ロセッサ緩衝器201を読取ってその内容を池の位置群
すなわち第1図の共通記憶装置28内の第2図のページ
記憶緩衝器202に転送する。
ッサ25の記憶装置28の呼出しは、データプロセッサ
24も表示プロセッサ43も占めない時間区間に生ずる
。マイクロプロセッサ25は記憶装置28内のデータプ
ロセッサ緩衝器201を読取ってその内容を池の位置群
すなわち第1図の共通記憶装置28内の第2図のページ
記憶緩衝器202に転送する。
ページ記憶緩衝器202は利用者が最も要求すると思わ
れるページに対応するテレテキストデータを記憶するた
めに用いられる。例えば、前のページは利用者に要求さ
れ易い。これを緩衝器202に記憶することにより、利
用者がその要求を開始しく14) たときその前ページがすでに緩衝器202に記憶されて
いるため、復号器はその前ページについて利月者に速や
かに応答することができる。
れるページに対応するテレテキストデータを記憶するた
めに用いられる。例えば、前のページは利用者に要求さ
れ易い。これを緩衝器202に記憶することにより、利
用者がその要求を開始しく14) たときその前ページがすでに緩衝器202に記憶されて
いるため、復号器はその前ページについて利月者に速や
かに応答することができる。
マイクロコンピュータ25は、データプロセッサ緩衝器
201のテレテキストデータをページ記憶緩衝器202
に転送した後、そのページ記憶緩衝器202を処理して
その結果を第2図に示すように表示ビットマツプ203
と呼ぶ共通記憶装置28内の他の位置群に記憶する。
201のテレテキストデータをページ記憶緩衝器202
に転送した後、そのページ記憶緩衝器202を処理して
その結果を第2図に示すように表示ビットマツプ203
と呼ぶ共通記憶装置28内の他の位置群に記憶する。
マイクロコンピュータ25と記憶装置28の間の実際の
データワード転送もまた2段過程で行われる。
データワード転送もまた2段過程で行われる。
第1段階では、アドレスワードがマイクロコンピュータ
25のアドレス端子45から線路46を介してスイッチ
32の端子Aに転送される。タイミング装置29はスイ
ッチ32を制御してアドレスワードを母線33に転送す
る。このアドレスワードは母線33から線路36を介し
てアドレスラッチ35の入力端子34にド 転送されてここに記憶される。記憶されたラレスワード
は出力端子37から記憶装置のアドレス端子38に転送
されて、テレテックスワードが転送され(15) る記憶装置28内の位置を選択する。
25のアドレス端子45から線路46を介してスイッチ
32の端子Aに転送される。タイミング装置29はスイ
ッチ32を制御してアドレスワードを母線33に転送す
る。このアドレスワードは母線33から線路36を介し
てアドレスラッチ35の入力端子34にド 転送されてここに記憶される。記憶されたラレスワード
は出力端子37から記憶装置のアドレス端子38に転送
されて、テレテックスワードが転送され(15) る記憶装置28内の位置を選択する。
第2段階では、マイクロプロセッサ25が記憶装置28
へまたは記憶装置28からの転送を行う。記憶装置への
転送が必要なら、データワードがマイクロコンピュータ
25のデータ端子から線路47を介してスイッチ32の
端子Bに転送される。タイミング装置29はスイッチ3
2を制御してデータワードを母線33に転送し、母線3
3はこのデータを記憶装置のデータ端子41に送る。こ
こでデータワードは記憶装置28内でアドレスラッチ3
5に記憶されたアドレスワードで選ばれた位置に記憶さ
れる。
へまたは記憶装置28からの転送を行う。記憶装置への
転送が必要なら、データワードがマイクロコンピュータ
25のデータ端子から線路47を介してスイッチ32の
端子Bに転送される。タイミング装置29はスイッチ3
2を制御してデータワードを母線33に転送し、母線3
3はこのデータを記憶装置のデータ端子41に送る。こ
こでデータワードは記憶装置28内でアドレスラッチ3
5に記憶されたアドレスワードで選ばれた位置に記憶さ
れる。
また記憶装置28からマイクロコンピュータ25への転
送が必要なら、データワードが記憶装置のデータ端子4
1から母線33に転送され、ここからさらにタイミング
装置29の制御の下にスイッチ32の端子Bに転送され
、さらに線路47を介してマイクロコンピュータのデー
タ端子48に転送される。
送が必要なら、データワードが記憶装置のデータ端子4
1から母線33に転送され、ここからさらにタイミング
装置29の制御の下にスイッチ32の端子Bに転送され
、さらに線路47を介してマイクロコンピュータのデー
タ端子48に転送される。
以上の説明から判るように、第3a図はテレテキストデ
ータがデータプロセッサ24によってデータプロセッサ
緩衝器201に転送されない場合のマイ(16) クロコンピユータ25からは記憶装置28への転送の呼
出し時間区間を表わす。この場合はマイクロコンピュー
タ25に時間区間が1つおきに割当てられるが、マイク
ロコンピュータ25はそのデータ呼出、しのため割当て
られていない時間に記憶装置28のアドレス指定を企て
ることが起ることがある。これカ起ると、マイクロコン
ピュータ25は次に利用できるそのデータ呼出し時間区
間まで待機状態に保たれる。例えば、モトローラ社(M
otorolaInc、)製のマイクロコンピュータM
068000型は、適当な入力信号に応じてこのよう
な待機状態をとるための内蔵機能を有する。
ータがデータプロセッサ24によってデータプロセッサ
緩衝器201に転送されない場合のマイ(16) クロコンピユータ25からは記憶装置28への転送の呼
出し時間区間を表わす。この場合はマイクロコンピュー
タ25に時間区間が1つおきに割当てられるが、マイク
ロコンピュータ25はそのデータ呼出、しのため割当て
られていない時間に記憶装置28のアドレス指定を企て
ることが起ることがある。これカ起ると、マイクロコン
ピュータ25は次に利用できるそのデータ呼出し時間区
間まで待機状態に保たれる。例えば、モトローラ社(M
otorolaInc、)製のマイクロコンピュータM
068000型は、適当な入力信号に応じてこのよう
な待機状態をとるための内蔵機能を有する。
第3b図はテレテキストデータがデータプロセッサ24
によって転送されつつある場合の記憶装置28に対する
マイクロコンピュータの呼出し時間区間を示す。この場
合、マイクロコンピュータ25は表示データの呼出しに
もテレテキストデータの呼出しにも割当てられない時間
区間だけが割当てられる。表示データ呼出し時間区間は
時間区間1つおきに交互に割当てられ、テレテキストデ
ータ呼出(17) し時間区間は呼出し時間区間8つに1つずつ割当てられ
る。
によって転送されつつある場合の記憶装置28に対する
マイクロコンピュータの呼出し時間区間を示す。この場
合、マイクロコンピュータ25は表示データの呼出しに
もテレテキストデータの呼出しにも割当てられない時間
区間だけが割当てられる。表示データ呼出し時間区間は
時間区間1つおきに交互に割当てられ、テレテキストデ
ータ呼出(17) し時間区間は呼出し時間区間8つに1つずつ割当てられ
る。
データプロセッサ24が共通記憶装置28の呼出しを行
っている場合は、マイクロコンピュータ25は、データ
プロセッサの呼出し時間区間が優先権を与えられておれ
ばその呼出しの順番を待たねばならない。データプロセ
ッサ24に与えられた優先権によって生ずるこのような
待機時間以外は、マイクロコンピュータ25は待機遅延
なしに動作を続ける。
っている場合は、マイクロコンピュータ25は、データ
プロセッサの呼出し時間区間が優先権を与えられておれ
ばその呼出しの順番を待たねばならない。データプロセ
ッサ24に与えられた優先権によって生ずるこのような
待機時間以外は、マイクロコンピュータ25は待機遅延
なしに動作を続ける。
タイミング装置29により行われるこのまず表示プロセ
ッサ43に1つおきに時間区間を割当て、残りの時間区
間をデータプロセッサ24とマイクロコンピュータ25
に割当てるという概念は、全フィールドのテレテキスト
データの速やかな処理を可能ならしめる共通記憶装置2
8とテレテキスト復号器の効率のよい分担をもたらす。
ッサ43に1つおきに時間区間を割当て、残りの時間区
間をデータプロセッサ24とマイクロコンピュータ25
に割当てるという概念は、全フィールドのテレテキスト
データの速やかな処理を可能ならしめる共通記憶装置2
8とテレテキスト復号器の効率のよい分担をもたらす。
共通記憶装置28から表示プロセッサ43へのデータワ
ードの転送は、共通記憶装置28からマイクロコンピュ
ータ25への転送と同様である。この場合は第1図に示
すようにアドレスワードが表示プロ(18) セッサ43のアドレス端子83から供給され、データワ
ードがデータ端子81に受信される。アドレスワードは
スイッチ32の端子Cに印加され、データワードは端子
りから供給される。タイミング装置2つからのタイミン
グ信号56は表示プロセッサ43の動作を制御するタイ
ミング信号を与える。データ転送は共通記憶装置28か
らマイクロコンピュータ25へデータを転送するために
用いた2段過程と同様の方法で行われる。共通記憶装置
28の呼出しは、母線33がアドレスワードとデータワ
ードの双方の転送に用いられるため、第1図の実施例用
の2段過程を要する。2段過程で行われる呼出し動作は
、アドレスワードとデータワードが共通記憶装置に各別
の母線を介して供給される他の変形においては、1段過
程によって行うこともできる。
ードの転送は、共通記憶装置28からマイクロコンピュ
ータ25への転送と同様である。この場合は第1図に示
すようにアドレスワードが表示プロ(18) セッサ43のアドレス端子83から供給され、データワ
ードがデータ端子81に受信される。アドレスワードは
スイッチ32の端子Cに印加され、データワードは端子
りから供給される。タイミング装置2つからのタイミン
グ信号56は表示プロセッサ43の動作を制御するタイ
ミング信号を与える。データ転送は共通記憶装置28か
らマイクロコンピュータ25へデータを転送するために
用いた2段過程と同様の方法で行われる。共通記憶装置
28の呼出しは、母線33がアドレスワードとデータワ
ードの双方の転送に用いられるため、第1図の実施例用
の2段過程を要する。2段過程で行われる呼出し動作は
、アドレスワードとデータワードが共通記憶装置に各別
の母線を介して供給される他の変形においては、1段過
程によって行うこともできる。
タイミング装置2つは、マイクロコンピュータ25とデ
ータプロセッサ24の状態に拘らず698n秒ごとに3
49n秒の表示プロセッサ呼出し時間区間を与えるよう
な最高の記憶装置28呼出し優先権を表示するプロセッ
サに与える。その上前述のように、(19) 表示プロセッサ43の用いる時間区間は、データプロセ
ッサ24が転送可能のデータワードを有するとき、その
データプロセッサに与えられ、データプロセッサ24が
記憶装置28への転送を要しなとき、マイクロコンピュ
ータ25に与えられる。
ータプロセッサ24の状態に拘らず698n秒ごとに3
49n秒の表示プロセッサ呼出し時間区間を与えるよう
な最高の記憶装置28呼出し優先権を表示するプロセッ
サに与える。その上前述のように、(19) 表示プロセッサ43の用いる時間区間は、データプロセ
ッサ24が転送可能のデータワードを有するとき、その
データプロセッサに与えられ、データプロセッサ24が
記憶装置28への転送を要しなとき、マイクロコンピュ
ータ25に与えられる。
第1図の表示プロセッサ43は共通記憶装置28の呼出
しが行われるたびに画素データワード4つを読取り、各
画素ワードが2進ビツト4つを含むから、1呼出し時間
区間において16ビツ)EEJ線3線区3り4つの画素
ワードを供給するために16ビツトの広い記憶ワードが
用いられる。第1図の実施例の表示プロセッサ43はタ
イミング装置2つの供給する一連の時間区間中の1つお
きの時間区間に共通記憶装置28の呼出しを行う。
しが行われるたびに画素データワード4つを読取り、各
画素ワードが2進ビツト4つを含むから、1呼出し時間
区間において16ビツ)EEJ線3線区3り4つの画素
ワードを供給するために16ビツトの広い記憶ワードが
用いられる。第1図の実施例の表示プロセッサ43はタ
イミング装置2つの供給する一連の時間区間中の1つお
きの時間区間に共通記憶装置28の呼出しを行う。
表示プロセッサ43は表示器49で表示するために充分
高速でその表示器に画素情報を供給する必要があること
がある。この発明の1特徴により、表示プロセッサ43
に共通記憶装置28の呼出しごとに複数個の画素データ
ワードを読取らせることによって高速表示の可能性が得
られる。例えばそれは(2O) 各記憶ワードに含まれる4つの画素ワードを読取ること
ができる。
高速でその表示器に画素情報を供給する必要があること
がある。この発明の1特徴により、表示プロセッサ43
に共通記憶装置28の呼出しごとに複数個の画素データ
ワードを読取らせることによって高速表示の可能性が得
られる。例えばそれは(2O) 各記憶ワードに含まれる4つの画素ワードを読取ること
ができる。
表示プロセッサ43は各4ビット画素ワードを例えば3
ビツト3群ないし1群から成る色コードと透明度コード
に変換する。この色コード群はそれぞれ赤、緑、青のア
ナログ信号の値を決め、その3つのアナログ信号はスイ
ッチ50のテレテキスト端子に印加される。スイッチ5
oの第2の端子のテレビ端子はテレビジョン信号処理回
路21から映像信号を受ける通常設計の輝度色度段52
から供給される赤、緑、青の信号の別の1組を供給する
。
ビツト3群ないし1群から成る色コードと透明度コード
に変換する。この色コード群はそれぞれ赤、緑、青のア
ナログ信号の値を決め、その3つのアナログ信号はスイ
ッチ50のテレテキスト端子に印加される。スイッチ5
oの第2の端子のテレビ端子はテレビジョン信号処理回
路21から映像信号を受ける通常設計の輝度色度段52
から供給される赤、緑、青の信号の別の1組を供給する
。
スイッチ50はそのテレテキスト端子からの信号を供給
すると共に、画素に対して変換された透明度コードのデ
ジタルコードに従ってそのテレビ端子からの信号も交互
に供給する。従って、画素ワードに付随する透明度コー
ドがそのデジタルコードによって、表示器4つに表示プ
ロセッサ43からのテレテキスト情報か、テレビジョン
信号処理回路21からの通常のテレビジョン画像のよう
な他の映像情報かlのどちらかを表示させる。この透明
度(21) コードの能力は例えば字幕付けに用いることもできる。
すると共に、画素に対して変換された透明度コードのデ
ジタルコードに従ってそのテレビ端子からの信号も交互
に供給する。従って、画素ワードに付随する透明度コー
ドがそのデジタルコードによって、表示器4つに表示プ
ロセッサ43からのテレテキスト情報か、テレビジョン
信号処理回路21からの通常のテレビジョン画像のよう
な他の映像情報かlのどちらかを表示させる。この透明
度(21) コードの能力は例えば字幕付けに用いることもできる。
画素色コードと透明度コードを処理する好都合な方法は
この出願と同日付、同一発明者および出願人の他の特許
願の明細書に記載されている。
この出願と同日付、同一発明者および出願人の他の特許
願の明細書に記載されている。
第1図のスイッチ32は第4図に示すように母線結合に
より構成することもできる。第1図と第4図で同じ数字
は同一機能を示す。第4図の破線内の回路はスイッチ3
2を示す。駆動器424.425.426.427.4
28はタイミング装置29のタイミング信号の制御によ
って母線33を駆動することができ、タイミング装置2
つは一度に1つの駆動器だけが母線33を駆動してデジ
タルワードの有効な転送を行うようにする。
より構成することもできる。第1図と第4図で同じ数字
は同一機能を示す。第4図の破線内の回路はスイッチ3
2を示す。駆動器424.425.426.427.4
28はタイミング装置29のタイミング信号の制御によ
って母線33を駆動することができ、タイミング装置2
つは一度に1つの駆動器だけが母線33を駆動してデジ
タルワードの有効な転送を行うようにする。
母線33を介して転送されたデジタルワードが受信装置
に必要な時間より短時間その母線に留まる必要があれば
、第4図に示すデータレジスタ429のような記憶素子
を導入して、その装置がワードを読取り得るようになる
まで転送されたデジタルワードをとってお(ようにする
必要がある。この構成はマイクロコンピュータ25にデ
ータワードを(22) 読込むのに用いることもできる。この方法を用いると、
マイクロコンピュータ25がデータワードを読取るまで
スイッチ32を同じ状態に保つ必要がある場合より、母
線33を介するデジタルワードの転送に短かい時間区間
を割当てることができる。
に必要な時間より短時間その母線に留まる必要があれば
、第4図に示すデータレジスタ429のような記憶素子
を導入して、その装置がワードを読取り得るようになる
まで転送されたデジタルワードをとってお(ようにする
必要がある。この構成はマイクロコンピュータ25にデ
ータワードを(22) 読込むのに用いることもできる。この方法を用いると、
マイクロコンピュータ25がデータワードを読取るまで
スイッチ32を同じ状態に保つ必要がある場合より、母
線33を介するデジタルワードの転送に短かい時間区間
を割当てることができる。
以上説明したこの発明の実施例では、マイクロコンピュ
ータ25を用いてデータプロセッサ24を制御し、記憶
装置28に記憶すべき情報を選択する。
ータ25を用いてデータプロセッサ24を制御し、記憶
装置28に記憶すべき情報を選択する。
マイクロコンピュータは利用者の発した指令に応じて制
御信号を発生する。マイクロコンピュータはまた記憶装
置28を読取って緩衝されたデータを得、これについて
所要の動作を行い、処理されたデータを同じ記憶装置の
その緩衝されたデータのある位置とは必ずしも同じでは
ない位置に記憶することにより、緩衝されたデータに必
要なデータ処理を行う。マイクロコンピュータはまた中
間結果と状態情報の記憶と回収に同じ記憶装置を使用す
る。
御信号を発生する。マイクロコンピュータはまた記憶装
置28を読取って緩衝されたデータを得、これについて
所要の動作を行い、処理されたデータを同じ記憶装置の
その緩衝されたデータのある位置とは必ずしも同じでは
ない位置に記憶することにより、緩衝されたデータに必
要なデータ処理を行う。マイクロコンピュータはまた中
間結果と状態情報の記憶と回収に同じ記憶装置を使用す
る。
マイクロコンピュータ25は実際は汎用マイクロコンピ
ュータであるから、テレテキスト信号の復(23) 号と無関係の仕事をすることもできる。このようす仕事
をするために、マイクロコンピュータ25ハ第2図に示
すような記憶装置28のスクラッチボッド204の記憶
スペースを用いることができる。マイクロコンピュータ
25はさらにキーボードからの信号に関する信号処理を
することもできる。
ュータであるから、テレテキスト信号の復(23) 号と無関係の仕事をすることもできる。このようす仕事
をするために、マイクロコンピュータ25ハ第2図に示
すような記憶装置28のスクラッチボッド204の記憶
スペースを用いることができる。マイクロコンピュータ
25はさらにキーボードからの信号に関する信号処理を
することもできる。
この実施例では、時分割された共通の記憶装置28を用
いて入来データを緩衝し、表示プロセッサ43の呼出し
を行っている。記憶装置を1つじが使用しないため、結
線が簡単になり、このためテレテキスト復号器に必要な
記憶スペースの有効経済的利用が行われる。
いて入来データを緩衝し、表示プロセッサ43の呼出し
を行っている。記憶装置を1つじが使用しないため、結
線が簡単になり、このためテレテキスト復号器に必要な
記憶スペースの有効経済的利用が行われる。
この実施例ではタイミング装置29がマイクロコンピュ
ータ25、データプロセッサ24および表示プロセッサ
43を動作させ、また、マイクロコンピュータ、データ
プロセッサおよび表示プロセッサのそれぞれについて共
通の記憶装置を呼出すスイッチ手段32を動作させるタ
イミング信号54を供給し、表示プロセッサ、マイクロ
コンピュータおよびデータプロセッサが必要とするよう
に記憶装置が呼(24) 出せるようにする。タイミング装置はまた連、続的に反
復する時間区間を画定する。この時間区間は所定の規則
正しい時間間隔で起る。記憶装置の呼出しはこれにアド
レスワードを供給してこれにより決まる位置に対してデ
ータワードを出入することにより行われる。タイミング
装置はその時間区間中に記憶装置を呼出し、各時間区間
当り1回だけ呼出しをすることができる。連続する時間
区間の順序はマイクロコンピュータ、データプロセッサ
および表示プロセッサ内の実時間動作に無関係で、その
ため例えはデータプロセッサが記憶装置の呼出しを要し
ても、その呼出しタイミングはその時間区間の所定のタ
イミングに「適合」する必要がある。データプロセッサ
、マイクロコンピュータおよび表示プロセッサに対する
各時間区間の割当てはタイミング装置の制御の下に行わ
れる。
ータ25、データプロセッサ24および表示プロセッサ
43を動作させ、また、マイクロコンピュータ、データ
プロセッサおよび表示プロセッサのそれぞれについて共
通の記憶装置を呼出すスイッチ手段32を動作させるタ
イミング信号54を供給し、表示プロセッサ、マイクロ
コンピュータおよびデータプロセッサが必要とするよう
に記憶装置が呼(24) 出せるようにする。タイミング装置はまた連、続的に反
復する時間区間を画定する。この時間区間は所定の規則
正しい時間間隔で起る。記憶装置の呼出しはこれにアド
レスワードを供給してこれにより決まる位置に対してデ
ータワードを出入することにより行われる。タイミング
装置はその時間区間中に記憶装置を呼出し、各時間区間
当り1回だけ呼出しをすることができる。連続する時間
区間の順序はマイクロコンピュータ、データプロセッサ
および表示プロセッサ内の実時間動作に無関係で、その
ため例えはデータプロセッサが記憶装置の呼出しを要し
ても、その呼出しタイミングはその時間区間の所定のタ
イミングに「適合」する必要がある。データプロセッサ
、マイクロコンピュータおよび表示プロセッサに対する
各時間区間の割当てはタイミング装置の制御の下に行わ
れる。
タイミング装置は表示プロセッサの独占使用のため所定
順序の時間間隔を割当て、その表示プロセッサへのタイ
ミング信号をその呼出し用のタイミングがその独占使用
のために割当てられた時間区(25) 間と一致するように供給する。各時間区間の始まる前に
その時間区間の割当てを決める優先式で、共通記憶装置
の同時呼出し要求が取扱われるため、この復号器におけ
る仲裁は表示プロセッサに予め割当てられなかった時間
区間に同期して行われる。
順序の時間間隔を割当て、その表示プロセッサへのタイ
ミング信号をその呼出し用のタイミングがその独占使用
のために割当てられた時間区(25) 間と一致するように供給する。各時間区間の始まる前に
その時間区間の割当てを決める優先式で、共通記憶装置
の同時呼出し要求が取扱われるため、この復号器におけ
る仲裁は表示プロセッサに予め割当てられなかった時間
区間に同期して行われる。
この実施例では表示プロセッサ43のために共通記憶装
置28に記憶されるデジタルワードは2つ以上の画素ワ
ードを含み、1つの画素ワードが表示プロセッサに1つ
の画素を表示するための情報を与え、表示プロセッサは
その呼出し時間区間中にそのデジタルワードに含まれた
画素ワードを読取る。
置28に記憶されるデジタルワードは2つ以上の画素ワ
ードを含み、1つの画素ワードが表示プロセッサに1つ
の画素を表示するための情報を与え、表示プロセッサは
その呼出し時間区間中にそのデジタルワードに含まれた
画素ワードを読取る。
(141図はこの発明を実施したテレテキスト復号器の
1例を示すブロック回路図、第2図は第1図の復号器の
共通の記憶装置に対する記憶割当てを示す略図、第3a
図および第3b図は種々の時間区間における共通記憶装
置の利用状態を示す図、第4図は第1図の復号器に用い
られるスイッチの1実施例のブロック図である。 (26) 28.35・・・共通の記憶装置、22.24.26・
・・取出し手段、25・・・処理手段、43・・・表示
処理器、50・・・切換手段、29・・・タイミング手
段。 特許出願人 アールシーニー コーポレーション代 理
人 清 水 哲 ほか2名 (27) 手続補正書(自発) 昭和59年12月26日 1、事件の表示 特願昭59−252805号 2、発明の名称 復号器 3、補正をする者 事件との関係 特許出願人 住 所 アメリカ合衆国 ニューヨーク州 1.002
0ニユーヨーク ロックフェラー ’7”y+P 30
名 称 (757) アールシーニー コーポレーショ
ン4、代理人 住 所 郵便番号 651 神戸市中央区雲井通7丁目1番1号 5 補正の対象 明細書の「特許請求の範囲」および「発明の詳細な説明
」の各欄。 6 補正の内容 (1)特許請求の範囲を別紙の通り補正する。 (2) 明細書第4頁第16〜17行の[表示装置によ
り表示する・・・・・情報を表わす]を「制御情報と表
示装置により表示するための表示可能の情報とを表わす
」と訂正する。 (3)同上第6頁第18行の「険知」を「検知」と訂正
する。 (4)同上第7頁第12行の[24]を「42」と訂・
正する。 (5)同上第11頁第9行の[56に」を[56を]と
訂正する。 添付書類 特許請求の範囲 以上 (2、 特許請求の範囲 (11制御情報と表示装置によって表示するための表示
可能の情報とを表わす2進データを含むテレテキスト状
信号のためのものであって、2進データを記憶する共通
の記憶装置と、テレテキスト状信号から記憶装置に記憶
するために予め選択されたデータを取出す手段と、記憶
された予め選択されたデータを処理して記憶装置に記憶
するための処理済データを生成する処理手段と、記憶さ
れた処理済データに応じて表示装置に上記表示可能の情
報を表示させるための信号を生成する表示処理 。 器と、上記取出し手段、処理手段および表示処理器を上
記共通の記憶装置に選択的に結合する切換手段と、上記
取出し手段、処理手段および表示処理器が所定の時間区
間列の各時間区間中上記記憶装置に結合されるように上
記切換手段を制御するタイミング手段とを含むことを特
徴とする復号器。
1例を示すブロック回路図、第2図は第1図の復号器の
共通の記憶装置に対する記憶割当てを示す略図、第3a
図および第3b図は種々の時間区間における共通記憶装
置の利用状態を示す図、第4図は第1図の復号器に用い
られるスイッチの1実施例のブロック図である。 (26) 28.35・・・共通の記憶装置、22.24.26・
・・取出し手段、25・・・処理手段、43・・・表示
処理器、50・・・切換手段、29・・・タイミング手
段。 特許出願人 アールシーニー コーポレーション代 理
人 清 水 哲 ほか2名 (27) 手続補正書(自発) 昭和59年12月26日 1、事件の表示 特願昭59−252805号 2、発明の名称 復号器 3、補正をする者 事件との関係 特許出願人 住 所 アメリカ合衆国 ニューヨーク州 1.002
0ニユーヨーク ロックフェラー ’7”y+P 30
名 称 (757) アールシーニー コーポレーショ
ン4、代理人 住 所 郵便番号 651 神戸市中央区雲井通7丁目1番1号 5 補正の対象 明細書の「特許請求の範囲」および「発明の詳細な説明
」の各欄。 6 補正の内容 (1)特許請求の範囲を別紙の通り補正する。 (2) 明細書第4頁第16〜17行の[表示装置によ
り表示する・・・・・情報を表わす]を「制御情報と表
示装置により表示するための表示可能の情報とを表わす
」と訂正する。 (3)同上第6頁第18行の「険知」を「検知」と訂正
する。 (4)同上第7頁第12行の[24]を「42」と訂・
正する。 (5)同上第11頁第9行の[56に」を[56を]と
訂正する。 添付書類 特許請求の範囲 以上 (2、 特許請求の範囲 (11制御情報と表示装置によって表示するための表示
可能の情報とを表わす2進データを含むテレテキスト状
信号のためのものであって、2進データを記憶する共通
の記憶装置と、テレテキスト状信号から記憶装置に記憶
するために予め選択されたデータを取出す手段と、記憶
された予め選択されたデータを処理して記憶装置に記憶
するための処理済データを生成する処理手段と、記憶さ
れた処理済データに応じて表示装置に上記表示可能の情
報を表示させるための信号を生成する表示処理 。 器と、上記取出し手段、処理手段および表示処理器を上
記共通の記憶装置に選択的に結合する切換手段と、上記
取出し手段、処理手段および表示処理器が所定の時間区
間列の各時間区間中上記記憶装置に結合されるように上
記切換手段を制御するタイミング手段とを含むことを特
徴とする復号器。
Claims (1)
- (1)制御情報と表示可能の情報を表わす2進データを
含むテレテキスト状信号を表示装置により表示するため
のものであって、2進データを記憶する共通の記憶装置
と、テレテキスト状信号から記憶装置に記憶するために
予め選択されたデータを取出す手段と、記憶された予め
選択されたデータを処理して記憶装置に記憶するための
処理済データを生成する処理手段と、記憶された処理済
データに応じて表示器に上記表示可能の情報を表示させ
るための信号を生成する表示処理器と、上記取出し手段
、処理手段および表示処理器を上記共通の記憶装置に選
択的に結合する切換手段と、上記取出し手段、処理手段
および表示処理器が所定の時間区間列の各時間区間中上
記記憶装置に結合されるように上記切換手段を制御する
タイミング手段とを含むことを特徴とする復号器。
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