JPS60117843A - デ−タ伝送システムの信号出力方式 - Google Patents
デ−タ伝送システムの信号出力方式Info
- Publication number
- JPS60117843A JPS60117843A JP22730183A JP22730183A JPS60117843A JP S60117843 A JPS60117843 A JP S60117843A JP 22730183 A JP22730183 A JP 22730183A JP 22730183 A JP22730183 A JP 22730183A JP S60117843 A JPS60117843 A JP S60117843A
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- JP
- Japan
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- signal
- bus
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- switch element
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- Pending
Links
- 230000005540 biological transmission Effects 0.000 title claims abstract description 18
- 238000001514 detection method Methods 0.000 claims abstract description 14
- 238000000034 method Methods 0.000 claims description 9
- 230000000630 rising effect Effects 0.000 description 7
- 238000010586 diagram Methods 0.000 description 6
- 238000005070 sampling Methods 0.000 description 2
- 238000003708 edge detection Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/40—Bus networks
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/40—Bus networks
- H04L12/407—Bus networks with decentralised control
- H04L12/413—Bus networks with decentralised control with random access, e.g. carrier-sense multiple-access with collision detection [CSMA-CD]
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明はデータ伝送システムにおける信号出力方式に関
するものである。
するものである。
〈従来技術〉
単一のバスを介して複数の端末機がデータを送信する場
合、捷ず何らかの方法でバスの使用権を獲得しなければ
ならない。その一方法としてＣ８ＭＡ／ＣＤ方式がある
が、これはテーク送信者は常時バスを監視しており、パ
ス上のキャリヤ（キャリヤが無い場合はデータ存続期間
をあてる）が存在しない時のみデータ送出を開始し、更
に送信中もパス上の信号をサンプルし自分の出している
信号と比較することにより、他の端末機との間て同時送
出によるデータの衝突がないかを監視する方法である。
合、捷ず何らかの方法でバスの使用権を獲得しなければ
ならない。その一方法としてＣ８ＭＡ／ＣＤ方式がある
が、これはテーク送信者は常時バスを監視しており、パ
ス上のキャリヤ（キャリヤが無い場合はデータ存続期間
をあてる）が存在しない時のみデータ送出を開始し、更
に送信中もパス上の信号をサンプルし自分の出している
信号と比較することにより、他の端末機との間て同時送
出によるデータの衝突がないかを監視する方法である。
ところでこの場合バスの構造を論理和構成にしておくと
衝突検出も可能であるばかりでなく、どちらか一方のデ
ータはその捷ま通過するので、もし伝送路の遅延が問題
にならなければ、特別なパックオフ処理も不要となり便
利である。
衝突検出も可能であるばかりでなく、どちらか一方のデ
ータはその捷ま通過するので、もし伝送路の遅延が問題
にならなければ、特別なパックオフ処理も不要となり便
利である。
第１図にこの種の構造のバスの一例を示す。図はオープ
ンコレククによるワイヤードＯＲ回路となっている。図
において、ＩＯはノくス形式のネットワーク、１１〜１
３は端末器（代表して出力回路のみ明記）、Ｒはプルア
ップ抵抗である。例では、端末機＋ １−１８のいずれ
か１つでも出力ＯＮの場合、バス１０の電圧レベルはＬ
ＯＷとなる。
ンコレククによるワイヤードＯＲ回路となっている。図
において、ＩＯはノくス形式のネットワーク、１１〜１
３は端末器（代表して出力回路のみ明記）、Ｒはプルア
ップ抵抗である。例では、端末機＋ １−１８のいずれ
か１つでも出力ＯＮの場合、バス１０の電圧レベルはＬ
ＯＷとなる。
この様、な伝送路を介して信号を送出する場合、もし衝
突が生じた場合ＬＯＷを出力した方が優先される。従っ
てＨＩＧＨを出力しＬＯＷを検出した端末機が直ちに送
信を中止することにより、バスＩＯ上のテークは保存さ
れる。
突が生じた場合ＬＯＷを出力した方が優先される。従っ
てＨＩＧＨを出力しＬＯＷを検出した端末機が直ちに送
信を中止することにより、バスＩＯ上のテークは保存さ
れる。
第２図はこの様子を説明するタイミング図である。図に
おいて、１ビは端末機１１の出方信号、＋ ２’は端末
機１２の出力信号、１０′はバス１０上の信号、２０は
端末機１１および１２においてデータサンプルを行なう
タイミング即ち衝突検出タイミングである。Ｐ点におい
て、端末機１２は自分の出力信号１２′とパス１０上の
電圧レベルＩ Ｏ’を比較することにより、衝突を検出
し以後データ送出を打切っている。端末機１１はＰ点に
おいては衝突とはならずその１捷継続してテークＩ １
’を出力し、パス１０上では同じデータＩ Ｏ’が現わ
れる。即ち一方のデータは必ず保存される。このため端
末機１１と１２の間でのバス調停作業も不要となり、非
常にメリットが大きい。
おいて、１ビは端末機１１の出方信号、＋ ２’は端末
機１２の出力信号、１０′はバス１０上の信号、２０は
端末機１１および１２においてデータサンプルを行なう
タイミング即ち衝突検出タイミングである。Ｐ点におい
て、端末機１２は自分の出力信号１２′とパス１０上の
電圧レベルＩ Ｏ’を比較することにより、衝突を検出
し以後データ送出を打切っている。端末機１１はＰ点に
おいては衝突とはならずその１捷継続してテークＩ １
’を出力し、パス１０上では同じデータＩ Ｏ’が現わ
れる。即ち一方のデータは必ず保存される。このため端
末機１１と１２の間でのバス調停作業も不要となり、非
常にメリットが大きい。
しかしこの様な単純なワイヤーＦＯＲによる出力回路は
容量性の負荷に対して弱い々いう欠点がある。第３図は
第１図に示す構造のバスに容量性負荷Ｃが接続された場
合の波形を示す。図において、（ａ）は本来の伝送信号
、（ｂ）は実際のパス１０上−の波形、（Ｃ）は受信側
でコンパレークを通しだ後の波形である。（ｂ）で示し
た様に、立上り部分はＣＲ時定数によって決まるためな
まっている。受信側では通常コンパレータにより波形を
整形するため、（ｃ）の様になりＨＩＧＨの期間が短か
くなる。立上りを急峻にするためにはＲを小さくすれば
良いが、そのためにはドライブで能力の高い出力装置が
必要であり、又消費電力も犬きくなり得策ではない。
容量性の負荷に対して弱い々いう欠点がある。第３図は
第１図に示す構造のバスに容量性負荷Ｃが接続された場
合の波形を示す。図において、（ａ）は本来の伝送信号
、（ｂ）は実際のパス１０上−の波形、（Ｃ）は受信側
でコンパレークを通しだ後の波形である。（ｂ）で示し
た様に、立上り部分はＣＲ時定数によって決まるためな
まっている。受信側では通常コンパレータにより波形を
整形するため、（ｃ）の様になりＨＩＧＨの期間が短か
くなる。立上りを急峻にするためにはＲを小さくすれば
良いが、そのためにはドライブで能力の高い出力装置が
必要であり、又消費電力も犬きくなり得策ではない。
〈発明の目的〉
本発明は、この様なネノトフークにおいて容量性の負荷
が接続された場合にも有効に働く信号出力方式を提供す
るものである。
が接続された場合にも有効に働く信号出力方式を提供す
るものである。
〈実 施 例〉
第４図は本発明の一実施例を説明−ｒるための信号：重
装回路および受信回路のフロック図である。
装回路および受信回路のフロック図である。
図において、４１および４２はトランジスタ等のスイッ
チ素子、４３は送信信号の立上りエツジを検出しパルス
を発生する回路、４４は受信回路、４５は所定のタイミ
ングで送信信号と受信信号を比較し衝突を検出する回路
である。第５図は各部位のタイミング図で、（ａ）は送
信信号ＴＸＤでＬＯＷＯ時スイッチ素子４２はＯＮされ
、パス１０にＬＯＷ信号を送出する。（ｂ）は立上り検
出回路４３の出力信号でＨｉＧＨＯ時スイッチ素子４１
をＯＮにする。（ｃ）は衝突検出回路４５において衝突
を検出するタイミングで、送信信号ＴＸＤの各ビットの
中点付近であり、ＬＯＷ信号出力時には検出不要である
。なぜならパス１０は負論理のＯＲ回路となっており、
ＬＯＷを出力すればバスレベルは必然的にＬＯＷとなり
比較する必要がないからである。
チ素子、４３は送信信号の立上りエツジを検出しパルス
を発生する回路、４４は受信回路、４５は所定のタイミ
ングで送信信号と受信信号を比較し衝突を検出する回路
である。第５図は各部位のタイミング図で、（ａ）は送
信信号ＴＸＤでＬＯＷＯ時スイッチ素子４２はＯＮされ
、パス１０にＬＯＷ信号を送出する。（ｂ）は立上り検
出回路４３の出力信号でＨｉＧＨＯ時スイッチ素子４１
をＯＮにする。（ｃ）は衝突検出回路４５において衝突
を検出するタイミングで、送信信号ＴＸＤの各ビットの
中点付近であり、ＬＯＷ信号出力時には検出不要である
。なぜならパス１０は負論理のＯＲ回路となっており、
ＬＯＷを出力すればバスレベルは必然的にＬＯＷとなり
比較する必要がないからである。
第４図において、バス１０のレベルをＬＯＷからＨＩＧ
Ｈにするには、スイッチ素子４２をＯＮからＱＦＦにす
るが、この時もしスイッチ素子４１がＯＦＦのままであ
ると、第１図と同じになり、パスの電圧レベルはＲによ
りＣを充電することにより上昇する。従って第５図（ｄ
）の破線で示した様に立上りかな筐り、受信側でコンパ
レークを通し波形を整形した場合、ＨＩＧＨレベルとＩ
−ＯＷレベルで同じｌビットに対しても期間が変わる。
Ｈにするには、スイッチ素子４２をＯＮからＱＦＦにす
るが、この時もしスイッチ素子４１がＯＦＦのままであ
ると、第１図と同じになり、パスの電圧レベルはＲによ
りＣを充電することにより上昇する。従って第５図（ｄ
）の破線で示した様に立上りかな筐り、受信側でコンパ
レークを通し波形を整形した場合、ＨＩＧＨレベルとＩ
−ＯＷレベルで同じｌビットに対しても期間が変わる。
これはすでに述べたとおりである。
本発明の方式は第４図に図示の如く、スイッチ素子４Ｉ
を付加し、信号立上り時に強制的にＯＮするものであっ
て、立上り時ＬＯＷインピーダンスでＣを充電するため
、瞬時にしてパスレベルはＨＩＧＨとなり、同図（ｄ）
の実線で示した様に立上りは急峻になり、受信側でコン
パレーク全通した後も正確な波形を受信することができ
る。
を付加し、信号立上り時に強制的にＯＮするものであっ
て、立上り時ＬＯＷインピーダンスでＣを充電するため
、瞬時にしてパスレベルはＨＩＧＨとなり、同図（ｄ）
の実線で示した様に立上りは急峻になり、受信側でコン
パレーク全通した後も正確な波形を受信することができ
る。
なお、ＨＩＧＨの期間中スイッチ素子４１をＯＮにして
おく必要はなく、特に衝突検出時はＯＦＦにしなければ
ならない。なぜなら衝突検出時にスイッチ素子４１がＯ
Ｎであるならけ、もし他の端末機がＬＯＷ出力であった
としても、パスレベルは確定しないため衝突検出はでき
なくなる。例えば・一方の端末機がＨＩＧＨ（スイッチ
素子４１をＯＮ）を出力し、他方の端末機が同時にＬＯ
Ｗ（スイッチ素子４２をＯＮ）を出力した場合、高レベ
ルとグランドが短絡状態となり、両方のスイッチの内部
抵抗の比或いは保護抵抗の比によってパスレベルが決定
され、衝突が検出できる保障はない。このためスイッチ
素子４１がＯＮの期間（第５図（ｂ）のＨＩＧＨレベル
期間）はできるだけ短い方が望捷しく、少なくとも衝突
検出タイミングと重なってはならない。
おく必要はなく、特に衝突検出時はＯＦＦにしなければ
ならない。なぜなら衝突検出時にスイッチ素子４１がＯ
Ｎであるならけ、もし他の端末機がＬＯＷ出力であった
としても、パスレベルは確定しないため衝突検出はでき
なくなる。例えば・一方の端末機がＨＩＧＨ（スイッチ
素子４１をＯＮ）を出力し、他方の端末機が同時にＬＯ
Ｗ（スイッチ素子４２をＯＮ）を出力した場合、高レベ
ルとグランドが短絡状態となり、両方のスイッチの内部
抵抗の比或いは保護抵抗の比によってパスレベルが決定
され、衝突が検出できる保障はない。このためスイッチ
素子４１がＯＮの期間（第５図（ｂ）のＨＩＧＨレベル
期間）はできるだけ短い方が望捷しく、少なくとも衝突
検出タイミングと重なってはならない。
〈発明の効果〉
この様に本発明によれば、パスを信号立上り時にＬＯＷ
インピーダンスでドライブすることにより、容量性のパ
スにおいても立上り時の波形のなまりを防止し、しかも
衝突検出時には本来の論理和回路を構成することにより
、衝突検出も可能となり、信頼性の高い伝送が可能にな
る。
インピーダンスでドライブすることにより、容量性のパ
スにおいても立上り時の波形のなまりを防止し、しかも
衝突検出時には本来の論理和回路を構成することにより
、衝突検出も可能となり、信頼性の高い伝送が可能にな
る。
第１図は従来の論理和形式のパス構造を示す図、第２図
は衝突検出時のタイミング図、第３図は第１ａｐ／＜ネ
・′における波形のなまりを説８Ａする図、第４図は本
発明方式の一実施例を説明する回路ブロック図、第５図
は第４図の各部位における信号波形である。 １０・パス、ｌｌ−１３・端末機、４１・４２・スイッ
チ素子、４３・立上りエッソ検出回路、４４・・・受信
回路、４５・衝突検出回路。 代理人 弁理士 福 士 愛 彦（他２名）第 ｌ 帆 一τ 第２図１ 第３図 第４ 図 第５αＩ
は衝突検出時のタイミング図、第３図は第１ａｐ／＜ネ
・′における波形のなまりを説８Ａする図、第４図は本
発明方式の一実施例を説明する回路ブロック図、第５図
は第４図の各部位における信号波形である。 １０・パス、ｌｌ−１３・端末機、４１・４２・スイッ
チ素子、４３・立上りエッソ検出回路、４４・・・受信
回路、４５・衝突検出回路。 代理人 弁理士 福 士 愛 彦（他２名）第 ｌ 帆 一τ 第２図１ 第３図 第４ 図 第５αＩ
Claims (1)
- へ、バス上にデータが存在しない時のみデータ送出が可
能で、データ送出時はパス上の信号と出力信号を比較す
ることにより衝突検出を行なうネットワークによるデー
タ伝送システムにおいて、信号を送出する場合、信号の
立上り時又は立下り時は低インピーダンスでバスを駆動
し、少なくともパス上の信号をサンプルする期間は、複
数の出力信号がパス上で論理和を形成する様にバスを駆
動することを特徴とするデータ伝送システムの信号出力
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22730183A JPS60117843A (ja) | 1983-11-29 | 1983-11-29 | デ−タ伝送システムの信号出力方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22730183A JPS60117843A (ja) | 1983-11-29 | 1983-11-29 | デ−タ伝送システムの信号出力方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60117843A true JPS60117843A (ja) | 1985-06-25 |
Family
ID=16858667
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22730183A Pending JPS60117843A (ja) | 1983-11-29 | 1983-11-29 | デ−タ伝送システムの信号出力方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60117843A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02222906A (ja) * | 1988-11-11 | 1990-09-05 | Furukawa Electric Co Ltd:The | プラスチック光ファイバ |
| US5343084A (en) * | 1991-04-30 | 1994-08-30 | Sgs-Thomson Microelectronics S.A. | Variable level periodic excitation circuit for a capacitive load |
| US8074004B2 (en) * | 2008-04-02 | 2011-12-06 | Novatek Microelectronics Corp. | Electronic device for contention detection of bidirectional bus and related method |
| JP2015204484A (ja) * | 2014-04-11 | 2015-11-16 | 株式会社デンソー | バス通信システム及びマスタ通信装置 |
| EP3252614A1 (en) * | 2016-06-01 | 2017-12-06 | Semiconductor Manufacturing International Corporation (Shanghai) | A self-enabled bus conflict detection circuit |
| US9852099B2 (en) | 2014-05-16 | 2017-12-26 | Denso Corporation | Slave communication device and bus communication system |
-
1983
- 1983-11-29 JP JP22730183A patent/JPS60117843A/ja active Pending
Cited By (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02222906A (ja) * | 1988-11-11 | 1990-09-05 | Furukawa Electric Co Ltd:The | プラスチック光ファイバ |
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| CN107451018A (zh) * | 2016-06-01 | 2017-12-08 | 中芯国际集成电路制造(上海)有限公司 | 总线故障检测电路 |
| US9990310B2 (en) | 2016-06-01 | 2018-06-05 | Semiconductor Manufacturing International (Shanghai) Corporation | Self-enabled bus conflict detection circuit |
| CN107451018B (zh) * | 2016-06-01 | 2020-07-28 | 中芯国际集成电路制造(上海)有限公司 | 总线故障检测电路 |
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