JPS5948142U - ヒステリシス特性を有するモス入力バツフア回路 - Google Patents
ヒステリシス特性を有するモス入力バツフア回路Info
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- JPS5948142U JPS5948142U JP1983121780U JP12178083U JPS5948142U JP S5948142 U JPS5948142 U JP S5948142U JP 1983121780 U JP1983121780 U JP 1983121780U JP 12178083 U JP12178083 U JP 12178083U JP S5948142 U JPS5948142 U JP S5948142U
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- JP
- Japan
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- electrode coupled
- mode field
- field effect
- effect transistor
- voltage
- Prior art date
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- 239000004020 conductor Substances 0.000 claims 5
- 230000005669 field effect Effects 0.000 claims 5
- 238000010586 diagram Methods 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/01—Shaping pulses
- H03K5/02—Shaping pulses by amplifying
- H03K5/023—Shaping pulses by amplifying using field effect transistors
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
- H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
- H03K3/353—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of field-effect transistors with internal or external positive feedback
- H03K3/356—Bistable circuits
- H03K3/3565—Bistables with hysteresis, e.g. Schmitt trigger
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Logic Circuits (AREA)
- Electronic Switches (AREA)
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は、本考案の好ましい実施例の概略図を示す。第
2図は、第1図の回路の切換特性を図示した曲線を示す
。第3図は、MO3LSI半導体ダイにおける第1図の
入力バッファ回路の応用を図示するダイヤグラムである
。
2図は、第1図の回路の切換特性を図示した曲線を示す
。第3図は、MO3LSI半導体ダイにおける第1図の
入力バッファ回路の応用を図示するダイヤグラムである
。
Claims (1)
- ゲート電極を入力に結合させ、ドレイン電極を出力に結
合させ、ソース電極を第1ノードに結−合させた第1エ
ンハンスメントモード電界トランジスタ、ドレイン電極
を第1ノードに結合させ、ソース電極を第1電圧導体に
結合させ、ゲート電極を第2電圧導体に結合させ、電圧
が第2電圧導体に接続された時に電圧による変化に追随
する負荷として機能する第1デプレツシヨンモード電界
効果トランジスタ、ソース電極を第1ノードに結合させ
、ドレイン電極を第2電圧導体に結合させ、ゲート電極
を出力に結合させ、出力と第17−ドとの間に電圧オフ
セットを有しない抵抗特性を与える第2デプレツシヨン
モード電界効果トランジスタ、ソース電極及びゲート電
極の両者を出力とドレイン電極に結合させた第3デプレ
ツシヨンモード電界効果トランジスタ、ドレイン電極及
びゲ −−ト電極の両者を第2電圧導体に結合させ、
ツース電極を第3デプレツシヨンモード電界効果トラン
ジスタのドレイン電極に結合させ、第1エンハンスメン
トモードトランジスタに関連した温度変化を補償する第
2エンハンスメントモード電界効果トランジスタ、を具
備する1人力、1出力を有する入力バッファ回路。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US741446 | 1976-11-12 | ||
US05/741,446 US4071784A (en) | 1976-11-12 | 1976-11-12 | MOS input buffer with hysteresis |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5948142U true JPS5948142U (ja) | 1984-03-30 |
JPH0224282Y2 JPH0224282Y2 (ja) | 1990-07-03 |
Family
ID=24980746
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12917577A Pending JPS5361958A (en) | 1976-11-12 | 1977-10-27 | Mos input buffer circuit having hysteresis characteristics |
JP1983121780U Granted JPS5948142U (ja) | 1976-11-12 | 1983-08-04 | ヒステリシス特性を有するモス入力バツフア回路 |
Family Applications Before (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12917577A Pending JPS5361958A (en) | 1976-11-12 | 1977-10-27 | Mos input buffer circuit having hysteresis characteristics |
Country Status (3)
Country | Link |
---|---|
US (1) | US4071784A (ja) |
JP (2) | JPS5361958A (ja) |
DE (1) | DE2749051A1 (ja) |
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JPS57183119A (en) * | 1981-05-02 | 1982-11-11 | Sanyo Electric Co Ltd | Schmitt circuit |
US4439691A (en) * | 1981-12-23 | 1984-03-27 | Bell Telephone Laboratories, Incorporated | Non-inverting shift register stage in MOS technology |
US4456841A (en) * | 1982-02-05 | 1984-06-26 | International Business Machines Corporation | Field effect level sensitive circuit |
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DE3318564A1 (de) * | 1983-05-20 | 1984-11-22 | Siemens AG, 1000 Berlin und 8000 München | Integrierte digitale mos-halbleiterschaltung |
DE3323446A1 (de) * | 1983-06-29 | 1985-01-10 | Siemens AG, 1000 Berlin und 8000 München | Eingangssignalpegelwandler fuer eine mos-digitalschaltung |
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DE2252130C2 (de) * | 1972-10-24 | 1978-06-08 | Deutsche Itt Industries Gmbh, 7800 Freiburg | Monolithisch integrierte Schmitt-Trigger-Schaltung aus Isolierschicht-Feldeffekttransistoren |
JPS551576B2 (ja) * | 1973-07-09 | 1980-01-16 | ||
US4023122A (en) * | 1975-01-28 | 1977-05-10 | Nippon Electric Company, Ltd. | Signal generating circuit |
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-
1976
- 1976-11-12 US US05/741,446 patent/US4071784A/en not_active Expired - Lifetime
-
1977
- 1977-10-27 JP JP12917577A patent/JPS5361958A/ja active Pending
- 1977-11-02 DE DE19772749051 patent/DE2749051A1/de not_active Ceased
-
1983
- 1983-08-04 JP JP1983121780U patent/JPS5948142U/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
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US4071784A (en) | 1978-01-31 |
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