JPS5929817U - Ａｇｃ回路 - Google Patents
Ａｇｃ回路Info
- Publication number
- JPS5929817U JPS5929817U JP12484582U JP12484582U JPS5929817U JP S5929817 U JPS5929817 U JP S5929817U JP 12484582 U JP12484582 U JP 12484582U JP 12484582 U JP12484582 U JP 12484582U JP S5929817 U JPS5929817 U JP S5929817U
- Authority
- JP
- Japan
- Prior art keywords
- agc circuit
- field effect
- effect transistor
- gate
- diode
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Control Of Amplification And Gain Control (AREA)
- Circuits Of Receivers In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図、第２図および第３図は従来例を示すブロック図
および特性図、第４図は本考案実施例を示す回路図であ
る。 Ｑ□・・・・・・デュアルゲート型ＦＥＴ、 Ｑ２・・
・・・・バイポーラ型トランジスタ、Ｄ・・・・・・Ｐ
ＩＮダイオード。
および特性図、第４図は本考案実施例を示す回路図であ
る。 Ｑ□・・・・・・デュアルゲート型ＦＥＴ、 Ｑ２・・
・・・・バイポーラ型トランジスタ、Ｄ・・・・・・Ｐ
ＩＮダイオード。
Claims (1)
- 【実用新案登録請求の範囲】 １ 電界効果型トランジスタの第１ゲートと第２ゲート
間にダイオードを接続し、ＡＧＣ電圧に応じて上記電界
効果型トランジスタとダイオードの入力レベルを軽減さ
せるように構成したことを特徴とするＡＧＣ回路。 ２ 上記電界効果型トランジスタがデュアルゲート型か
ら成ることを特徴とする実用新案登録請求の範囲第１項
記載のＡＧＣ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12484582U JPS5929817U (ja) | 1982-08-17 | 1982-08-17 | Ａｇｃ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12484582U JPS5929817U (ja) | 1982-08-17 | 1982-08-17 | Ａｇｃ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5929817U true JPS5929817U (ja) | 1984-02-24 |
Family
ID=30284450
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12484582U Pending JPS5929817U (ja) | 1982-08-17 | 1982-08-17 | Ａｇｃ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5929817U (ja) |
-
1982
- 1982-08-17 JP JP12484582U patent/JPS5929817U/ja active Pending
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