JPS5936428A - 位相同期装置 - Google Patents

位相同期装置

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Publication number
JPS5936428A
JPS5936428A JP57145525A JP14552582A JPS5936428A JP S5936428 A JPS5936428 A JP S5936428A JP 57145525 A JP57145525 A JP 57145525A JP 14552582 A JP14552582 A JP 14552582A JP S5936428 A JPS5936428 A JP S5936428A
Authority
JP
Japan
Prior art keywords
phase
output
voltage
voltage control
frequency
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP57145525A
Other languages
English (en)
Inventor
Masayuki Ogasawara
小笠原 正幸
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP57145525A priority Critical patent/JPS5936428A/ja
Publication of JPS5936428A publication Critical patent/JPS5936428A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00Automatic control of frequency or phase; Synchronisation
    • H03L7/06Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08Details of the phase-locked loop
    • H03L7/099Details of the phase-locked loop concerning mainly the controlled oscillator of the loop
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00Automatic control of frequency or phase; Synchronisation
    • H03L7/06Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08Details of the phase-locked loop
    • H03L7/10Details of the phase-locked loop for assuring initial synchronisation or for broadening the capture range

Landscapes

  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、広い入力周波数範囲の同期引込みが可能な位
相同期装置に関する。
従来、この種の位相同期装置としては、第1図のブロッ
ク図に見られるように2位相比較器1とループフィルタ
2と電圧制御発振器3とによって構成されたものが用い
られている。位相比較器1は、入力信号f・の周波数お
よび位相と電圧制御発振器3の発振周波数および位相上
を比較し、誤差電圧を出力する。との誤差電圧は、不要
成分を除去し、系の応答特性を決定するルーフ0フイル
タ2を通って電圧制御発振器3の制御端子に加えられる
。これによって、入力信号f1と電圧制御発振器;3の
出力信号f。との位相差を低減する方向に電圧制御発掘
器30周波数が制御され、遂には電圧制御発振器は位相
同期状態に置かれる。このような動作を同期引込作用と
言い、この同期引込みの可能な入力信号周波数の範囲を
同期引込周波数範囲と言う。
しかし乍ら、上記のように構成された位相同期装置にお
いては、広い同期引込周波数範囲を得ようとしても、電
圧制御発振器の制御電圧対周波数特性の感度が低く、か
つ、線形の周波数範囲が狭く、実現不能であったり、経
済的に高価になるという欠点があった。
本発明の目的は、上記の欠点を除去し、広い同期引込周
波数帯囲で入力信号に位相同期した出力信号を得ること
のできる高性能、かつ経済的な位相同期装置を提供する
にある。
本発明によれば、それぞれ発振周波数帯を異ならせた複
数の電圧制御発振器と、これ等複数の電圧制御発振器の
それぞれの出力を受けて、これ等り適応する1つを選択
する手段と、該選択手段で選択された出力信号と入力信
号との位相差を検出する位相比較器と、該位相比較器の
出力をうけ。
前記複数の電圧制御発振器のうちの適応する1つを制御
するループフィルタと、前記選択手段により選択された
出力信号と入力信号とをうけて該出力信号の位相同期状
態を検出する同期検出器と。
該同期検出器の出力に応答して前記選択手段の選択を切
換え制御する手段とからなる位相同期装置が得られる。
次に2本発明による位相同期装置について実施例を挙げ
1図面を参照して説明する。
第2図は1本発明による第1の実施例の構成をブロック
図により示したものである。この位相同期装置は2位相
比較器11.ループフィルタ12゜電圧制御発振器13
−1〜13−n 、電圧制御発振器選択回路14.π/
2位相推移器】5.同期検出器I6および選択回路制御
器17により構成されている。このうち2位相比較器1
1およびループフィルタ12は第1図における位相比較
器1およびループフィルタ2とそれぞれ同じ機能を有す
る。
電圧制御発振器13−1〜13−nは、それぞれ同期引
込周波数帯が異なり、かつそれぞれの帯域が縦続的に引
継がれるように設定されたn個の電圧制御発振器であり
、それぞれの電圧制御端子はループフィルター2の出力
側に並列に接続されている。
電圧制御発振器選択回路14は、入力側に電圧制御発振
器13−1〜13−nのそれぞれの出力をうけ。
発振器に対応して接続された制御線11〜lnを介して
与えられた信号により電圧制御発振器13−114で選
択された電圧制御発振器の出力信号f。と入力信号f、
とは位相比較器IIで位相比較され。
両者の位相差に応じた電圧が出力側にイ与られる。
この電圧は、ループフィルター2により不要な高調波成
分および雑音が除去されたのち、電圧制御発振器13−
1〜13−nの発振周波数を制御することによって位相
同期用帰還ループが形成される。
更に、上記選択された出力信号f。は、π7々位相推移
器15を通して入力信号f1とともに位相比較機能を備
えた同期検出器16に加えられる。ここで、入力信号f
。と選択された電圧制御発振器の出力信号f。とが位相
同期している場合には、同期検出器16の2つの入力は
90度の位相角をもち。
したがって最大振幅の電圧が出力側に現われて選択回路
制御器17に加えられる。選択回路制御器17は、予め
設定された閾値を超えて大きい電圧が与えられると、制
御線11〜lnのうち、引込状態にある電圧制御発振器
を選択している制御線の信号を伺勢された状態のまま保
持する。これによって、電圧制御発振器選択回路14は
同期引込作用にある電圧制御発振器を選択した状態に置
かれる。
次に、入力信号f1と選択された電圧制御発振器の出力
信号f。とが位相同期していない場合には。
同期検出器16から2つ入力の差周波数により発生する
ビート(マたは・ぐルス)、すなわち非同期状態を表わ
す振幅の小さい信号が得られる。選択回路制御器17は
このビート信号を受けるが、入力側に設定された閾値よ
り低いことを検出すると。
位相同期ルーツ0の同期確立に要する時間だけ間をとっ
て次の制御線に信号の付勢を移し、これに対応する電圧
制御発振器の出力を選択する。それによって、隣接する
発振周波数帯での同期引込動作が試みられる。なお2選
択回路制御器17には。
上記のごとき入力信号の小さいときに動作する制御’l
l線11〜lnへの信号印加切換回路が内蔵きれており
、切換の順序は電圧制御発振器13−1−13−nの有
する発振周波数帯を周波数の低い方から高い方(あるい
は、その逆方向)へ順次引継いて選択できるように設定
されている。このようにして。
順次選択された発振周波数帯における同期引込動作が試
みられ、入力周波数が含まれる発振周波数イ1Fの電圧
制餌1発振器を選択した吉きに同期引込みが達成される
第3図は1本発明による第2の実施例の構成をブロック
図により示したものである。なお、この図において、第
2図に見られる符号と同じ符号で示された要素はそれぞ
れ同じ機能を有するものと理解されたい。新たに付加さ
れている周波数弁別器18は位相比較器IIの出力と同
期検出器16の出力とを受け1周波数の変化量を電圧値
で、また周波数変化の方向を電圧の極性により検出する
この検出された出力は選択回路制御器17′に制御入力
として与えられ2位相同期がとれていない場合に、この
制御入力の極性にしたがって隣接する好寸しい方向の発
振周波数帯をもつ電圧制御発振器を選択するべく、対応
する制御線に信号を(=J勢しかえる。これによって、
同期引込みか第1の実施例に比べてより短時間で達成さ
れる。
以上の説明により明らかなように1本発明によれば、そ
れぞれ発振周波数帯を異ならせた複数の電圧制御発振器
をルーフ0フイルタのあとに並列に接続し、入力信号の
周波数に適合する電圧制御発振器を選択的に位相比較器
に接続するよう制御することによって、広い入力周波数
の範囲で同期引込みが可能になり、経済性および利用価
値が高められる点において得られる効果は大きい。
【図面の簡単な説明】
第1図は従来の位相同期装置の構成例を示すプロ、り図
、第2図は本発明による第1の実施例の構成を示すプロ
、り図、第3図は本発明による第2の実施例の構成を示
すプロ、り図である。 図において、1は位相比較器、12はルーフフィルタ、
+3−1〜13−nは電圧制御発振器、14は電圧制御
発振器選択回路、15はπ/2位相推移器、16は同期
検出器、17.17’は選択回路制御器、18は周波数
弁別器である。 第1図 弗2図

Claims (1)

  1. 【特許請求の範囲】 1 それぞれ発振周波数帯を異ならせた複数の器の出力
    のうちから切換え制御により適応する1つを選択する手
    段と、該選択手段で選択された出力信号と入力信号との
    位相差を検出する位相比較器と、該位相比較器の出力を
    うけ、前記複数の電圧制躬1発振器のうちの適応する1
    つを制御するループフィルタと、前記選択手段により選
    択された出力信号と入力信号とをうけて該出力信号の位
    相同期状態を検出する同期検出器と、該同期検出器の出
    力に応答して前記選択手段の選択を切換え制御する手段
    とからなる位相同期装置。 2、特許請求の範囲第1項に記載の位相同期装置におい
    て、前記位相比較器の出力と前記同期検出器の出力とを
    うけて、前記選択手段により選択された出力周波数の入
    力周波数に対する偏移方向および変化量を検出する周波
    数弁別手段を付加し。 該周波数弁別手段の出力により前記選択切換制御手段の
    動作を制御することを特徴とする位相同期装置。
JP57145525A 1982-08-24 1982-08-24 位相同期装置 Pending JPS5936428A (ja)

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JP57145525A JPS5936428A (ja) 1982-08-24 1982-08-24 位相同期装置

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JP57145525A JPS5936428A (ja) 1982-08-24 1982-08-24 位相同期装置

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JPS5936428A true JPS5936428A (ja) 1984-02-28

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ID=15387230

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JP57145525A Pending JPS5936428A (ja) 1982-08-24 1982-08-24 位相同期装置

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63123226A (ja) * 1986-11-12 1988-05-27 Sony Corp Pll回路
JPS63133739U (ja) * 1987-02-24 1988-09-01
JPH01183688A (ja) * 1988-01-18 1989-07-21 Hitachi Ltd 表示システム

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63123226A (ja) * 1986-11-12 1988-05-27 Sony Corp Pll回路
JPS63133739U (ja) * 1987-02-24 1988-09-01
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