JPS59211120A - インタフエ−ス変換方式 - Google Patents
インタフエ−ス変換方式Info
- Publication number
- JPS59211120A JPS59211120A JP58085312A JP8531283A JPS59211120A JP S59211120 A JPS59211120 A JP S59211120A JP 58085312 A JP58085312 A JP 58085312A JP 8531283 A JP8531283 A JP 8531283A JP S59211120 A JPS59211120 A JP S59211120A
- Authority
- JP
- Japan
- Prior art keywords
- interface
- channel
- input
- sequence
- driver
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ）発明の技術分野
本発明は異なるインタフェースを持つ上位装置と下位装
置との間に於いて、夫々のインタフェースに適合するよ
うにインタフェースを変換するインタフェース変換装置
に係り、特に下位装置の障害によるインタフェース上の
シーケンスの誤りを検出し、該誤り検出により下位装置
からの信号の送出を阻止するインタフェース変換方式に
関する。
置との間に於いて、夫々のインタフェースに適合するよ
うにインタフェースを変換するインタフェース変換装置
に係り、特に下位装置の障害によるインタフェース上の
シーケンスの誤りを検出し、該誤り検出により下位装置
からの信号の送出を阻止するインタフェース変換方式に
関する。
（ｂ）従来技術と問題点
計算機システムのチャネルに接続されて動作する入出力
制御装置の中にはインタフェースの仕様が前記チャネル
に接続して動作する為の仕様と異なり、該チャネルに直
接接続することが出来ない装置がある。この場合インタ
フェース変換装置を設けることにより、接続するが、該
インタフェース変換装置はインタフェースの仕様の相違
点を吸収する機能のみ付与されている為、異常なシーケ
ンスであっても変換して送出することとなり、前記入出
力制御装置が障害を発生して異常なシーケンスの信号を
チャネルに送出した時、該チャネルに所謂いもづる式に
接続されている他の入出力制御装置迄停止させてしまう
欠点がある。
制御装置の中にはインタフェースの仕様が前記チャネル
に接続して動作する為の仕様と異なり、該チャネルに直
接接続することが出来ない装置がある。この場合インタ
フェース変換装置を設けることにより、接続するが、該
インタフェース変換装置はインタフェースの仕様の相違
点を吸収する機能のみ付与されている為、異常なシーケ
ンスであっても変換して送出することとなり、前記入出
力制御装置が障害を発生して異常なシーケンスの信号を
チャネルに送出した時、該チャネルに所謂いもづる式に
接続されている他の入出力制御装置迄停止させてしまう
欠点がある。
（Ｃ）発明の目的
本発明の目的は上記欠点を除（為、折角シーケンス変換
機能を持つインタフェース変換装置であるから、異常な
シーケンスをチェックする機能を持たせることにより、
異常シーケンスの信号を上位装置であるチャネルに送出
することを■止し、正常な入出力制御装置をも停止させ
ることを防止するインタフェース変換方式を提供するこ
とにある。
機能を持つインタフェース変換装置であるから、異常な
シーケンスをチェックする機能を持たせることにより、
異常シーケンスの信号を上位装置であるチャネルに送出
することを■止し、正常な入出力制御装置をも停止させ
ることを防止するインタフェース変換方式を提供するこ
とにある。
（ｄ）発明の構成
本発明の構成は異なるインタフェースを持つ上位装置と
下位装置との間にあって、夫々のインタフェースに適合
するようにインタフェースを変換するインタフェース変
換装置に於いて、インタフェース上の異常シーケンスを
検出する手段を設けたものである。
下位装置との間にあって、夫々のインタフェースに適合
するようにインタフェースを変換するインタフェース変
換装置に於いて、インタフェース上の異常シーケンスを
検出する手段を設けたものである。
（ｅ）発明の実施例
図は本発明の一実施例を示す回路のブロック図である。
チャネル１はインタフェース変換装置２を経て入出力制
御装置３を制御する。又所謂いもする式に接続された入
出力制御装置４も制御する。
御装置３を制御する。又所謂いもする式に接続された入
出力制御装置４も制御する。
入出力制御装置３はインタフェースの仕様が入出力制御
装置４と異なり、インタフェース変換装置２により前記
インタフェース仕様の相違点が吸収される。インタフェ
ース変換装置２はチャネル１に対するインタフェースに
ドライバ／レシーバ５と入出力制御装置３に対するイン
タフェースにドライバ／レシーバ７とを持ち、信号の授
受を行う。
装置４と異なり、インタフェース変換装置２により前記
インタフェース仕様の相違点が吸収される。インタフェ
ース変換装置２はチャネル１に対するインタフェースに
ドライバ／レシーバ５と入出力制御装置３に対するイン
タフェースにドライバ／レシーバ７とを持ち、信号の授
受を行う。
チャネル１からの信号はインタフェース変換部６でシー
ケンスの変換が行われ、入出力制御装置３へ、入出力制
御装置３からの信号は同様にインタフェース変換部６で
変換されチャネル１へ送出される。インタフェースチェ
ック回路８はドライバ／レシーバ７より入出力制御装置
３からの信号を取込んで常に監視し、該信号のシーケン
スに異常があり、他の入出力制御装置４に影響する場合
、ドライバ／レシーバ５の動作を停止させ前記異常信号
がチャネル１に送出されることを阻止する。
ケンスの変換が行われ、入出力制御装置３へ、入出力制
御装置３からの信号は同様にインタフェース変換部６で
変換されチャネル１へ送出される。インタフェースチェ
ック回路８はドライバ／レシーバ７より入出力制御装置
３からの信号を取込んで常に監視し、該信号のシーケン
スに異常があり、他の入出力制御装置４に影響する場合
、ドライバ／レシーバ５の動作を停止させ前記異常信号
がチャネル１に送出されることを阻止する。
この場合チャネル１と入出力制御装置３との間で、ある
シーケンスが実行されている時にドライバ／レシーバ５
が動作を停止すると、チャネル１に対する信号が全く帰
らなくなり、これによりチャネル１はインタフェース・
チェック又はデバイス・エンド・タイムアウトを検出し
、シーケンスの内容によりリトライを行って来る。この
時再びデバイス・エンド・タイムアウトが発生しないよ
うにする為、チャネル１より送られる選択線をドライバ
／レシーバ５の前で入出力制御装置４にバイバスする。
シーケンスが実行されている時にドライバ／レシーバ５
が動作を停止すると、チャネル１に対する信号が全く帰
らなくなり、これによりチャネル１はインタフェース・
チェック又はデバイス・エンド・タイムアウトを検出し
、シーケンスの内容によりリトライを行って来る。この
時再びデバイス・エンド・タイムアウトが発生しないよ
うにする為、チャネル１より送られる選択線をドライバ
／レシーバ５の前で入出力制御装置４にバイバスする。
（ｆ）発明の詳細
な説明した如く、本発明はインタフェース変換装置にシ
ーケンスの異常を検出する機能を追加することでインタ
フェースの相違点を吸収するのみでなく、異常シーケン
スを上位装置に送出することを阻止する為、正常な入出
力制御装置の動作を妨害することを防止することが出来
る。
ーケンスの異常を検出する機能を追加することでインタ
フェースの相違点を吸収するのみでなく、異常シーケン
スを上位装置に送出することを阻止する為、正常な入出
力制御装置の動作を妨害することを防止することが出来
る。
図は本発明の一実施例を示す回路のブロック図である。
１はチャネル、２はインタフェース変換装置、３．４は
入出力制御装置、５．７はドライバ／レシーバ、６はイ
ンタフェース変換部、８はインタフェースチェック回路
である。
入出力制御装置、５．７はドライバ／レシーバ、６はイ
ンタフェース変換部、８はインタフェースチェック回路
である。
Claims (1)
- 異なるインタフェースを持つ上位装置と下位装置との間
にあって、夫々のインタフェースに適合するようにイン
タフェースを変換するインタフェース変換装置に於いて
、インタフェース上の異常シーケンスを検出する手段を
設けたことを特徴とするインタフェース変換方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58085312A JPS59211120A (ja) | 1983-05-16 | 1983-05-16 | インタフエ−ス変換方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58085312A JPS59211120A (ja) | 1983-05-16 | 1983-05-16 | インタフエ−ス変換方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59211120A true JPS59211120A (ja) | 1984-11-29 |
Family
ID=13855084
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58085312A Pending JPS59211120A (ja) | 1983-05-16 | 1983-05-16 | インタフエ−ス変換方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59211120A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04264906A (ja) * | 1991-02-20 | 1992-09-21 | Nec Ibaraki Ltd | インタフェース制御回路 |
| CN100460876C (zh) * | 2006-05-30 | 2009-02-11 | 威盛电子股份有限公司 | 测试系统及其数据接口转换装置 |
| JP2013251875A (ja) * | 2012-06-04 | 2013-12-12 | Olympus Medical Systems Corp | 制御信号変換装置、コントローラ、被制御機器、機器制御システム、及び状態検出方法 |
-
1983
- 1983-05-16 JP JP58085312A patent/JPS59211120A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04264906A (ja) * | 1991-02-20 | 1992-09-21 | Nec Ibaraki Ltd | インタフェース制御回路 |
| CN100460876C (zh) * | 2006-05-30 | 2009-02-11 | 威盛电子股份有限公司 | 测试系统及其数据接口转换装置 |
| JP2013251875A (ja) * | 2012-06-04 | 2013-12-12 | Olympus Medical Systems Corp | 制御信号変換装置、コントローラ、被制御機器、機器制御システム、及び状態検出方法 |
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