JPS59201478A - ジヨセフソン素子集積回路の製造方法 - Google Patents
ジヨセフソン素子集積回路の製造方法Info
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- JPS59201478A JPS59201478A JP58076618A JP7661883A JPS59201478A JP S59201478 A JPS59201478 A JP S59201478A JP 58076618 A JP58076618 A JP 58076618A JP 7661883 A JP7661883 A JP 7661883A JP S59201478 A JPS59201478 A JP S59201478A
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- Japan
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- superconducting conductor
- conductor
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- 239000004020 conductor Substances 0.000 claims abstract description 50
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- 239000000758 substrate Substances 0.000 claims abstract description 7
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- 239000002887 superconductor Substances 0.000 abstract description 3
- 238000009413 insulation Methods 0.000 abstract 1
- 230000001590 oxidative effect Effects 0.000 description 4
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- Superconductor Devices And Manufacturing Methods Thereof (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明に、ジョセフソン素子集積回路の製造方法に関
するものでりる。
するものでりる。
従来のジョセフソン素子集積回路を第1図に示す。図に
おいて、111はたとえばSiエクなる基板、+21に
たとえばNbよVなる下部超電導導体、(3)は薄い絶
縁膜で、たとえば、下部超電導導体(2)の一部を酸化
して得た酸化膜でるる。+41rlcたとえばPb又は
Nb工りなる上部超電導導体、+51に絶縁体で、下部
超電導導体(2)と上部超電導導体(3)を酸化して得
られたもの、(6)に電極導体、(7)にスルーホール
である。
おいて、111はたとえばSiエクなる基板、+21に
たとえばNbよVなる下部超電導導体、(3)は薄い絶
縁膜で、たとえば、下部超電導導体(2)の一部を酸化
して得た酸化膜でるる。+41rlcたとえばPb又は
Nb工りなる上部超電導導体、+51に絶縁体で、下部
超電導導体(2)と上部超電導導体(3)を酸化して得
られたもの、(6)に電極導体、(7)にスルーホール
である。
次に第1図に示す一ジョセフノン素子集積回路の製造方
法について説明する。第2図に示すように、基板tll
上に下部超電導導体(2)全積層し、この下部超電導導
体(2)の表面全酸化して薄い絶縁膜(3)全形成し、
さらに絶縁膜(3)の上に上部超電導導体141全積層
する・この仮、たとえば写真!#版投技術用いる1il
!−により、上部超電導導体14+と下部超電導導体(
2)の一部を酸化して第3図に示す絶縁体+51を得る
。
法について説明する。第2図に示すように、基板tll
上に下部超電導導体(2)全積層し、この下部超電導導
体(2)の表面全酸化して薄い絶縁膜(3)全形成し、
さらに絶縁膜(3)の上に上部超電導導体141全積層
する・この仮、たとえば写真!#版投技術用いる1il
!−により、上部超電導導体14+と下部超電導導体(
2)の一部を酸化して第3図に示す絶縁体+51を得る
。
吾らに第4図に示す工うに上部層′亀導導坏(4)の、
一部全酸化して、絶縁体(5)を形成する。次に、第5
図に示すように下部超電導導体+2+上の絶縁体(51
の−Sにスルーホール(7)をあけた後、下部超電導導
体+21及び上部超電導導体(4)にそれぞれ電極導体
(61全形成し、第6図に示すジョセフソン素子集積回
路を得る。
一部全酸化して、絶縁体(5)を形成する。次に、第5
図に示すように下部超電導導体+2+上の絶縁体(51
の−Sにスルーホール(7)をあけた後、下部超電導導
体+21及び上部超電導導体(4)にそれぞれ電極導体
(61全形成し、第6図に示すジョセフソン素子集積回
路を得る。
従来のジョセフソン素子集積回路の製造方法に以上のよ
うな工程を施すため、スルーホール(7)全形成する必
要がるり、多くの工程全必要とするという欠点がろった
0 この発明は上記のよ′)な従来のものの欠点を除去する
ためになされたもので、基板上に下部超電導導体を積層
する工程、この下部超電導導体上に絶縁膜を介在させて
上部超電導導体を積層する工程、下部fPfi電冴導体
が共通となるように絶縁体で上部超電導導体全分離する
工程、分離はれた下部超電導導体にそれぞれ電極導体を
形成する工程を7Mして、スルーホールが不安となり、
製造が簡単なジョセフソン素子集積回路の製造方法全提
供することを目的としている〇 以下、この発明の一実施例を図について説明する。第7
囚に、この発明の製造方法によって得られたジョセフソ
ン素子集積回路を示す。従来と同様に、第3図に示すジ
ョセフソン接合?得た後、下部超電導導体(2)が共通
な状態で、上部超電導導体(41が分離されるLうに絶
縁体(8)を形成する。この絶縁体(8)はたとえば上
部超電導導体141の一部を酸化して形成したものであ
る。この後に、分離された上部超電導導体t41にそれ
ぞれ電極導体(61を形成して、2個のジョセフソン接
合を直列に有するジョセフソン素子集積回路を得ること
ができる。
うな工程を施すため、スルーホール(7)全形成する必
要がるり、多くの工程全必要とするという欠点がろった
0 この発明は上記のよ′)な従来のものの欠点を除去する
ためになされたもので、基板上に下部超電導導体を積層
する工程、この下部超電導導体上に絶縁膜を介在させて
上部超電導導体を積層する工程、下部fPfi電冴導体
が共通となるように絶縁体で上部超電導導体全分離する
工程、分離はれた下部超電導導体にそれぞれ電極導体を
形成する工程を7Mして、スルーホールが不安となり、
製造が簡単なジョセフソン素子集積回路の製造方法全提
供することを目的としている〇 以下、この発明の一実施例を図について説明する。第7
囚に、この発明の製造方法によって得られたジョセフソ
ン素子集積回路を示す。従来と同様に、第3図に示すジ
ョセフソン接合?得た後、下部超電導導体(2)が共通
な状態で、上部超電導導体(41が分離されるLうに絶
縁体(8)を形成する。この絶縁体(8)はたとえば上
部超電導導体141の一部を酸化して形成したものであ
る。この後に、分離された上部超電導導体t41にそれ
ぞれ電極導体(61を形成して、2個のジョセフソン接
合を直列に有するジョセフソン素子集積回路を得ること
ができる。
この発明における集積回路においてぼ、スルーホールT
hiける必要がなく、製造工程が簡単VCなった。
hiける必要がなく、製造工程が簡単VCなった。
なお、上記実施例においてに、絶縁膜(3)又に絶縁体
(5)、及び絶縁体(8)を上、下層電導導体121.
1411jH酸化して得る例を示したが、他の絶縁体又
は絶縁膜をそう人したりして形成しても、同様の効果が
める0 以上のように、この発明に工り、ば、ジョセフソン素子
集積回路を、基板上に下部超電導導体全積層する工程、
この下部超電導導体上に絶縁膜を介在させて上部超電導
導体を積層する工程、下部超電導導体が共通となるよう
に絶縁体で上部超電導導体を分離する工程、分離された
上部超電導導体にそれぞれ電極導体全形厄する工程を施
して製造し、ジョセフソン接合ヲ直列に接続して使用で
きるよりKなっているので、スルーホールをもうける工
程が必要でなくなるため、製造カニ簡単になるという効
果がめる。
(5)、及び絶縁体(8)を上、下層電導導体121.
1411jH酸化して得る例を示したが、他の絶縁体又
は絶縁膜をそう人したりして形成しても、同様の効果が
める0 以上のように、この発明に工り、ば、ジョセフソン素子
集積回路を、基板上に下部超電導導体全積層する工程、
この下部超電導導体上に絶縁膜を介在させて上部超電導
導体を積層する工程、下部超電導導体が共通となるよう
に絶縁体で上部超電導導体を分離する工程、分離された
上部超電導導体にそれぞれ電極導体全形厄する工程を施
して製造し、ジョセフソン接合ヲ直列に接続して使用で
きるよりKなっているので、スルーホールをもうける工
程が必要でなくなるため、製造カニ簡単になるという効
果がめる。
第1図は従来の製造方法によって得られるジョセフソン
素子集積回路を示す断面図、第2図〜第6図に従来のジ
ョセフソン素子集積回路の製造工程を順に示す断面図、
第7図はこの発明の一実施例による製造方法によって得
られるジョセフソン素子集積回路を示す断面図でめる0 図において、il+・基板、(2)・・・下部超′Ik
尋導体、(3)・・・絶縁膜、(4)・・・上部超電導
導体、(6)・・電極導体。 (8)・・・絶縁体を示す0 なシ、図中、同一符号は同−一部に相当部分を示す◎ 代理人 大岩増雄 第1図 第2図 1 第:3図 1
素子集積回路を示す断面図、第2図〜第6図に従来のジ
ョセフソン素子集積回路の製造工程を順に示す断面図、
第7図はこの発明の一実施例による製造方法によって得
られるジョセフソン素子集積回路を示す断面図でめる0 図において、il+・基板、(2)・・・下部超′Ik
尋導体、(3)・・・絶縁膜、(4)・・・上部超電導
導体、(6)・・電極導体。 (8)・・・絶縁体を示す0 なシ、図中、同一符号は同−一部に相当部分を示す◎ 代理人 大岩増雄 第1図 第2図 1 第:3図 1
Claims (1)
- 基板上に下部超電導導体を積層する工程、この下部超電
導導体上に絶縁Mt−介在させて上部超電導導体を積層
する工程、下部超電導導体が共通となるように絶縁体で
上部超電導導体を分離する工程、分離された上部超電導
等体にそれぞれ電極導体を形成する工程を施すジョセフ
ソン素子集積回路の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58076618A JPS59201478A (ja) | 1983-04-28 | 1983-04-28 | ジヨセフソン素子集積回路の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58076618A JPS59201478A (ja) | 1983-04-28 | 1983-04-28 | ジヨセフソン素子集積回路の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS59201478A true JPS59201478A (ja) | 1984-11-15 |
Family
ID=13610334
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58076618A Pending JPS59201478A (ja) | 1983-04-28 | 1983-04-28 | ジヨセフソン素子集積回路の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59201478A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6279684A (ja) * | 1985-10-02 | 1987-04-13 | Agency Of Ind Science & Technol | ジヨセフソン集積回路の製造方法 |
-
1983
- 1983-04-28 JP JP58076618A patent/JPS59201478A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6279684A (ja) * | 1985-10-02 | 1987-04-13 | Agency Of Ind Science & Technol | ジヨセフソン集積回路の製造方法 |
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