JPS60177689A - 超伝導回路装置 - Google Patents

超伝導回路装置

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Publication number
JPS60177689A
JPS60177689A JP59032875A JP3287584A JPS60177689A JP S60177689 A JPS60177689 A JP S60177689A JP 59032875 A JP59032875 A JP 59032875A JP 3287584 A JP3287584 A JP 3287584A JP S60177689 A JPS60177689 A JP S60177689A
Authority
JP
Japan
Prior art keywords
tunnel barrier
insulating layer
superconductor
contact
layer
Prior art date
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Pending
Application number
JP59032875A
Other languages
English (en)
Inventor
Ichiro Ishida
一郎 石田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
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Publication of JPS60177689A publication Critical patent/JPS60177689A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10NELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10N60/00Superconducting devices
    • H10N60/80Constructional details
    • H10N60/81Containers; Mountings
    • H10N60/815Containers; Mountings for Josephson-effect devices

Landscapes

  • Superconductor Devices And Manufacturing Methods Thereof (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は超伝導回路装置に関するものである。
更に特定すれは超伝導トンネル障壁を有する超伝導U略
装W<関するものである。超伝導トンネル障壁を有する
超伝導回路装置として第1図に示す断面構造が考えられ
る。第1図に於いて基板1上(−シて第1の超伝導体2
、第2の超伝導体3及び絶縁層5が設けられ、第1、第
2の超伝導体2.3はトンネル障壁4を介して隣接して
いる。この装置構造ではトンネル障壁の一端が装置表面
に表われているため、この部分からトンネル障壁の化学
的汚染及び物理的損傷が進行し、トンネ1し障壁の歩留
及び信頼性の低下が生じる。
本発明の目的は、上記構造上の欠点を除去せしめた超伝
導回路装置を提供することにある。
本発明によれば所要の基板上に接して、第1の超伝導体
と該第1の超伝導体の側面とトンネル障壁を介して隣接
した第2の超伝導体から成り、該トンネル障壁の両側で
該第1の超伝導体が形成する主表面の該基板からの距離
と該第2の超伝導体が形成する主表面の該基板からの距
離が等しい構造に於いて該トンネル障壁端の全周囲に接
して絶縁層を設けた事を特徴とする超伝導回路装置が得
られる。
以下図面に従って本発明を説明する。第2図に示す如く
所要の基板1上に接して、第1の超伝導体2、第2の超
伝導体3及び絶縁層5が設けられ、第1、第2の超伝導
体2.3はトンネル障壁4を介して隣接し、それ等の周
囲は絶縁層5によって保護されている。更忙トンネル障
壁4の他の一端に接して絶縁層6が設けられている。こ
の絶縁層6を設ける事により、トンネル障壁4の全端部
が保護されトンネル障壁の化学的汚染及び物理的損傷に
よる劣化を低減する事ができる。以上の結果本発明はト
ンネル障壁を用いる縦型超伝導回路装置において、高歩
留及び高信頼性忙適した装置構造を実現することができ
る゛。
次に本発明をより良く理解するために実施例をあげて説
明する。第3図に本発明の好ましい実施例としてジョセ
フソン素子素子回路の構造を示す。
第3図(a) K平面形状を示す。第3図(bl K、
第3図fal内に示したA −a部分の断面図を示す。
例えばシリコン基板11上K例えばNbを用いてグラン
ドブレーンN#12が設けられている。その上に例えば
SiOとN b、0.を用いて絶縁層13が設けられて
いる。上記絶縁層13上に接して例えばNbで第1の超
伝導電極14、第2の超伝導電極15及び例えばNbl
06を用いて絶縁層17がほぼ同じ厚さで設けられてい
る。第1と第2の超伝導電極はトンネル障壁16を介し
て掻方向に配置され、その周囲に接した絶縁層17で包
囲されている。又トンネル障壁16の上部の端に接して
おおうように絶縁#18が設けられている。各−を極の
連結は連結線路19&Cよって行われる。この結果トン
ネル障壁の周囲の端部は全て絶縁層でおおわれる。本実
施例では絶縁層18が絶縁層17の一部をおおうように
もうけられているが、絶縁層18は少なくとも装置主表
面上に表われたトンネル障壁16の一端に接しておおっ
ていればよくその形状は任意であり絶縁層17をおおう
部分がなくてもあるいは絶縁層17の全ての領域をおお
ってもよい。その結果トンネル障壁は周囲の環境から保
護され、トンネル障壁の劣化が低減する。
更に絶縁層18の厚さを超伝導線路19と同じにし、且
つ超伝導線路19が形成される領域以外の領域に絶縁層
18をもうけると、素子連結後の゛装置主表面を平坦化
する事ができ、三次元的に素子を集積するの忙適した装
置構造が得られる。
第4図に本発明の別の好ましい実施例としてジョセフソ
ン素子回路の断面構造を示す。シリコン基板11上K例
えばNbを用いてグランドブレーン層12が設けられて
いる。その上に例えばSiOとN b、 O,を用いて
絶縁層13が設けられている。
上記絶縁層13上に接して例えばNbで第1の超伝導電
極14、第2の超伝導電極15及び例えばN b20.
を用いて絶縁層17が設けられ、第1と第2の超伝導電
極はトンネル障壁16を介して横方向に配置され、その
周囲に接した絶縁層17で包囲されている。第1、第2
の超伝導電極14.’15及び絶縁層17で構成される
主表面上の電極フンタクト以外の部分に絶縁層18が設
けられている。
各素子の連結は連結線路19によって行われる。
この結果トンネル障壁の包囲の端部は全て絶縁層でおお
われる構造のため、トンネル障壁は周囲の環境から保護
され、トンネル障壁の劣化が低減する。
以上実施例について説明したが本発明はトンネル障壁を
介して隣接する超伝導電極を基板上に接して基板に平行
な方向に配置した構造に於いて、トンネル障壁端の全周
囲に接して絶縁層が設けられているところKI#徴があ
り、トンネル障壁の化学的汚染及び物理的損傷を防止し
、トンネル障壁の歩留りおよび信頼性の低下を一防止す
ることができる。
【図面の簡単な説明】
第1図は考えられうる従来の技術を説明するための超伝
導回路装置の構造断面図である。 第2図は本発明の詳細な説明するための超伝導回路装置
の4°i’l造断面図である。 第3図は本発明の一実施例を説明するためのジョセフソ
ン素子回路の構造を示jもので(alは平面図、(bl
は断面図である。 第4図は本発明の別の一実施例を説明するためのジョセ
フソン素子回路の構造断面図である。 図において1は基板、2.14は第1の超伝導体、3.
15は第2の超伝導体、4.16はトンネル障壁、5.
6は絶縁層、11はシリコン基板。 12はグランドプレーン、13.17及び18は絶縁層
、19は連絡線路である。 f(埋入弁理上 内 原 智r゛ (a) (b)

Claims (1)

    【特許請求の範囲】
  1. 所要の基板上に接して、第1の超伝導体と、該第1の超
    伝導体の側面とトンネル障壁を介して隣接した第2の超
    伝導体から成り、該トンネル障壁の両側で該第1の超伝
    導体が形成する主表面の該基板からの距離と該第2の超
    伝導体が形成する主表面の該基板からの距離が等しい構
    造に於〜・て該トンネル障壁端の全周囲に接して絶縁層
    を設けた事を特徴とする超伝導回路装置。
JP59032875A 1984-02-23 1984-02-23 超伝導回路装置 Pending JPS60177689A (ja)

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JP59032875A JPS60177689A (ja) 1984-02-23 1984-02-23 超伝導回路装置

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62104179A (ja) * 1985-10-31 1987-05-14 Agency Of Ind Science & Technol 超伝導回路装置
JPS62172771A (ja) * 1986-01-25 1987-07-29 Agency Of Ind Science & Technol 超伝導回路装置の製造方法
JPS62183575A (ja) * 1986-02-08 1987-08-11 Agency Of Ind Science & Technol 超伝導回路装置

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62104179A (ja) * 1985-10-31 1987-05-14 Agency Of Ind Science & Technol 超伝導回路装置
JPS62172771A (ja) * 1986-01-25 1987-07-29 Agency Of Ind Science & Technol 超伝導回路装置の製造方法
JPH0515075B2 (ja) * 1986-01-25 1993-02-26 Kogyo Gijutsuin
JPS62183575A (ja) * 1986-02-08 1987-08-11 Agency Of Ind Science & Technol 超伝導回路装置

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