JPS5851779A - インバ−タ装置 - Google Patents
インバ−タ装置Info
- Publication number
- JPS5851779A JPS5851779A JP56148543A JP14854381A JPS5851779A JP S5851779 A JPS5851779 A JP S5851779A JP 56148543 A JP56148543 A JP 56148543A JP 14854381 A JP14854381 A JP 14854381A JP S5851779 A JPS5851779 A JP S5851779A
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- JP
- Japan
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- output
- switching elements
- timer
- drive
- current
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- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of ac power input into dc power output; Conversion of dc power input into ac power output
- H02M7/42—Conversion of dc power input into ac power output without possibility of reversal
- H02M7/44—Conversion of dc power input into ac power output without possibility of reversal by static converters
- H02M7/48—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/53—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
- H02M7/537—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only, e.g. single switched pulse inverters
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はインバータ装置、特にスイッチング素子を交互
又は順次駆動するブリッジインバータ装置の制御方式に
関し、その目的とするところぽ負荷変動、電源電圧変動
に対し安定な制御装置を提供するものである。
又は順次駆動するブリッジインバータ装置の制御方式に
関し、その目的とするところぽ負荷変動、電源電圧変動
に対し安定な制御装置を提供するものである。
一般にブリッジインバータ装置はスイッチング素子を複
数個、電源に直列に接続し、その直列接続点から負荷を
接続する。このインバータ装置は電源に直接スイッチン
グ素子を直列接続するため、万一、複数のスイッチング
素子が同時に駆動されると、このスイッチング素子は電
源短絡となり過大な電流が流れ素子は瞬時に破壊される
。すなわち、スイッチング素子に順次与える駆動信号が
スイッチング素子の温度上昇又は負荷の増大により素子
自体のスイッチング時間が長くなるため、一つのスイッ
チング素子のスイッチングが終了しないうちに次のスイ
ッチング素子が駆動され電源短絡状態が発生する危険を
有している。
数個、電源に直列に接続し、その直列接続点から負荷を
接続する。このインバータ装置は電源に直接スイッチン
グ素子を直列接続するため、万一、複数のスイッチング
素子が同時に駆動されると、このスイッチング素子は電
源短絡となり過大な電流が流れ素子は瞬時に破壊される
。すなわち、スイッチング素子に順次与える駆動信号が
スイッチング素子の温度上昇又は負荷の増大により素子
自体のスイッチング時間が長くなるため、一つのスイッ
チング素子のスイッチングが終了しないうちに次のスイ
ッチング素子が駆動され電源短絡状態が発生する危険を
有している。
この点にかんがみ本発明はスイッチング素子が必らずオ
フしてから次のスイッチング素子を駆動しようとするも
ので、具体的手段として、スイッチング素子の駆動電流
の逆バイアス電流の終了点を検知して後、次のスイッチ
ング素子をオンさせるもので、以下本発明を一実施例に
もとづき詳述する。
フしてから次のスイッチング素子を駆動しようとするも
ので、具体的手段として、スイッチング素子の駆動電流
の逆バイアス電流の終了点を検知して後、次のスイッチ
ング素子をオンさせるもので、以下本発明を一実施例に
もとづき詳述する。
第１図は本発明を誘導加熱調理器に応用した一実施例の
構成を示すブロック図、第２図は本発明の詳細な説明す
るための波形図、第３図は本発明第１図の具体構成を示
す電気結線図である。
構成を示すブロック図、第２図は本発明の詳細な説明す
るための波形図、第３図は本発明第１図の具体構成を示
す電気結線図である。
第１図に於いて、１は商用電源、２は整流器、３はフィ
ルタコンデンサ、４及び６は加熱コイル６と共振動作を
する共振コンデンサ、６は加熱コイル、７及び８はスイ
ッチング動作を行うトラン−ジスタで整流器２の出力の
直流電源に直列に接続されている。９及び１０はダイオ
ードでトランジス匁及び８の夫々のコレクタ・エミッタ
間に接続されている。１１は鍋で加熱コイル６の負荷で
ある。１２及び１′３はトランジスタ７及び８のベース
電流を検出する変流器、１４及び１６は波形整形回路で
変流器１２及び１３の出力信号を入力としている。１６
は第１のタイマ回路で、トランジスタ７及び８の休止期
間設定タイマである。１７及び１８は休止時間設定タイ
マ１６の休止時間を設定するコンデンサ及び抵抗である
。１９は第２のタイマ回路で、トランジスタ７、及び８
の駆動時間設定タイマである。２０及び２１は駆動時間
を設定するコンデンサ及び抵抗である。２２は駆動時間
を可変する外部調節端子でこの端子の直流電圧を変える
ことによりトランジスタ７及び８のオン時間を調節する
。２３及び２４は駆動回路で駆動時間設定タイマ１９の
出力を増巾しトランジスタ８及び７のベース端子に与え
るものである。
ルタコンデンサ、４及び６は加熱コイル６と共振動作を
する共振コンデンサ、６は加熱コイル、７及び８はスイ
ッチング動作を行うトラン−ジスタで整流器２の出力の
直流電源に直列に接続されている。９及び１０はダイオ
ードでトランジス匁及び８の夫々のコレクタ・エミッタ
間に接続されている。１１は鍋で加熱コイル６の負荷で
ある。１２及び１′３はトランジスタ７及び８のベース
電流を検出する変流器、１４及び１６は波形整形回路で
変流器１２及び１３の出力信号を入力としている。１６
は第１のタイマ回路で、トランジスタ７及び８の休止期
間設定タイマである。１７及び１８は休止時間設定タイ
マ１６の休止時間を設定するコンデンサ及び抵抗である
。１９は第２のタイマ回路で、トランジスタ７、及び８
の駆動時間設定タイマである。２０及び２１は駆動時間
を設定するコンデンサ及び抵抗である。２２は駆動時間
を可変する外部調節端子でこの端子の直流電圧を変える
ことによりトランジスタ７及び８のオン時間を調節する
。２３及び２４は駆動回路で駆動時間設定タイマ１９の
出力を増巾しトランジスタ８及び７のベース端子に与え
るものである。
次に第２図に於いて、１４．はトランジスタ７及びダイ
オード９の電流波形、１２はトランジスタ８及びダイオ
ード１ｏの電流波形である。ａはトランジスタ７のベー
ス電流を検知した変流器１２の出力波形、ｂはトランジ
スタ８のベース電流を検知した変流器１３の出力波形で
ある□ａ及びｂの波形図中のＶｒｅｆは波形整形のしき
い値である。
オード９の電流波形、１２はトランジスタ８及びダイオ
ード１ｏの電流波形である。ａはトランジスタ７のベー
ス電流を検知した変流器１２の出力波形、ｂはトランジ
スタ８のベース電流を検知した変流器１３の出力波形で
ある□ａ及びｂの波形図中のＶｒｅｆは波形整形のしき
い値である。
Ｃは波形整形回路１４の出力波形、ｄは波形整形回路１
６の出力波形である。ｅ及びｆは休止時間設定タイマ１
６の出力波形で、波形ｅは波形Ｃを入力信号とし、波形
ｆは波形ｄを入力信号としている。ｑ及びｈは駆動時間
設定タイマ１９の出力波形で、波形ｑは波形ｅを入力信
号とし、波形りは波形ｆを入力信号としている。
６の出力波形である。ｅ及びｆは休止時間設定タイマ１
６の出力波形で、波形ｅは波形Ｃを入力信号とし、波形
ｆは波形ｄを入力信号としている。ｑ及びｈは駆動時間
設定タイマ１９の出力波形で、波形ｑは波形ｅを入力信
号とし、波形りは波形ｆを入力信号としている。
以上の構成に於いて動作を説明する。先ず、トランジス
タ７がオンしている状態を想定し動作の説明を行う。第
２図ｔ０点において、ｈ点に信号が発生し、この信号は
駆動回路２４で増幅されトランジスタ７のベースに電流
が流れトランジスタ７はオンする。トランジスタ７のオ
ンによりトランジスタ７にはｉ、波形に示される電流が
流れ始める。そして、駆動時間設定タイマ１９で定まる
環流を与える。トランジスタ７のベース順電流が終了す
るとトランジスタ７のスイッチング速度を早めるために
ベース端子には逆バイアス電圧が与えられベース逆バイ
アス電流が流れ始める（第２図中ｔ１点）。この逆バイ
アス電流が変流器１２で検出されその出力波形が第２図
８に示されている。このベース電流出力波形が負電圧の
しきい値Ｖ ｒ ｅ ｆを越えると、波形整形回路１４
の出力Ｃには第２図に示すような波形が発生する。この
トランジスタ７のベース逆バイアス電流はベースに蓄積
されたキャリア放出が終了すると零になりトランジスタ
はオフする（第２図ｔ２点）。このキャリア放出時間は
トランジスタの蓄積時間と呼ばれ第２図中にｔｌで示し
である。
タ７がオンしている状態を想定し動作の説明を行う。第
２図ｔ０点において、ｈ点に信号が発生し、この信号は
駆動回路２４で増幅されトランジスタ７のベースに電流
が流れトランジスタ７はオンする。トランジスタ７のオ
ンによりトランジスタ７にはｉ、波形に示される電流が
流れ始める。そして、駆動時間設定タイマ１９で定まる
環流を与える。トランジスタ７のベース順電流が終了す
るとトランジスタ７のスイッチング速度を早めるために
ベース端子には逆バイアス電圧が与えられベース逆バイ
アス電流が流れ始める（第２図中ｔ１点）。この逆バイ
アス電流が変流器１２で検出されその出力波形が第２図
８に示されている。このベース電流出力波形が負電圧の
しきい値Ｖ ｒ ｅ ｆを越えると、波形整形回路１４
の出力Ｃには第２図に示すような波形が発生する。この
トランジスタ７のベース逆バイアス電流はベースに蓄積
されたキャリア放出が終了すると零になりトランジスタ
はオフする（第２図ｔ２点）。このキャリア放出時間は
トランジスタの蓄積時間と呼ばれ第２図中にｔｌで示し
である。
波形整形回路１４の出力Ｃが終了した時小ｔ２より休止
時間設定タイマ１６は作動を開始し、出力ｅには第２図
に示すような出力波形が発生する。
時間設定タイマ１６は作動を開始し、出力ｅには第２図
に示すような出力波形が発生する。
この出力ｅの設定時間ｔａは次にオンさせるトラ、ンジ
スタ８のベース順電流の駆動信号ｑを遅延さぜている。
スタ８のベース順電流の駆動信号ｑを遅延さぜている。
このｔａ期間は、トランジスタ７がオフし、共振電流が
ダイオード１ｏに流れている期間（第２図１２参照）以
下に設定され、トランジスタ７及び８の双方がオフする
よう設けられている。そして、この出力ｅが終了すると
（第２図ｔ３点）、この出力ｅの立下り信号により駆動
時間設定タイマ１９は作動開始し、出力ｑには第２図に
示すよう出力が発生する。この出力ｑは駆動回路２３に
より増幅されトランジスタ８にベース順電流を供給しト
ランジスタ８はオンする。そして駆動時間設定タイマ１
９で定まる一定時間（第２図ｔｂで示す）ベース順電流
を与えた後、トランジスタ８のベース端子には逆バイア
ス電圧が与えられベース逆バイアス電流が流れ始める（
第２図ｔ４点）。以下、同様の動作を繰り返し、インバ
ータは発振を持続する。
ダイオード１ｏに流れている期間（第２図１２参照）以
下に設定され、トランジスタ７及び８の双方がオフする
よう設けられている。そして、この出力ｅが終了すると
（第２図ｔ３点）、この出力ｅの立下り信号により駆動
時間設定タイマ１９は作動開始し、出力ｑには第２図に
示すよう出力が発生する。この出力ｑは駆動回路２３に
より増幅されトランジスタ８にベース順電流を供給しト
ランジスタ８はオンする。そして駆動時間設定タイマ１
９で定まる一定時間（第２図ｔｂで示す）ベース順電流
を与えた後、トランジスタ８のベース端子には逆バイア
ス電圧が与えられベース逆バイアス電流が流れ始める（
第２図ｔ４点）。以下、同様の動作を繰り返し、インバ
ータは発振を持続する。
次に第３図の構成、動作について説明する。第３図にお
いて第１図、第２図と同一機能のものについては同一番
号を附与しである。第３図においで、２５．２７は変流
器１２及び、１３の負荷抵抗２６．２８，３４，３５．
４３及び４４は電圧比較器、２９及び４０はオア回路、
３１，４２．５３及び６８はトランジスタ、３０，３２
，３２゜４１．４９，５４．５１及び６６は抵抗器、３
６゜３７．４５及び４６はアンド回路、３８及び４７は
ノット回路、３９及び４８はＲ／Ｓフリップフロップ、
６０及び６６はパルストランス、６２及び６７はコンデ
ンサである。
いて第１図、第２図と同一機能のものについては同一番
号を附与しである。第３図においで、２５．２７は変流
器１２及び、１３の負荷抵抗２６．２８，３４，３５．
４３及び４４は電圧比較器、２９及び４０はオア回路、
３１，４２．５３及び６８はトランジスタ、３０，３２
，３２゜４１．４９，５４．５１及び６６は抵抗器、３
６゜３７．４５及び４６はアンド回路、３８及び４７は
ノット回路、３９及び４８はＲ／Ｓフリップフロップ、
６０及び６６はパルストランス、６２及び６７はコンデ
ンサである。
以上の構成において各ブロックの動作を簡単に説明する
。波形整形回路１４及び１５の動作は周知の回路である
ので省略する。休止時間設定タイマ１６及び、駆動時間
設定タイマ１９の回路構成は同一であるので、休止時間
設定タイマ１６の動作のみを説明する。休止時間設定タ
イマ１６の入力端子Ｃ又はｄに正論理のパルス信号が与
えられると、オア回路２９の出力には同一レベルで出力
パルス信号が発生し、トランジスタ３１がオンし、コン
デンサ１７は瞬時に電源電圧迄充電される。
。波形整形回路１４及び１５の動作は周知の回路である
ので省略する。休止時間設定タイマ１６及び、駆動時間
設定タイマ１９の回路構成は同一であるので、休止時間
設定タイマ１６の動作のみを説明する。休止時間設定タ
イマ１６の入力端子Ｃ又はｄに正論理のパルス信号が与
えられると、オア回路２９の出力には同一レベルで出力
パルス信号が発生し、トランジスタ３１がオンし、コン
デンサ１７は瞬時に電源電圧迄充電される。
このとき、電圧比較器３４．３５の非反転入力には抵抗
３２．３３で定まる基準電圧が与えられており（駆動時
間設定タイマ１９の場合には端子２２に外部基準電圧を
与える）、電圧比較器３４及び３６の夫々の出力はＨレ
ベル（電源電圧＋ｖｃｃレベル）である。一方、オア回
路２９の出力パルス信号はノット回路３８で論理反転さ
れ、オア回路２９の出力パルス信号が発生しているとき
、ノット回路３８の出力はＬレベル（ＧＮＤレベル）に
なり、この出力に接続されているアンド回路３６．３７
を禁止している。従ってこの時意志は出力ｅ及びｆには
出力は発生しない。又、一方、入力端子Ｃ及びｄはＲ／
Ｓフリップフロップ３９のセント端子、リセット端子に
接続されており、Ｃ端子にパルス信号が発生するとＲ／
Ｓフリップ７０ツブ３９の出力ＱはＨレベル、ＱＦｉＬ
レベルになり、アンド回路３６を開放状態、３７を禁止
状態にしている。
３２．３３で定まる基準電圧が与えられており（駆動時
間設定タイマ１９の場合には端子２２に外部基準電圧を
与える）、電圧比較器３４及び３６の夫々の出力はＨレ
ベル（電源電圧＋ｖｃｃレベル）である。一方、オア回
路２９の出力パルス信号はノット回路３８で論理反転さ
れ、オア回路２９の出力パルス信号が発生しているとき
、ノット回路３８の出力はＬレベル（ＧＮＤレベル）に
なり、この出力に接続されているアンド回路３６．３７
を禁止している。従ってこの時意志は出力ｅ及びｆには
出力は発生しない。又、一方、入力端子Ｃ及びｄはＲ／
Ｓフリップフロップ３９のセント端子、リセット端子に
接続されており、Ｃ端子にパルス信号が発生するとＲ／
Ｓフリップ７０ツブ３９の出力ＱはＨレベル、ＱＦｉＬ
レベルになり、アンド回路３６を開放状態、３７を禁止
状態にしている。
ここでオア回路２９．０出力パルス信号がなくなる（Ｌ
レベル）とトランジスタ３１がオフし、コンデンサ１７
に充電さ九た電荷は抵抗１８を通じ載電を開始する。こ
のときノット回路３８の出力はＬレベルからＨレベルに
なり、電圧比較器３４の出力、（Ｈレベル）はアンド回
路３６を通じ出力端子・に発生する。そしてコンデンサ
１７の電荷が放電し抵抗３２．３３で定まる基準電圧よ
り高くなると電圧比較器３４の出力は反転し、出力端子
ｅの出力はＬレベルになる。このコンデンサ１７の放電
時間で定まる出力端子ｅの出力時間幅が休止時間である
。（一方、駆動時間設定タイマ１９の場合は端子２２０
基準電圧で定まる出力端子ｑ又はｈの出力パルス幅はト
ランジスタ７又は８の駆動時間である）次に、入力端子
ｄにノくルス信号が入力されるとＲ／Ｓフリップフロッ
プ３９は反転し、アンド回路３６が禁止状態に、３７が
開放状態になり出力端子受に休止時間を与える出力パル
スが発生するものである。
レベル）とトランジスタ３１がオフし、コンデンサ１７
に充電さ九た電荷は抵抗１８を通じ載電を開始する。こ
のときノット回路３８の出力はＬレベルからＨレベルに
なり、電圧比較器３４の出力、（Ｈレベル）はアンド回
路３６を通じ出力端子・に発生する。そしてコンデンサ
１７の電荷が放電し抵抗３２．３３で定まる基準電圧よ
り高くなると電圧比較器３４の出力は反転し、出力端子
ｅの出力はＬレベルになる。このコンデンサ１７の放電
時間で定まる出力端子ｅの出力時間幅が休止時間である
。（一方、駆動時間設定タイマ１９の場合は端子２２０
基準電圧で定まる出力端子ｑ又はｈの出力パルス幅はト
ランジスタ７又は８の駆動時間である）次に、入力端子
ｄにノくルス信号が入力されるとＲ／Ｓフリップフロッ
プ３９は反転し、アンド回路３６が禁止状態に、３７が
開放状態になり出力端子受に休止時間を与える出力パル
スが発生するものである。
次に駆動回路２３及び２４はパルストランスω又は６６
によるベース順電流、逆バイアス駆動方式の一例ケ示し
ている。駆動回路２３の動作を述べる。入力端子ｑに入
力パルス信号が与えられるとトランジスタ５３がオンし
パルストランス６０を駆動し２次巻線に接続されたトラ
ンジスタ８−にベース順バイアス電流を与えると同時に
コンデンサ５２を充電する。そして、入力信号ｑがなく
なるとトランジスタ５３はオフし、パルストランス６ｏ
の２次巻線に誘起された逆起電力とコンデンサ６２の充
電電圧によりトランジスタ８のベース・エミッタに逆バ
イアス電圧が印加されベース逆バイアス電圧が流れるも
のである。駆動回路２４は駆動回路２３と同一動作であ
る。以上が本発明の構成及び動作である。
によるベース順電流、逆バイアス駆動方式の一例ケ示し
ている。駆動回路２３の動作を述べる。入力端子ｑに入
力パルス信号が与えられるとトランジスタ５３がオンし
パルストランス６０を駆動し２次巻線に接続されたトラ
ンジスタ８−にベース順バイアス電流を与えると同時に
コンデンサ５２を充電する。そして、入力信号ｑがなく
なるとトランジスタ５３はオフし、パルストランス６ｏ
の２次巻線に誘起された逆起電力とコンデンサ６２の充
電電圧によりトランジスタ８のベース・エミッタに逆バ
イアス電圧が印加されベース逆バイアス電圧が流れるも
のである。駆動回路２４は駆動回路２３と同一動作であ
る。以上が本発明の構成及び動作である。
以上述べたように本発明の制御方式によればスイッチン
グ素子の駆動電流の逆バイアス電流の終了時点を検知し
一つのスイッチング素子がオフして、次のスイッチング
素子の駆動電流を与えるため、負荷変動又は電源電圧変
動に対し非常に安定なインバータ装置が提供でき不もの
である。更に、本発明の制御方式はインバータ回路から
高電圧信号ｆｒパ５ｔ−夕として入力しないので制御装
置の安全性、動作の安定性に大きく寄与するものである
。加えて、具体的な回路構成においては駆動時間、休止
時間の設定回路は単一のコンデンサで複数のスイッチン
グ素子のタイマ時間を設定するため、ブリッジインバー
タのスイッチング素子群の負荷電流等の使用条形が等し
くなる特徴を有している。
グ素子の駆動電流の逆バイアス電流の終了時点を検知し
一つのスイッチング素子がオフして、次のスイッチング
素子の駆動電流を与えるため、負荷変動又は電源電圧変
動に対し非常に安定なインバータ装置が提供でき不もの
である。更に、本発明の制御方式はインバータ回路から
高電圧信号ｆｒパ５ｔ−夕として入力しないので制御装
置の安全性、動作の安定性に大きく寄与するものである
。加えて、具体的な回路構成においては駆動時間、休止
時間の設定回路は単一のコンデンサで複数のスイッチン
グ素子のタイマ時間を設定するため、ブリッジインバー
タのスイッチング素子群の負荷電流等の使用条形が等し
くなる特徴を有している。
【図面の簡単な説明】
第１図は本発明の一実施例を示すインバータ装置のブロ
ック図、第２図は同装置の動作波形図、第３図は同具体
構成を示す電気結線図である。 １２．１３・・会・・・変流器、１４．１６・・・・・
・波形整形回路、１６・・・−・・第１のタイマ〔休止
時間設定タイマ）、１７・・・・・・第２のタイマ（駆
動時間設定タイマ）。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名＠１
ｖ４ 第 ２ 図
ック図、第２図は同装置の動作波形図、第３図は同具体
構成を示す電気結線図である。 １２．１３・・会・・・変流器、１４．１６・・・・・
・波形整形回路、１６・・・−・・第１のタイマ〔休止
時間設定タイマ）、１７・・・・・・第２のタイマ（駆
動時間設定タイマ）。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名＠１
ｖ４ 第 ２ 図
Claims (2)
- （１）交互又は順次導通する複数のスイッチング素子を
インバータ回路に設け、前記複数のスイッチング素子の
駆動電流を検出する検出手段、この検出手段の出力に接
続された第１のタイマ群、及びこの第１のタイマ群の出
力に接続される第２のタイマ群より成り、前記複数のス
イッチング素子の駆動端子の逆バイアス電流の終焉点よ
り前記第１のタイマ群で定まる一定時間、前記複数のス
イッチング素子を休止させ、前記第２のタイマ群で定ま
る一定時間、前記複数のスイッチング素子を順次導通さ
せるインバータ装置。 - （２）前記第１及び第２のタイマ群は複数の電圧比較器
の入力端子の一端を共通端子とし、単二の時定数決定用
抵抗及びコンデンサを接続し、前記複数の電圧比較器の
他端は共通接続し基準電圧源に接続し、前記複数の電圧
比較器の数に相消する入力端子と出力端子を有し、この
複数の入力端子に接続される出力端子切換手段を有し、
前記複数の入力端子のどの端子の入力信号でも同一出力
時間幅を得る特許請求の範囲第１項記載のインバータ装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56148543A JPS5851779A (ja) | 1981-09-18 | 1981-09-18 | インバ−タ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56148543A JPS5851779A (ja) | 1981-09-18 | 1981-09-18 | インバ−タ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5851779A true JPS5851779A (ja) | 1983-03-26 |
Family
ID=15455116
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56148543A Pending JPS5851779A (ja) | 1981-09-18 | 1981-09-18 | インバ−タ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5851779A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1985001400A1 (en) * | 1983-09-19 | 1985-03-28 | Minitronics Pty. Limited | Minimization of harmonic contents for mains operated solid state inverters driving gas discharge lamps |
| JPS60194763A (ja) * | 1983-11-22 | 1985-10-03 | Touken:Kk | トランジスタインバ−タ装置 |
-
1981
- 1981-09-18 JP JP56148543A patent/JPS5851779A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| JPS60194763A (ja) * | 1983-11-22 | 1985-10-03 | Touken:Kk | トランジスタインバ−タ装置 |
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