JPS58202525A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS58202525A JPS58202525A JP57085937A JP8593782A JPS58202525A JP S58202525 A JPS58202525 A JP S58202525A JP 57085937 A JP57085937 A JP 57085937A JP 8593782 A JP8593782 A JP 8593782A JP S58202525 A JPS58202525 A JP S58202525A
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S438/00—Semiconductor device manufacturing: process
- Y10S438/914—Doping
- Y10S438/923—Diffusion through a layer
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は半導体装置の製造方法に係り、特に配線部分
及び電極部分におけるオーミック接触の改良を考慮した
半導体装置の製造方法に関する。
及び電極部分におけるオーミック接触の改良を考慮した
半導体装置の製造方法に関する。
発明の技術的背景及び問題点
従来より、半導体装置の電極及び配線に耐酸性及び耐熱
性に優れており、また自己整合法を適用し得るため、多
結晶シリコンが多く用いられて来たoしかし、多結晶シ
リコンは比抵抗が高く素子の高速動作には不利であるこ
とが分かってきた。
性に優れており、また自己整合法を適用し得るため、多
結晶シリコンが多く用いられて来たoしかし、多結晶シ
リコンは比抵抗が高く素子の高速動作には不利であるこ
とが分かってきた。
一方、最近、金属硅化物を用いる方法も着目されている
が、金属硅化物では配線等に必要なオーミック接続がで
きない。このため、例えばリンをドーピングしたMoS
i2膜を使用したり、MoSi2膜とSi基板との界面
にイオン注入するなどの方法が採られている。これらの
方法は多結晶シリコンを用いた製造方法と類似しておら
ず既存の設備を利用できなかったり危険性が大きく、ま
たオーミック性が悪いなど欠点がある。
が、金属硅化物では配線等に必要なオーミック接続がで
きない。このため、例えばリンをドーピングしたMoS
i2膜を使用したり、MoSi2膜とSi基板との界面
にイオン注入するなどの方法が採られている。これらの
方法は多結晶シリコンを用いた製造方法と類似しておら
ず既存の設備を利用できなかったり危険性が大きく、ま
たオーミック性が悪いなど欠点がある。
発明の目的
この発明は、以上の様な実情に基づいて成されたもので
あり、金属及び金属硅化物の電極又は配線を有し且つこ
れらの電極又は配線の基板とのオーミック性の良く、信
頼性の島い1だ高速動作の期待できる半導体装置の製造
方法を提供することを目的とする。
あり、金属及び金属硅化物の電極又は配線を有し且つこ
れらの電極又は配線の基板とのオーミック性の良く、信
頼性の島い1だ高速動作の期待できる半導体装置の製造
方法を提供することを目的とする。
発明の概要
この目的を達成するため、この発明によれば、半導体基
板表面に絶縁膜を形成してその絶縁膜上及びその絶縁膜
を除去した部分に金属及び硅素を同時に蒸着させた配線
用及び電極用の膜を形成する工程と、この膜の表面から
前記半導体基板の界面に対して多量の不純物を導入する
工程とを素子の半導体領域を形成する工程に先立って実
行する様にする。
板表面に絶縁膜を形成してその絶縁膜上及びその絶縁膜
を除去した部分に金属及び硅素を同時に蒸着させた配線
用及び電極用の膜を形成する工程と、この膜の表面から
前記半導体基板の界面に対して多量の不純物を導入する
工程とを素子の半導体領域を形成する工程に先立って実
行する様にする。
すなわち、この発明によれば、電極又は配線材料として
金属及び金属硅化物を用い表面からガス拡散又は固体拡
散により、半導体基板との界面て多数に不純物を膜厚に
関係ン<ドープしオーミック性を持たせ、また下地物質
が絶縁物の場合には自己整合的に半導体領域側には不純
物がドープされないようにするものである。
金属及び金属硅化物を用い表面からガス拡散又は固体拡
散により、半導体基板との界面て多数に不純物を膜厚に
関係ン<ドープしオーミック性を持たせ、また下地物質
が絶縁物の場合には自己整合的に半導体領域側には不純
物がドープされないようにするものである。
発明の実施例
以下、添付図面に従ってこの発明の詳細な説明する0以
下に説明する実施例は、nチャネルMO8−F’ETの
製造にこの発明を適用した例を示すものであるが、この
発明はこの実施例に限定されるものではない。
下に説明する実施例は、nチャネルMO8−F’ETの
製造にこの発明を適用した例を示すものであるが、この
発明はこの実施例に限定されるものではない。
先づ、第1図に示す様に、p型のシリコン基板lを熱酸
化し約1000Aのシリコン酸化膜2を形成してバター
ニングする。この後、更に酸化し約10OAのゲート酸
化膜3を形成しく第2図)、壕だ電極部分のパターニン
グラスる。
化し約1000Aのシリコン酸化膜2を形成してバター
ニングする。この後、更に酸化し約10OAのゲート酸
化膜3を形成しく第2図)、壕だ電極部分のパターニン
グラスる。
次に、第3図に示す様に、シリコンStとモリブデンM
oを同時に蒸着し約roooAのMoS i2膜≠を形
成する。ここで、表面からPOCI sの拡散jを/
000 ’Cで13分間行うことにより、MO8I2膜
弘の比抵抗が下がると同時に、シリコン基板/と膜部の
接している部分にだけ自己整合的にリンPがシリコン基
板lにドープされオーミック接触の領域tが形成される
。
oを同時に蒸着し約roooAのMoS i2膜≠を形
成する。ここで、表面からPOCI sの拡散jを/
000 ’Cで13分間行うことにより、MO8I2膜
弘の比抵抗が下がると同時に、シリコン基板/と膜部の
接している部分にだけ自己整合的にリンPがシリコン基
板lにドープされオーミック接触の領域tが形成される
。
この後、バターニング工程を経てざOkeVでヒ素As
のイオン注入を行いソース領域7B及びドレイン領域7
bを形成する。最後に、CVD法による5to2膜rを
形成しパンシベーシ■ン膜とする。
のイオン注入を行いソース領域7B及びドレイン領域7
bを形成する。最後に、CVD法による5to2膜rを
形成しパンシベーシ■ン膜とする。
尚、相互接続配線並びに入出力配線は例えばアルミニウ
ム膜りをもって形成する。
ム膜りをもって形成する。
尚、シリコン酸化膜λは絶縁を目的とするものであるか
ら他の材料を用いてよいのはもちろんのことである。
ら他の材料を用いてよいのはもちろんのことである。
発明の効果
この発明によれば、以上の実施例の様に配線用及び電極
用の膜にMoS 12を用いることにより、多結晶シリ
コンの配線及び電極に比べて比抵抗が小さく従って高速
動作が可能な半導体装置を提供することができる。また
、オーミック接触領域を形成したいシリコン基板部分に
自己整合的に且つ高濃度に不純物をドープすることがで
き、特にこのことにより高密度LSIの製造を可能とす
る。更に、例えばゲート電極部の部分にリンイオンP−
が含まれるため、これが絶縁膜λ等に含まれるゲッタと
なりゲート電極部分における安定性信頼性が得られ望ま
しい。
用の膜にMoS 12を用いることにより、多結晶シリ
コンの配線及び電極に比べて比抵抗が小さく従って高速
動作が可能な半導体装置を提供することができる。また
、オーミック接触領域を形成したいシリコン基板部分に
自己整合的に且つ高濃度に不純物をドープすることがで
き、特にこのことにより高密度LSIの製造を可能とす
る。更に、例えばゲート電極部の部分にリンイオンP−
が含まれるため、これが絶縁膜λ等に含まれるゲッタと
なりゲート電極部分における安定性信頼性が得られ望ま
しい。
第1図乃至第μ図はこの発明の実施例に係る半導体装置
の製造方法を示す工程図であるOl・・・半導体基板、
2,3・・・シリコン酸化膜、弘・・・MoSi2膜、
j・・・拡散ガス、2・・・オーミック接触領域、7m
、7b・・・ソース及びドレイン領域、了・・・CvD
シリコン酸化膜、り・・・アルミニウム膜。 出願人代理人 猪 股 清 手続補正書 昭和開用8月11日 特許庁長官 若 杉 和 夫 殿 1、事件の表示 昭和57年9・4′許願第85937号2、発明の名称 半導体装置の製造方法 3、補正をする者 事件との関係 特許出願人 (307)東夏芝浦電気株式会社 」1 7、補正の対象 明細書の「特許請求の範囲」および「発明の詳細な説明
」の各欄 (1) 8、補正の内容 1、%、1!f請求の範囲を下記文の通りに訂正する。 「特許請求の範囲 ■、半導体基板表面に絶縁膜を形成しその絶縁膜上及び
その絶縁膜を除去した部分に金属及び硅素を同時に蒸着
させた配線用及び電極用の膜を形成する工程と、この膜
の表面から前記半導体基板の界面に対して多量の不純物
を導入する工程とを素子の半導体領域を形成する工程に
先立って実行する様にして成る半導体装置の製造方法。 2、特許請求の範囲第1項記載の方法において、前記半
導体基板は単結晶シリコン基板であり、前記配線用及び
電極用の膜はシリサイドまたは金属であるようにして成
る半導体装置の製造方法。」 2、明細85頁2行「ンース領域」の前K「第4図に示
すように」を挿入する。 3、同6頁2行「望ましい。」の前に「、特にトランジ
スタのしきい値耐圧が向上し」を挿入する。 (2)
の製造方法を示す工程図であるOl・・・半導体基板、
2,3・・・シリコン酸化膜、弘・・・MoSi2膜、
j・・・拡散ガス、2・・・オーミック接触領域、7m
、7b・・・ソース及びドレイン領域、了・・・CvD
シリコン酸化膜、り・・・アルミニウム膜。 出願人代理人 猪 股 清 手続補正書 昭和開用8月11日 特許庁長官 若 杉 和 夫 殿 1、事件の表示 昭和57年9・4′許願第85937号2、発明の名称 半導体装置の製造方法 3、補正をする者 事件との関係 特許出願人 (307)東夏芝浦電気株式会社 」1 7、補正の対象 明細書の「特許請求の範囲」および「発明の詳細な説明
」の各欄 (1) 8、補正の内容 1、%、1!f請求の範囲を下記文の通りに訂正する。 「特許請求の範囲 ■、半導体基板表面に絶縁膜を形成しその絶縁膜上及び
その絶縁膜を除去した部分に金属及び硅素を同時に蒸着
させた配線用及び電極用の膜を形成する工程と、この膜
の表面から前記半導体基板の界面に対して多量の不純物
を導入する工程とを素子の半導体領域を形成する工程に
先立って実行する様にして成る半導体装置の製造方法。 2、特許請求の範囲第1項記載の方法において、前記半
導体基板は単結晶シリコン基板であり、前記配線用及び
電極用の膜はシリサイドまたは金属であるようにして成
る半導体装置の製造方法。」 2、明細85頁2行「ンース領域」の前K「第4図に示
すように」を挿入する。 3、同6頁2行「望ましい。」の前に「、特にトランジ
スタのしきい値耐圧が向上し」を挿入する。 (2)
Claims (1)
- 【特許請求の範囲】 l 半導体基板表面に絶縁膜を形成しその絶縁膜上及び
その絶縁膜を除去した部分に金属及び硅素を同時に゛蒸
着させた配線用及び電極用の膜を形成する工程と、この
膜の表面から前記半導体基板の界面に対して多量の不純
物を導入する工程とを素子の半導体領域を形成する工程
に先立って実行する様にして成る半導体装置の製造方法
。 λ特許請求の範囲第1項記載の方法において、前記半導
体基板は単結晶シリコン基板であシ、前記配線用及び電
極用の膜はMoSi2であるようにして成る半導体装置
の製造方法。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57085937A JPS58202525A (ja) | 1982-05-21 | 1982-05-21 | 半導体装置の製造方法 |
US06/496,581 US4536943A (en) | 1982-05-21 | 1983-05-20 | Method of manufacturing a FET |
DE8383105022T DE3374102D1 (en) | 1982-05-21 | 1983-05-20 | Method of making ohmic contacts regions and device manufactured by the method |
EP83105022A EP0098941B1 (en) | 1982-05-21 | 1983-05-20 | Method of making ohmic contacts regions and device manufactured by the method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57085937A JPS58202525A (ja) | 1982-05-21 | 1982-05-21 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58202525A true JPS58202525A (ja) | 1983-11-25 |
JPH0371768B2 JPH0371768B2 (ja) | 1991-11-14 |
Family
ID=13872669
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57085937A Granted JPS58202525A (ja) | 1982-05-21 | 1982-05-21 | 半導体装置の製造方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US4536943A (ja) |
EP (1) | EP0098941B1 (ja) |
JP (1) | JPS58202525A (ja) |
DE (1) | DE3374102D1 (ja) |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
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