JPS5819903A - 制御装置 - Google Patents
制御装置Info
- Publication number
- JPS5819903A JPS5819903A JP12030681A JP12030681A JPS5819903A JP S5819903 A JPS5819903 A JP S5819903A JP 12030681 A JP12030681 A JP 12030681A JP 12030681 A JP12030681 A JP 12030681A JP S5819903 A JPS5819903 A JP S5819903A
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- JP
- Japan
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- pulse width
- servo
- width modulation
- circuit
- phase
- Prior art date
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- Pending
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Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B11/00—Automatic controllers
- G05B11/01—Automatic controllers electric
- G05B11/26—Automatic controllers electric in which the output signal is a pulse-train
- G05B11/28—Automatic controllers electric in which the output signal is a pulse-train using pulse-height modulation; using pulse-width modulation
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Feedback Control In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、同時に独立して動作する２つのサーボ系を有
し、その両サーボ系の制御出力がそれぞれパルス幅変調
用′力で−あφ、制御装置に関し、特に定常動禄時に′
おける電源ラインの電流リップμを低減゛し電源電圧変
動を少くすることな目的とす表例えば、回転ヘッド型磁
気録画再生装置（以下ＶＴＲ−、：称す）は磁気テープ
の走行制御をおこなうキャプスタンサーボ系と回転ヘッ
ドを制御するシリンダサーボ系と同時に独立して動作す
る２′）のす゛−ボ系を有する〇 このようなサーボ系の回路を個別部品で組立てた場合・
部品点数ルーく・回路が大きくなるなどの欠点があり、
集積回路化が進められている。
し、その両サーボ系の制御出力がそれぞれパルス幅変調
用′力で−あφ、制御装置に関し、特に定常動禄時に′
おける電源ラインの電流リップμを低減゛し電源電圧変
動を少くすることな目的とす表例えば、回転ヘッド型磁
気録画再生装置（以下ＶＴＲ−、：称す）は磁気テープ
の走行制御をおこなうキャプスタンサーボ系と回転ヘッ
ドを制御するシリンダサーボ系と同時に独立して動作す
る２′）のす゛−ボ系を有する〇 このようなサーボ系の回路を個別部品で組立てた場合・
部品点数ルーく・回路が大きくなるなどの欠点があり、
集積回路化が進められている。
集積回路化の利率として、回路の小型軽量化、信頼性の
向上等があｆｉ、ＶＴＲのように２つのサーボ系を有す
る回路をモノリシック集積回路で実現する開発がおこな
われている。
向上等があｆｉ、ＶＴＲのように２つのサーボ系を有す
る回路をモノリシック集積回路で実現する開発がおこな
われている。
２つのサーボ系をディジタμ手法によ多制御するディジ
タルサーボ装置をモノリシック集積回路で実現する場合
、７ビン数削減のために、出力信号をディジタμ・アナ
ログ変換として一般的に用いられるパルづ幅変調方式で
発生させている。この結果、出力端子はＶＴＲの場合、
シリンダサーボの速度系ふ位相系、キャプスタンサーボ
の速度系と位相系の計４ピンとすることができる。
タルサーボ装置をモノリシック集積回路で実現する場合
、７ビン数削減のために、出力信号をディジタμ・アナ
ログ変換として一般的に用いられるパルづ幅変調方式で
発生させている。この結果、出力端子はＶＴＲの場合、
シリンダサーボの速度系ふ位相系、キャプスタンサーボ
の速度系と位相系の計４ピンとすることができる。
−パルス幅変調方式で出力信号を得る場合、各々のサー
ボ系が定常状態の時、デユティサイクル略６０チの出力
信号が得られるようにする仁とが望ましい。
ボ系が定常状態の時、デユティサイクル略６０チの出力
信号が得られるようにする仁とが望ましい。
４つの出力信１号の位相関係が特に指定されてい３ ；
−： ない場合、例えば定常状態で第１図に示すような関係と
する。ＶＴＲを例にとって、第１図において、ａをシリ
ンダサーボの速度系、ｂをシリンダサーボ・の位相系、
Ｃをキャプスタンサーボの速度系、ｄをキャプスタンサ
ーボの位相系のそれぞれパルス幅変調出力とし、ｅを４
つの出力端子の出力電流の総和とする。
−： ない場合、例えば定常状態で第１図に示すような関係と
する。ＶＴＲを例にとって、第１図において、ａをシリ
ンダサーボの速度系、ｂをシリンダサーボ・の位相系、
Ｃをキャプスタンサーボの速度系、ｄをキャプスタンサ
ーボの位相系のそれぞれパルス幅変調出力とし、ｅを４
つの出力端子の出力電流の総和とする。
ただし、パルス幅変調方式でビット数を速度系はｎビッ
ト、位相系をｍピッ′トとし、第１図ではｍ＝ｎ＋２な
る関係を示している。
ト、位相系をｍピッ′トとし、第１図ではｍ＝ｎ＋２な
る関係を示している。
各サーボ系の出力端子では、パルス幅変調出力が′Ｈ″
ならば出力電流ｉが流れ ％ Ｌ Ｉならば出力電流が
流れないとすると、４つのパルス幅変調出力の出力電流
の総和ｅは、時間と共に、４ｉ→２１→４１→２１→゛
２１→０→之１→０→・・・・・・と周期的に変化する
。
ならば出力電流ｉが流れ ％ Ｌ Ｉならば出力電流が
流れないとすると、４つのパルス幅変調出力の出力電流
の総和ｅは、時間と共に、４ｉ→２１→４１→２１→゛
２１→０→之１→０→・・・・・・と周期的に変化する
。
従って、ＶＴＲのサーボ系に係るパルス幅変調方式によ
る回路を用いると、回路の電源ラインおよびグランドラ
インの電圧降下が周期的に変化しＶＴＲの他の回路系の
雑音となり、悪影響を及ぼす欠点がある。
る回路を用いると、回路の電源ラインおよびグランドラ
インの電圧降下が周期的に変化しＶＴＲの他の回路系の
雑音となり、悪影響を及ぼす欠点がある。
本発明は、上記の欠点を解決し、定常状態において出力
電流の周期的な変化を起させないサーボ装置を提供する
ものである。
電流の周期的な変化を起させないサーボ装置を提供する
ものである。
第２図は本発明の実施例を示し、第３図は定常状態にお
ける本発明のサーボ系の出力信号の位相関係を示してい
る。
ける本発明のサーボ系の出力信号の位相関係を示してい
る。
第２図および第３図において、１は基準信号発生器、２
は第１のす、−ボ・系６の速度制御−路、３は第１の妄
−ボ系６の位相制御回路、４は第２のサーボ系７の速度
制御回路、６は第２のサーボ系７の位相制御回路１、ａ
は第１のサーボ系の速度制御回路２の六ルス幅変調出力
信萼、ｂは第１の菩−５系０位相豐御回路３ （Ｄ ／
＜ ／Ｉ／ ２幅変調出力信号・Ｃは第２のサニボ系の
速度制御回路４のパルス幅変調出力信号、ｄは第２のサ
ーボ系の位相１ｔｉｉｊ御回路６のパルス幅変調出力信
号である。パルス幅変調方式による出力信号、ａ、ｂ、
ｃ、１の位相関係は基準信号発止器１によって決めるこ
とができ、第３図に示すように、速度制御回路２および
４の ゛御回路３および６の出力信号すとｄも１８
０°の位相差を有するように構成している。
は第１のす、−ボ・系６の速度制御−路、３は第１の妄
−ボ系６の位相制御回路、４は第２のサーボ系７の速度
制御回路、６は第２のサーボ系７の位相制御回路１、ａ
は第１のサーボ系の速度制御回路２の六ルス幅変調出力
信萼、ｂは第１の菩−５系０位相豐御回路３ （Ｄ ／
＜ ／Ｉ／ ２幅変調出力信号・Ｃは第２のサニボ系の
速度制御回路４のパルス幅変調出力信号、ｄは第２のサ
ーボ系の位相１ｔｉｉｊ御回路６のパルス幅変調出力信
号である。パルス幅変調方式による出力信号、ａ、ｂ、
ｃ、１の位相関係は基準信号発止器１によって決めるこ
とができ、第３図に示すように、速度制御回路２および
４の ゛御回路３および６の出力信号すとｄも１８
０°の位相差を有するように構成している。
ただし、パルス幅変調のビット数°ホ゛、速度系は・′
ピ・ト、位相系は・ピ・トとする。
ピ・ト、位相系は・ピ・トとする。
上記のような構成をすれば、第３図からもわかるように
、定常状態では常時２つの出力信号が、′Ｈ″となり、
残りの２つの出力信号が％ Ｌ ｌとなる。
、定常状態では常時２つの出力信号が、′Ｈ″となり、
残りの２つの出力信号が％ Ｌ ｌとなる。
よ；て、定常状態における出力電流の総和は、第３図の
６に示しであるように２１となり、一定になる。
６に示しであるように２１となり、一定になる。
この結果、集積回路内における電源ライン、グランドラ
インの電圧変動を無くすることが可能である。
インの電圧変動を無くすることが可能である。
また上記の説明ではパルス幅変調のビット数を速度系は
ｎビット、位相系は論ビットとして周波数を揃えた場合
を示したが各々の系でビット数が異なる場合でもパルス
幅変調出力の周波数が速度系同志、位相系同志で等しく
なるよ′うに構成すれば同様の効果が期待できる。
ｎビット、位相系は論ビットとして周波数を揃えた場合
を示したが各々の系でビット数が異なる場合でもパルス
幅変調出力の周波数が速度系同志、位相系同志で等しく
なるよ′うに構成すれば同様の効果が期待できる。
以上の説明で明らかなように、本発明では、２ 。
つのサーボ系を有する制御装置をモノリシック集積回路
化するに際し、動作時の定常状態において出力端子の出
力電流が均一化さする構成としただめ、集積回路内の電
源ライン、グランドラインの電圧変動を極めて小さくす
ることができ、他の回路系べの影響を防止できるもので
ある。 ゛第１図は２つのサーボ系の出力信
号の位相関係 。
化するに際し、動作時の定常状態において出力端子の出
力電流が均一化さする構成としただめ、集積回路内の電
源ライン、グランドラインの電圧変動を極めて小さくす
ることができ、他の回路系べの影響を防止できるもので
ある。 ゛第１図は２つのサーボ系の出力信
号の位相関係 。
を指定しない場合の一例を示す図、第２図は本発明の１
実施例を示すブロック図、第３図は本発明の２つのサー
ボ系の゛出力信号の位相関係を示す図である。
実施例を示すブロック図、第３図は本発明の２つのサー
ボ系の゛出力信号の位相関係を示す図である。
１・・・・・・基準信号発生器、２，４・・・・・・速
度制御回路、３，６・・−・・・位相制御回路、６・・
・・・・第１のサーが凰７・・・・・・第２のサーボ系
。
度制御回路、３，６・・−・・・位相制御回路、６・・
・・・・第１のサーが凰７・・・・・・第２のサーボ系
。
Claims (1)
- ２のサニボ系を有し、前記第１と第２のサーボ系のパル
ス幅変調出力の周波数を等しく、かつ位相差を１８０°
としたことを特徴とする制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12030681A JPS5819903A (ja) | 1981-07-30 | 1981-07-30 | 制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12030681A JPS5819903A (ja) | 1981-07-30 | 1981-07-30 | 制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5819903A true JPS5819903A (ja) | 1983-02-05 |
Family
ID=14782968
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12030681A Pending JPS5819903A (ja) | 1981-07-30 | 1981-07-30 | 制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5819903A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6337850U (ja) * | 1986-08-28 | 1988-03-11 | ||
| US4950968A (en) * | 1987-12-18 | 1990-08-21 | Kabushiki Kaisha Toshiba | DC motor driving apparatus with function for compensating for drive voltage change |
| US5075608A (en) * | 1974-06-24 | 1991-12-24 | Erdman David M | Control system, electronically commutated motor system, draft inducer apparatus and method |
| JPH0478601U (ja) * | 1990-11-15 | 1992-07-09 | ||
| USRE35124E (en) * | 1974-06-24 | 1995-12-19 | General Electric Company | Control system, electronically commutated motor system, draft inducer apparatus and method |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5297153A (en) * | 1976-02-10 | 1977-08-15 | Nippon Steel Corp | Operational quantity control system in sampling control system |
-
1981
- 1981-07-30 JP JP12030681A patent/JPS5819903A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5297153A (en) * | 1976-02-10 | 1977-08-15 | Nippon Steel Corp | Operational quantity control system in sampling control system |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5075608A (en) * | 1974-06-24 | 1991-12-24 | Erdman David M | Control system, electronically commutated motor system, draft inducer apparatus and method |
| USRE35124E (en) * | 1974-06-24 | 1995-12-19 | General Electric Company | Control system, electronically commutated motor system, draft inducer apparatus and method |
| JPS6337850U (ja) * | 1986-08-28 | 1988-03-11 | ||
| JPH0523873Y2 (ja) * | 1986-08-28 | 1993-06-17 | ||
| US4950968A (en) * | 1987-12-18 | 1990-08-21 | Kabushiki Kaisha Toshiba | DC motor driving apparatus with function for compensating for drive voltage change |
| JPH0478601U (ja) * | 1990-11-15 | 1992-07-09 |
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