JPS58178404A - シ−ケンスコントロ−ラの外部演算ユニツト - Google Patents

シ−ケンスコントロ−ラの外部演算ユニツト

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Publication number
JPS58178404A
JPS58178404A JP6186882A JP6186882A JPS58178404A JP S58178404 A JPS58178404 A JP S58178404A JP 6186882 A JP6186882 A JP 6186882A JP 6186882 A JP6186882 A JP 6186882A JP S58178404 A JPS58178404 A JP S58178404A
Authority
JP
Japan
Prior art keywords
microprocessor
data
image memory
memory
sequence controller
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP6186882A
Other languages
English (en)
Inventor
Takehiko Hayashi
林 毅彦
Yoshio Kasai
葛西 由夫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP6186882A priority Critical patent/JPS58178404A/ja
Publication of JPS58178404A publication Critical patent/JPS58178404A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05BCONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B19/00Programme-control systems
    • G05B19/02Programme-control systems electric
    • G05B19/04Programme control other than numerical control, i.e. in sequence controllers or logic controllers
    • G05B19/05Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Automation & Control Theory (AREA)
  • Programmable Controllers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、シーケンスコントローラの本体に接続され
る外部演算ユニットに関する。
周知のように、最近のシーケンスコントローラにあって
はビット演算だけでなく、数値演算環のより複雑な制御
を行なえるようになってきた。しかし、従来のこの種の
シーケンスコントローラは、ビット演算を行なうマイク
ロプロセッサでもって数値演算等の処理も行なうように
構成されているため、数値演算命令等を含んだシーケン
スプログラムの処理時間が長くなるという欠点があった
また従来のシーケンスコントローラでは、ある制御対象
に適用するに際してプントローラのデータメモリが不足
する場合、この不足を補うために、より大規模なコント
ローラを使用するか、複数台のプントローラを使用しな
ければならなかった。
この発明は前述した従来の問題点に鑑みなされたもので
あり、その目的は、コントローラ本体のOPUユニット
と演算処理を分担させることによりシーケンスプログラ
ムの処理時間を短縮させたり、あるいはコントローラ本
体のデータメモリの不足を補う目的で使用することので
きるシーケンスコントローラの外部演算ユニットを提供
することにある。
上記の目的を達成するために、この発明の外部演算ユニ
ットは、マイクロプロセッサと、このマイクロプロセッ
サの制御用メモリおよび制御用データメモリと、シーケ
ンスコントローラ本体との間のデータ伝送用のイメージ
メモリと、このイメージメモリに対して上記マイクロプ
ロセッサがアクセスするか上記シーケンスコントローラ
がアクセスするかを切換える切換手段とを有し、上記マ
イクロプロセッサが、上記シーケンスコントローラ本体
によって上記イメージメモリに書込まれた演に伝えるよ
うに構成したことを%徴とする。
以下、図面に基づいて本発明の好適な実施例を説明する
第1図はこの発明による外部演算ユニットの構成を示す
。この外部演算ユニットは、点線1示すクーケンスコン
トローラ本体10に接続される。
ここでコントローラ本体10とは、シーケンスコントロ
ーラのOPUユニットのマイクロプロセッサである。
この外部演算ユニットは、当該ユニットの全体制御およ
び後述の演算処理を行なうマイクロプロセッサ12と、
このマイクロプロセッサ12によって実行されるシステ
ムプログラムを格納した制御用メモリ14(ROM)と
、上記マイクロプロセッサ12により各種可変データの
一時格納エリアとして使われる制御用データメモリ16
(RAM)と、コントローラ本体10との間のデータ伝
送用のイメージメモリ18と、このイメージメモリ18
に対してマイクロプロセッサ12がアクセスするかコン
トローラ本体lOがアクセスするかを切換えるアドレス
・データメモリのノセススイッチ20.22とを有する
。この2つのノセススイッチ20.22は択一的に一方
のみをオンにすることができる。
次に、上記のように構成された外部演算ユニットの動作
について説明する。コントローラ本体10はシーケンス
プログラムの実行過程において、外部演算ユニットに処
理させるべき演算指令(数値演算など)を上記ノ々スス
イッチ22をオンにして、上記イメージメモリ18に書
込む。次にマイクロプロセッサ12がノ々ススイッチ2
0をオンにし、イメージメモリ18にコントローラ本体
lOによって書込まれた上記演算指令を読取り、その内
容に従って演算処理を行なう。これと並行してコントロ
ーラ本体10ではシーケンスプログラムの処理が進めら
れる。
マイクロプロセッサ12が指令された演算を実行するこ
とによって得られたデータは、マイクロトローラ本体l
Oがノ々ススイッチ22をオンにし、マイクロプロセッ
サ12によってイメージメモリ18に書込まれた上記デ
ータを読取り、コントローラ本体10自身によって演算
処理して得たデータとともにシーケンス制御のデータと
して取扱われる。
このように本発明の外部演算ユニットを用いれば、シー
ケンスプログラム処理に必要な演算の一部を当該ユニッ
トに分担させて、コントローラ本体と並行的に処理を進
めることができ、シーケンスプログラムの処理時間を短
縮することができる。
また上記の説明で明かなように、当誼ユニットにおける
制御データメモリ16をコントローラ本体10@から実
質的にデータメモリの一部として使用することができる
ので、これによりコントロー2本体10側のデータメモ
リの不足を補うことができる。なお、その場合には上記
制御データメモリ16をAツテリノ々ツクアップにより
不揮発性化し、停電時でも制御データが消失しないよう
に構成する。
以上詳細に説明したように、この発明に係るシーケンス
コントローラの外部演算ユニットによれば、シーケンス
プログラムの処理時間を短縮化できるとともに、コント
ローラ本体のデータメモリの不足を補うことができる。
【図面の簡単な説明】
第4図は本発明の一実施例による外部演算ユニットの構
成を示すブロック図である。 図において、10はコントロ〜う本体、12はマイクロ
プロセッサ、14は制御メモリ、16は制御データメモ
リ、18はイメージメモリ、20および22はノ々スス
イッチである。 代理人 弁理士  葛 野 信 − (外1名) [1°−] 1

Claims (1)

    【特許請求の範囲】
  1. (1)  マイクロプロセッサと、このマイクロプロセ
    ッサによって実行されるプログラムを格納した制御用メ
    モリと、上記マイクロプロセッサによって各種データの
    −0記憶エリアとして使われる制御用データメモリと、
    シーケンスコントローラ本体との間のデータ伝送用のイ
    メージメモリと、このイメージメモリに対して上記マイ
    クロプロセッサがアクセスするか上記シーケンスコント
    ローラ本体がアクセスするかを切換える切換手段とを有
    し、上記マイクロプロセッサが、上記シーケンスコント
    ローラ本体によって上記イメージメモリに書込まれた演
    算指令を読取って実行処理し、その(2、特許請求の範
    囲(1)に記載のものにおいて、上記制御用データメモ
    リがノ々ツテリノ々ツクアップされて不揮発性化されて
    いることを特徴とするシーケンスコントローラの外部演
    算ユニット。
JP6186882A 1982-04-14 1982-04-14 シ−ケンスコントロ−ラの外部演算ユニツト Pending JPS58178404A (ja)

Priority Applications (1)

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JP6186882A JPS58178404A (ja) 1982-04-14 1982-04-14 シ−ケンスコントロ−ラの外部演算ユニツト

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JP6186882A JPS58178404A (ja) 1982-04-14 1982-04-14 シ−ケンスコントロ−ラの外部演算ユニツト

Publications (1)

Publication Number Publication Date
JPS58178404A true JPS58178404A (ja) 1983-10-19

Family

ID=13183527

Family Applications (1)

Application Number Title Priority Date Filing Date
JP6186882A Pending JPS58178404A (ja) 1982-04-14 1982-04-14 シ−ケンスコントロ−ラの外部演算ユニツト

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JP (1) JPS58178404A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6093513A (ja) * 1983-10-27 1985-05-25 Fanuc Ltd 数値制御装置におけるアプリケ−シヨンシステムのデ−タ入出力器
DE112011101685T5 (de) 2010-05-18 2013-04-11 Suzuki Motor Corporation Blowbygas-Behandlungsvorrichtung für einen Motor

Cited By (2)

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Publication number Priority date Publication date Assignee Title
JPS6093513A (ja) * 1983-10-27 1985-05-25 Fanuc Ltd 数値制御装置におけるアプリケ−シヨンシステムのデ−タ入出力器
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