JPS5810924A - 初期状態設定回路 - Google Patents
初期状態設定回路Info
- Publication number
- JPS5810924A JPS5810924A JP10857581A JP10857581A JPS5810924A JP S5810924 A JPS5810924 A JP S5810924A JP 10857581 A JP10857581 A JP 10857581A JP 10857581 A JP10857581 A JP 10857581A JP S5810924 A JPS5810924 A JP S5810924A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- power
- turned
- power supply
- logic circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/22—Modifications for ensuring a predetermined initial state when the supply voltage has been applied
Landscapes
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はメモリ機能を有するロジック回路を用いて電子
スイッチ等のコントロールを行なう電子機器において、
バックアップ電源が放電しきった後に電源をオンにした
とき、上記ロジック回路が必ず特定の状態にセフ）され
るようにしたものである。
スイッチ等のコントロールを行なう電子機器において、
バックアップ電源が放電しきった後に電源をオンにした
とき、上記ロジック回路が必ず特定の状態にセフ）され
るようにしたものである。
通常この種の電子機器には、電源オフ時にロジック回路
をバックアップする機能が設けられているが、長期間電
源オフのままにするとバックアップ電源が放電してしま
い、ロジック回路のメモリ機能が失なわれてしまう。こ
のためこの状態で電源を再びオンにすると、ロジック回
路が勝手に動作し、どのスイッチがオンになるか全くわ
からないという不都合が生じる。
をバックアップする機能が設けられているが、長期間電
源オフのままにするとバックアップ電源が放電してしま
い、ロジック回路のメモリ機能が失なわれてしまう。こ
のためこの状態で電源を再びオンにすると、ロジック回
路が勝手に動作し、どのスイッチがオンになるか全くわ
からないという不都合が生じる。
本発明はこのような問題を解決し、バックアップ電源が
放電した後に電源をオンにしたとき、ロジック回路が必
ず特定の状態にセットされるようにした初期状態設定回
路を提供するものである。
放電した後に電源をオンにしたとき、ロジック回路が必
ず特定の状態にセットされるようにした初期状態設定回
路を提供するものである。
以下本発明の一実施例を図面とともに説明する。
第１図において、１はＭＯ３ＩＣで構成された口シック
回路であり、ここではオーディオ機器においてプログラ
ムソースを切換えるセレクタスイッチを電子的に切換え
るために使用している。２゜３．４はロジック回路１の
複数の入力端子１ａ。
回路であり、ここではオーディオ機器においてプログラ
ムソースを切換えるセレクタスイッチを電子的に切換え
るために使用している。２゜３．４はロジック回路１の
複数の入力端子１ａ。
Ｉｂ、Ｉｃに接続された手動スイッチであシ、スイッチ
２を瞬間的に閉じるとたとえばレコードプレヤーが選択
される。同様にスイッチ３，４を瞬間的に閉じるとテー
プレコーダ、チー−すが選択される。６は機器の電源ス
ィッチ、６は電源トランス等を含む電源回路、７はスイ
ッチとして動作するダイオード、８は抵抗、９はバック
アップ電源として動作する電界コンデンサ、１０はロジ
ック回路１の動作を保証する最低電圧（基準電圧）を発
生するツェナーダイオード、１１は抵抗、１２はバック
アップ電源の放電後の電源オン時にパＩＶスを発生する
トランジスタである。
２を瞬間的に閉じるとたとえばレコードプレヤーが選択
される。同様にスイッチ３，４を瞬間的に閉じるとテー
プレコーダ、チー−すが選択される。６は機器の電源ス
ィッチ、６は電源トランス等を含む電源回路、７はスイ
ッチとして動作するダイオード、８は抵抗、９はバック
アップ電源として動作する電界コンデンサ、１０はロジ
ック回路１の動作を保証する最低電圧（基準電圧）を発
生するツェナーダイオード、１１は抵抗、１２はバック
アップ電源の放電後の電源オン時にパＩＶスを発生する
トランジスタである。
上記構成において、電源スィッチ６をオンにしｊ
た通常動作時には、電源回路６からダイオード７
゜抵抗８を介してロジック回路１に電源が供給される。
た通常動作時には、電源回路６からダイオード７
゜抵抗８を介してロジック回路１に電源が供給される。
このためスイッチ２． ３．４のいずれかを閉しること
によりロジック回路１を働かせ、プレヤー、テープレコ
ーダ、テ≧−す等の好みのプログラムソースを選択する
ことができる。このとき電源回路６から抵抗８を介して
電界コンデンサ９に充電電流が流れ、電界コンデンサ９
が充電される。
によりロジック回路１を働かせ、プレヤー、テープレコ
ーダ、テ≧−す等の好みのプログラムソースを選択する
ことができる。このとき電源回路６から抵抗８を介して
電界コンデンサ９に充電電流が流れ、電界コンデンサ９
が充電される。
このためｂ点の電位が上昇し、トランジスタ／Ｚはオフ
状態となる。
状態となる。
次に電源スィッチ６をオフにすると、電源回路６からロ
ジック回路１へ電源が供給されなくなるが、このときは
電界臼ンデンサ９の端子電圧がバックアップ電源として
ロジック回路１へ供給される。このためロジック回路１
は通常動作時にセクトされた状態を保持しつづける。そ
して電界コンデンサ９の端子電圧（ｂ点の電位）が、ツ
ェナーダイオード１ｏで規定される基準電圧に達するま
ではトランジスタ１２は動作せず、オフの状態を維持す
る。
ジック回路１へ電源が供給されなくなるが、このときは
電界臼ンデンサ９の端子電圧がバックアップ電源として
ロジック回路１へ供給される。このためロジック回路１
は通常動作時にセクトされた状態を保持しつづける。そ
して電界コンデンサ９の端子電圧（ｂ点の電位）が、ツ
ェナーダイオード１ｏで規定される基準電圧に達するま
ではトランジスタ１２は動作せず、オフの状態を維持す
る。
やがて所定期間経過後電界コンデンサ９の端子電圧が基
準電圧以下に低下すると、ロジック回路１のメモリ機能
は失なわれる。
準電圧以下に低下すると、ロジック回路１のメモリ機能
は失なわれる。
この状態で再び電源スィッチ５をオンにすると、ａ点の
電位は第２図ａに示すように比較的速やかに立上るが、
ｂ点の電位は抵抗８と電界コンデンサ９で決まる時定数
にしたがって、第２図すに示すようにゆるやかに立上り
、ａ、 ｂ点間に第２図に−で示す電位差が生じる。
電位は第２図ａに示すように比較的速やかに立上るが、
ｂ点の電位は抵抗８と電界コンデンサ９で決まる時定数
にしたがって、第２図すに示すようにゆるやかに立上り
、ａ、 ｂ点間に第２図に−で示す電位差が生じる。
このためトランジスタ１２に順方向バイアスがかかり、
このトランジスタ１２がオンする。その結果、トランジ
スタ１２のコレクタから、ロジック回路１のチューナの
入力端子１Ｃに対してパルス状の電位が与えられ、ロジ
ック回路１を強制的にチー−すを選択する状態にセット
する０したがってバックアップ電源の放電後に電源をオ
ンにした場合には、必ずチューナが選択されることにな
る。そして電源をオンした後、電界コンデンサ９の充電
が み、ｂ点の電位が基準電圧を越えると、トランジス
タ１２は再びオフになり、入力端子１ｃへはパルスが印
加されなくなる。
このトランジスタ１２がオンする。その結果、トランジ
スタ１２のコレクタから、ロジック回路１のチューナの
入力端子１Ｃに対してパルス状の電位が与えられ、ロジ
ック回路１を強制的にチー−すを選択する状態にセット
する０したがってバックアップ電源の放電後に電源をオ
ンにした場合には、必ずチューナが選択されることにな
る。そして電源をオンした後、電界コンデンサ９の充電
が み、ｂ点の電位が基準電圧を越えると、トランジス
タ１２は再びオフになり、入力端子１ｃへはパルスが印
加されなくなる。
なお、上記実施例ではロジック回路１によりてセレクタ
スイッチを切換える場合について説明したが、この他の
機能を行なうものでもよい。また基準電圧発生回路をツ
ェナーダイオード１０で構成し、比較回路をトランジス
タ１２で構成したが実質的にこれらと等価な機能をもつ
ものであれば他の回路でもよいことはいうまでもない。
スイッチを切換える場合について説明したが、この他の
機能を行なうものでもよい。また基準電圧発生回路をツ
ェナーダイオード１０で構成し、比較回路をトランジス
タ１２で構成したが実質的にこれらと等価な機能をもつ
ものであれば他の回路でもよいことはいうまでもない。
以上のように本発明は、バックアップ電源が放電した後
再び電源をオンしたときに、ｂシック回路を強制的に特
定の状態にセクトするようにしたものであるから、電源
オン時に機器がどの状態にセクトされるかわからないと
いう従来の不都合を解消し、きわめて使い勝手のよい電
子機器を構成することができる。
再び電源をオンしたときに、ｂシック回路を強制的に特
定の状態にセクトするようにしたものであるから、電源
オン時に機器がどの状態にセクトされるかわからないと
いう従来の不都合を解消し、きわめて使い勝手のよい電
子機器を構成することができる。
【図面の簡単な説明】
第１図は本発明の一実施例を示す回路図、第２図はその
動作説明図である。 １・・・・・・ロジック回路、１ａ〜１ｃ・・・・・・
入力端子、２〜４・・・・・・入力スイッチ、５・・・
・・・電源スィッチ、６・・・・・・電源回路、７・・
・・・・スイッチ・・・・・基準電圧発生回路を構成す
るツェナーダイオード、１２・・・・・・パルス発生回
路を構成するトランジスタ。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名鶏
１１！１ 第２図 むＯＮ ｔ
動作説明図である。 １・・・・・・ロジック回路、１ａ〜１ｃ・・・・・・
入力端子、２〜４・・・・・・入力スイッチ、５・・・
・・・電源スィッチ、６・・・・・・電源回路、７・・
・・・・スイッチ・・・・・基準電圧発生回路を構成す
るツェナーダイオード、１２・・・・・・パルス発生回
路を構成するトランジスタ。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名鶏
１１！１ 第２図 むＯＮ ｔ
Claims (1)
- 複数の入力端子を有し、各入力端子に与えられるロジッ
ク入力にもとづいて所定の状態に設定されるロジック回
路と、電源オン時に上記ロジック回路に電源を供給する
電源回路と、電源オン時に上記電源回路により充電され
、電源オフ時に上記ロジック回路に電源を供給するバッ
クアップ電源と、電源オン時に速やかに上記ロジック回
路の動作を保証する基準電圧を発生する基準電圧発生回
路と、上記バックアップ電源の電圧が上記基準電圧以下
に低下した状態で電源をオンしたときに、上記バックア
ップ電源の出力と上記基準電圧発生回路の電圧とを比較
してパルスを発生する比較回路とを備え、上記比較回路
の出力を上記ロジック回路の予め定められた入力端子に
加えるようにしたことを特徴とする初期状態設定回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10857581A JPS5810924A (ja) | 1981-07-10 | 1981-07-10 | 初期状態設定回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10857581A JPS5810924A (ja) | 1981-07-10 | 1981-07-10 | 初期状態設定回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5810924A true JPS5810924A (ja) | 1983-01-21 |
| JPH0345578B2 JPH0345578B2 (ja) | 1991-07-11 |
Family
ID=14488287
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10857581A Granted JPS5810924A (ja) | 1981-07-10 | 1981-07-10 | 初期状態設定回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5810924A (ja) |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4946933U (ja) * | 1972-07-29 | 1974-04-24 | ||
| JPS516850U (ja) * | 1974-06-28 | 1976-01-19 | ||
| JPS54143107U (ja) * | 1978-03-28 | 1979-10-04 | ||
| JPS55107741U (ja) * | 1979-01-19 | 1980-07-28 |
-
1981
- 1981-07-10 JP JP10857581A patent/JPS5810924A/ja active Granted
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4946933U (ja) * | 1972-07-29 | 1974-04-24 | ||
| JPS516850U (ja) * | 1974-06-28 | 1976-01-19 | ||
| JPS54143107U (ja) * | 1978-03-28 | 1979-10-04 | ||
| JPS55107741U (ja) * | 1979-01-19 | 1980-07-28 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0345578B2 (ja) | 1991-07-11 |
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