JP3284742B2 - スイッチ付レギュレータ電源の起動制御回路および方法 - Google Patents
スイッチ付レギュレータ電源の起動制御回路および方法Info
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- JP3284742B2 JP3284742B2 JP07586794A JP7586794A JP3284742B2 JP 3284742 B2 JP3284742 B2 JP 3284742B2 JP 07586794 A JP07586794 A JP 07586794A JP 7586794 A JP7586794 A JP 7586794A JP 3284742 B2 JP3284742 B2 JP 3284742B2
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- power supplies
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- Direct Current Feeding And Distribution (AREA)
- Continuous-Control Power Sources That Use Transistors (AREA)
- Television Receiver Circuits (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、テレビジョン受像機等
の電子機器の複数の回路に動作電圧を供給するため複数
配設されたスイッチ付きレギュレータ電源のそれぞれの
回路に対する起動に対応して起動制御されるスイッチ付
レギュレータ電源の起動制御回路および起動制御方法に
関するものである。
の電子機器の複数の回路に動作電圧を供給するため複数
配設されたスイッチ付きレギュレータ電源のそれぞれの
回路に対する起動に対応して起動制御されるスイッチ付
レギュレータ電源の起動制御回路および起動制御方法に
関するものである。
【０００２】
【従来の技術】従来、テレビジョン受像機の電源には、
回路構成が簡単で安価であるためスイッチ付きレギュレ
ータ電源が用いられてきた。しかしながら、動作電圧を
供給する各回路に対してそれぞれの電源のオンオフタイ
ミングを考慮しなければならない場合には、スイッチ端
子に印加する起動制御信号を所望のタイミングになるよ
うに遅延する際、例えば図３に示すように、電源Ａに対
して電源Ｂのオンオフタイミングを遅延させる場合、電
源Ｂのスイッチ端子に抵抗１００およびコンデンサ１０
１により構成される積分回路を付加することによって遅
延させていた。
回路構成が簡単で安価であるためスイッチ付きレギュレ
ータ電源が用いられてきた。しかしながら、動作電圧を
供給する各回路に対してそれぞれの電源のオンオフタイ
ミングを考慮しなければならない場合には、スイッチ端
子に印加する起動制御信号を所望のタイミングになるよ
うに遅延する際、例えば図３に示すように、電源Ａに対
して電源Ｂのオンオフタイミングを遅延させる場合、電
源Ｂのスイッチ端子に抵抗１００およびコンデンサ１０
１により構成される積分回路を付加することによって遅
延させていた。
【０００３】
【発明が解決しようとする課題】しかしながら、遅延時
間はＣＲの時定数によって決まってしまうため遅延時間
には限度があり、遅延時間に関しても正確に制御するこ
とは不可能であった。
間はＣＲの時定数によって決まってしまうため遅延時間
には限度があり、遅延時間に関しても正確に制御するこ
とは不可能であった。
【０００４】
【課題を解決するための手段】上記課題を解決するため
に本発明は、スイッチ付きレギュレータ電源の出力電圧
の立ち上がり時間およびツェナダイオードのツェナー電
圧により遅延時間を設定するようにしたことにより、簡
単な回路構成で安価に複数の電源のタイミング制御を可
能としたものであり、マイコンを備えたテレビジョン受
信機等の電子機器において、スイッチ付レギュレータ電
源の中の第１の電源Ａの出力端子にカソード側が接続さ
れ、第２の電源Ｂのスイッチ端子にアノード側が接続さ
れるようにツェナーダイオードを配設し、前記第１の電
源Ａの起動に対する第２の電源Ｂの起動を前記電源Ａの
出力電圧の立ち上がり時間と前記ツェナーダイオードの
ツェナー電圧により前記第１の電源Ａの起動に対する第
２の電源Ｂの起動が所定の時間遅延するように構成した
ものである。
に本発明は、スイッチ付きレギュレータ電源の出力電圧
の立ち上がり時間およびツェナダイオードのツェナー電
圧により遅延時間を設定するようにしたことにより、簡
単な回路構成で安価に複数の電源のタイミング制御を可
能としたものであり、マイコンを備えたテレビジョン受
信機等の電子機器において、スイッチ付レギュレータ電
源の中の第１の電源Ａの出力端子にカソード側が接続さ
れ、第２の電源Ｂのスイッチ端子にアノード側が接続さ
れるようにツェナーダイオードを配設し、前記第１の電
源Ａの起動に対する第２の電源Ｂの起動を前記電源Ａの
出力電圧の立ち上がり時間と前記ツェナーダイオードの
ツェナー電圧により前記第１の電源Ａの起動に対する第
２の電源Ｂの起動が所定の時間遅延するように構成した
ものである。
【０００５】
【作用】上記のスイッチ付レギュレータ電源の出力電圧
の立ち上がり時間に対してツェナダイオードのツェナー
電圧を設定することによって電源Ａ起動に対する電源Ｂ
の立ち上がりおよび立ち下がり時間を設定制御すること
ができるものである。
の立ち上がり時間に対してツェナダイオードのツェナー
電圧を設定することによって電源Ａ起動に対する電源Ｂ
の立ち上がりおよび立ち下がり時間を設定制御すること
ができるものである。
【０００６】
【実施例】以下、本発明の実施例について、図１および
図２を用いて説明する。
図２を用いて説明する。
【０００７】図１において、スイッチ付レギュレータ電
源Ａの出力電圧により制御されるスイッチ付レギュレー
タ電源Ｂは、電源Ａの起動に対して所定時間遅延して起
動するように構成され、電源Ａのオンオフはマイコン２
の起動制御信号により制御される。マイコンからの起動
制御信号により電源Ａのスイッチ端子１８の電圧が所定
電圧になると電源Ａが立ち上がり、電源Ａの立ち上がり
と共に電源Ａの出力電圧端子に接続されているツェナダ
イオードＤ１のカソード側の電圧が上昇する。ツェナダ
イオードＤ１のアノード側は電源Ｂのスイッチ端子１９
に接続されている。電源Ａが起動してから一定時間経過
後に電源Ａの出力電圧が所定の電圧迄立ち上がり、ツェ
ナダイオードＤ１のカソードの電圧がツェナー電圧を越
えると、ツェナダイオードＤ１が動作し、電源Ｂのスイ
ッチ端子１９に所定の電圧が印加されスイッチ端子１９
の端子電圧が上昇する。前記端子電圧が電源Ｂのスイッ
チングのオンレベルに達すると電源Ｂが起動する。抵抗
１０は電源Ｂのスイッチ端子１９に流れこむ電流を制限
する電流制限用の抵抗である。ツェナダイオードＤ１の
ツェナー電圧により電源Ａの起動に対して電源Ｂの起動
タイミングが決定される。したがって、ツェナー電圧に
より電源Ｂの遅延タイミングを任意に設定することが可
能となる。遅延時間の変動要素としては、電源Ｂの出力
電圧の立ち上がり時間、ツェナー電圧のバラツキ、電源
Ｂのスイッチ端子１９のスイッチングにおけるスレッシ
ョルドレベルの３要素がある。遅延時間の保障に関して
は、３要素の変動を考慮して条件が最も不利な時につい
ても保障できるようにツェナー電圧の値を設定する必要
がある。電源オフ時については、電源Ａの立ち下がりと
共にツェナダイオードＤ１のカソードの電圧が下がり、
それとともに電源Ｂのスイッチ端子１９の端子電圧が低
下し、スイッチングのオフレベルに達すると電源Ｂの動
作が停止する。抵抗１１は電源Ｂのスイッチ端子１９の
電圧がゼロ電位にならないようにするためのゼロ電位保
障用の抵抗である。
源Ａの出力電圧により制御されるスイッチ付レギュレー
タ電源Ｂは、電源Ａの起動に対して所定時間遅延して起
動するように構成され、電源Ａのオンオフはマイコン２
の起動制御信号により制御される。マイコンからの起動
制御信号により電源Ａのスイッチ端子１８の電圧が所定
電圧になると電源Ａが立ち上がり、電源Ａの立ち上がり
と共に電源Ａの出力電圧端子に接続されているツェナダ
イオードＤ１のカソード側の電圧が上昇する。ツェナダ
イオードＤ１のアノード側は電源Ｂのスイッチ端子１９
に接続されている。電源Ａが起動してから一定時間経過
後に電源Ａの出力電圧が所定の電圧迄立ち上がり、ツェ
ナダイオードＤ１のカソードの電圧がツェナー電圧を越
えると、ツェナダイオードＤ１が動作し、電源Ｂのスイ
ッチ端子１９に所定の電圧が印加されスイッチ端子１９
の端子電圧が上昇する。前記端子電圧が電源Ｂのスイッ
チングのオンレベルに達すると電源Ｂが起動する。抵抗
１０は電源Ｂのスイッチ端子１９に流れこむ電流を制限
する電流制限用の抵抗である。ツェナダイオードＤ１の
ツェナー電圧により電源Ａの起動に対して電源Ｂの起動
タイミングが決定される。したがって、ツェナー電圧に
より電源Ｂの遅延タイミングを任意に設定することが可
能となる。遅延時間の変動要素としては、電源Ｂの出力
電圧の立ち上がり時間、ツェナー電圧のバラツキ、電源
Ｂのスイッチ端子１９のスイッチングにおけるスレッシ
ョルドレベルの３要素がある。遅延時間の保障に関して
は、３要素の変動を考慮して条件が最も不利な時につい
ても保障できるようにツェナー電圧の値を設定する必要
がある。電源オフ時については、電源Ａの立ち下がりと
共にツェナダイオードＤ１のカソードの電圧が下がり、
それとともに電源Ｂのスイッチ端子１９の端子電圧が低
下し、スイッチングのオフレベルに達すると電源Ｂの動
作が停止する。抵抗１１は電源Ｂのスイッチ端子１９の
電圧がゼロ電位にならないようにするためのゼロ電位保
障用の抵抗である。
【０００８】更に図１において、電源Ｂに対する電源Ｃ
の起動遅延時間についても、電源Ｂの出力電圧の立ち上
がり時間とツェナーダイオードＤ２のツェナー電圧によ
り、所定の遅延時間になるように設定できる。
の起動遅延時間についても、電源Ｂの出力電圧の立ち上
がり時間とツェナーダイオードＤ２のツェナー電圧によ
り、所定の遅延時間になるように設定できる。
【０００９】また、図１のように、配設された複数の電
源の中の電源Ａと電源Ｎを直接マイコン２からの起動制
御信号によって起動制御し、他の電源との起動時間に対
応させずに独立に起動を制御することも可能であり、図
２のように、電源Ｎの起動を電源Ｃの起動とともに行う
ように構成することもできる。
源の中の電源Ａと電源Ｎを直接マイコン２からの起動制
御信号によって起動制御し、他の電源との起動時間に対
応させずに独立に起動を制御することも可能であり、図
２のように、電源Ｎの起動を電源Ｃの起動とともに行う
ように構成することもできる。
【００１０】
【発明の効果】以上のように本発明によれば、テレビジ
ョン受信機等の電子機器の複数の回路にそれぞれ動作電
圧を供給するために複数配設されたスイッチ付レギュレ
ータ電源間相互の起動遅延時間を各電源の出力端子の電
圧が立ち上がる時間とツェナーダイオードのツェナー電
圧値の組合せにより、任意に設定することができるとと
もに、マイコンからの起動制御信号により同時に起動す
ることも可能な構成であり、部品点数も少なく、安価に
実現することが可能なものである
ョン受信機等の電子機器の複数の回路にそれぞれ動作電
圧を供給するために複数配設されたスイッチ付レギュレ
ータ電源間相互の起動遅延時間を各電源の出力端子の電
圧が立ち上がる時間とツェナーダイオードのツェナー電
圧値の組合せにより、任意に設定することができるとと
もに、マイコンからの起動制御信号により同時に起動す
ることも可能な構成であり、部品点数も少なく、安価に
実現することが可能なものである
【図１】本発明の一実施例におけるスイッチ付レギュレ
ータ電源のブロック構成図
ータ電源のブロック構成図
【図２】本発明の他の実施例おけるスイッチ付レギュレ
ータ電源のブロック構成図
ータ電源のブロック構成図
【図３】従来のスイッチ付レギュレータ電源のブロック
構成図
構成図
２ マイコン Ｄ１，Ｄ２ ツェナーダイオード ３，４，５，６ スイッチ付レギュレータ電源 １０，１２ 電流制限用抵抗 １１，１３ ゼロ電位保障用抵抗
Claims (3)
- 【請求項１】 テレビジョン受信機等の電子機器の複数
の回路Ａ乃至回路Ｎをそれぞれ動作させるためのスイッ
チ付レギュレータ電源Ａ乃至電源Ｎの起動において、前
記複数の回路の中の回路Ｂ〜Ｄを回路Ａに対して順次一
定時間遅延させて回路Ａ〜Ｄの順に動作させるととも
に、前記複数の回路の中の回路Ｅ〜Ｎを回路Ａと同時に
動作させるために、前記電源Ａ〜Ｃの各出力端子が前記
電源Ｂ〜Ｄの各スイッチ端子に接続されるように、前記
複数の電源Ａ〜Ｄの各電源間をツェナーダイオードを介
して電源Ａ〜Ｄの順に順次接続し、電源Ａに対してそれ
ぞれ順次一定時間遅延して起動する前記電源Ｂ〜Ｄの各
スイッチ端子に印加される起動制御電圧を前記電源Ａ〜
Ｃの各出力電圧がそれぞれツェナーダイオードのツェナ
ー電圧に達する迄の立上り時間によって設定するととも
に、前記回路Ａと同時に動作させる前記回路Ｅ〜Ｎの各
スイッチ端子に前記電源Ａのスイッチ端子に印加される
起動制御電圧をそれぞれ直接供給し、前記電子機器を構
成する複数の回路に動作電圧をそれぞれ供給するために
複数配設されたスイッチ付レギュレータ電源の各起動時
間を前記各回路が回路Ａに対して動作を開始する順序に
従って前記各電源間の起動遅延時間を設定制御するよう
にしたことを特徴とするスイッチ付レギュレータ電源の
起動制御方法。 - 【請求項２】 テレビジョン受像機等の電子機器に配設
された複数のスイッチ付レギュレータ電源Ａ〜Ｍと、前
記各電源Ａ〜Ｍからそれぞれ動作電圧が供給される複数
の回路Ａ〜Ｎと、前記各電源Ａ〜Ｍを起動する制御信号
を出力するマイコンと、前記複数のスイッチ付レギュレ
ータ電源の中の電源Ａ〜Ｃの各出力端子にカソード側が
接続された複数のツェナーダイオードＤａ〜Ｄｃとを備
え、前記複数のツェナーダイオードＤａ〜Ｄｃのカソー
ド側を前記複数の各電源Ｂ〜Ｄの各スイッチ端子に接続
するとともに、前記複数の電源の中の任意の電源Ｈ〜Ｌ
の出力端子を前記複数の各電源Ｅ〜Ｍのスイッチ端子に
直接接続し、前記複数の各電源Ｂ〜Ｄのスイッチ端子に
ツェナーダイオードＤａ〜Ｄｃのアノード側が接続され
た前記複数の電源Ｂ〜Ｄを前記電源Ａ〜Ｃに対して各ツ
ェナーダイオードＤａ〜Ｄｃのツェナー電圧に達する迄
の立上り時間によって設定された各遅延時間それぞれ遅
延させ、前記複数の電源Ａ〜Ｄを電源Ａ〜Ｄの順に順次
遅延させて起 動させるとともに、前記電源Ａの出力電圧
が各スイッチ端子に直接供給される複数の電源Ｅ〜Ｍを
前記マイコンにより前記電源Ａと同時に動作させるよう
にしたことを特徴とするスイッチ付レギュレータ電源の
起動制御回路。 - 【請求項３】 マイコンからの制御信号により起動する
複数のスイッチ付レギュレータ電源によりそれぞれ動作
電圧が供給され、それぞれ起動時間が異なる複数の回路
を備えたテレビジョン受信機等の電子機器において、前
記複数のスイッチ付レギュレータ電源は、前記マイコン
から直接起動制御電圧がスイッチ端子に供給される電源
と、他のスイッチ付レギュレータ電源の出力電圧が直接
スイッチ端子に供給される電源と、他のスイッチ付レギ
ュレータ電源の出力電圧がツェナーダイオードを介して
スイッチ端子に供給される電源とで構成され、複数のス
イッチ付レギュレータ電源の中の任意の複数の電源は前
記マイコンからの起動制御信号により起動して複数の回
路を動作させ、又、他の任意の複数の電源は他の電源が
起動してから一定時間遅延して起動して複数の回路を動
作させ、更に、他の複数の電源は順次一定時間ずつ遅延
して起動し、複数の回路を順次一定時間ずつ遅延して動
作させるようにしたことを特徴とするスイッチ付レギュ
レータ電源の起動制御方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP07586794A JP3284742B2 (ja) | 1994-04-14 | 1994-04-14 | スイッチ付レギュレータ電源の起動制御回路および方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP07586794A JP3284742B2 (ja) | 1994-04-14 | 1994-04-14 | スイッチ付レギュレータ電源の起動制御回路および方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07288928A JPH07288928A (ja) | 1995-10-31 |
| JP3284742B2 true JP3284742B2 (ja) | 2002-05-20 |
Family
ID=13588641
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP07586794A Expired - Fee Related JP3284742B2 (ja) | 1994-04-14 | 1994-04-14 | スイッチ付レギュレータ電源の起動制御回路および方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3284742B2 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3405871B2 (ja) | 1995-11-28 | 2003-05-12 | 富士通株式会社 | 直流−直流変換制御回路および直流−直流変換装置 |
| JP2002171665A (ja) * | 2000-12-05 | 2002-06-14 | Murata Mach Ltd | 電子機器 |
| JP4739904B2 (ja) * | 2005-10-19 | 2011-08-03 | 三洋電機株式会社 | 電源回路 |
| JP2008059141A (ja) * | 2006-08-30 | 2008-03-13 | Seiko Epson Corp | 複合型システム電源回路 |
-
1994
- 1994-04-14 JP JP07586794A patent/JP3284742B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH07288928A (ja) | 1995-10-31 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |