JPS58103053A - 共有記憶システム - Google Patents
共有記憶システムInfo
- Publication number
- JPS58103053A JPS58103053A JP20132481A JP20132481A JPS58103053A JP S58103053 A JPS58103053 A JP S58103053A JP 20132481 A JP20132481 A JP 20132481A JP 20132481 A JP20132481 A JP 20132481A JP S58103053 A JPS58103053 A JP S58103053A
- Authority
- JP
- Japan
- Prior art keywords
- shared storage
- central processing
- shared
- storage devices
- processing unit
- Prior art date
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- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/16—Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
- G06F15/163—Interprocessor communication
- G06F15/167—Interprocessor communication using a common memory, e.g. mailbox
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Theoretical Computer Science (AREA)
- Software Systems (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Multi Processors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の属する分
この発明は計算機システムにおける共有記憶装置に関す
るものである。
るものである。
従来技術の構成
従来、この種の装置として第1図に示すものがあった。
図において(1)は共有記憶装置、 (2+。
(3)、 +41. (51はそれぞれ中央処理装置、
(61,+71. (81゜(9)はそれぞれ共有記
憶装置(1)と中央処理装置(2)(1) +31. +41. +5)を接続するケーブルを示す
。
(61,+71. (81゜(9)はそれぞれ共有記
憶装置(1)と中央処理装置(2)(1) +31. +41. +5)を接続するケーブルを示す
。
従来技術の動作
次に動作について説明する。中央処理装置(2)+3)
、 +41. +51は、それぞれ共有記憶装置(1)
を各インタフイスを介して共有してアクセスできる。
、 +41. +51は、それぞれ共有記憶装置(1)
を各インタフイスを介して共有してアクセスできる。
従来技術の欠点
従来の共有記憶装置として、中央処理装置とは別個のシ
ャーシを必要とし、また2例えば共有記憶装置の電源に
故障が発生したような場合共有記憶システム全体の重障
害となるなどの欠点があった。
ャーシを必要とし、また2例えば共有記憶装置の電源に
故障が発生したような場合共有記憶システム全体の重障
害となるなどの欠点があった。
発明の目的
この発明は上記のような従来のものの欠点を除去するた
めになされたもので、別個の共有記憶装置用のシャーシ
を設けず、各中央処理装置内に分散配置することにより
安価に、かつ信頼性の高い共有記憶システムを提供する
ことを目的としている。
めになされたもので、別個の共有記憶装置用のシャーシ
を設けず、各中央処理装置内に分散配置することにより
安価に、かつ信頼性の高い共有記憶システムを提供する
ことを目的としている。
本発明の構成
以下この発明の一実施例を図について説明す(2)
る。第2図において、 (2++31+4051は中央
処理装置。
処理装置。
(21)■(23H24)は各中央処理装置(21(3
) +4+ +5+内に分散配置された共有記憶、(2
51は分散された共有記憶(21)(221t23)(
財)を接続する共有記憶バスケーブルである。
) +4+ +5+内に分散配置された共有記憶、(2
51は分散された共有記憶(21)(221t23)(
財)を接続する共有記憶バスケーブルである。
第3図は第2図をさらに詳細に示したものであり、 (
2H3+は中央処理装置全体、婦)は第2図と同様に共
有記憶バス、 (311は共有記憶インタフェイス、(
32は共有記憶、 (331は各中央処理装置個有の主
記憶、(34)はCPLT、(35+はCP U (3
4)、主記憶+331 、共有記憶(3’lJ 、共有
記憶インタフェイスGllを接続するシステムバスであ
る。
2H3+は中央処理装置全体、婦)は第2図と同様に共
有記憶バス、 (311は共有記憶インタフェイス、(
32は共有記憶、 (331は各中央処理装置個有の主
記憶、(34)はCPLT、(35+はCP U (3
4)、主記憶+331 、共有記憶(3’lJ 、共有
記憶インタフェイスGllを接続するシステムバスであ
る。
本発明の動作各中央処理装置内に分散配置された共有記
憶(3力はそれぞれ共有記憶バス(25)で接続される
共有記憶インタフェイスGl+を介し、さらに中央処理
装置内のシステムバス(35)によって互に接続されて
いる。同様に各CP U t341ともシステムバス(
35)によって接続される。従ってCPLIは自分の中
央処理装置内の共有記憶も、他の中央処理装置内に配置
されている共有記憶も自由にアクセスすることが可能で
ある。
憶(3力はそれぞれ共有記憶バス(25)で接続される
共有記憶インタフェイスGl+を介し、さらに中央処理
装置内のシステムバス(35)によって互に接続されて
いる。同様に各CP U t341ともシステムバス(
35)によって接続される。従ってCPLIは自分の中
央処理装置内の共有記憶も、他の中央処理装置内に配置
されている共有記憶も自由にアクセスすることが可能で
ある。
(3)
このような実装方式をとることにより、共有記憶装置と
して中央処理装置と別に用意する必要はなく、安価にシ
ステムを構成することができ、かつ例えば中央処理装置
のどれか1つが故障して切りはなされても、残りの部分
で共有記憶システムを維持することも可能である。
して中央処理装置と別に用意する必要はなく、安価にシ
ステムを構成することができ、かつ例えば中央処理装置
のどれか1つが故障して切りはなされても、残りの部分
で共有記憶システムを維持することも可能である。
本発明の他の実施例
なお、上記実施例では中央処理装置を4台として説明し
たが何台でもか1わない。すなわち。
たが何台でもか1わない。すなわち。
従来の方式では共有記憶装置のケーブルインタフェイス
のコネクタの数による中央処理装置の接続台数への制限
も存在するが1木刀式によれば共有記憶バス方式のため
上記のような制約は存在しない。
のコネクタの数による中央処理装置の接続台数への制限
も存在するが1木刀式によれば共有記憶バス方式のため
上記のような制約は存在しない。
本発明の効果
以上のように、この発明によれば共有記憶をバス方式で
接続し、中央処理装置内に分散配置したので、システム
が安価にでキ、−!た信頼性の高いものが得られる効果
がある。
接続し、中央処理装置内に分散配置したので、システム
が安価にでキ、−!た信頼性の高いものが得られる効果
がある。
(4)
第1図は従来の共有記憶システムを示すブロック図、第
2図はこの発明の一実施例の概略構成を示すブロック図
、第3図は第2図をより詳細に示したブロック図である
。図において(1)は共有記憶装置、 (21f31(
4H51は中央処理装置、 +6171F81 +9+
は共有記憶ケーブル、 CI!II (J2+ (23
+ +24i国は共有記憶、(ハ)は共有記憶バスまた
はバスケーブル、 (311は共有記憶インクフェイス
、 +331は主記憶、(財)はCPLT、(35+は
システムバスである。なお9図中。 同一符号は同一、または相当部分を示す。 代理人 葛 野 信 − (5) 事 1 賄 奉 Z 恥
2図はこの発明の一実施例の概略構成を示すブロック図
、第3図は第2図をより詳細に示したブロック図である
。図において(1)は共有記憶装置、 (21f31(
4H51は中央処理装置、 +6171F81 +9+
は共有記憶ケーブル、 CI!II (J2+ (23
+ +24i国は共有記憶、(ハ)は共有記憶バスまた
はバスケーブル、 (311は共有記憶インクフェイス
、 +331は主記憶、(財)はCPLT、(35+は
システムバスである。なお9図中。 同一符号は同一、または相当部分を示す。 代理人 葛 野 信 − (5) 事 1 賄 奉 Z 恥
Claims (1)
- 複数の中央処理装置が使用する共有記憶を備えるシステ
ムにおいて1個々の中央処理装置内に記憶装置を分散実
装し、上記各中央処理装置内をシステムバスにて接続す
るとともに、上記側々の中央処理装置内の記憶装置をイ
ンターフェイスを介して接続したことを特徴とする共有
記憶システム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20132481A JPS58103053A (ja) | 1981-12-14 | 1981-12-14 | 共有記憶システム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20132481A JPS58103053A (ja) | 1981-12-14 | 1981-12-14 | 共有記憶システム |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58103053A true JPS58103053A (ja) | 1983-06-18 |
Family
ID=16439117
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP20132481A Pending JPS58103053A (ja) | 1981-12-14 | 1981-12-14 | 共有記憶システム |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58103053A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6938078B1 (en) | 1998-12-09 | 2005-08-30 | Nec Corporation | Data processing apparatus and data processing method |
-
1981
- 1981-12-14 JP JP20132481A patent/JPS58103053A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6938078B1 (en) | 1998-12-09 | 2005-08-30 | Nec Corporation | Data processing apparatus and data processing method |
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