JPS59135554A - 計算機システム間通信方式 - Google Patents

計算機システム間通信方式

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Publication number
JPS59135554A
JPS59135554A JP58009548A JP954883A JPS59135554A JP S59135554 A JPS59135554 A JP S59135554A JP 58009548 A JP58009548 A JP 58009548A JP 954883 A JP954883 A JP 954883A JP S59135554 A JPS59135554 A JP S59135554A
Authority
JP
Japan
Prior art keywords
partition
communication
computer systems
service processor
processor
Prior art date
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Pending
Application number
JP58009548A
Other languages
English (en)
Inventor
Hiroshi Iiyama
飯山 弘
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
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Publication of JPS59135554A publication Critical patent/JPS59135554A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/22Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing

Landscapes

  • Engineering & Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Hardware Redundancy (AREA)
  • Maintenance And Management Of Digital Transmission (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (a)発明の技術分野 本発明は複数のパーティション(処理プログラムが動作
する領域であり、中央処理装置、記憶装置、チャネル制
御装置等の集合体)を有する計算機システムのパーティ
ション毎に運転及び保守診断を実行するサービスプロセ
ッサに係り、特に該サービスプロセッサを経由して計算
機システム間の通信を可能とする計算機システム間通信
方式に関する。
(b)従来技術と問題点 従来、計算機システム間の通信を行うには、3M信制御
装置又はチャネル間結合装置等を用いる方式がある。こ
れらの方式では、パーティションを構成する本体系装置
の中央処理装置、記憶装置。
チャネル制御装置等のいずれか一つでも障害が発生する
と、計算機システム間の通信が不可能となり、計算機シ
ステム切り換え時等に於ける緊急の各種情報が計算機ソ
ステム間で転送出来ない欠点がある。
(C)発明の目的 本発明の目的は上記欠点を除く為、複数のパーティショ
ンを有する計算機システムに於て、パーティション毎の
運転及び保守診断を実行するサービスプロセンサに、サ
ービスプロセッサ相互に通信する手段を設げ、計算機シ
ステム間の通信を可能とするのみならず2本体系装置の
ダウン時にも。
計算機システム間の情報交換が可能となる計算機システ
ム間通信方式を提供することにある。
(d)発明の構成 本発明の構成は複数のパーティションを有する計算機シ
ステムに於て、パーティション毎の運転及び保守診断を
実行するサービスプロセッサに。
サービスプロセッサ相互に通信する手段を設け。
通常の計算機システム間通信を可能とするのみならず、
パーティションを構成する本体系装置に障害が発生した
場合に於ても、該手段を介して計算機システム切り換え
時等の各種情報の緊急通信を可能とする様にしたもので
ある。
(e)発明の実施例 第1図は本発明の一実施例を示す計算機システム間の通
信方式を説明するブロック図である。パーティション6
及び7は同一構成の為、パーティション7については大
部分省略しである。サービスプロセッサ1はメモリ制御
装置2及びメモリ制御語N2を経て記1.a装置3と中
央処理装置4及びチャネル制御装置5を統轄管理し、こ
れら各装置の運転及び保守診断を行う。パーティション
6に所Bするサービスプロセッサ1ばパーティション7
に所属するサービスプロセッサ1”との間に相互の通信
を行う回路を設ける。
第2図は第1図に於&ノるサービスプロセッサ1の詳細
ブロック図である。サービスプロセッサ1゛はサービス
プロセッサ1と同一である。マイクロプロセッサ8は共
通バス12を経てメモリ9.メモリ制御装置アダプタ1
0及びザーヒスプロセソザアダプタ11を制御し、メモ
リ制御装置アダプタ10を介してメモリ制御装置2と接
続し、前記の如(メモリ制御装置2.記憶装置3.中央
処理装置4及びチャネル制御装置5の運転及び保守診断
を実行する。又マイクロプロセッサ8はサービスプロセ
ッサアダプタ11を介して例えばパーティション6に所
属するサービスプロセッサ1の場合、相手のパーティシ
ョン7に所属するサービスプロセッサ1゛のサービスプ
ロセッサアダプタ11゛と通信回線等を経て接続し、メ
モリ9の内容を相手パーティション7のサービスプロセ
ッサ1″に転送シたり、逆に相手パーティション7のサ
ービスプロセッサ1′から受信した情報をメモ1)9に
才各納したりする゛。
上記の如く動作する為、パーティション6のメモリ制御
装置2.記憶装置3.中央処理装置4゜チャネル制御装
置5の各装置のいずれかGこ障害力(発生した場合、パ
ーティション6の機能は停止し。
パーティション7に切り替るが、)ぐ−テイション6の
サービスプロセ、7す1は動作可能である為。
それ迄に蓄積した種々の情報をノぐ−テイション7のサ
ービスプロセッサ1′に転送することが出来る。
(f)発明の詳細 な説明した如く3本発明は計算機システム間の通信を可
能とするのみならず、パーティションを構成する本体系
装置がダウンした時にも、該ノ々−ティションに所属す
るサービスプロセ・ノサ番こより、他のパーティション
のサービスプロセ・ノサを経て計算機システム間の情報
交換が可能となる為。
その効果は大なるものがある。
【図面の簡単な説明】
第1図は本発明の一実施例を示す計算機システム間の通
信方式を説明するプロ・ツク図、第2Jま第1図に於け
る号−ビスプロセ・ノサ1の詳細ブロック図である。 1.1“はサービスプロセ・ノサ、2はメモリ制御装置
、3は記憶装置、4は中央処理装置、5はチャネル制御
装置、6.7はパーティション、8はマイクロプロセ・
7す、9はメモリ、10はメモリ制御装置アダプタ、1
1.11’はサービスプロセッサアダプタである。

Claims (1)

    【特許請求の範囲】
  1. 複数のパーティションを有する計算機システムに於て、
    パーティション毎の運転及び保守診断を実行するサービ
    スプロセッサに、サービスプロセッサ相互に通信する手
    段を設け2通常の計算機システム間通信を可能とするの
    みならず、パーティションを構成する本体系装置に障害
    が発生した場合に於ても、該手段量分して計算機システ
    ム切り換え時等の各種情報の緊急通信を可能とすること
    を特徴とする計算機システム間通信方式。
JP58009548A 1983-01-24 1983-01-24 計算機システム間通信方式 Pending JPS59135554A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58009548A JPS59135554A (ja) 1983-01-24 1983-01-24 計算機システム間通信方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58009548A JPS59135554A (ja) 1983-01-24 1983-01-24 計算機システム間通信方式

Publications (1)

Publication Number Publication Date
JPS59135554A true JPS59135554A (ja) 1984-08-03

Family

ID=11723323

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58009548A Pending JPS59135554A (ja) 1983-01-24 1983-01-24 計算機システム間通信方式

Country Status (1)

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JP (1) JPS59135554A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62296264A (ja) * 1986-06-16 1987-12-23 Nec Corp デ−タ処理システムの構成制御方式
JPS6385939A (ja) * 1986-09-30 1988-04-16 Nec Corp 情報処理システム

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62296264A (ja) * 1986-06-16 1987-12-23 Nec Corp デ−タ処理システムの構成制御方式
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