JPH1083160A - プラズマディスプレイパネルの駆動方法 - Google Patents
プラズマディスプレイパネルの駆動方法Info
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of Gas Discharge Display Tubes (AREA)
- Gas-Filled Discharge Tubes (AREA)
Abstract
(57)【要約】
【課題】 誤放電のない安定した表示動作が可能なプラ
ズマディスプレイパネルの駆動方法を提供することを目
的とする。 【解決手段】 複数の行電極対と、行電極対に交差して
配列された複数の列電極とを有し、第１のリセットパル
スを印加して行電極対間に放電を生じさせる一斉リセッ
ト期間と、画素データに応じて点灯及び消灯画素を選択
するアドレス期間と、点灯及び消灯画素を維持する維持
放電期間とを用いて表示を行うプラズマディスプレイパ
ネルの駆動方法であって、一斉リセット期間において第
１のリセットパルスの終了直後に行電極対の内の一方の
行電極に第２のリセットパルスを印加することを特徴と
する。
ズマディスプレイパネルの駆動方法を提供することを目
的とする。 【解決手段】 複数の行電極対と、行電極対に交差して
配列された複数の列電極とを有し、第１のリセットパル
スを印加して行電極対間に放電を生じさせる一斉リセッ
ト期間と、画素データに応じて点灯及び消灯画素を選択
するアドレス期間と、点灯及び消灯画素を維持する維持
放電期間とを用いて表示を行うプラズマディスプレイパ
ネルの駆動方法であって、一斉リセット期間において第
１のリセットパルスの終了直後に行電極対の内の一方の
行電極に第２のリセットパルスを印加することを特徴と
する。
Description
【０００１】
【発明の属する技術分野】本発明は、マトリクス表示方
式の面放電型のプラズマディスプレイパネル（ＰＤＰ）
の駆動方法に関する。
式の面放電型のプラズマディスプレイパネル（ＰＤＰ）
の駆動方法に関する。
【０００２】
【従来の技術】本出願人は、先に特願平７−９０９７７
号の出願にてアドレスマージンが大幅に改善され、誤放
電の無い正確な発光表示を得ることができるＰＤＰの駆
動方法を提案している。図５は、かかる駆動方法を示
し、ＰＤＰに印加される各種パルスの印加タイミングを
示す図である。プラズマディスプレイパネルは、周知の
如く、薄型の２次画面表示器の１つとして近時種々の研
究がなされており、その１つにメモリ機能を有する交流
型放電型マトリクス方式のプラズマディスプレイパネル
が知られている。図４は、かかるプラズマディスプレイ
パネルを含むプラズマディスプレイ装置の概略構成を示
す図である。
号の出願にてアドレスマージンが大幅に改善され、誤放
電の無い正確な発光表示を得ることができるＰＤＰの駆
動方法を提案している。図５は、かかる駆動方法を示
し、ＰＤＰに印加される各種パルスの印加タイミングを
示す図である。プラズマディスプレイパネルは、周知の
如く、薄型の２次画面表示器の１つとして近時種々の研
究がなされており、その１つにメモリ機能を有する交流
型放電型マトリクス方式のプラズマディスプレイパネル
が知られている。図４は、かかるプラズマディスプレイ
パネルを含むプラズマディスプレイ装置の概略構成を示
す図である。
【０００３】かかる図４において、駆動装置１００は、
入力されたビデオ信号を１画素毎に対応したデジタルの
画素データに変換して、この画素データに対応した画素
データパルスをＰＤＰ（プラズマディスプレイパネル）
１１の列電極Ｄ1 〜Ｄm に印加する。ＰＤＰ１１は、上
記列電極Ｄ1 〜Ｄm 、及びかかる列電極と直交し且つＸ
及びＹなる一対にて１行を構成する行電極Ｘ1 〜Ｘn 及
びＹ1 〜Ｙn を備えている。これら列電極及び行電極対
各々は図示せぬ誘電体を挟んで形成されており、１つの
列電極及び行電極対が交差する部分に１つの画素セルが
形成される。
入力されたビデオ信号を１画素毎に対応したデジタルの
画素データに変換して、この画素データに対応した画素
データパルスをＰＤＰ（プラズマディスプレイパネル）
１１の列電極Ｄ1 〜Ｄm に印加する。ＰＤＰ１１は、上
記列電極Ｄ1 〜Ｄm 、及びかかる列電極と直交し且つＸ
及びＹなる一対にて１行を構成する行電極Ｘ1 〜Ｘn 及
びＹ1 〜Ｙn を備えている。これら列電極及び行電極対
各々は図示せぬ誘電体を挟んで形成されており、１つの
列電極及び行電極対が交差する部分に１つの画素セルが
形成される。
【０００４】駆動装置１００は、上記ＰＤＰ１１の全て
の上記行電極対間に強制的に放電励起せしめて壁電荷を
形成（もしくは消去）させるためのプライミングパルス
ＰＰｘ及びＰＰｙを発生してこれらをＰＤＰ１１の行電
極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn夫々に印加する。又、駆動
装置１００は、ＰＤＰ１１に上記画素データを書き込む
ための走査パルスＳＰ、放電発光を維持するための維持
パルスＩＰｘ及びＩＰｙ、更に、維持放電発光を停止さ
せるための消去パルスＥＰの各々を発生してこれらをＰ
ＤＰ１１の行電極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn に印加す
る。
の上記行電極対間に強制的に放電励起せしめて壁電荷を
形成（もしくは消去）させるためのプライミングパルス
ＰＰｘ及びＰＰｙを発生してこれらをＰＤＰ１１の行電
極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn夫々に印加する。又、駆動
装置１００は、ＰＤＰ１１に上記画素データを書き込む
ための走査パルスＳＰ、放電発光を維持するための維持
パルスＩＰｘ及びＩＰｙ、更に、維持放電発光を停止さ
せるための消去パルスＥＰの各々を発生してこれらをＰ
ＤＰ１１の行電極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn に印加す
る。
【０００５】次に、各種駆動パルスの印加タイミングに
ついて図５を参照して説明する。図５において、先ず、
駆動装置１００は、負電圧のリセットパルスＲＰｘを全
ての行電極Ｘ1 〜Ｘn に印加すると同時に、正電圧のリ
セットパルスＲＰｙを行電極Ｙ1 〜Ｙn の各々に印加す
る。かかるリセットパルスの印加によりＰＤＰ１１の全
ての行電極対問に放電が生じる。かかる放電により、各
画素セル内において荷電粒子が発生し、その放電終息後
に壁電荷が蓄積形成される（一斉リセット行程）。ここ
で、リセットパルスＲＰｘ，ＲＰｙは、表示に関係ない
リセットパルスによる放電発光を抑え、コントラストを
向上させるために、（長時定数）のパルスを用いてい
る。
ついて図５を参照して説明する。図５において、先ず、
駆動装置１００は、負電圧のリセットパルスＲＰｘを全
ての行電極Ｘ1 〜Ｘn に印加すると同時に、正電圧のリ
セットパルスＲＰｙを行電極Ｙ1 〜Ｙn の各々に印加す
る。かかるリセットパルスの印加によりＰＤＰ１１の全
ての行電極対問に放電が生じる。かかる放電により、各
画素セル内において荷電粒子が発生し、その放電終息後
に壁電荷が蓄積形成される（一斉リセット行程）。ここ
で、リセットパルスＲＰｘ，ＲＰｙは、表示に関係ない
リセットパルスによる放電発光を抑え、コントラストを
向上させるために、（長時定数）のパルスを用いてい
る。
【０００６】次に、駆動装置１００は、各行毎の画素デ
ータに対応した画素データパルスＤＰ1 〜ＤＰn を順
次、列電極Ｄ1 〜Ｄn に印加する。駆動装置１００は、
上記画素データパルスＤＰ1 〜ＤＰn 夫々の印加タイミ
ングに同期して走査パルスＳＰを行電極Ｙ1 〜Ｙn へ順
次印加して行く。この際、かかる画素データパルスＤ
Ｐ、及び走査パルスＳＰが夫々列電極及び行電極に同時
に印加された画素セルにのみ放電が生じて、上記一斉リ
セットにて形成された壁電荷の大半が消滅する。
ータに対応した画素データパルスＤＰ1 〜ＤＰn を順
次、列電極Ｄ1 〜Ｄn に印加する。駆動装置１００は、
上記画素データパルスＤＰ1 〜ＤＰn 夫々の印加タイミ
ングに同期して走査パルスＳＰを行電極Ｙ1 〜Ｙn へ順
次印加して行く。この際、かかる画素データパルスＤ
Ｐ、及び走査パルスＳＰが夫々列電極及び行電極に同時
に印加された画素セルにのみ放電が生じて、上記一斉リ
セットにて形成された壁電荷の大半が消滅する。
【０００７】―方、走査パルスＳＰが印加されたものの
画素データパルスＤＰが印加されない画素セルにおいて
は、上述の如き放電が生じないので、上記一斉リセット
にて形成された所望量の壁電荷はそのまま残留する。つ
まり、上記一斉リセットにて形成された所望量の壁電荷
は、画素データの内容に応じて選択的に消去されるので
ある（画素データ書込行程）。
画素データパルスＤＰが印加されない画素セルにおいて
は、上述の如き放電が生じないので、上記一斉リセット
にて形成された所望量の壁電荷はそのまま残留する。つ
まり、上記一斉リセットにて形成された所望量の壁電荷
は、画素データの内容に応じて選択的に消去されるので
ある（画素データ書込行程）。
【０００８】次に、駆動装置１００は、正極性の維持パ
ルスＩＰｘを連続して行電極Ｘ1 〜Ｘn の夫々に印加す
ると共に、かかる維持パルスＩＰｘの印加タイミングと
は、ずれたタイミングにて正極性の維持パルスＩＰｙを
連続して行電極Ｙ1 〜Ｙn の夫々に印加する。かかる維
持パルスが連続して印加されている期間にわたり上記壁
電荷が残留したままになっている画素セルのみが放電発
光を維持する（維持放電行程）。
ルスＩＰｘを連続して行電極Ｘ1 〜Ｘn の夫々に印加す
ると共に、かかる維持パルスＩＰｘの印加タイミングと
は、ずれたタイミングにて正極性の維持パルスＩＰｙを
連続して行電極Ｙ1 〜Ｙn の夫々に印加する。かかる維
持パルスが連続して印加されている期間にわたり上記壁
電荷が残留したままになっている画素セルのみが放電発
光を維持する（維持放電行程）。
【０００９】次に、駆動装置１００は、消去パルスＥＰ
を行電極Ｘ1 〜Ｘn 夫々に印加することにより、上記維
持放電を停止せしめる（維持放電停止行程）。
を行電極Ｘ1 〜Ｘn 夫々に印加することにより、上記維
持放電を停止せしめる（維持放電停止行程）。
【００１０】
【発明が解決しようとする課題】ところで、上述の駆動
方法では、一斉リセット期間において放電維持パルスに
比して立ち上がり又は立ち下がり時間が十分長いリセッ
トパルスを用いているので、リセット放電が維持放電に
比して非常に弱いものとなっている。そのため、一斉リ
セット期間において各画素セルで放電するタイミングが
異なり、各画素セルで形成される壁電荷量が異なること
となる。従って、次のアドレス期間における動作が不安
定になる。本発明は、かかる問題を解決するためになさ
れたものであり、誤放電のない安定した表示動作が可能
なプラズマディスプレイパネルの駆動方法を提供するこ
とを目的とする。
方法では、一斉リセット期間において放電維持パルスに
比して立ち上がり又は立ち下がり時間が十分長いリセッ
トパルスを用いているので、リセット放電が維持放電に
比して非常に弱いものとなっている。そのため、一斉リ
セット期間において各画素セルで放電するタイミングが
異なり、各画素セルで形成される壁電荷量が異なること
となる。従って、次のアドレス期間における動作が不安
定になる。本発明は、かかる問題を解決するためになさ
れたものであり、誤放電のない安定した表示動作が可能
なプラズマディスプレイパネルの駆動方法を提供するこ
とを目的とする。
【００１１】
【課題を解決するための手段】請求項１の発明は、複数
の行電極対と、行電極対に交差して配列された複数の列
電極とを有し、行電極対と列電極の各交差する点毎に画
定される画素セルとを有し、全ての行電極対間に放電維
持パルスに比して立ち上がり又は立ち下がり時間が十分
長い第１のリセットパルスを印加して行電極対間に放電
を生じさせる一斉リセット期間と、行電極対に走査パル
スを印加するとともに列電極に画素データパルスを印加
して画素データに応じて点灯及び消灯画素を選択するア
ドレス期間と、行電極対に交互に放電維持パルスを印加
して点灯及び消灯画素を維持する維持放電期間とを用い
て表示を行うプラズマディスプレイパネルの駆動方法で
あって、一斉リセット期間において第１のリセットパル
スの終了直後に行電極対の内の一方の行電極に第２のリ
セットパルスを印加することを特徴とする。
の行電極対と、行電極対に交差して配列された複数の列
電極とを有し、行電極対と列電極の各交差する点毎に画
定される画素セルとを有し、全ての行電極対間に放電維
持パルスに比して立ち上がり又は立ち下がり時間が十分
長い第１のリセットパルスを印加して行電極対間に放電
を生じさせる一斉リセット期間と、行電極対に走査パル
スを印加するとともに列電極に画素データパルスを印加
して画素データに応じて点灯及び消灯画素を選択するア
ドレス期間と、行電極対に交互に放電維持パルスを印加
して点灯及び消灯画素を維持する維持放電期間とを用い
て表示を行うプラズマディスプレイパネルの駆動方法で
あって、一斉リセット期間において第１のリセットパル
スの終了直後に行電極対の内の一方の行電極に第２のリ
セットパルスを印加することを特徴とする。
【００１２】請求項２の発明は、請求項１記載のプラズ
マディスプレイパネルの駆動方法であって、第１のリセ
ットパルスは、行電極対の内の一方の行電極に印加され
る所定極性のリセットパルスと、行電極対の内の他方の
行電極に同時に印加される所定極性とは逆極性のリセッ
トパルスとからなり、第２のリセットパルスは、行電極
対の内の一方の行電極に印加される所定極性のリセット
パルスとは逆極性であることを特徴とする。請求項３の
発明は、請求項１又は２記載のプラズマディスプレイパ
ネルの駆動方法であって、アドレス期間において走査パ
ルスの直前に行電極対にプライミングパルスを印加する
ことを特徴とする。
マディスプレイパネルの駆動方法であって、第１のリセ
ットパルスは、行電極対の内の一方の行電極に印加され
る所定極性のリセットパルスと、行電極対の内の他方の
行電極に同時に印加される所定極性とは逆極性のリセッ
トパルスとからなり、第２のリセットパルスは、行電極
対の内の一方の行電極に印加される所定極性のリセット
パルスとは逆極性であることを特徴とする。請求項３の
発明は、請求項１又は２記載のプラズマディスプレイパ
ネルの駆動方法であって、アドレス期間において走査パ
ルスの直前に行電極対にプライミングパルスを印加する
ことを特徴とする。
【００１３】請求項４の発明は、請求項１乃至３のいず
れか１に記載のプラズマディスプレイパネルの駆動方法
であって、画素セル内の行電極の幅を３００μｍ以上と
したことを特徴とする。請求項５の発明は、請求項１乃
至３のいずれか１に記載のプラズマディスプレイパネル
の駆動方法であって、画素セル内の行電極対は、放電ギ
ャップを介して互いに対向して突出した突出部を有する
ことを特徴とする。請求項６の発明は、請求項５記載の
プラズマディスプレイパネルの駆動方法であって、突出
部は、放電ギャップ近傍の幅広部とそれに続く幅狭部と
を有することを特徴とする。
れか１に記載のプラズマディスプレイパネルの駆動方法
であって、画素セル内の行電極の幅を３００μｍ以上と
したことを特徴とする。請求項５の発明は、請求項１乃
至３のいずれか１に記載のプラズマディスプレイパネル
の駆動方法であって、画素セル内の行電極対は、放電ギ
ャップを介して互いに対向して突出した突出部を有する
ことを特徴とする。請求項６の発明は、請求項５記載の
プラズマディスプレイパネルの駆動方法であって、突出
部は、放電ギャップ近傍の幅広部とそれに続く幅狭部と
を有することを特徴とする。
【００１４】
【作用】請求項１の発明は、プラズマディスプレイパネ
ルの駆動方法の一斉リセット期間において第１のリセッ
トパルスの終了直後に行電極対の内の一方の行電極に第
２のリセットパルスを印加するようにしたので、第１リ
セットパルスで生じていた壁電荷の差を第２リセットパ
ルスの印加により軽減することができる。
ルの駆動方法の一斉リセット期間において第１のリセッ
トパルスの終了直後に行電極対の内の一方の行電極に第
２のリセットパルスを印加するようにしたので、第１リ
セットパルスで生じていた壁電荷の差を第２リセットパ
ルスの印加により軽減することができる。
【００１５】請求項２の発明では、第１のリセットパル
スは、行電極対の内の一方の行電極に印加される所定極
性のリセットパルスと、行電極対の内の他方の行電極に
同時に印加される所定極性とは逆極性のリセットパルス
とからなり、第２のリセットパルスは、行電極対の内の
一方の行電極に印加される所定極性のリセットパルスと
は逆極性となるようにしたので、第１リセットパルスで
生じていた壁電荷の差を第２リセットパルスの印加によ
り軽減することができる。請求項３の発明では、アドレ
ス期間において走査パルスの直前に行電極対にプライミ
ングパルスを印加するようにしたので、壁電荷量及び放
電形成を加速させるプライミング粒子の数が行毎に異な
らないようにすることができる。
スは、行電極対の内の一方の行電極に印加される所定極
性のリセットパルスと、行電極対の内の他方の行電極に
同時に印加される所定極性とは逆極性のリセットパルス
とからなり、第２のリセットパルスは、行電極対の内の
一方の行電極に印加される所定極性のリセットパルスと
は逆極性となるようにしたので、第１リセットパルスで
生じていた壁電荷の差を第２リセットパルスの印加によ
り軽減することができる。請求項３の発明では、アドレ
ス期間において走査パルスの直前に行電極対にプライミ
ングパルスを印加するようにしたので、壁電荷量及び放
電形成を加速させるプライミング粒子の数が行毎に異な
らないようにすることができる。
【００１６】請求項４の発明では、画素セル内の行電極
の幅を３００μｍ以上としたことにより、維持放電発光
を強くすることができる。請求項５の発明では、画素セ
ル内の行電極対が、放電ギャップを介して互いに対向し
て突出した突出部を有するようにしたので、リセット放
電を局所化することができる。請求項６の発明では、突
出部を、放電ギャップ近傍の幅広部とそれに続く幅狭部
とを有するようにしたので、リセット放電を局所化する
ことができる。
の幅を３００μｍ以上としたことにより、維持放電発光
を強くすることができる。請求項５の発明では、画素セ
ル内の行電極対が、放電ギャップを介して互いに対向し
て突出した突出部を有するようにしたので、リセット放
電を局所化することができる。請求項６の発明では、突
出部を、放電ギャップ近傍の幅広部とそれに続く幅狭部
とを有するようにしたので、リセット放電を局所化する
ことができる。
【００１７】
【発明の実施の形態】図１は、本発明による駆動方法に
てパネル駆動を行う駆動装置を備えたプラズマディスプ
レイ装置の構成を示す図である。かかる図１において、
同期分離回路１は、供給された入カビデオ信号中から水
平及び垂直同期信号を抽出してこれらをタイミングパル
ス発生回路２に供給する。タイミングパルス発生回路２
は、これら抽出された水平及び垂直同期信号に基づいた
抽出同期信号タイミングパルスを発生してこれをＡ／Ｄ
変換器３、メモリ制御回路５及び読出タイミング信号発
生回路７の各々に供給する。
てパネル駆動を行う駆動装置を備えたプラズマディスプ
レイ装置の構成を示す図である。かかる図１において、
同期分離回路１は、供給された入カビデオ信号中から水
平及び垂直同期信号を抽出してこれらをタイミングパル
ス発生回路２に供給する。タイミングパルス発生回路２
は、これら抽出された水平及び垂直同期信号に基づいた
抽出同期信号タイミングパルスを発生してこれをＡ／Ｄ
変換器３、メモリ制御回路５及び読出タイミング信号発
生回路７の各々に供給する。
【００１８】Ａ／Ｄ変換器３は、上記抽出同期信号タイ
ミングパルスに同期して入力ビデオ信号を１画素毎に対
応したデジタル画素データに変換し、これをフレームメ
モリ４に供給する。メモリ制御回路５は．上記抽出同期
信号タイミングパルスに同期した書込信号及び読出信号
をフレームメモリ４に供給する。フレームメモリ４は、
かかる書込信号に応じて、Ａ／Ｄ変操器３から供給され
た各画素データを順次取り込む。
ミングパルスに同期して入力ビデオ信号を１画素毎に対
応したデジタル画素データに変換し、これをフレームメ
モリ４に供給する。メモリ制御回路５は．上記抽出同期
信号タイミングパルスに同期した書込信号及び読出信号
をフレームメモリ４に供給する。フレームメモリ４は、
かかる書込信号に応じて、Ａ／Ｄ変操器３から供給され
た各画素データを順次取り込む。
【００１９】又、フレームメモリ４は、かかる読出信号
に応じて、このフレームメモリ４内に記憶されている画
素データを順次読み出して次段の出力処理回路６へ供給
する。読出タイミング信号発生回路７は、放電発光動作
を制御するための各種タイミング信号を発生してこれら
を行電極駆動パルス発生回路１０、及び出力処理回路６
の各々に供給する。出力処理回路６は、読出タイミング
信号発生回路７からのタイミング信号に同期させて、上
記フレームメモリ４から供給された画素データを画素デ
ータパルス発生回路１２に供給する。
に応じて、このフレームメモリ４内に記憶されている画
素データを順次読み出して次段の出力処理回路６へ供給
する。読出タイミング信号発生回路７は、放電発光動作
を制御するための各種タイミング信号を発生してこれら
を行電極駆動パルス発生回路１０、及び出力処理回路６
の各々に供給する。出力処理回路６は、読出タイミング
信号発生回路７からのタイミング信号に同期させて、上
記フレームメモリ４から供給された画素データを画素デ
ータパルス発生回路１２に供給する。
【００２０】画素データパルス発生回路１２は、出力処
理回路６から供給される各画素データに応じた画素デー
タパルスＤＰを発生して上記ＰＤＰ（プラズマディスプ
レイパネル）１１の列電極Ｄ1 〜Ｄm に印加する。行電
極駆動パルス発生回路１０は、上記ＰＤＰ１１の全ての
行電極対間に強制的に放電を励起せしめて後述する放電
空間に荷電粒子を発生させるための第１リセットパルス
ＲＰｘ1 及びＲＰｙ、第２リセットパルスＲＰｘ2 、上
記荷電粒子を再形成するためのプライミングパルスＰ
Ｐ、画素データ書き込みのための走査パルスＳＰ、放電
発光を維持するための維持パルスＩＰｘ及びＩＰｙ、更
に上記維持放電発光を停止させるための消去パルスＥＰ
の各々を発生して、これらを上記読出タイミング信号発
生回路７から供給された各種のタイミング信号に応じた
タイミングにてＰＤＰ１１の行電極Ｘ1 〜Ｘn 及びＹ1
〜Ｙn に印加する。
理回路６から供給される各画素データに応じた画素デー
タパルスＤＰを発生して上記ＰＤＰ（プラズマディスプ
レイパネル）１１の列電極Ｄ1 〜Ｄm に印加する。行電
極駆動パルス発生回路１０は、上記ＰＤＰ１１の全ての
行電極対間に強制的に放電を励起せしめて後述する放電
空間に荷電粒子を発生させるための第１リセットパルス
ＲＰｘ1 及びＲＰｙ、第２リセットパルスＲＰｘ2 、上
記荷電粒子を再形成するためのプライミングパルスＰ
Ｐ、画素データ書き込みのための走査パルスＳＰ、放電
発光を維持するための維持パルスＩＰｘ及びＩＰｙ、更
に上記維持放電発光を停止させるための消去パルスＥＰ
の各々を発生して、これらを上記読出タイミング信号発
生回路７から供給された各種のタイミング信号に応じた
タイミングにてＰＤＰ１１の行電極Ｘ1 〜Ｘn 及びＹ1
〜Ｙn に印加する。
【００２１】図６は、かかるＰＤＰ１１の構造を示す図
である。図６において、表示面である前面ガラス基板１
１０の内面（後述する背面ガラス基板１１３と対向する
面）には、互いに対となるように行電極Ｙ1 〜Ｙn 及び
行電極Ｘ1 〜Ｘn 夫々が形成されている。これら行電極
は、誘電体層１１１にて被覆されている。かかる誘電体
層１１１には、ＭｇＯ（酸化マグネシウム）層１１２が
蒸着されている。ＭｇＯ層１１２と背面ガラス基板１１
３との間には放電空間１１４が形成されている。背面ガ
ラス基板１１３には、蛍光体が塗布された列電極Ｄ1 〜
Ｄm が形成されている。この際、上記行電極Ｙ1 〜Ｙn
及び行電極Ｘ1 〜Ｘn は、Ｘ及びＹなる一対にて画像の
１行を形成するようになっており、この１行分の行電極
対Ｘi ，Ｙi (i=1, ‥‥,n )と、１つの列電極Ｄ
j (j=1, ‥‥,m )とが交差（上面から見て）する部分に
１つの画素セルＰi,j が形成される。
である。図６において、表示面である前面ガラス基板１
１０の内面（後述する背面ガラス基板１１３と対向する
面）には、互いに対となるように行電極Ｙ1 〜Ｙn 及び
行電極Ｘ1 〜Ｘn 夫々が形成されている。これら行電極
は、誘電体層１１１にて被覆されている。かかる誘電体
層１１１には、ＭｇＯ（酸化マグネシウム）層１１２が
蒸着されている。ＭｇＯ層１１２と背面ガラス基板１１
３との間には放電空間１１４が形成されている。背面ガ
ラス基板１１３には、蛍光体が塗布された列電極Ｄ1 〜
Ｄm が形成されている。この際、上記行電極Ｙ1 〜Ｙn
及び行電極Ｘ1 〜Ｘn は、Ｘ及びＹなる一対にて画像の
１行を形成するようになっており、この１行分の行電極
対Ｘi ，Ｙi (i=1, ‥‥,n )と、１つの列電極Ｄ
j (j=1, ‥‥,m )とが交差（上面から見て）する部分に
１つの画素セルＰi,j が形成される。
【００２２】図２は、上記の各種駆動パルスの印加タイ
ミングを示す図である。図２において、列電極Ｄ1 〜Ｄ
m には、画素データパルスＤＰ1 〜ＤＰn が所望の画素
に対応する行電極Ｙ1 〜Ｙn の走査パルスＳＰに同期し
て印加される。一斉リセット時には、負電圧の立ち上が
りの緩やかなリセットパルスＲＰｘ1 、すなわち第１リ
セットパルスＲＰｘ1 を全ての行電極Ｘ1 〜Ｘn に印加
すると同時に、正電圧の同じく立ち上がりの緩やかな第
１リセットパルスＲＰｙを行電極Ｙ1 〜Ｙn の各々に印
加する。かかるリセットパルスの印加によりＰＤＰ１１
の全ての行電極対問に放電が生じ、その放電終息後に壁
電荷が蓄積形成されるが、立ち上がりが緩いパルスのた
め、放電するタイミングが各画素セルで異なり壁電荷の
残量に差が生じる。
ミングを示す図である。図２において、列電極Ｄ1 〜Ｄ
m には、画素データパルスＤＰ1 〜ＤＰn が所望の画素
に対応する行電極Ｙ1 〜Ｙn の走査パルスＳＰに同期し
て印加される。一斉リセット時には、負電圧の立ち上が
りの緩やかなリセットパルスＲＰｘ1 、すなわち第１リ
セットパルスＲＰｘ1 を全ての行電極Ｘ1 〜Ｘn に印加
すると同時に、正電圧の同じく立ち上がりの緩やかな第
１リセットパルスＲＰｙを行電極Ｙ1 〜Ｙn の各々に印
加する。かかるリセットパルスの印加によりＰＤＰ１１
の全ての行電極対問に放電が生じ、その放電終息後に壁
電荷が蓄積形成されるが、立ち上がりが緩いパルスのた
め、放電するタイミングが各画素セルで異なり壁電荷の
残量に差が生じる。
【００２３】そこで、次に行電極Ｘ1 〜Ｘn に第１リセ
ットパルスＲＰｘ1 の終了直後に正電圧の立ち上がりが
比較的速い第２リセットパルスＲＰｘ2 を印加する。こ
の第２リセットパルスＲＰｘ2 の印加により行電極Ｘ，
Ｙ間の壁電荷が放電され、各画素セルの残留壁電荷量の
差は軽減され、プライミングパルスＰＰ以降の諸動作が
各画素セルに対し壁電荷の差による影響をほとんど受け
ることなく可能となる。
ットパルスＲＰｘ1 の終了直後に正電圧の立ち上がりが
比較的速い第２リセットパルスＲＰｘ2 を印加する。こ
の第２リセットパルスＲＰｘ2 の印加により行電極Ｘ，
Ｙ間の壁電荷が放電され、各画素セルの残留壁電荷量の
差は軽減され、プライミングパルスＰＰ以降の諸動作が
各画素セルに対し壁電荷の差による影響をほとんど受け
ることなく可能となる。
【００２４】また、プライミングパルスＰＰの印加は、
図２に示すように走査パルスＳＰの直前に行うようにし
たので、第２リセットパルスＲＰｙ2 の終了時からプラ
イミングパルスＰＰの印加までの期間が各行により異な
るが、プライミングパルスと走査パルスＳＰの間を短く
各行に対し同じくすることで、各画素セルにおける壁電
荷量及び放電形成を加速させる、プライミング粒子数が
ほぼ同じになるので、走査パルスＳＰでの安定したアド
レス動作を可能とすることができる。
図２に示すように走査パルスＳＰの直前に行うようにし
たので、第２リセットパルスＲＰｙ2 の終了時からプラ
イミングパルスＰＰの印加までの期間が各行により異な
るが、プライミングパルスと走査パルスＳＰの間を短く
各行に対し同じくすることで、各画素セルにおける壁電
荷量及び放電形成を加速させる、プライミング粒子数が
ほぼ同じになるので、走査パルスＳＰでの安定したアド
レス動作を可能とすることができる。
【００２５】なお、第２のリセットパルスＲＰｙ2 の印
加による放電発光により、コントラストは若干低下する
が、図３（ａ）に示すように、行電極Ｘj ，Ｙi の幅ｌ
を３００μｍ以上とすることにより電極面積を広くし、
維持放電発光を強めることにより相対的にコントラスト
を向上させるようにしても良い。また、図３（ｂ）、
（ｃ）のように、画素セル毎に行電極対に対向する突出
部Ｔを設け、または、突出部ＴをギャップＧ近傍の幅広
部と幅狭部で構成し、第１リセットパルスＲＰｘ1 ，Ｒ
Ｐｙ1 によるリセット放電をギャップＧ近傍に局所化す
ることによりリセット放電発光を弱め、相対的にコント
ラストを向上させるようにしても良い。
加による放電発光により、コントラストは若干低下する
が、図３（ａ）に示すように、行電極Ｘj ，Ｙi の幅ｌ
を３００μｍ以上とすることにより電極面積を広くし、
維持放電発光を強めることにより相対的にコントラスト
を向上させるようにしても良い。また、図３（ｂ）、
（ｃ）のように、画素セル毎に行電極対に対向する突出
部Ｔを設け、または、突出部ＴをギャップＧ近傍の幅広
部と幅狭部で構成し、第１リセットパルスＲＰｘ1 ，Ｒ
Ｐｙ1 によるリセット放電をギャップＧ近傍に局所化す
ることによりリセット放電発光を弱め、相対的にコント
ラストを向上させるようにしても良い。
【００２６】
【発明の効果】本発明のプラズマディスプレイパネルの
駆動方法によれば、長時定数の第１リセットパルスに続
く第２リセットパルスの印加によりコントラストを損な
うことなく各画素セルの壁電荷量の差を軽減することに
より、誤放電のない安定した表示動作が可能となる。
駆動方法によれば、長時定数の第１リセットパルスに続
く第２リセットパルスの印加によりコントラストを損な
うことなく各画素セルの壁電荷量の差を軽減することに
より、誤放電のない安定した表示動作が可能となる。
【図１】本発明の実施の形態によるプラズマディスプレ
イパネルの駆動装置を示す図である。
イパネルの駆動装置を示す図である。
【図２】本発明の実施の形態によるプラズマディスプレ
イパネルの駆動パルスの印加タイミングを示す図であ
る。
イパネルの駆動パルスの印加タイミングを示す図であ
る。
【図３】本発明の実施の形態による行電極対の構造を示
す上面図である。
す上面図である。
【図４】従来のプラズマディスプレイ装置の概略構成を
示す図である。
示す図である。
【図５】従来のプラズマディスプレイパネルの駆動パル
スの印加タイミングを示す図である。
スの印加タイミングを示す図である。
【図６】プラズマディスプレイパネルの構造を示す図で
ある。
ある。
１ ・・・・・ 同期分離回路 ２ ・・・・・ タイミングパルス発生回路 ３ ・・・・・ Ａ／Ｄ変換器 ４ ・・・・・ フレームメモリ ５ ・・・・・ メモリ制御回路 ６ ・・・・・ 出力処理回路 ７ ・・・・・ 読出タイミング信号発生回路 １０ ・・・・・ 行電極駆動パルス発生回路 １１ ・・・・・ ＰＤＰ １２ ・・・・・ 画素データパルス発生回路 １００ ・・・・・ 駆動装置 １１０ ・・・・・ 前面ガラス基板 １１１ ・・・・・ 誘電体層 １１２ ・・・・・ ＭｇＯ層 １１３ ・・・・・ 背面ガラス基板 １１４ ・・・・・ 放電空間
Claims (6)
- 【請求項１】 複数の行電極対と、前記行電極対に交差
して配列された複数の列電極と、 前記行電極対と列電極の各交差する点毎に画定される画
素セルとを有し、 前記全ての行電極対間に放電維持パルスに比して立ち上
がり又は立ち下がり時間が十分長い第１のリセットパル
スを印加して前記行電極対間に放電を生じさせる一斉リ
セット期間と、 前記行電極対に走査パルスを印加するとともに前記列電
極に画素データパルスを印加して画素データに応じて点
灯及び消灯画素を選択するアドレス期間と、 前記行電極対に交互に放電維持パルスを印加して前記点
灯及び消灯画素を維持する維持放電期間とを用いて表示
を行うプラズマディスプレイパネルの駆動方法であっ
て、 前記一斉リセット期間において前記第１のリセットパル
スの終了直後に前記行電極対の内の一方の行電極に第２
のリセットパルスを印加することを特徴とするプラズマ
ディスプレイパネルの駆動方法。 - 【請求項２】 前記第１のリセットパルスは、前記行電
極対の内の一方の行電極に印加される所定極性のリセッ
トパルスと、 前記行電極対の内の他方の行電極に同時に印加される前
記所定極性とは逆極性のリセットパルスとからなり、 前記第２のリセットパルスは、前記行電極対の内の一方
の行電極に印加される所定極性のリセットパルスとは逆
極性であることを特徴とする請求項１記載のプラズマデ
ィスプレイパネルの駆動方法。 - 【請求項３】 前記アドレス期間において前記走査パル
スの直前に前記行電極対にプライミングパルスを印加す
ることを特徴とする請求項１又は２記載のプラズマディ
スプレイパネルの駆動方法。 - 【請求項４】 前記画素セル内の行電極の幅を３００μ
ｍ以上としたことを特徴とする請求項１乃至３のいずれ
か１に記載のプラズマディスプレイパネルの駆動方法。 - 【請求項５】 前記画素セル内の行電極対は、放電ギャ
ップを介して互いに対向して突出した突出部を有するこ
とを特徴とする請求項１乃至３のいずれか１に記載のプ
ラズマディスプレイパネルの駆動方法。 - 【請求項６】 前記突出部は、前記放電ギャップ近傍の
幅広部とそれに続く幅狭部とを有することを特徴とする
請求項５記載のプラズマディスプレイパネルの駆動方
法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25765396A JP3549138B2 (ja) | 1996-09-06 | 1996-09-06 | プラズマディスプレイパネルの駆動方法 |
| US08/934,004 US5943031A (en) | 1996-09-06 | 1997-08-28 | Method for driving a plasma display panel |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25765396A JP3549138B2 (ja) | 1996-09-06 | 1996-09-06 | プラズマディスプレイパネルの駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1083160A true JPH1083160A (ja) | 1998-03-31 |
| JP3549138B2 JP3549138B2 (ja) | 2004-08-04 |
Family
ID=17309246
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25765396A Expired - Fee Related JP3549138B2 (ja) | 1996-09-06 | 1996-09-06 | プラズマディスプレイパネルの駆動方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5943031A (ja) |
| JP (1) | JP3549138B2 (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6118416A (en) * | 1996-09-30 | 2000-09-12 | Nec Corporation | Method of controlling alternating current plasma display panel with positive priming discharge pulse and negative priming discharge pulse |
| US6404411B1 (en) | 1998-07-29 | 2002-06-11 | Hitachi, Limited | Display panel driving method and discharge type display apparatus |
| US6522075B2 (en) | 1998-12-28 | 2003-02-18 | Pioneer Corporation | Plasma display panel |
| KR100430085B1 (ko) * | 2001-05-16 | 2004-05-03 | 엘지전자 주식회사 | 평판 디스플레이 패널 및 그 구동방법 |
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|---|---|---|---|---|
| US6861803B1 (en) * | 1992-01-28 | 2005-03-01 | Fujitsu Limited | Full color surface discharge type plasma display device |
| US6160530A (en) * | 1997-04-02 | 2000-12-12 | Nec Corporation | Method and device for driving a plasma display panel |
| JP3596846B2 (ja) * | 1997-07-22 | 2004-12-02 | パイオニア株式会社 | プラズマディスプレイパネルの駆動方法 |
| JP3526179B2 (ja) * | 1997-07-29 | 2004-05-10 | パイオニア株式会社 | プラズマディスプレイ装置 |
| JP4210805B2 (ja) * | 1998-06-05 | 2009-01-21 | 株式会社日立プラズマパテントライセンシング | ガス放電デバイスの駆動方法 |
| JP3421578B2 (ja) * | 1998-06-11 | 2003-06-30 | 富士通株式会社 | Ｐｄｐの駆動方法 |
| JP3424587B2 (ja) * | 1998-06-18 | 2003-07-07 | 富士通株式会社 | プラズマディスプレイパネルの駆動方法 |
| JP3259766B2 (ja) * | 1998-08-19 | 2002-02-25 | 日本電気株式会社 | プラズマディスプレイパネルの駆動方法 |
| JP3466098B2 (ja) | 1998-11-20 | 2003-11-10 | 富士通株式会社 | ガス放電パネルの駆動方法 |
| JP2001022323A (ja) * | 1999-07-02 | 2001-01-26 | Seiko Instruments Inc | 発光表示器駆動回路 |
| JP2001228823A (ja) * | 1999-12-07 | 2001-08-24 | Pioneer Electronic Corp | プラズマディスプレイ装置 |
| JP3933831B2 (ja) * | 1999-12-22 | 2007-06-20 | パイオニア株式会社 | プラズマ表示装置 |
| JP3552990B2 (ja) * | 2000-04-12 | 2004-08-11 | 日本電気株式会社 | Ａｃ型プラズマディスプレイパネルの駆動方法 |
| JP4748878B2 (ja) * | 2000-12-06 | 2011-08-17 | パナソニック株式会社 | プラズマディスプレイ装置 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE69318196T2 (de) * | 1992-01-28 | 1998-08-27 | Fujitsu Ltd | Plasma Farbanzeige-Vorrichtung von Oberflächenentladungs-Typ |
| US5684499A (en) * | 1993-11-29 | 1997-11-04 | Nec Corporation | Method of driving plasma display panel having improved operational margin |
| JP2772753B2 (ja) * | 1993-12-10 | 1998-07-09 | 富士通株式会社 | プラズマディスプレイパネル並びにその駆動方法及び駆動回路 |
-
1996
- 1996-09-06 JP JP25765396A patent/JP3549138B2/ja not_active Expired - Fee Related
-
1997
- 1997-08-28 US US08/934,004 patent/US5943031A/en not_active Expired - Lifetime
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| Publication number | Priority date | Publication date | Assignee | Title |
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| US6404411B1 (en) | 1998-07-29 | 2002-06-11 | Hitachi, Limited | Display panel driving method and discharge type display apparatus |
| US6522075B2 (en) | 1998-12-28 | 2003-02-18 | Pioneer Corporation | Plasma display panel |
| US6657386B2 (en) | 1998-12-28 | 2003-12-02 | Pioneer Corporation | Plasma display panel |
| US7148625B2 (en) | 1998-12-28 | 2006-12-12 | Pioneer Corporation | Plasma display panel |
| US7202604B2 (en) | 1998-12-28 | 2007-04-10 | Pioneer Corporation | Plasma display panel |
| US7205722B2 (en) | 1998-12-28 | 2007-04-17 | Pioneer Corporation | Plasma display panel |
| KR100430085B1 (ko) * | 2001-05-16 | 2004-05-03 | 엘지전자 주식회사 | 평판 디스플레이 패널 및 그 구동방법 |
Also Published As
| Publication number | Publication date |
|---|---|
| US5943031A (en) | 1999-08-24 |
| JP3549138B2 (ja) | 2004-08-04 |
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