JPH09175317A - エアバッグシステム - Google Patents
エアバッグシステムInfo
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- JPH09175317A JPH09175317A JP33735295A JP33735295A JPH09175317A JP H09175317 A JPH09175317 A JP H09175317A JP 33735295 A JP33735295 A JP 33735295A JP 33735295 A JP33735295 A JP 33735295A JP H09175317 A JPH09175317 A JP H09175317A
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- cpu
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Abstract
(57)【要約】
【課題】 衝突によるバッテリ電圧供給停止が生じた場
合のメモリ記録完了時刻の電源電圧保証を、バックアッ
プコンデンサのキャパシタンスを大きな値にすること、
あるいは展開用昇圧回路の昇圧電圧を高い値にすること
なしに行えるようにして、ユニットコストの低減を図る
こと。 【解決手段】 Ｇセンサ５４の入力により車両衝突状態
を検知し、バックアップコンデンサ５９が並列に接続さ
れたバッテリ電源５１とグランドの間に設けられた展開
用トランジスタ５５をＯＮ状態とすることにより点火装
置５６に所定の電源を印加し点火させるとともに、Ｇセ
ンサ入力処理結果もしくは衝突前後のシステムの状態を
不揮発性メモリ６２に記録するエアバッグシステムにお
いて、前記車両衝突状態検知後、衝突から不揮発性メモ
リ６２の記録終了までの間に処理が必要とされない機能
の消費電流を低減するように構成した。
合のメモリ記録完了時刻の電源電圧保証を、バックアッ
プコンデンサのキャパシタンスを大きな値にすること、
あるいは展開用昇圧回路の昇圧電圧を高い値にすること
なしに行えるようにして、ユニットコストの低減を図る
こと。 【解決手段】 Ｇセンサ５４の入力により車両衝突状態
を検知し、バックアップコンデンサ５９が並列に接続さ
れたバッテリ電源５１とグランドの間に設けられた展開
用トランジスタ５５をＯＮ状態とすることにより点火装
置５６に所定の電源を印加し点火させるとともに、Ｇセ
ンサ入力処理結果もしくは衝突前後のシステムの状態を
不揮発性メモリ６２に記録するエアバッグシステムにお
いて、前記車両衝突状態検知後、衝突から不揮発性メモ
リ６２の記録終了までの間に処理が必要とされない機能
の消費電流を低減するように構成した。
Description
【０００１】
【発明の属する技術分野】 本発明は、安価なエアバッ
グシステム構成法に関する。
グシステム構成法に関する。
【０００２】
【従来の技術】 従来のエアバッグシステムとしては、
例えば図４に示すようなものがある。１０はエアバッグ
制御ユニットであり、バッテリ１１より車両ハーネス１
２を介して供給される電源電圧Ｖｒによって動作を行
う。１３はＣＰＵであり、Ｇセンサ１４から入力される
車両の加速度信号の処理を行ない、車両の衝突を判別す
る。１８はバッテリ逆接及び電源系負サージからの保護
用ダイオード、１９は展開用昇圧回路であり、車両の衝
突時に前記ハーネス１２の外れ等の原因により前記バッ
テリ１１からの電源電圧Ｖｒが供給されなくなった場合
でも所定の時間（ｔｅ）展開電流（Ｉｅ）が流せるだけ
の電荷（ｔｅ×Ｉｅ）をバックアップコンデンサ２０に
蓄える。２１はＣＰＵ用電源であり、前記電源電圧Ｖｒ
を基に前記ＣＰＵ１３に供給する５Ｖ電圧を発生する。
前記ＣＰＵ１３が点火判断を行った場合、点火用トラン
ジスタ１５をＯＮすることにより点火装置１６に展開電
流Ｉｓが流れ、点火装置１６内の火薬に点火することに
よりバッグを展開するとともに、衝突形態等前記ＣＰＵ
１３の処理結果等を不揮発性メモリ２５に記録する。ま
た、車両の衝突時前記理由により電源電圧Ｖｒが供給さ
れなくなった場合、ＣＰＵ１３は、電源バックアップ用
トランジスタ２３をＯＮすることより、前記バックアッ
プコンデンサ２０に蓄えられている電荷を前記ＣＰＵ用
電源２１に供給する。
例えば図４に示すようなものがある。１０はエアバッグ
制御ユニットであり、バッテリ１１より車両ハーネス１
２を介して供給される電源電圧Ｖｒによって動作を行
う。１３はＣＰＵであり、Ｇセンサ１４から入力される
車両の加速度信号の処理を行ない、車両の衝突を判別す
る。１８はバッテリ逆接及び電源系負サージからの保護
用ダイオード、１９は展開用昇圧回路であり、車両の衝
突時に前記ハーネス１２の外れ等の原因により前記バッ
テリ１１からの電源電圧Ｖｒが供給されなくなった場合
でも所定の時間（ｔｅ）展開電流（Ｉｅ）が流せるだけ
の電荷（ｔｅ×Ｉｅ）をバックアップコンデンサ２０に
蓄える。２１はＣＰＵ用電源であり、前記電源電圧Ｖｒ
を基に前記ＣＰＵ１３に供給する５Ｖ電圧を発生する。
前記ＣＰＵ１３が点火判断を行った場合、点火用トラン
ジスタ１５をＯＮすることにより点火装置１６に展開電
流Ｉｓが流れ、点火装置１６内の火薬に点火することに
よりバッグを展開するとともに、衝突形態等前記ＣＰＵ
１３の処理結果等を不揮発性メモリ２５に記録する。ま
た、車両の衝突時前記理由により電源電圧Ｖｒが供給さ
れなくなった場合、ＣＰＵ１３は、電源バックアップ用
トランジスタ２３をＯＮすることより、前記バックアッ
プコンデンサ２０に蓄えられている電荷を前記ＣＰＵ用
電源２１に供給する。
【０００３】図２は、車両衝突が発生し、同時に前記ハ
ーネス１２が外れた場合の前記電源電圧Ｖｒと前記展開
電流Ｉｓのふるまいを示したものである。Ｘ軸は時間経
過を表わし、ｔ０（ｔ＝０ｍｓ）が衝突発生時とする。
ここで、Ｔ１は前記ＣＰＵ１３が点火信号を出力するま
での時間であり、ハーネス外れによって前記電源バック
アップ用トランジスタ２３がＯＮ状態になっているた
め、展開電流Ｉｓとして、前記ＣＰＵ１３の消費電流Ｉ
ｃが流れるため、ｔ０において前記バックアップコンデ
ンサ２０の保持電圧Ｖ０であった前記電源電圧Ｖｒは、
時刻ｔ１には、Ｖ１＝Ｖ０−Ｉｃ×Ｔ１／Ｃまで低下す
る。Ｔ２は点火電流通電時間であり、前記点火装置１６
の抵抗をＲ、前記バックアップコンデンサ２０の容量を
Ｃとすると時刻ｔ２にはＶ２＝Ｖ１×ε＾−（Ｔ２／Ｒ
Ｃ）−Ｉｃ×Ｔ２／Ｃまで低下する。Ｔ３は点火完了か
ら前記不揮発性メモリ記録完了までの時間であり、展開
電流Ｉｓとしては前記ＣＰＵ１３の消費電流Ｉｃが流れ
るため、前記電源電圧Ｖｒは、時刻ｔ３にはＶ３＝Ｖ２
−Ｉｃ×Ｔ３／Ｃまで低下する。
ーネス１２が外れた場合の前記電源電圧Ｖｒと前記展開
電流Ｉｓのふるまいを示したものである。Ｘ軸は時間経
過を表わし、ｔ０（ｔ＝０ｍｓ）が衝突発生時とする。
ここで、Ｔ１は前記ＣＰＵ１３が点火信号を出力するま
での時間であり、ハーネス外れによって前記電源バック
アップ用トランジスタ２３がＯＮ状態になっているた
め、展開電流Ｉｓとして、前記ＣＰＵ１３の消費電流Ｉ
ｃが流れるため、ｔ０において前記バックアップコンデ
ンサ２０の保持電圧Ｖ０であった前記電源電圧Ｖｒは、
時刻ｔ１には、Ｖ１＝Ｖ０−Ｉｃ×Ｔ１／Ｃまで低下す
る。Ｔ２は点火電流通電時間であり、前記点火装置１６
の抵抗をＲ、前記バックアップコンデンサ２０の容量を
Ｃとすると時刻ｔ２にはＶ２＝Ｖ１×ε＾−（Ｔ２／Ｒ
Ｃ）−Ｉｃ×Ｔ２／Ｃまで低下する。Ｔ３は点火完了か
ら前記不揮発性メモリ記録完了までの時間であり、展開
電流Ｉｓとしては前記ＣＰＵ１３の消費電流Ｉｃが流れ
るため、前記電源電圧Ｖｒは、時刻ｔ３にはＶ３＝Ｖ２
−Ｉｃ×Ｔ３／Ｃまで低下する。
【０００４】
【発明が解決しようとする課題】 しかしながらこの従
来のエアバッグシステムにあっては、メモリ記録完了時
刻ｔ３の電源電圧Ｖｒを前記ＣＰＵ１３の動作保証電圧
以上に保持する必要があり、降下電圧に反比例する前記
バックアップコンデンサ２０のキャパシタンスを十分大
きな値にするか、もしくは展開用昇圧回路１９の昇圧電
圧を十分高い値にする必要があり、ユニットコストが高
くなるという欠点があった。本発明はこのような従来の
問題点に着目してなされたものであり、ＣＰＵの処理に
よって展開判断がなされると、所定時間の展開電流出力
及び衝突データ記録以外のＣＰＵ内機能回路の電源もし
くはクロックを遮断することにより以上問題点を解決す
ることを目的としてる。
来のエアバッグシステムにあっては、メモリ記録完了時
刻ｔ３の電源電圧Ｖｒを前記ＣＰＵ１３の動作保証電圧
以上に保持する必要があり、降下電圧に反比例する前記
バックアップコンデンサ２０のキャパシタンスを十分大
きな値にするか、もしくは展開用昇圧回路１９の昇圧電
圧を十分高い値にする必要があり、ユニットコストが高
くなるという欠点があった。本発明はこのような従来の
問題点に着目してなされたものであり、ＣＰＵの処理に
よって展開判断がなされると、所定時間の展開電流出力
及び衝突データ記録以外のＣＰＵ内機能回路の電源もし
くはクロックを遮断することにより以上問題点を解決す
ることを目的としてる。
【０００５】
【課題を解決するための手段】 上述の目的達成のた
め、本発明では、Ｇセンサ入力を処理することにより車
両衝突状態を検知し、バックアップ用コンデンサが並列
に接続されたバッテリ電源とグランドの間に設けられた
点火装置に直列に接続された少なくとも１つの点火用ト
ランジスタをＯＮ状態とすることにより、該点火装置に
所定の電源を印加し、点火させるとともに、Ｇセンサ入
力処理結果もしくは衝突前後のシステムの状態を不揮発
性メモリに記録するエアバッグシステムにおいて、前記
車両衝突状態検知後、衝突から不揮発性メモリの記録終
了までの間に処理が必要とされない機能の消費電流を低
減するよう構成した。なお、消費電流を低減するにあた
り、請求項２に記載のように、車両衝突状態検知後、衝
突から不揮発性メモリの記録終了までの間に処理が必要
とされない機能への電力供給を停止するように構成して
もよいし、あるいは請求項３に記載のように、車両衝突
状態検知後、衝突から不揮発性メモリの記録終了までの
間に処理が必要とされない機能へのクロック供給を停止
するように構成してもよい。
め、本発明では、Ｇセンサ入力を処理することにより車
両衝突状態を検知し、バックアップ用コンデンサが並列
に接続されたバッテリ電源とグランドの間に設けられた
点火装置に直列に接続された少なくとも１つの点火用ト
ランジスタをＯＮ状態とすることにより、該点火装置に
所定の電源を印加し、点火させるとともに、Ｇセンサ入
力処理結果もしくは衝突前後のシステムの状態を不揮発
性メモリに記録するエアバッグシステムにおいて、前記
車両衝突状態検知後、衝突から不揮発性メモリの記録終
了までの間に処理が必要とされない機能の消費電流を低
減するよう構成した。なお、消費電流を低減するにあた
り、請求項２に記載のように、車両衝突状態検知後、衝
突から不揮発性メモリの記録終了までの間に処理が必要
とされない機能への電力供給を停止するように構成して
もよいし、あるいは請求項３に記載のように、車両衝突
状態検知後、衝突から不揮発性メモリの記録終了までの
間に処理が必要とされない機能へのクロック供給を停止
するように構成してもよい。
【０００６】
【発明の実施の形態】 以下、この発明の実施の形態を
を図面に基づいて説明する。図１はこの発明の実施の形
態１を示す図である。まず構成を説明すると、５０はエ
アバッグ制御ユニットであり、５１はバッテリ電源、５
２はバッテリ電源電圧を供給するハーネス、５４はＧセ
ンサ、５５は展開用トランジスタ、５６は点火装置、５
７はバッテリ逆接及び電源系負サージからの保護用ダイ
オード、５８は展開用昇圧回路、５９はバックアップコ
ンデンサ、６０は５Ｖ電源バックアップトランジスタ、
６１はＣＰＵ用電源、６２は衝突データ記録用の不揮発
性メモリである。５３はＣＰＵであり、該ＣＰＵ５３内
部は第１ブロック７０、第２ブロック７１の２個のブロ
ックに分かれており、それぞれのブロック７０，７１は
該ＣＰＵ５３内部で分岐した別々の電源線７２，７３に
接続されている。前記第１ブロック７０に接続する電源
線７２は電源遮断用トランジスタ７４を介して電源電圧
を供給する。前記第１ブロック７０は、ＣＰＵとしての
処理を行なうＣＰＵコア６３、プログラム及びデータを
格納するＲＯＭ／ＲＡＭ等のメモリ６５、アナログ入力
処理用のＡ／Ｄコンバータ６４等からなる。また、第２
ブロック７１は、展開信号出力時間を計測するタイマ６
６、前記不揮発性メモリ６２に記録するデータを格納す
るレジスタ等のデータ記憶手段６７、該データ記憶手段
６７内データを前記不揮発性メモリ６２へシリアル送信
するＳＣＩ回路６８、１ビットフリップフロップにより
構成される展開フラグ６９からなる。該展開フラグ６９
の入力は前記ＣＰＵコア６３に接続され、該展開フラグ
６９の出力は前記タイマ６６及びＳＣＩ回路６８に接続
されている。前記タイマ６６の出力は前記展開用トラン
ジスタ５５のベースに接続されており、前記展開フラグ
６９がセットされると所定の時間該展開用トランジスタ
５５をＯＮする。
を図面に基づいて説明する。図１はこの発明の実施の形
態１を示す図である。まず構成を説明すると、５０はエ
アバッグ制御ユニットであり、５１はバッテリ電源、５
２はバッテリ電源電圧を供給するハーネス、５４はＧセ
ンサ、５５は展開用トランジスタ、５６は点火装置、５
７はバッテリ逆接及び電源系負サージからの保護用ダイ
オード、５８は展開用昇圧回路、５９はバックアップコ
ンデンサ、６０は５Ｖ電源バックアップトランジスタ、
６１はＣＰＵ用電源、６２は衝突データ記録用の不揮発
性メモリである。５３はＣＰＵであり、該ＣＰＵ５３内
部は第１ブロック７０、第２ブロック７１の２個のブロ
ックに分かれており、それぞれのブロック７０，７１は
該ＣＰＵ５３内部で分岐した別々の電源線７２，７３に
接続されている。前記第１ブロック７０に接続する電源
線７２は電源遮断用トランジスタ７４を介して電源電圧
を供給する。前記第１ブロック７０は、ＣＰＵとしての
処理を行なうＣＰＵコア６３、プログラム及びデータを
格納するＲＯＭ／ＲＡＭ等のメモリ６５、アナログ入力
処理用のＡ／Ｄコンバータ６４等からなる。また、第２
ブロック７１は、展開信号出力時間を計測するタイマ６
６、前記不揮発性メモリ６２に記録するデータを格納す
るレジスタ等のデータ記憶手段６７、該データ記憶手段
６７内データを前記不揮発性メモリ６２へシリアル送信
するＳＣＩ回路６８、１ビットフリップフロップにより
構成される展開フラグ６９からなる。該展開フラグ６９
の入力は前記ＣＰＵコア６３に接続され、該展開フラグ
６９の出力は前記タイマ６６及びＳＣＩ回路６８に接続
されている。前記タイマ６６の出力は前記展開用トラン
ジスタ５５のベースに接続されており、前記展開フラグ
６９がセットされると所定の時間該展開用トランジスタ
５５をＯＮする。
【０００７】次に作用を説明する。前記第１ブロック７
０の前記Ｇセンサ５４出力信号処理により展開判断がさ
れると前記ＣＰＵコア６３は展開フラグ６９をセットす
ると同時に、前記不揮発性メモリ６２に記録するデータ
を、前記データ記憶手段６７に転送する。前記展開フラ
グ６９の出力は前記第２ブロック７１に展開信号出力命
令を出すとともに前記第１ブロック７０に接続される電
源線７２を電源遮断用トランジスタ７４により遮断す
る。前記第２ブロック７１内のタイマ６６は前記展開フ
ラグ６９がセットされると所定の時間、前記展開用トラ
ンジスタ５５のベースに電流を流すことにより該展開用
トランジスタ５５をＯＮさせ、前記点火装置５６に点火
電流Ｉｓを印加する。前記第２ブロック７１内のＳＣＩ
回路６８は前記展開フラグ６９がセットされると前記デ
ータ記憶手段６７に記憶されているデータを時分割シリ
アルデータに変換し、前記不揮発性メモリ６２に転送す
る。
０の前記Ｇセンサ５４出力信号処理により展開判断がさ
れると前記ＣＰＵコア６３は展開フラグ６９をセットす
ると同時に、前記不揮発性メモリ６２に記録するデータ
を、前記データ記憶手段６７に転送する。前記展開フラ
グ６９の出力は前記第２ブロック７１に展開信号出力命
令を出すとともに前記第１ブロック７０に接続される電
源線７２を電源遮断用トランジスタ７４により遮断す
る。前記第２ブロック７１内のタイマ６６は前記展開フ
ラグ６９がセットされると所定の時間、前記展開用トラ
ンジスタ５５のベースに電流を流すことにより該展開用
トランジスタ５５をＯＮさせ、前記点火装置５６に点火
電流Ｉｓを印加する。前記第２ブロック７１内のＳＣＩ
回路６８は前記展開フラグ６９がセットされると前記デ
ータ記憶手段６７に記憶されているデータを時分割シリ
アルデータに変換し、前記不揮発性メモリ６２に転送す
る。
【０００８】ここで、前記ＣＰＵ５３の消費電流を５０
ｍｓ、第１ブロック７０の消費電流を４０ｍｓ、第２ブ
ロック７１の消費電流を１０ｍｓとすると、前記展開フ
ラグ６９がセットされる以前の消費電流は５０ｍｓ、セ
ット以降の消費電流は１０ｍｓとなる。
ｍｓ、第１ブロック７０の消費電流を４０ｍｓ、第２ブ
ロック７１の消費電流を１０ｍｓとすると、前記展開フ
ラグ６９がセットされる以前の消費電流は５０ｍｓ、セ
ット以降の消費電流は１０ｍｓとなる。
【０００９】図２は、車両衝突が発生し、同時に前記ハ
ーネス５２が外れた場合の電源電圧Ｖｒと前記展開電流
Ｉｓのふるまいを示したもので、Ｘ軸は時間経過を表わ
し、ｔ０＝（ｔ＝０ｍｓ）が衝突発生時とする。ここで
時間Ｔ１１は前記ＣＰＵ５３が点火信号を出力するまで
の時間であり、ハーネス外れによって前記５Ｖ電源バッ
クアップトランジスタ６０がＯＮ状態になっているた
め、展開電流Ｉｓとして前記ＣＰＵ５３の全消費電流Ｉ
ｃ１（５０ｍｓ）が流れ、ｔ０において前記バックアッ
プコンデンサ５９の保持電圧Ｖ０であった前記電源電圧
Ｖｒは、時刻ｔ１にはＶ１＝Ｖ０−Ｉｃ１×Ｔ１／Ｃま
で低下する。時間Ｔ１２は点火電流通過時間であり、前
記点火装置５６の抵抗をＲ、前記バックアップコンデン
サ５９の容量をＣとすると、前記第１ブロック７０の電
源遮断効果により前記ＣＰＵ５３の消費電流はＩｃ２
（１０ｍＡ）となり、時刻ｔ２にはＶ２’＝Ｖ１×ε＾
−（Ｔ２／ＲＣ）−Ｉｃ２×Ｔ２／Ｃまでしか低下しな
い。時間Ｔ１３は点火完了から前記不揮発性メモリ６２
の記録完了までの時間であり、展開電流Ｉｓとしては前
記ＣＰＵ５３の消費電流Ｉｃ２（１０ｍＡ）が流れるた
めに、前記電源電圧Ｖｒは、時刻ｔ３にはＶ３’＝Ｖ
２’−Ｉｃ２×Ｔ３／Ｃまでしか低下しない。
ーネス５２が外れた場合の電源電圧Ｖｒと前記展開電流
Ｉｓのふるまいを示したもので、Ｘ軸は時間経過を表わ
し、ｔ０＝（ｔ＝０ｍｓ）が衝突発生時とする。ここで
時間Ｔ１１は前記ＣＰＵ５３が点火信号を出力するまで
の時間であり、ハーネス外れによって前記５Ｖ電源バッ
クアップトランジスタ６０がＯＮ状態になっているた
め、展開電流Ｉｓとして前記ＣＰＵ５３の全消費電流Ｉ
ｃ１（５０ｍｓ）が流れ、ｔ０において前記バックアッ
プコンデンサ５９の保持電圧Ｖ０であった前記電源電圧
Ｖｒは、時刻ｔ１にはＶ１＝Ｖ０−Ｉｃ１×Ｔ１／Ｃま
で低下する。時間Ｔ１２は点火電流通過時間であり、前
記点火装置５６の抵抗をＲ、前記バックアップコンデン
サ５９の容量をＣとすると、前記第１ブロック７０の電
源遮断効果により前記ＣＰＵ５３の消費電流はＩｃ２
（１０ｍＡ）となり、時刻ｔ２にはＶ２’＝Ｖ１×ε＾
−（Ｔ２／ＲＣ）−Ｉｃ２×Ｔ２／Ｃまでしか低下しな
い。時間Ｔ１３は点火完了から前記不揮発性メモリ６２
の記録完了までの時間であり、展開電流Ｉｓとしては前
記ＣＰＵ５３の消費電流Ｉｃ２（１０ｍＡ）が流れるた
めに、前記電源電圧Ｖｒは、時刻ｔ３にはＶ３’＝Ｖ
２’−Ｉｃ２×Ｔ３／Ｃまでしか低下しない。
【００１０】すなわち、前記第１ブロック７０の電源遮
断効果による電源電圧降下低減効果（Ｖ３’−Ｖ３）
は、前記バックアップコンデンサ５９の容量Ｃを一定と
すると（Ｉｃ１−Ｉｃ２）×（Ｔ２＋Ｔ３）／Ｃとな
り、Ｖ３’＝Ｖ３＝（ＣＰＵ動作保証電圧）とした場合
にバックアップコンデンサの容量を減らすことができ
る。あるいは、ｔ０１＝における前記バックアップコン
デンサ５９の保持電圧Ｖ０すなわち展開用昇圧回路５８
の昇圧電圧を低減（ＩＰ１からＩＰ２に低減）すること
ができる。
断効果による電源電圧降下低減効果（Ｖ３’−Ｖ３）
は、前記バックアップコンデンサ５９の容量Ｃを一定と
すると（Ｉｃ１−Ｉｃ２）×（Ｔ２＋Ｔ３）／Ｃとな
り、Ｖ３’＝Ｖ３＝（ＣＰＵ動作保証電圧）とした場合
にバックアップコンデンサの容量を減らすことができ
る。あるいは、ｔ０１＝における前記バックアップコン
デンサ５９の保持電圧Ｖ０すなわち展開用昇圧回路５８
の昇圧電圧を低減（ＩＰ１からＩＰ２に低減）すること
ができる。
【００１１】図３に示す実施の形態２について説明す
る。まず構成を説明すると、１００はエアバッグ制御ユ
ニット、１０１はバッテリ電源、１０２はバッテリ電源
電圧を供給するためのハーネス、１０４はＧセンサ、１
０５は展開用トランジスタ、１０６は点火装置、１０７
はバッテリ逆接及び電源系負サージからの保護用ダイオ
ード、１０８は展開用昇圧回路、１０９はバックアップ
コンデンサ、１１０は５Ｖ電源バックアップトランジス
タ、１１１はＣＰＵ用電源、１１２は衝突データ記録用
の不揮発性メモリである。１０３はＣＰＵであり、該Ｃ
ＰＵ１０３の内部は第１ブロック１２０、第２ブロック
１２１の２個のブロックに分かれており、それぞれのブ
ロックはクロック発生器１２４により生成したシステム
クロックを供給するための該ＣＰＵ１０３内部で分岐し
た別々のクロック線１２２，１２３に接続されている。
前記第１ブロック１２０に接続するクロック線１２２は
クロック遮断用ゲート回路１２５を介してクロックを供
給する。前記第１ブロック１２０は、ＣＰＵとしての処
理を行なうＣＰＵコア１１３、プログラム及びデータを
格納するＲＯＭ／ＲＡＭ等のメモリ１１５、アナログ入
力処理用のＡ／Ｄコンバータ１１４等からなる。また第
２ブロック１２１は展開信号出力時間を計測するタイマ
１１６、前記不揮発性メモリ１１２に記録するデータを
格納するレジスタ等のデータ記憶手段１１７、データ記
憶手段１１７内のデータを前記不揮発性メモリ１１２ヘ
シリアル送信するＳＣＩ回路１１８、１ビットフリップ
フロップにより構成される展開フラグ１１９からなる。
該展開フラグ１１９の入力は前記ＣＰＵコア１１３に接
続され、該展開フラグ１１９の出力は前記タイマ１１６
及びＳＣＩ回路１１８に接続されている。該タイマ１１
６の出力は前記展開用トランジスタ１０５のベースに接
続されており、前記展開フラグ１１９がセットされると
所定の時間、展開用トランジスタ１０５をＯＮする。
る。まず構成を説明すると、１００はエアバッグ制御ユ
ニット、１０１はバッテリ電源、１０２はバッテリ電源
電圧を供給するためのハーネス、１０４はＧセンサ、１
０５は展開用トランジスタ、１０６は点火装置、１０７
はバッテリ逆接及び電源系負サージからの保護用ダイオ
ード、１０８は展開用昇圧回路、１０９はバックアップ
コンデンサ、１１０は５Ｖ電源バックアップトランジス
タ、１１１はＣＰＵ用電源、１１２は衝突データ記録用
の不揮発性メモリである。１０３はＣＰＵであり、該Ｃ
ＰＵ１０３の内部は第１ブロック１２０、第２ブロック
１２１の２個のブロックに分かれており、それぞれのブ
ロックはクロック発生器１２４により生成したシステム
クロックを供給するための該ＣＰＵ１０３内部で分岐し
た別々のクロック線１２２，１２３に接続されている。
前記第１ブロック１２０に接続するクロック線１２２は
クロック遮断用ゲート回路１２５を介してクロックを供
給する。前記第１ブロック１２０は、ＣＰＵとしての処
理を行なうＣＰＵコア１１３、プログラム及びデータを
格納するＲＯＭ／ＲＡＭ等のメモリ１１５、アナログ入
力処理用のＡ／Ｄコンバータ１１４等からなる。また第
２ブロック１２１は展開信号出力時間を計測するタイマ
１１６、前記不揮発性メモリ１１２に記録するデータを
格納するレジスタ等のデータ記憶手段１１７、データ記
憶手段１１７内のデータを前記不揮発性メモリ１１２ヘ
シリアル送信するＳＣＩ回路１１８、１ビットフリップ
フロップにより構成される展開フラグ１１９からなる。
該展開フラグ１１９の入力は前記ＣＰＵコア１１３に接
続され、該展開フラグ１１９の出力は前記タイマ１１６
及びＳＣＩ回路１１８に接続されている。該タイマ１１
６の出力は前記展開用トランジスタ１０５のベースに接
続されており、前記展開フラグ１１９がセットされると
所定の時間、展開用トランジスタ１０５をＯＮする。
【００１２】前記第１ブロック１２０の前記Ｇセンサ１
０４の出力信号処理により展開判断がされると、前記Ｃ
ＰＵコア１１３は展開フラグ１１９をセットすると同時
に、前記不揮発性メモリ１１２に記録するデータを、前
記データ記憶手段１１７に転送する。前記展開フラグ１
１９の出力は前記第２ブロック１２１に展開信号出力命
令を出すとともに前記第１ブロック１２０に接続される
クロック線１２２をクロック遮断用ゲート１２５により
遮断する。前記第２ブロック１２１内のタイマ１１６は
前記展開フラグ１１９がセットされると所定の時間前記
展開用トランジスタ１０５のベースへ電流を流すことに
より該展開用トランジスタ１０５をＯＮさせ、前記点火
装置１０６に点火電流Ｉｓを印加する。前記第２ブロッ
ク１２１内のＳＣＩ回路１１８は前記展開フラグ１１９
がセットされると、前記データ記憶手段１１７に記憶さ
れているデータを時分割シリアルデータに変換し、前記
不揮発性メモリ１１２に転送する。
０４の出力信号処理により展開判断がされると、前記Ｃ
ＰＵコア１１３は展開フラグ１１９をセットすると同時
に、前記不揮発性メモリ１１２に記録するデータを、前
記データ記憶手段１１７に転送する。前記展開フラグ１
１９の出力は前記第２ブロック１２１に展開信号出力命
令を出すとともに前記第１ブロック１２０に接続される
クロック線１２２をクロック遮断用ゲート１２５により
遮断する。前記第２ブロック１２１内のタイマ１１６は
前記展開フラグ１１９がセットされると所定の時間前記
展開用トランジスタ１０５のベースへ電流を流すことに
より該展開用トランジスタ１０５をＯＮさせ、前記点火
装置１０６に点火電流Ｉｓを印加する。前記第２ブロッ
ク１２１内のＳＣＩ回路１１８は前記展開フラグ１１９
がセットされると、前記データ記憶手段１１７に記憶さ
れているデータを時分割シリアルデータに変換し、前記
不揮発性メモリ１１２に転送する。
【００１３】ここで、前記ＣＰＵ１０３の消費電流を５
０ｍｓ、第１ブロック１２０の消費電流を４０ｍｓ、第
２ブロック１２１の消費電流を１０ｍｓとすると、前記
展開フラグ１１９がセットされる以前の消費電流は５０
ｍｓ、セット以降の消費電流は１０ｍｓとなる。よって
前記展開判断後の電流電圧遮断とバックアップコンデン
サ１０９の容量低減効果もしくは展開用昇圧回路１０８
の昇圧電圧低減効果が得られる。
０ｍｓ、第１ブロック１２０の消費電流を４０ｍｓ、第
２ブロック１２１の消費電流を１０ｍｓとすると、前記
展開フラグ１１９がセットされる以前の消費電流は５０
ｍｓ、セット以降の消費電流は１０ｍｓとなる。よって
前記展開判断後の電流電圧遮断とバックアップコンデン
サ１０９の容量低減効果もしくは展開用昇圧回路１０８
の昇圧電圧低減効果が得られる。
【００１４】
【発明の効果】 以上説明してきたように、この発明に
よれば、その構成をＣＰＵの処理によって展開判断がな
されると、所定時間の展開電流出力及び衝突データ記録
以外のＣＰＵ内機能回路の電源もしくはクロックを遮断
することにより、衝突によるバッテリ電圧供給停止が生
じた場合を想定した場合のハードウェアのコストアップ
を抑えるという効果が得られる。
よれば、その構成をＣＰＵの処理によって展開判断がな
されると、所定時間の展開電流出力及び衝突データ記録
以外のＣＰＵ内機能回路の電源もしくはクロックを遮断
することにより、衝突によるバッテリ電圧供給停止が生
じた場合を想定した場合のハードウェアのコストアップ
を抑えるという効果が得られる。
【図１】本発明の実施の形態１のエアバッグシステムの
構成図である。
構成図である。
【図２】実施の形態のエアバッグシステム衝突後の動作
説明図である。
説明図である。
【図３】実施の形態２のエアバッグシステムの構成図で
ある。
ある。
【図４】従来のエアバッグシステムの構成図である。
【図５】従来のエアバッグシステムの衝突後の動作説明
図である。
図である。
５１ バッテリ電源 ５４ Ｇセンサ ５５ 展開用トランジスタ（点火用トランジスタ） ５６ 点火装置 ５９ バックアップコンデンサ ６２ 不揮発性メモリ
Claims (3)
- 【請求項１】 Ｇセンサ入力を処理することにより車両
衝突状態を検知し、バックアップ用コンデンサが並列に
接続されたバッテリ電源とグランドの間に設けられた点
火装置に直列に接続された少なくとも１つの点火用トラ
ンジスタをＯＮ状態とすることにより、該点火装置に所
定の電源を印加し、点火させるとともに、Ｇセンサ入力
処理結果もしくは衝突前後のシステムの状態を不揮発性
メモリに記録するエアバッグシステムにおいて、 前記車両衝突状態検知後、衝突から不揮発性メモリの記
録終了までの間に処理が必要とされない機能の消費電流
を低減することを特徴とするエアバッグシステム。 - 【請求項２】 車両衝突状態検知後、衝突から不揮発性
メモリの記録終了までの間に処理が必要とされない機能
への電力供給を停止することを特徴とする上記請求項１
記載のエアバッグシステム。 - 【請求項３】 車両衝突状態検知後、衝突から不揮発性
メモリの記録終了までの間に処理が必要とされない機能
へのクロック供給を停止することを特徴とする上記請求
項１記載のエアバッグシステム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33735295A JPH09175317A (ja) | 1995-12-25 | 1995-12-25 | エアバッグシステム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33735295A JPH09175317A (ja) | 1995-12-25 | 1995-12-25 | エアバッグシステム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09175317A true JPH09175317A (ja) | 1997-07-08 |
Family
ID=18307818
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP33735295A Pending JPH09175317A (ja) | 1995-12-25 | 1995-12-25 | エアバッグシステム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09175317A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2017159736A (ja) * | 2016-03-08 | 2017-09-14 | 株式会社デンソー | 電子装置 |
-
1995
- 1995-12-25 JP JP33735295A patent/JPH09175317A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2017159736A (ja) * | 2016-03-08 | 2017-09-14 | 株式会社デンソー | 電子装置 |
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