JPH08308099A - Ｉｃメモリカードのメモリｉｃへの電力供給方法およびその回路 - Google Patents
Ｉｃメモリカードのメモリｉｃへの電力供給方法およびその回路Info
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- JPH08308099A JPH08308099A JP7326892A JP32689295A JPH08308099A JP H08308099 A JPH08308099 A JP H08308099A JP 7326892 A JP7326892 A JP 7326892A JP 32689295 A JP32689295 A JP 32689295A JP H08308099 A JPH08308099 A JP H08308099A
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Abstract
(57)【要約】
【課題】電池が消耗し尽くすまで電力供給が可能な、メ
モリＩＣへの電力供給方法とその回路を提供する。 【解決手段】１次電池７と２次電池１６とを直列に接続
したり並列に接続したりする直並列転換スイッチング手
段（１８、１９、２０）と、メモリＩＣ８に供給される
電圧が基準電圧２５以下に下降した場合には電圧検出信
号を発生する電圧検出手段４０と、電圧検出信号を受け
て直並列転換スイッチング手段を制御して１次電池７と
２次電池１６とを直列または並列に接続するように制御
するスイッチング制御手段５０とからなる電力供給回路
と、外部電力が入力されない場合には、先ず１次電池７
と２次電池１６とを並列に接続し、１次電池７および２
次電池１６の電圧が基準電圧２５以下に下降した場合に
は直列に接続して電力を供給する電力供給方法とからな
る。
モリＩＣへの電力供給方法とその回路を提供する。 【解決手段】１次電池７と２次電池１６とを直列に接続
したり並列に接続したりする直並列転換スイッチング手
段（１８、１９、２０）と、メモリＩＣ８に供給される
電圧が基準電圧２５以下に下降した場合には電圧検出信
号を発生する電圧検出手段４０と、電圧検出信号を受け
て直並列転換スイッチング手段を制御して１次電池７と
２次電池１６とを直列または並列に接続するように制御
するスイッチング制御手段５０とからなる電力供給回路
と、外部電力が入力されない場合には、先ず１次電池７
と２次電池１６とを並列に接続し、１次電池７および２
次電池１６の電圧が基準電圧２５以下に下降した場合に
は直列に接続して電力を供給する電力供給方法とからな
る。
Description
【０００１】
【発明の属する技術分野】本発明は、バッテリーバック
アップを要するＩＣメモリカードのメモリＩＣへの電力
供給方法およびその回路に関し、特にデータバックアッ
プ時間の延長を可能とするＩＣメモリカードのメモリＩ
Ｃへの電力供給方法およびその回路に関する。
アップを要するＩＣメモリカードのメモリＩＣへの電力
供給方法およびその回路に関し、特にデータバックアッ
プ時間の延長を可能とするＩＣメモリカードのメモリＩ
Ｃへの電力供給方法およびその回路に関する。
【０００２】
【従来の技術】クレジットカードのような小さなカード
にメモリＩＣを設置して、大量の情報を保存して各種の
サービスに用いる従来のＩＣメモリカードにおいては、
メモリＩＣのデータを保持するために、常にメモリＩＣ
へ電力を供給する必要がある。
にメモリＩＣを設置して、大量の情報を保存して各種の
サービスに用いる従来のＩＣメモリカードにおいては、
メモリＩＣのデータを保持するために、常にメモリＩＣ
へ電力を供給する必要がある。
【０００３】図２は、従来のＩＣメモリカードのメモリ
ＩＣへの電力供給回路図である。本図に示す従来のＩＣ
メモリカードのメモリＩＣへの電力供給回路において
は、１次電池のみを用いてメモリＩＣに電力を供給す
る。
ＩＣへの電力供給回路図である。本図に示す従来のＩＣ
メモリカードのメモリＩＣへの電力供給回路において
は、１次電池のみを用いてメモリＩＣに電力を供給す
る。
【０００４】この回路においては、外部電源は電源端子
１に接続されており、電力は外部電力線２を通じて、電
源ＩＣ３の第１の端子から、電圧調整機能を有する電源
ＩＣ３に供給される。電源ＩＣ３の第２の端子は、接地
線１０に接続されている。更に、電源ＩＣ３の第３の端
子（出力端子）は、内部電力線４に接続されており、内
部電力線４を介してダイオード５のカソードと、メモリ
ＩＣ８の電源端子とに接続されている。ダイオード５の
アノードは、抵抗６の第１の端子に接続されており、抵
抗６の第２の端子は、１次電池７のプラス端子に接続さ
れている。１次電池７のマイナス端子は接地され、接地
端子９は、接地線１０に接続されている。
１に接続されており、電力は外部電力線２を通じて、電
源ＩＣ３の第１の端子から、電圧調整機能を有する電源
ＩＣ３に供給される。電源ＩＣ３の第２の端子は、接地
線１０に接続されている。更に、電源ＩＣ３の第３の端
子（出力端子）は、内部電力線４に接続されており、内
部電力線４を介してダイオード５のカソードと、メモリ
ＩＣ８の電源端子とに接続されている。ダイオード５の
アノードは、抵抗６の第１の端子に接続されており、抵
抗６の第２の端子は、１次電池７のプラス端子に接続さ
れている。１次電池７のマイナス端子は接地され、接地
端子９は、接地線１０に接続されている。
【０００５】このような回路においては、メモリＩＣ８
内のデータを保持するためには、電源が常に供給されて
いる必要がある。電源端子１と接地端子９とに接続され
ている外部電源が取り外された場合にも、１次電池７と
抵抗６とダイオード５とからなる内部電力供給手段によ
って電力は継続して供給される。したがって、メモリＩ
Ｃ８には常に電力が供給され、データが保持される。
内のデータを保持するためには、電源が常に供給されて
いる必要がある。電源端子１と接地端子９とに接続され
ている外部電源が取り外された場合にも、１次電池７と
抵抗６とダイオード５とからなる内部電力供給手段によ
って電力は継続して供給される。したがって、メモリＩ
Ｃ８には常に電力が供給され、データが保持される。
【０００６】さて、電源ＩＣ３の出力電圧をＶICO、１
次電池７の電圧をＶBT7、ダイオード５の順方向電圧降
下をＶD5、電源ＩＣ３内の電流をＩICO、ダイオード５
内の電流をＩD5と定義する。
次電池７の電圧をＶBT7、ダイオード５の順方向電圧降
下をＶD5、電源ＩＣ３内の電流をＩICO、ダイオード５
内の電流をＩD5と定義する。
【０００７】正常な外部電圧が供給されている場合、す
なわちＶICO＞ＶBT7−ＶD5の場合には、ＩD5≒０とな
り、１次電池７の電流消費はなく、内部電力線４にはＶ
ICOが現われる。
なわちＶICO＞ＶBT7−ＶD5の場合には、ＩD5≒０とな
り、１次電池７の電流消費はなく、内部電力線４にはＶ
ICOが現われる。
【０００８】しかしながら、何らかの原因で外部供給電
圧が低くなるか遮断され、ＶICO＜ＶBT7−ＶD5となる
と、ＩICO≒０となり、１次電池７からＶBT7−ＶD5が内
部電力線４に現われ、メモリＩＣ８に供給される。
圧が低くなるか遮断され、ＶICO＜ＶBT7−ＶD5となる
と、ＩICO≒０となり、１次電池７からＶBT7−ＶD5が内
部電力線４に現われ、メモリＩＣ８に供給される。
【０００９】このような動作によって、内部電力線４に
は常に電力が供給され、メモリＩＣ８への電力供給が遮
断されることはなく、メモリＩＣ８のデータは保持され
る。しかしながら、１次電池７の容量には限界があるの
で、一定時間経過後には、１次電池７の電圧がメモリＩ
Ｃ８のデータ保持限界電圧以下に降下し、その結果、メ
モリＩＣ８内にデータが保持されないようになる。
は常に電力が供給され、メモリＩＣ８への電力供給が遮
断されることはなく、メモリＩＣ８のデータは保持され
る。しかしながら、１次電池７の容量には限界があるの
で、一定時間経過後には、１次電池７の電圧がメモリＩ
Ｃ８のデータ保持限界電圧以下に降下し、その結果、メ
モリＩＣ８内にデータが保持されないようになる。
【００１０】以上説明した図２に示す従来のＩＣメモリ
カードのメモリＩＣ８への電力供給回路においては、１
次電池７の寿命が限定されているので、データを長時間
保持することは難しい。そこで、データ保持期間を延長
するために、図３に示しすような１次電池７と２次電池
１６とを用いる回路が提案されている。
カードのメモリＩＣ８への電力供給回路においては、１
次電池７の寿命が限定されているので、データを長時間
保持することは難しい。そこで、データ保持期間を延長
するために、図３に示しすような１次電池７と２次電池
１６とを用いる回路が提案されている。
【００１１】この回路においては、外部電源は電源端子
１に接続されており、外部電力線２を通じて電源ＩＣ３
の第１の端子と抵抗１１の第１の端子とに接続されてい
る。電源ＩＣ３の第３の端子、すなわち出力端子は、内
部電力線４を介して、ダイオード５のカソードと、ダイ
オード１４のカソードと、メモリＩＣ８の電源端子とに
接続されている。抵抗１１の第２の端子は、ツェナーダ
イオード１２のカソードとダイオード１３のアノードと
に接続され、ツェナーダイオード１２のアノードは接地
されている。ダイオード１３のカソードは、抵抗１５の
第１の端子に接続されており、抵抗１５の第２の端子
は、２次電池１６のプラス端子とダイオード１４のアノ
ードとに接続されている。ダイオード５のアノードは、
抵抗６の第１の端子に接続され、抵抗６の第２の端子
は、１次電池７のプラス端子に接続されている。２次電
池１６のマイナス端子と、１次電池７のマイナス端子
と、メモリＩＣ８のマイナス端子は、接地線１０に接続
されている。外部電源の接地端子９も接地線１０に接続
されている。
１に接続されており、外部電力線２を通じて電源ＩＣ３
の第１の端子と抵抗１１の第１の端子とに接続されてい
る。電源ＩＣ３の第３の端子、すなわち出力端子は、内
部電力線４を介して、ダイオード５のカソードと、ダイ
オード１４のカソードと、メモリＩＣ８の電源端子とに
接続されている。抵抗１１の第２の端子は、ツェナーダ
イオード１２のカソードとダイオード１３のアノードと
に接続され、ツェナーダイオード１２のアノードは接地
されている。ダイオード１３のカソードは、抵抗１５の
第１の端子に接続されており、抵抗１５の第２の端子
は、２次電池１６のプラス端子とダイオード１４のアノ
ードとに接続されている。ダイオード５のアノードは、
抵抗６の第１の端子に接続され、抵抗６の第２の端子
は、１次電池７のプラス端子に接続されている。２次電
池１６のマイナス端子と、１次電池７のマイナス端子
と、メモリＩＣ８のマイナス端子は、接地線１０に接続
されている。外部電源の接地端子９も接地線１０に接続
されている。
【００１２】図３に示す回路の動作のうち、１次電池７
に関連する動作は図２に示した回路の動作と同様であ
る。すなわち、内部電力線４の電圧が低下すると、１次
電池７の電圧が抵抗６とダイオード５とを通じてメモリ
ＩＣ８に供給される。
に関連する動作は図２に示した回路の動作と同様であ
る。すなわち、内部電力線４の電圧が低下すると、１次
電池７の電圧が抵抗６とダイオード５とを通じてメモリ
ＩＣ８に供給される。
【００１３】外部から正常な電圧が供給されている場合
には、２次電池１６は、抵抗１１とダイオード１３とを
通じて充電される。ツェナーダイオード１２の電圧をＶ
ZD、ダイオード１３の順方向電圧降下をＶD13、ダイオ
ード１４の順方向電圧降下をＶD14、２次電池１６の電
圧をＶBT16とする。更に、またＶBT16＞ＶBT7と仮定す
る。電源端子１に供給される外部電力は、抵抗１１を通
じてツェナーダイオード１２に供給され、２次電池１６
にはＶZD−ＶD13の電圧が供給され、その結果、２次電
池１６が充電される。
には、２次電池１６は、抵抗１１とダイオード１３とを
通じて充電される。ツェナーダイオード１２の電圧をＶ
ZD、ダイオード１３の順方向電圧降下をＶD13、ダイオ
ード１４の順方向電圧降下をＶD14、２次電池１６の電
圧をＶBT16とする。更に、またＶBT16＞ＶBT7と仮定す
る。電源端子１に供給される外部電力は、抵抗１１を通
じてツェナーダイオード１２に供給され、２次電池１６
にはＶZD−ＶD13の電圧が供給され、その結果、２次電
池１６が充電される。
【００１４】また、この外部電源は、電源ＩＣ３を通じ
て内部電力線４に出力電圧ＶICOを供給するので、ＶICO
は、ＶBT16−ＶD14及びＶBT7−ＶD5より大きくなる。し
たがって、電源ＩＣ３を流れる電流ＩICOがメモリＩＣ
８に電力を供給し、１次電池７と２次電池１６は消費さ
れない。
て内部電力線４に出力電圧ＶICOを供給するので、ＶICO
は、ＶBT16−ＶD14及びＶBT7−ＶD5より大きくなる。し
たがって、電源ＩＣ３を流れる電流ＩICOがメモリＩＣ
８に電力を供給し、１次電池７と２次電池１６は消費さ
れない。
【００１５】電源端子１に外部電力が供給されない場合
には、１次電池７と２次電池１６とから内部電力線４に
電力が供給される。しかしながら、ＶBT16＞ＶBT7であ
るので、２次電池１６がダイオード１４を通じてメモリ
ＩＣ８に電力を供給する。こうして、ＶBT16≒ＶBT7に
なるまで電流消耗が進むと、１次電池と２次電池とがと
もに電力を供給するようになる。したがって、１次電池
のみを用いる図２の回路の場合よりも長時間の電力供給
が可能となり、その結果、データをより長期間保持する
ことが可能となる。
には、１次電池７と２次電池１６とから内部電力線４に
電力が供給される。しかしながら、ＶBT16＞ＶBT7であ
るので、２次電池１６がダイオード１４を通じてメモリ
ＩＣ８に電力を供給する。こうして、ＶBT16≒ＶBT7に
なるまで電流消耗が進むと、１次電池と２次電池とがと
もに電力を供給するようになる。したがって、１次電池
のみを用いる図２の回路の場合よりも長時間の電力供給
が可能となり、その結果、データをより長期間保持する
ことが可能となる。
【００１６】しかしながら、１次電池７と２次電池１６
の容量には限界があるので、一定時間経過後にはこれら
の電池の電圧がメモリＩＣ８のデータ保持限界電圧以下
に降下し、その結果、メモリＩＣ８内にデータが保持さ
れないようになる。
の容量には限界があるので、一定時間経過後にはこれら
の電池の電圧がメモリＩＣ８のデータ保持限界電圧以下
に降下し、その結果、メモリＩＣ８内にデータが保持さ
れないようになる。
【００１７】
【発明が解決しようとする課題】上記説明したように、
１次電池７のみを用いてＩＣメモリカードのメモリＩＣ
８へ電力を供給する従来の技術においても、１次電池７
と２次電池１６とを用いてＩＣメモリカードのメモリＩ
Ｃ８へ電力を供給する従来の技術においても、１次電池
７、または、１次電池７と２次電池１６の容量には限界
があるので、一定時間経過後にはこれらの電池の電圧が
メモリＩＣ８のデータ保持限界電圧以下に降下し、その
結果、メモリＩＣ８内にデータが保持されないようにな
るという問題がある。
１次電池７のみを用いてＩＣメモリカードのメモリＩＣ
８へ電力を供給する従来の技術においても、１次電池７
と２次電池１６とを用いてＩＣメモリカードのメモリＩ
Ｃ８へ電力を供給する従来の技術においても、１次電池
７、または、１次電池７と２次電池１６の容量には限界
があるので、一定時間経過後にはこれらの電池の電圧が
メモリＩＣ８のデータ保持限界電圧以下に降下し、その
結果、メモリＩＣ８内にデータが保持されないようにな
るという問題がある。
【００１８】本発明の目的は、上記従来技術における問
題点を解決するために、１次電池と２次電池とを用いて
データ保持期間を延長する従来の方法を改良して、電池
が消耗し尽くす瞬間まで電力供給の継続を可能ならしめ
て、データ保持期間の延長を可能とする、ＩＣメモリカ
ードのメモリＩＣへの電力供給方法およびその回路を提
供することにある。
題点を解決するために、１次電池と２次電池とを用いて
データ保持期間を延長する従来の方法を改良して、電池
が消耗し尽くす瞬間まで電力供給の継続を可能ならしめ
て、データ保持期間の延長を可能とする、ＩＣメモリカ
ードのメモリＩＣへの電力供給方法およびその回路を提
供することにある。
【００１９】
【課題を解決するための手段】上記目的を達成するため
に、本願発明のＩＣメモリカードのメモリＩＣへの電力
供給回路は、１次電池および２次電池と、上記２次電池
を充電する２次電池充電回路と、外部電源が遮断された
場合に、上記１次電池と上記２次電池とをメモリＩＣに
接続する１次電池及び２次電池放電回路とを備え、上記
１次電池と上記２次電池とを上記メモリＩＣのデータ保
持用電源に用いるＩＣメモリカードのメモリＩＣへの電
力供給回路において、上記１次電池と上記２次電池とを
直列に接続したり並列に接続したりする直並列転換スイ
ッチング手段と、上記メモリＩＣに供給される電圧と基
準電圧とを比較して、上記メモリＩＣに供給される電圧
が基準電圧以下に下降した場合には電圧検出信号を発生
する電圧検出手段と、上記電圧検出手段の上記電圧検出
信号を受け、上記直並列転換スイッチング手段を制御し
て上記１次電池と上記２次電池とを直列または並列に接
続するように制御するスイッチング制御手段と、を含ん
で構成することを特徴とする。
に、本願発明のＩＣメモリカードのメモリＩＣへの電力
供給回路は、１次電池および２次電池と、上記２次電池
を充電する２次電池充電回路と、外部電源が遮断された
場合に、上記１次電池と上記２次電池とをメモリＩＣに
接続する１次電池及び２次電池放電回路とを備え、上記
１次電池と上記２次電池とを上記メモリＩＣのデータ保
持用電源に用いるＩＣメモリカードのメモリＩＣへの電
力供給回路において、上記１次電池と上記２次電池とを
直列に接続したり並列に接続したりする直並列転換スイ
ッチング手段と、上記メモリＩＣに供給される電圧と基
準電圧とを比較して、上記メモリＩＣに供給される電圧
が基準電圧以下に下降した場合には電圧検出信号を発生
する電圧検出手段と、上記電圧検出手段の上記電圧検出
信号を受け、上記直並列転換スイッチング手段を制御し
て上記１次電池と上記２次電池とを直列または並列に接
続するように制御するスイッチング制御手段と、を含ん
で構成することを特徴とする。
【００２０】この場合、上記電圧検出手段は、基準電圧
とメモリＩＣに供給される電源の電圧とを比較する比較
器を含んで構成することを特徴とする。
とメモリＩＣに供給される電源の電圧とを比較する比較
器を含んで構成することを特徴とする。
【００２１】またこの場合、上記直並列スイッチング手
段は、上記２次電池のマイナス端子と接地との間に接続
された第１スイッチと、上記１次電池のプラス端子と上
記２次電池のマイナス端子との間に接続された第２スイ
ッチと、上記２次電池のプラス端子と上記メモリＩＣの
電源端子との間にダイオードと並列に接続された第３ス
イッチと、を含んで構成することを特徴とする。
段は、上記２次電池のマイナス端子と接地との間に接続
された第１スイッチと、上記１次電池のプラス端子と上
記２次電池のマイナス端子との間に接続された第２スイ
ッチと、上記２次電池のプラス端子と上記メモリＩＣの
電源端子との間にダイオードと並列に接続された第３ス
イッチと、を含んで構成することを特徴とする。
【００２２】またこの場合、上記スイッチング制御手段
は、上記電圧検出手段の電圧検出信号をクロック入力端
子から受け、外部電源電圧をリセット端子から受けて、
出力端子の電圧をハイあるいはローに制御するＪＫフリ
ップフロップを含んで構成することを特徴とする。
は、上記電圧検出手段の電圧検出信号をクロック入力端
子から受け、外部電源電圧をリセット端子から受けて、
出力端子の電圧をハイあるいはローに制御するＪＫフリ
ップフロップを含んで構成することを特徴とする。
【００２３】またこの場合、上記スイッチング制御手段
は、上記電圧検出手段の電圧検出信号をクロック入力端
子から受け、外部電源電圧をリセット端子から受けて出
力端子の電圧をハイあるいはローに制御するＪＫフリッ
プフロップからなり、上記ＪＫフリップフロップの出力
端子を上記第２スイッチの制御端子と上記第３スイッチ
の制御端子とに接続し、上記ＪＫフリップフロップの出
力端子をインバータを介して上記第１スイッチの制御端
子に接続する、ことを特徴とする。
は、上記電圧検出手段の電圧検出信号をクロック入力端
子から受け、外部電源電圧をリセット端子から受けて出
力端子の電圧をハイあるいはローに制御するＪＫフリッ
プフロップからなり、上記ＪＫフリップフロップの出力
端子を上記第２スイッチの制御端子と上記第３スイッチ
の制御端子とに接続し、上記ＪＫフリップフロップの出
力端子をインバータを介して上記第１スイッチの制御端
子に接続する、ことを特徴とする。
【００２４】また上記目的を達成するための本願発明の
ＩＣメモリカードのメモリＩＣへの電力供給方法は、１
次電池および２次電池と、上記２次電池を充電する２次
電池充電回路と、外部電源が遮断された場合に、上記１
次電池と上記２次電池とをメモリＩＣに接続する１次電
池及び２次電池放電回路と、上記１次電池と上記２次電
池とを直列に接続したり並列に接続したりする直並列転
換スイッチング手段と、上記メモリＩＣに供給される電
圧と基準電圧とを比較して、上記メモリＩＣに供給され
る電圧が基準電圧以下に下降した場合には電圧検出信号
を発生する電圧検出手段と、上記電圧検出手段の上記電
圧検出信号を受け、上記直並列転換スイッチング手段を
制御して上記１次電池と上記２次電池とを直列または並
列に接続するように制御するスイッチング制御手段と、
を含んで構成するＩＣメモリカードのメモリＩＣへの電
力供給回路を用いるＩＣメモリカードのメモリＩＣへの
電力供給方法において、外部電力が入力されない場合に
は、先ず、上記１次電池と上記２次電池とを並列に接続
してメモリＩＣに電力を供給し、次ぎに、上記１次電池
および上記２次電池の電圧が基準電圧以下に下降した場
合には、上記１次電池と上記２次電池とを直列に接続し
てメモリＩＣに電力を供給することを特徴とする。
ＩＣメモリカードのメモリＩＣへの電力供給方法は、１
次電池および２次電池と、上記２次電池を充電する２次
電池充電回路と、外部電源が遮断された場合に、上記１
次電池と上記２次電池とをメモリＩＣに接続する１次電
池及び２次電池放電回路と、上記１次電池と上記２次電
池とを直列に接続したり並列に接続したりする直並列転
換スイッチング手段と、上記メモリＩＣに供給される電
圧と基準電圧とを比較して、上記メモリＩＣに供給され
る電圧が基準電圧以下に下降した場合には電圧検出信号
を発生する電圧検出手段と、上記電圧検出手段の上記電
圧検出信号を受け、上記直並列転換スイッチング手段を
制御して上記１次電池と上記２次電池とを直列または並
列に接続するように制御するスイッチング制御手段と、
を含んで構成するＩＣメモリカードのメモリＩＣへの電
力供給回路を用いるＩＣメモリカードのメモリＩＣへの
電力供給方法において、外部電力が入力されない場合に
は、先ず、上記１次電池と上記２次電池とを並列に接続
してメモリＩＣに電力を供給し、次ぎに、上記１次電池
および上記２次電池の電圧が基準電圧以下に下降した場
合には、上記１次電池と上記２次電池とを直列に接続し
てメモリＩＣに電力を供給することを特徴とする。
【００２５】
【発明の実施の形態】以下、本発明の実施の形態を添付
図面に基づいて詳細に説明する。
図面に基づいて詳細に説明する。
【００２６】図１は、本発明の実施の１形態であるＩＣ
メモリカードのメモリＩＣへの電力供給回路図である。
メモリカードのメモリＩＣへの電力供給回路図である。
【００２７】本発明の実施の１形態であるＩＣメモリカ
ードのメモリＩＣ８への電力供給回路は、１次電池７お
よび２次電池１６と、２次電池１６を充電する２次電池
充電回路と、外部電源が遮断された場合に、１次電池７
と２次電池１６とをメモリＩＣ８に接続する１次電池７
及び２次電池１６放電回路と、１次電池７と２次電池１
６とを直列に接続したり並列に接続したりする直並列転
換スイッチング手段と、メモリＩＣ８に供給される電圧
と基準電圧とを比較して、メモリＩＣ８に供給される電
圧が基準電圧以下に下降した場合には電圧検出信号を発
生する電圧検出手段４０と、電圧検出手段４０の電圧検
出信号を受け、直並列転換スイッチング手段を制御して
１次電池と２次電池とを直列または並列に接続するよう
に制御するスイッチング制御手段５０と、を含んで構成
される。
ードのメモリＩＣ８への電力供給回路は、１次電池７お
よび２次電池１６と、２次電池１６を充電する２次電池
充電回路と、外部電源が遮断された場合に、１次電池７
と２次電池１６とをメモリＩＣ８に接続する１次電池７
及び２次電池１６放電回路と、１次電池７と２次電池１
６とを直列に接続したり並列に接続したりする直並列転
換スイッチング手段と、メモリＩＣ８に供給される電圧
と基準電圧とを比較して、メモリＩＣ８に供給される電
圧が基準電圧以下に下降した場合には電圧検出信号を発
生する電圧検出手段４０と、電圧検出手段４０の電圧検
出信号を受け、直並列転換スイッチング手段を制御して
１次電池と２次電池とを直列または並列に接続するよう
に制御するスイッチング制御手段５０と、を含んで構成
される。
【００２８】電源端子１に外部電源が接続されると、外
部電源は外部電力線２を通じて電源ＩＣ３に接続され、
電源ＩＣ３の出力はメモリＩＣ８に印加される。
部電源は外部電力線２を通じて電源ＩＣ３に接続され、
電源ＩＣ３の出力はメモリＩＣ８に印加される。
【００２９】１次電池７の放電回路は、抵抗６と、ダイ
オード５と、メモリＩＣ８と、接地線１０とからなる直
列回路である。
オード５と、メモリＩＣ８と、接地線１０とからなる直
列回路である。
【００３０】２次電池１６の放電回路は、ダイオード１
４と、メモリＩＣ８と、接地線１０と、第１スイッチ１
９とからなる直列回路の第１放電通路か、または、第３
スイッチ２０と、メモリＩＣ８と、接地線１０と、１次
電池７と、第２スイッチ１８とからなる直列回路の第２
放電通路である。
４と、メモリＩＣ８と、接地線１０と、第１スイッチ１
９とからなる直列回路の第１放電通路か、または、第３
スイッチ２０と、メモリＩＣ８と、接地線１０と、１次
電池７と、第２スイッチ１８とからなる直列回路の第２
放電通路である。
【００３１】２次電池１６を充電する２次電池充電回路
は、電源端子１を通じて接続される外部電力が、外部電
力線２と抵抗１１とを介して、ツェナーダイオード１２
のカソードとダイオード１３のアノードとに接続される
ように構成される。更に、ツェナーダイオード１２のア
ノードは接地線１０に接続され、ダイオード１３のカソ
ードは抵抗１５を介して２次電池１６のプラス端子に接
続され、２次電池１６のマイナス端子は第１スイッチ１
９を介して接地される。
は、電源端子１を通じて接続される外部電力が、外部電
力線２と抵抗１１とを介して、ツェナーダイオード１２
のカソードとダイオード１３のアノードとに接続される
ように構成される。更に、ツェナーダイオード１２のア
ノードは接地線１０に接続され、ダイオード１３のカソ
ードは抵抗１５を介して２次電池１６のプラス端子に接
続され、２次電池１６のマイナス端子は第１スイッチ１
９を介して接地される。
【００３２】１次電池７と２次電池１６とを直列または
並列に接続する直並列転換スイッチング手段は、２次電
池１６のマイナス端子と接地線１０との間に接続された
第１スイッチ１９と、１次電池７のプラス端子と２次電
池１６のマイナス端子との間に接続された第２スイッチ
１８と、２次電池１６のプラス端子とメモリＩＣ８の電
源端子との間にダイオード１４と並列に接続された第３
スイッチ２０と、からなる。
並列に接続する直並列転換スイッチング手段は、２次電
池１６のマイナス端子と接地線１０との間に接続された
第１スイッチ１９と、１次電池７のプラス端子と２次電
池１６のマイナス端子との間に接続された第２スイッチ
１８と、２次電池１６のプラス端子とメモリＩＣ８の電
源端子との間にダイオード１４と並列に接続された第３
スイッチ２０と、からなる。
【００３３】電圧検出信号を発生する電圧検出手段４０
は、基準電圧２５を１つの入力端子に受け、他の１つの
入力端子にはメモリＩＣ８の電力供給電圧が接続された
比較器２４を含んで構成される。メモリＩＣ８への電力
供給電圧が基準電圧２５より高いか低いかに応じて、比
較器２４の出力線にはローまたはハイの電圧状態が出力
される。
は、基準電圧２５を１つの入力端子に受け、他の１つの
入力端子にはメモリＩＣ８の電力供給電圧が接続された
比較器２４を含んで構成される。メモリＩＣ８への電力
供給電圧が基準電圧２５より高いか低いかに応じて、比
較器２４の出力線にはローまたはハイの電圧状態が出力
される。
【００３４】１次電池７と２次電池１６とが直列接続ま
たは並列接続になるように制御するスイッチング制御手
段５０は、ＪＫフリップフロップ２２を含んで構成され
る。ＪＫフリップフロップ２２のＪ端子は電源（メモリ
ＩＣ８の電源と同一）に接続し、Ｋ端子は接地し、クロ
ック入力端子ＣＫは電圧検出信号に接続する。更に、リ
セット端子ＲＥＳＥＴは外部電力線２に接続し、出力端
子Ｑは第２スイッチ１８および第３スイッチ２０のコン
トロール端子に接続すると共に、インバータ２１を介し
て第１スイッチ１９のコントロール端子に接続して構成
する。
たは並列接続になるように制御するスイッチング制御手
段５０は、ＪＫフリップフロップ２２を含んで構成され
る。ＪＫフリップフロップ２２のＪ端子は電源（メモリ
ＩＣ８の電源と同一）に接続し、Ｋ端子は接地し、クロ
ック入力端子ＣＫは電圧検出信号に接続する。更に、リ
セット端子ＲＥＳＥＴは外部電力線２に接続し、出力端
子Ｑは第２スイッチ１８および第３スイッチ２０のコン
トロール端子に接続すると共に、インバータ２１を介し
て第１スイッチ１９のコントロール端子に接続して構成
する。
【００３５】全体的に再度説明すると、外部電源は外部
電力線２に接続され、同時に、抵抗１１の第１の端子
と、電源ＩＣ３の第１の端子（入力端子）と、ＪＫフリ
ップフロップ２２のリセット端子ＲＥＳＥＴとに接続さ
れる。抵抗１１の第２の端子は、ツェナーダイオード１
２のカソードと、ダイオード１３のアノードとに接続さ
れ、ツェナーダイオード１２のアノードは接地線１０に
接続される。ダイオード１３のカソードは、抵抗１５を
介してダイオード１４のアノードと、第３スイッチ２０
の第１の端子と、２次電池１６のプラス端子とに接続さ
れる。
電力線２に接続され、同時に、抵抗１１の第１の端子
と、電源ＩＣ３の第１の端子（入力端子）と、ＪＫフリ
ップフロップ２２のリセット端子ＲＥＳＥＴとに接続さ
れる。抵抗１１の第２の端子は、ツェナーダイオード１
２のカソードと、ダイオード１３のアノードとに接続さ
れ、ツェナーダイオード１２のアノードは接地線１０に
接続される。ダイオード１３のカソードは、抵抗１５を
介してダイオード１４のアノードと、第３スイッチ２０
の第１の端子と、２次電池１６のプラス端子とに接続さ
れる。
【００３６】２次電池１６のマイナス端子は、第１スイ
ッチ１９の第１の端子に接続され、第１スイッチ１９の
第２の端子は接地線１０に接続される。抵抗６の第２の
端子はダイオード５のアノードに接続される。電源ＩＣ
３の第２の端子は接地線１０に接続され、第３の端子
（出力端子）は内部電力線４と、ダイオード１４のカソ
ードと、ダイオード５のカソードと、第３スイッチ２０
の第２の端子と、コンデンサ２３の第１の端子と、ＪＫ
フリップフロップ２２のＶＣＣ端子及びＪ入力端子と、
比較器２４のＶＣＣ端子及びマイナス入力端子と、メモ
リＩＣ８の電源端子とにそれぞれ接続される。コンデン
サ２３の第２の端子は接地線１０に接続され、メモリＩ
Ｃ８の第２の端子も接地線１０に接続される。比較器２
４のプラス端子は基準電圧２５のプラス端子に接続さ
れ、基準電圧２５のマイナス端子は接地線１０に接続さ
れる。
ッチ１９の第１の端子に接続され、第１スイッチ１９の
第２の端子は接地線１０に接続される。抵抗６の第２の
端子はダイオード５のアノードに接続される。電源ＩＣ
３の第２の端子は接地線１０に接続され、第３の端子
（出力端子）は内部電力線４と、ダイオード１４のカソ
ードと、ダイオード５のカソードと、第３スイッチ２０
の第２の端子と、コンデンサ２３の第１の端子と、ＪＫ
フリップフロップ２２のＶＣＣ端子及びＪ入力端子と、
比較器２４のＶＣＣ端子及びマイナス入力端子と、メモ
リＩＣ８の電源端子とにそれぞれ接続される。コンデン
サ２３の第２の端子は接地線１０に接続され、メモリＩ
Ｃ８の第２の端子も接地線１０に接続される。比較器２
４のプラス端子は基準電圧２５のプラス端子に接続さ
れ、基準電圧２５のマイナス端子は接地線１０に接続さ
れる。
【００３７】比較器２４のＧＮＤ端子は接地線１０に接
続され、比較器２４の出力端子はＪＫフリップフロップ
２２のクロック入力端子ＣＫに接続され、ＪＫフリップ
フロップ２２のＫ端子は接地線１０に接続される。ＪＫ
フリップフロップ２２の出力端子Ｑは、第２スイッチ１
８のコントロール端子と第３スイッチ２０のコントロー
ル端子とインバータ２１の入力端子とに接続される。イ
ンバータ２１の出力端子は、第１スイッチ１９のコント
ロール端子に接続される。ＪＫフリップフロップ２２の
ＧＮＤ端子は接地線１０に接続される。
続され、比較器２４の出力端子はＪＫフリップフロップ
２２のクロック入力端子ＣＫに接続され、ＪＫフリップ
フロップ２２のＫ端子は接地線１０に接続される。ＪＫ
フリップフロップ２２の出力端子Ｑは、第２スイッチ１
８のコントロール端子と第３スイッチ２０のコントロー
ル端子とインバータ２１の入力端子とに接続される。イ
ンバータ２１の出力端子は、第１スイッチ１９のコント
ロール端子に接続される。ＪＫフリップフロップ２２の
ＧＮＤ端子は接地線１０に接続される。
【００３８】上記構成の本願発明の実施の形態の回路の
動作は以下のとおりである。
動作は以下のとおりである。
【００３９】（１）外部電源が入力される場合 外部電源が電源端子１を通じて電源ＩＣ３に入力される
と、電源ＩＣの出力としてＶICOが内部電力線４に生じ
る。同時に、外部電力は抵抗１１を介してツェナーダイ
オード１２に供給され、ＶZDに等価な電圧がダイオード
１３と抵抗１５とを介して２次電池１６のプラス端子に
供給され、２次電池１６は電圧ＶBT16に充電される。
と、電源ＩＣの出力としてＶICOが内部電力線４に生じ
る。同時に、外部電力は抵抗１１を介してツェナーダイ
オード１２に供給され、ＶZDに等価な電圧がダイオード
１３と抵抗１５とを介して２次電池１６のプラス端子に
供給され、２次電池１６は電圧ＶBT16に充電される。
【００４０】（２）外部電源が入力されない場合 外部電源の接続が絶たれると、ＶZD≒０になり、ＪＫフ
リップフロップ２２のリセットが解放されて、正常動作
モードとなる。しかし、第２スイッチ１８と第３スイッ
チ２０とは、引き続きターン オフ状態にあり、一方、
第１スイッチ１９はターン オン状態にある。
リップフロップ２２のリセットが解放されて、正常動作
モードとなる。しかし、第２スイッチ１８と第３スイッ
チ２０とは、引き続きターン オフ状態にあり、一方、
第１スイッチ１９はターン オン状態にある。
【００４１】したがって、１次電池７と２次電池１６の
うち電圧が高い方の１つが、内部電力線４に電圧を供給
する。この電圧は、２次電池１６の電圧は１次電池７の
電圧よりも高く設計されているので、ＶBT16−ＶD14に
等価である。２次電池１６が使用されて電圧が下降した
後には、１次電池７と２次電池１６とが同時に電力を供
給するようになる。
うち電圧が高い方の１つが、内部電力線４に電圧を供給
する。この電圧は、２次電池１６の電圧は１次電池７の
電圧よりも高く設計されているので、ＶBT16−ＶD14に
等価である。２次電池１６が使用されて電圧が下降した
後には、１次電池７と２次電池１６とが同時に電力を供
給するようになる。
【００４２】しかしながら、比較器２４のマイナス端子
には内部電力線４の内部電源電圧が接続されており、比
較器２４のプラス端子には基準電圧２５のプラス側が接
続されている。（基準電圧２５の電圧Ｖrは、メモリＩ
Ｃにデータを保持可能な一定の電圧値を有する。）した
がって、比較器２４の出力は、正負の入力端子によって
決定される。すなわち、マイナス端子の電圧がプラス端
子の電圧より高い場合にはロー出力が出力され、一方、
それと反対の場合には、ハイ出力が出力される。ＪＫフ
リップフロップ２２のクロック信号ＣKは、ハイエッジ
においてトリガを行なうようになっている。
には内部電力線４の内部電源電圧が接続されており、比
較器２４のプラス端子には基準電圧２５のプラス側が接
続されている。（基準電圧２５の電圧Ｖrは、メモリＩ
Ｃにデータを保持可能な一定の電圧値を有する。）した
がって、比較器２４の出力は、正負の入力端子によって
決定される。すなわち、マイナス端子の電圧がプラス端
子の電圧より高い場合にはロー出力が出力され、一方、
それと反対の場合には、ハイ出力が出力される。ＪＫフ
リップフロップ２２のクロック信号ＣKは、ハイエッジ
においてトリガを行なうようになっている。
【００４３】電池の消耗が更に進行してＶICO＜Ｖrとな
ると、比較器２４の出力がハイに変わり、ＪＫフリップ
フロップ２２のＱ端子の出力がハイとなる。すると、第
２スイッチ１８と第３スイッチ２０とがターン オンさ
れ、第１スイッチ１９はターン オフされる。その結
果、１次電池７と２次電池１６とが直列に接続される。
また、ダイオード１４は存在しないと同様の状態にな
る。したがって、電圧関係は、ＶICO＝ＶBT16＋ＶBT7と
なり、ダイオード１４の順方向電圧降下ＶD14もなくな
り、メモリＩＣ８には連続的に電圧が供給されるように
なる。
ると、比較器２４の出力がハイに変わり、ＪＫフリップ
フロップ２２のＱ端子の出力がハイとなる。すると、第
２スイッチ１８と第３スイッチ２０とがターン オンさ
れ、第１スイッチ１９はターン オフされる。その結
果、１次電池７と２次電池１６とが直列に接続される。
また、ダイオード１４は存在しないと同様の状態にな
る。したがって、電圧関係は、ＶICO＝ＶBT16＋ＶBT7と
なり、ダイオード１４の順方向電圧降下ＶD14もなくな
り、メモリＩＣ８には連続的に電圧が供給されるように
なる。
【００４４】
【発明の効果】上記本願発明のＩＣメモリカードのメモ
リＩＣへの電力供給方法およびその回路によれば、最初
は１次電池と２次電池とを並列に接続して使用し、１次
電池と２次電池とが消耗し始めた場合には、１次電池と
２次電池とを直列に接続して使用するので、電池の残存
電力を最大限に利用してメモリＩＣのデータ保持を継続
できるという効果がある。さらに、１次電池と２次電池
とを直列に接続した場合に、電源供給回路からダイオー
ドを除外することができるので、更に、ダイオードの順
方向電圧降下分、長時間にわたって電池の残存電力を最
大限に利用してメモリＩＣのデータ保持を継続できると
いう効果がある。
リＩＣへの電力供給方法およびその回路によれば、最初
は１次電池と２次電池とを並列に接続して使用し、１次
電池と２次電池とが消耗し始めた場合には、１次電池と
２次電池とを直列に接続して使用するので、電池の残存
電力を最大限に利用してメモリＩＣのデータ保持を継続
できるという効果がある。さらに、１次電池と２次電池
とを直列に接続した場合に、電源供給回路からダイオー
ドを除外することができるので、更に、ダイオードの順
方向電圧降下分、長時間にわたって電池の残存電力を最
大限に利用してメモリＩＣのデータ保持を継続できると
いう効果がある。
【図１】本発明のＩＣメモリカードのメモリＩＣへの電
力供給回路図である。
力供給回路図である。
【図２】従来のＩＣメモリカードのメモリＩＣへの電力
供給回路図である。
供給回路図である。
【図３】従来のＩＣメモリカードのメモリＩＣへの電力
供給回路図である。
供給回路図である。
１…電源端子、 ２…外部電力線、 ３…電源ＩＣ、 ４…内部電力線、 ５…ダイオード、 ６…抵抗、 ７…１次電池、 ８…メモリＩＣ、 ９…接地端子、 １０…接地線、 １１…抵抗、 １２…ツェナーダイオード、 １３…ダイオード、 １４…ダイオード、 １５…抵抗、 １６…２次電池、 １８…第２スイッチ、 １９…第１スイッチ、 ２０…第３スイッチ、 ２１…インバータ、 ２２…ＪＫフリップフロップ、 ２３…コンデンサ、 ２４…比較器、 ２５…基準電圧、 ４０…電圧検出手段、 ５０…スイッチング制御手段
Claims (6)
- 【請求項１】１次電池および２次電池と、 上記２次電池を充電する２次電池充電回路と、 外部電源が遮断された場合に、上記１次電池と上記２次
電池とをメモリＩＣに接続する１次電池及び２次電池放
電回路とを備え、上記１次電池と上記２次電池とを上記
メモリＩＣのデータ保持用電源に用いるＩＣメモリカー
ドのメモリＩＣへの電力供給回路において、 上記１次電池と上記２次電池とを直列に接続したり並列
に接続したりする直並列転換スイッチング手段と、 上記メモリＩＣに供給される電圧と基準電圧とを比較し
て、上記メモリＩＣに供給される電圧が基準電圧以下に
下降した場合には電圧検出信号を発生する電圧検出手段
と、 上記電圧検出手段の上記電圧検出信号を受け、上記直並
列転換スイッチング手段を制御して上記１次電池と上記
２次電池とを直列または並列に接続するように制御する
スイッチング制御手段と、 を含んで構成することを特徴とするＩＣメモリカードの
メモリＩＣへの電力供給回路。 - 【請求項２】請求項１に記載のＩＣメモリカードのメモ
リＩＣへの電力供給回路において、上記電圧検出手段
は、基準電圧とメモリＩＣに供給される電源の電圧とを
比較する比較器を含んで構成することを特徴とするＩＣ
メモリカードのメモリＩＣへの電力供給回路。 - 【請求項３】請求項１に記載のＩＣメモリカードのメモ
リＩＣへの電力供給回路において、上記直並列スイッチ
ング手段は、 上記２次電池のマイナス端子と接地との間に接続された
第１スイッチと、 上記１次電池のプラス端子と上記２次電池のマイナス端
子との間に接続された第２スイッチと、 上記２次電池のプラス端子と上記メモリＩＣの電源端子
との間にダイオードと並列に接続された第３スイッチ
と、 を含んで構成することを特徴とするＩＣメモリカードの
メモリＩＣへの電力供給回路。 - 【請求項４】請求項１に記載のＩＣメモリカードのメモ
リＩＣへの電力供給回路において、上記スイッチング制
御手段は、上記電圧検出手段の電圧検出信号をクロック
入力端子から受け、外部電源電圧をリセット端子から受
けて、出力端子の電圧をハイあるいはローに制御するＪ
Ｋフリップフロップを含んで構成することを特徴とする
ＩＣメモリカードのメモリＩＣへの電力供給回路。 - 【請求項５】請求項３に記載のＩＣメモリカードのメモ
リＩＣへの電力供給回路において、上記スイッチング制
御手段は、 上記電圧検出手段の電圧検出信号をクロック入力端子か
ら受け、外部電源電圧をリセット端子から受けて出力端
子の電圧をハイあるいはローに制御するＪＫフリップフ
ロップからなり、 上記ＪＫフリップフロップの出力端子を上記第２スイッ
チの制御端子と上記第３スイッチの制御端子とに接続
し、 上記ＪＫフリップフロップの出力端子をインバータを介
して上記第１スイッチの制御端子に接続する、 ことを特徴とするＩＣメモリカードのメモリＩＣへの電
力供給回路。 - 【請求項６】１次電池および２次電池と、 上記２次電池を充電する２次電池充電回路と、 外部電源が遮断された場合に、上記１次電池と上記２次
電池とをメモリＩＣに接続する１次電池及び２次電池放
電回路と、 上記１次電池と上記２次電池とを直列に接続したり並列
に接続したりする直並列転換スイッチング手段と、 上記メモリＩＣに供給される電圧と基準電圧とを比較し
て、上記メモリＩＣに供給される電圧が基準電圧以下に
下降した場合には電圧検出信号を発生する電圧検出手段
と、 上記電圧検出手段の上記電圧検出信号を受け、上記直並
列転換スイッチング手段を制御して上記１次電池と上記
２次電池とを直列または並列に接続するように制御する
スイッチング制御手段と、 を含んで構成するＩＣメモリカードのメモリＩＣへの電
力供給回路を用いるＩＣメモリカードのメモリＩＣへの
電力供給方法において、 外部電力が入力されない場合には、先ず、上記１次電池
と上記２次電池とを並列に接続してメモリＩＣに電力を
供給し、次ぎに、上記１次電池および上記２次電池の電
圧が基準電圧以下に下降した場合には、上記１次電池と
上記２次電池とを直列に接続してメモリＩＣに電力を供
給することを特徴とするＩＣメモリカードのメモリＩＣ
への電力供給方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019950010039A KR0147199B1 (ko) | 1995-04-27 | 1995-04-27 | Ic 메모리 카드의 메모리 ic 전원공급 방법 및 회로 |
| KR1995-10039 | 1995-04-27 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH08308099A true JPH08308099A (ja) | 1996-11-22 |
| JP2880104B2 JP2880104B2 (ja) | 1999-04-05 |
Family
ID=19413071
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7326892A Expired - Fee Related JP2880104B2 (ja) | 1995-04-27 | 1995-12-15 | Ｉｃメモリカードのメモリｉｃへの電力供給方法およびその回路 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5687129A (ja) |
| JP (1) | JP2880104B2 (ja) |
| KR (1) | KR0147199B1 (ja) |
Families Citing this family (25)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| EP0952512A4 (en) * | 1997-01-14 | 2000-09-13 | Citizen Watch Co Ltd | POWER SUPPLY CIRCUIT FOR PORTABLE DEVICE |
| AUPR269301A0 (en) * | 2001-01-24 | 2001-02-22 | Cochlear Limited | Power supply for a cochlear implant |
| US8026637B2 (en) * | 2001-01-24 | 2011-09-27 | Cochlear Limited | Power supply having an auxiliary power cell |
| KR100419485B1 (ko) * | 2001-07-23 | 2004-02-19 | 한국전자통신연구원 | 아이씨 카드용 전원 공급 장치 |
| KR20030042968A (ko) * | 2001-11-26 | 2003-06-02 | 한국전자통신연구원 | 전하 순환 회로를 이용한 아이 씨 카드용 승압 장치 및 그제어방법 |
| US6854657B2 (en) * | 2001-11-28 | 2005-02-15 | General Instrument Corporation | Dual battery configuration and method of using the same to provide a long-term power solution in a programmable smart card |
| FR2837583B1 (fr) * | 2002-03-19 | 2005-02-04 | Schneider Automation | Dispositif de sauvegarde de donnees d'une carte electronique mobile |
| KR100730490B1 (ko) * | 2005-05-11 | 2007-06-20 | 가부시키가이샤 에프이시 | 비접촉식 아이씨 카드를 위한 아이씨 칩 내 전력 공급 회로 |
| KR100962101B1 (ko) * | 2006-03-14 | 2010-06-10 | 가부시키가이샤 리코 | 메모리 카드 및 메모리 카드 제어 전환 방법 |
| EP2110921B1 (en) * | 2008-04-14 | 2013-06-19 | Stanley Black & Decker, Inc. | Battery management system for a cordless tool |
| KR101599835B1 (ko) * | 2009-04-23 | 2016-03-15 | 삼성전자주식회사 | 보조 전원 장치 및 그것을 포함하는 사용자 장치 |
| US8806271B2 (en) | 2008-12-09 | 2014-08-12 | Samsung Electronics Co., Ltd. | Auxiliary power supply and user device including the same |
| CA2745365C (en) | 2008-12-23 | 2013-01-08 | J.J. Mackay Canada Limited | Low power wireless parking meter and parking meter network |
| CA3178279A1 (en) | 2011-03-03 | 2012-09-03 | J.J. Mackay Canada Limited | Parking meter with contactless payment |
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