JPH08216900A - 電動パワーステアリング装置 - Google Patents
電動パワーステアリング装置Info
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- JPH08216900A JPH08216900A JP2840895A JP2840895A JPH08216900A JP H08216900 A JPH08216900 A JP H08216900A JP 2840895 A JP2840895 A JP 2840895A JP 2840895 A JP2840895 A JP 2840895A JP H08216900 A JPH08216900 A JP H08216900A
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Abstract
(57)【要約】
【目的】 フェイルセーフリレーがオフされた後の電力
消費を抑制できると共に、イグニッションキースイッチ
がオフされるまで、発生する異常を確実に把握すること
ができる電動パワーステアリング装置の提供。 【構成】 走行状態及びコントローラ１ａの動作状態を
検出する複数のセンサｓ１〜ｓｎの各別の信号処理回路
ｐ１〜ｐｎが出力する検出信号に基づいて、モータ駆動
回路８によりモータＭを駆動し、その駆動力を操舵機構
へ与えて操舵補助を行う電動パワーステアリング装置。
異常検知手段２ａが複数のセンサｓ１〜ｓｎの何れかの
異常を検知したときに、モータ駆動回路８の電源回路７
ａと、異常が発生したセンサの信号処理回路の電源回路
とをオフ制御する電源制御手段２ａを備えている。
消費を抑制できると共に、イグニッションキースイッチ
がオフされるまで、発生する異常を確実に把握すること
ができる電動パワーステアリング装置の提供。 【構成】 走行状態及びコントローラ１ａの動作状態を
検出する複数のセンサｓ１〜ｓｎの各別の信号処理回路
ｐ１〜ｐｎが出力する検出信号に基づいて、モータ駆動
回路８によりモータＭを駆動し、その駆動力を操舵機構
へ与えて操舵補助を行う電動パワーステアリング装置。
異常検知手段２ａが複数のセンサｓ１〜ｓｎの何れかの
異常を検知したときに、モータ駆動回路８の電源回路７
ａと、異常が発生したセンサの信号処理回路の電源回路
とをオフ制御する電源制御手段２ａを備えている。
Description
【０００１】
【産業上の利用分野】本発明は、異常が発生したとき
に、フェイルセーフリレーを作動させる電動パワーステ
アリング装置の改良に関するものである。
に、フェイルセーフリレーを作動させる電動パワーステ
アリング装置の改良に関するものである。
【０００２】
【従来の技術】図３は、従来の電動パワーステアリング
装置の１例の要部構成を示すブロック図である。この電
動パワーステアリング装置は、操舵トルク、車速等車両
の走行状態及びコントローラ１の動作状態を検出する複
数のセンサｓ１〜ｓｎと、センサｓ１〜ｓｎの各別のセ
ンサ信号処理回路ｐ１〜ｐｎと、センサ信号処理回路ｐ
１〜ｐｎの各別の電源回路ｄ１〜ｄｎとを備え、電源回
路ｄ１〜ｄｎは、バッテリＢから電源を供給されてい
る。また、センサ信号処理回路ｐ１〜ｐｎの各検出信号
はＣＰＵ２へ与えられ、ＣＰＵ２は、その各検出信号に
基づいて、ＦＥＴ制御回路８（モータ駆動回路）により
ＦＥＴブリッジ９を介してモータＭを駆動する。モータ
Ｍの駆動力は、ＣＰＵ２がクラッチ制御回路５を通じて
オン／オフ制御するクラッチ６（電磁クラッチ）を介し
て、操舵機構（図示せず）へ与えられ、操舵補助が行わ
れる。
装置の１例の要部構成を示すブロック図である。この電
動パワーステアリング装置は、操舵トルク、車速等車両
の走行状態及びコントローラ１の動作状態を検出する複
数のセンサｓ１〜ｓｎと、センサｓ１〜ｓｎの各別のセ
ンサ信号処理回路ｐ１〜ｐｎと、センサ信号処理回路ｐ
１〜ｐｎの各別の電源回路ｄ１〜ｄｎとを備え、電源回
路ｄ１〜ｄｎは、バッテリＢから電源を供給されてい
る。また、センサ信号処理回路ｐ１〜ｐｎの各検出信号
はＣＰＵ２へ与えられ、ＣＰＵ２は、その各検出信号に
基づいて、ＦＥＴ制御回路８（モータ駆動回路）により
ＦＥＴブリッジ９を介してモータＭを駆動する。モータ
Ｍの駆動力は、ＣＰＵ２がクラッチ制御回路５を通じて
オン／オフ制御するクラッチ６（電磁クラッチ）を介し
て、操舵機構（図示せず）へ与えられ、操舵補助が行わ
れる。
【０００３】ＣＰＵ２は、異常が発生したときには、フ
ェイルセーフリレー３をオフし、クラッチ６及びＦＥＴ
ブリッジ９へのバッテリＢからの電源供給を停止すると
共に、アラームランプＡＬを点滅させる。ＣＰＵ２、ク
ラッチ制御回路５の電源回路４、ＦＥＴ制御回路８の電
源回路７及びクロック発生回路１０は、バッテリＢから
直接電源供給される。
ェイルセーフリレー３をオフし、クラッチ６及びＦＥＴ
ブリッジ９へのバッテリＢからの電源供給を停止すると
共に、アラームランプＡＬを点滅させる。ＣＰＵ２、ク
ラッチ制御回路５の電源回路４、ＦＥＴ制御回路８の電
源回路７及びクロック発生回路１０は、バッテリＢから
直接電源供給される。
【０００４】以下に、このような構成の電動パワーステ
アリング装置に異常が発生したときのＣＰＵ２の動作を
説明する。図４は、この電動パワーステアリング装置に
異常が発生したときのＣＰＵ２の動作を示すフローチャ
ートである。ＣＰＵ２は、復帰不能な異常を検出すると
（Ｓ４０）、ＦＥＴ制御回路８をオフ制御し（Ｓ４
２）、ＦＥＴブリッジ９を介したモータＭの駆動制御を
停止する。次に、ＣＰＵ２は、クラッチ制御回路５をオ
フ制御し（Ｓ４４）、クラッチ６を操舵機構から切り離
す。ＣＰＵ２は、ＦＥＴ制御回路８及びクラッチ制御回
路５をオフ制御した（Ｓ４２，Ｓ４４）後、フェイルセ
ーフリレー３をオフして（Ｓ４６）、クラッチ６及びＦ
ＥＴブリッジ９へのバッテリＢからの電源供給を停止
し、アラームランプＡＬを点滅させる（Ｓ４８）。
アリング装置に異常が発生したときのＣＰＵ２の動作を
説明する。図４は、この電動パワーステアリング装置に
異常が発生したときのＣＰＵ２の動作を示すフローチャ
ートである。ＣＰＵ２は、復帰不能な異常を検出すると
（Ｓ４０）、ＦＥＴ制御回路８をオフ制御し（Ｓ４
２）、ＦＥＴブリッジ９を介したモータＭの駆動制御を
停止する。次に、ＣＰＵ２は、クラッチ制御回路５をオ
フ制御し（Ｓ４４）、クラッチ６を操舵機構から切り離
す。ＣＰＵ２は、ＦＥＴ制御回路８及びクラッチ制御回
路５をオフ制御した（Ｓ４２，Ｓ４４）後、フェイルセ
ーフリレー３をオフして（Ｓ４６）、クラッチ６及びＦ
ＥＴブリッジ９へのバッテリＢからの電源供給を停止
し、アラームランプＡＬを点滅させる（Ｓ４８）。
【０００５】
【発明が解決しようとする課題】従来の電動パワーステ
アリング装置は、上述のように、異常を検出したときに
電源がオフされるのは、フェイルセーフリレー３により
電源がオフされるクラッチ６及びＦＥＴブリッジ９のみ
であり、その他のＦＥＴ制御回路８、クラッチ制御回路
５及びセンサ信号処理回路ｐ１〜ｐｎ等には、それぞれ
の電源回路を通じて、電源供給が継続され、作動する必
要のない部分で無駄な電力が消費されていた。
アリング装置は、上述のように、異常を検出したときに
電源がオフされるのは、フェイルセーフリレー３により
電源がオフされるクラッチ６及びＦＥＴブリッジ９のみ
であり、その他のＦＥＴ制御回路８、クラッチ制御回路
５及びセンサ信号処理回路ｐ１〜ｐｎ等には、それぞれ
の電源回路を通じて、電源供給が継続され、作動する必
要のない部分で無駄な電力が消費されていた。
【０００６】本発明は、上述のような事情に鑑みてなさ
れたものであり、フェイルセーフリレーがオフされた後
の電力消費を抑制できると共に、キースイッチがオフさ
れるまで、発生する異常を確実に把握することができる
電動パワーステアリング装置を提供することを目的とす
る。
れたものであり、フェイルセーフリレーがオフされた後
の電力消費を抑制できると共に、キースイッチがオフさ
れるまで、発生する異常を確実に把握することができる
電動パワーステアリング装置を提供することを目的とす
る。
【０００７】
【課題を解決するための手段】本発明の第１発明に係る
電動パワーステアリング装置は、モータを制御する制御
手段と、走行状態と前記制御手段の動作状態とを検出す
る複数のセンサの各別の信号処理回路及びモータ駆動回
路それぞれの電源回路と、前記複数のセンサの異常を検
知する異常検知手段とを備え、前記複数のセンサの各別
の信号処理回路が出力する検出信号に基づいて、前記制
御手段が前記モータ駆動回路によりモータを駆動制御
し、その駆動力を操舵機構へ与えて操舵補助を行う電動
パワーステアリング装置において、前記異常検知手段が
前記複数のセンサの何れかの異常を検知したときに、前
記モータ駆動回路及び異常が発生したセンサの信号処理
回路の各電源回路をオフ制御する電源制御手段を備える
ことを特徴とする。
電動パワーステアリング装置は、モータを制御する制御
手段と、走行状態と前記制御手段の動作状態とを検出す
る複数のセンサの各別の信号処理回路及びモータ駆動回
路それぞれの電源回路と、前記複数のセンサの異常を検
知する異常検知手段とを備え、前記複数のセンサの各別
の信号処理回路が出力する検出信号に基づいて、前記制
御手段が前記モータ駆動回路によりモータを駆動制御
し、その駆動力を操舵機構へ与えて操舵補助を行う電動
パワーステアリング装置において、前記異常検知手段が
前記複数のセンサの何れかの異常を検知したときに、前
記モータ駆動回路及び異常が発生したセンサの信号処理
回路の各電源回路をオフ制御する電源制御手段を備える
ことを特徴とする。
【０００８】第２発明に係る電動パワーステアリング装
置は、モータを制御する制御手段と、走行状態と前記制
御手段の動作状態とを検出する複数のセンサの各別の信
号処理回路及びモータ駆動回路それぞれの電源回路と、
前記複数のセンサの異常を検知する異常検知手段を有す
るＣＰＵとを備え、前記複数のセンサの各別の信号処理
回路が出力する検出信号に基づいて、前記ＣＰＵが前記
モータ駆動回路によりモータを駆動し、その駆動力を操
舵機構へ与えて操舵補助を行う電動パワーステアリング
装置において、前記ＣＰＵは、さらに、前記異常検知手
段が前記複数のセンサの何れかの異常を検知したとき
に、前記モータ駆動回路及び異常が発生したセンサの信
号処理回路の各電源回路をオフ制御する電源制御手段
と、前記異常検知手段が前記複数のセンサの何れかの異
常を検知したときに、クロック周波数を低周波数へ切り
換え制御する周波数制御手段とを有することを特徴とす
る。
置は、モータを制御する制御手段と、走行状態と前記制
御手段の動作状態とを検出する複数のセンサの各別の信
号処理回路及びモータ駆動回路それぞれの電源回路と、
前記複数のセンサの異常を検知する異常検知手段を有す
るＣＰＵとを備え、前記複数のセンサの各別の信号処理
回路が出力する検出信号に基づいて、前記ＣＰＵが前記
モータ駆動回路によりモータを駆動し、その駆動力を操
舵機構へ与えて操舵補助を行う電動パワーステアリング
装置において、前記ＣＰＵは、さらに、前記異常検知手
段が前記複数のセンサの何れかの異常を検知したとき
に、前記モータ駆動回路及び異常が発生したセンサの信
号処理回路の各電源回路をオフ制御する電源制御手段
と、前記異常検知手段が前記複数のセンサの何れかの異
常を検知したときに、クロック周波数を低周波数へ切り
換え制御する周波数制御手段とを有することを特徴とす
る。
【０００９】
【作用】第１発明に係る電動パワーステアリング装置で
は、異常検知手段がセンサの何れかの異常を検知したと
きは、電源制御手段は、モータ駆動回路及び異常が発生
したセンサの信号処理回路の各電源回路をオフ制御し、
モータ駆動回路及び異常が発生したセンサの信号処理回
路の電力消費を止める。
は、異常検知手段がセンサの何れかの異常を検知したと
きは、電源制御手段は、モータ駆動回路及び異常が発生
したセンサの信号処理回路の各電源回路をオフ制御し、
モータ駆動回路及び異常が発生したセンサの信号処理回
路の電力消費を止める。
【００１０】第２発明に係る電動パワーステアリング装
置では、異常検知手段が複数のセンサの何れかの異常を
検知したときは、電源制御手段が、モータ駆動回路及び
異常が発生したセンサの信号処理回路の各電源回路をオ
フ制御し、モータ駆動回路及び異常が発生したセンサの
信号処理回路の電力消費を止め、周波数制御手段が、ク
ロック周波数を低周波数へ切り換え制御し、ＣＰＵの電
力消費を抑制する。
置では、異常検知手段が複数のセンサの何れかの異常を
検知したときは、電源制御手段が、モータ駆動回路及び
異常が発生したセンサの信号処理回路の各電源回路をオ
フ制御し、モータ駆動回路及び異常が発生したセンサの
信号処理回路の電力消費を止め、周波数制御手段が、ク
ロック周波数を低周波数へ切り換え制御し、ＣＰＵの電
力消費を抑制する。
【００１１】
【実施例】以下に、本発明の実施例を、それを示す図面
に基づいて説明する。図１は、第１発明及び第２発明に
係る電動パワーステアリング装置の１実施例の要部構成
を示すブロック図である。この電動パワーステアリング
装置は、操舵トルク及び車速等車両の走行状態を検出す
るセンサ、及びウォッチドッグパルス、ＦＥＴ制御回路
８の電圧、周波数可変クロック発生回路１０ａのクロッ
ク、演算増幅器の電圧等コントローラ１ａの動作状態を
検出する複数のセンサｓ１〜ｓｎと、センサｓ１〜ｓｎ
の各別のセンサ信号処理回路ｐ１〜ｐｎと、センサ信号
処理回路ｐ１〜ｐｎの各別の電源回路ｄ１ａ〜ｄｎａと
を備え、電源回路ｄ１ａ〜ｄｎａは、バッテリＢから電
源を供給されている。
に基づいて説明する。図１は、第１発明及び第２発明に
係る電動パワーステアリング装置の１実施例の要部構成
を示すブロック図である。この電動パワーステアリング
装置は、操舵トルク及び車速等車両の走行状態を検出す
るセンサ、及びウォッチドッグパルス、ＦＥＴ制御回路
８の電圧、周波数可変クロック発生回路１０ａのクロッ
ク、演算増幅器の電圧等コントローラ１ａの動作状態を
検出する複数のセンサｓ１〜ｓｎと、センサｓ１〜ｓｎ
の各別のセンサ信号処理回路ｐ１〜ｐｎと、センサ信号
処理回路ｐ１〜ｐｎの各別の電源回路ｄ１ａ〜ｄｎａと
を備え、電源回路ｄ１ａ〜ｄｎａは、バッテリＢから電
源を供給されている。
【００１２】また、センサ信号処理回路ｐ１〜ｐｎの各
検出信号はＣＰＵ２ａへ与えられ、ＣＰＵ２ａは、該各
検出信号に基づいて、ＦＥＴ制御回路８（モータ駆動回
路）によりＦＥＴブリッジ９を介してモータＭを駆動す
る。モータＭの駆動力は、ＣＰＵ２ａがクラッチ制御回
路５を通じてオン／オフ制御するクラッチ６（電磁クラ
ッチ）を介して、操舵機構（図示せず）へ与えられ、操
舵補助が行われる。電源回路ｄ１ａ〜ｄｎａは、ＣＰＵ
２ａからオン／オフ制御される。
検出信号はＣＰＵ２ａへ与えられ、ＣＰＵ２ａは、該各
検出信号に基づいて、ＦＥＴ制御回路８（モータ駆動回
路）によりＦＥＴブリッジ９を介してモータＭを駆動す
る。モータＭの駆動力は、ＣＰＵ２ａがクラッチ制御回
路５を通じてオン／オフ制御するクラッチ６（電磁クラ
ッチ）を介して、操舵機構（図示せず）へ与えられ、操
舵補助が行われる。電源回路ｄ１ａ〜ｄｎａは、ＣＰＵ
２ａからオン／オフ制御される。
【００１３】ＣＰＵ２ａは、異常が発生したときには、
フェイルセーフリレー３をオフし、クラッチ６及びＦＥ
Ｔブリッジ９へのバッテリＢからの電源供給を停止する
と共に、アラームランプＡＬを点滅させる。ＣＰＵ２
ａ、クラッチ制御回路５の電源回路４ａ、ＦＥＴ制御回
路８の電源回路７ａ及び周波数可変クロック発生回路１
０ａは、バッテリＢから直接電源供給され、電源回路４
ａ，７ａはＣＰＵ２ａからオン／オフ制御される。ＣＰ
Ｕ２ａは、周波数可変クロック発生回路１０ａが出力す
るクロックの周波数を低周波数へ切り換え制御する。
フェイルセーフリレー３をオフし、クラッチ６及びＦＥ
Ｔブリッジ９へのバッテリＢからの電源供給を停止する
と共に、アラームランプＡＬを点滅させる。ＣＰＵ２
ａ、クラッチ制御回路５の電源回路４ａ、ＦＥＴ制御回
路８の電源回路７ａ及び周波数可変クロック発生回路１
０ａは、バッテリＢから直接電源供給され、電源回路４
ａ，７ａはＣＰＵ２ａからオン／オフ制御される。ＣＰ
Ｕ２ａは、周波数可変クロック発生回路１０ａが出力す
るクロックの周波数を低周波数へ切り換え制御する。
【００１４】以下に、このような構成の電動パワーステ
アリング装置の、異常が発生したときの動作を説明す
る。図２は、この電動パワーステアリング装置に異常が
発生したときのＣＰＵ２ａの動作を示すフローチャート
である。ＣＰＵ２ａは、復帰不能な異常を検出すると
（Ｓ１０）、ＦＥＴ制御回路８をオフ制御し（Ｓ１
２）、ＦＥＴブリッジ９を介したモータＭの駆動制御を
停止する。次に、ＣＰＵ２ａは、クラッチ制御回路５を
オフ制御し（Ｓ１４）、クラッチ６を操舵機構から切り
離す。ＣＰＵ２ａは、ＦＥＴ制御回路８及びクラッチ制
御回路５をオフ制御した（Ｓ１２，Ｓ１４）後、フェイ
ルセーフリレー３をオフして（Ｓ１６）、クラッチ６及
びＦＥＴブリッジ９へのバッテリＢからの電源供給を停
止し、アラームランプＡＬを点滅させる（Ｓ１８）。
アリング装置の、異常が発生したときの動作を説明す
る。図２は、この電動パワーステアリング装置に異常が
発生したときのＣＰＵ２ａの動作を示すフローチャート
である。ＣＰＵ２ａは、復帰不能な異常を検出すると
（Ｓ１０）、ＦＥＴ制御回路８をオフ制御し（Ｓ１
２）、ＦＥＴブリッジ９を介したモータＭの駆動制御を
停止する。次に、ＣＰＵ２ａは、クラッチ制御回路５を
オフ制御し（Ｓ１４）、クラッチ６を操舵機構から切り
離す。ＣＰＵ２ａは、ＦＥＴ制御回路８及びクラッチ制
御回路５をオフ制御した（Ｓ１２，Ｓ１４）後、フェイ
ルセーフリレー３をオフして（Ｓ１６）、クラッチ６及
びＦＥＴブリッジ９へのバッテリＢからの電源供給を停
止し、アラームランプＡＬを点滅させる（Ｓ１８）。
【００１５】次に、ＣＰＵ２ａは、クラッチ制御回路５
の電源回路４ａとＦＥＴ制御回路８の電源回路７ａとを
オフ制御した（Ｓ２０，Ｓ２２）後、異常が発生したセ
ンサのセンサ信号処理回路の電源回路をオフ制御する
（Ｓ２４）。次に、ＣＰＵ２ａは、周波数可変クロック
発生回路１０ａが出力するクロックの周波数を、ＣＰＵ
２ａが正常に作動し続けることができる範囲内の低周波
数に切り換え制御する（Ｓ２６）。その後、ＣＰＵ２ａ
は、キースイッチがオフされるまで、その他の異常を監
視し続け（Ｓ２８，Ｓ３２）、異常が発生したときは、
異常が発生したセンサのセンサ信号処理回路の電源回路
をオフ制御する（Ｓ３０）。尚、異常が発生したセンサ
が正常に復帰したときは、正常に復帰したセンサのセン
サ信号処理回路の電源回路をオン制御する。
の電源回路４ａとＦＥＴ制御回路８の電源回路７ａとを
オフ制御した（Ｓ２０，Ｓ２２）後、異常が発生したセ
ンサのセンサ信号処理回路の電源回路をオフ制御する
（Ｓ２４）。次に、ＣＰＵ２ａは、周波数可変クロック
発生回路１０ａが出力するクロックの周波数を、ＣＰＵ
２ａが正常に作動し続けることができる範囲内の低周波
数に切り換え制御する（Ｓ２６）。その後、ＣＰＵ２ａ
は、キースイッチがオフされるまで、その他の異常を監
視し続け（Ｓ２８，Ｓ３２）、異常が発生したときは、
異常が発生したセンサのセンサ信号処理回路の電源回路
をオフ制御する（Ｓ３０）。尚、異常が発生したセンサ
が正常に復帰したときは、正常に復帰したセンサのセン
サ信号処理回路の電源回路をオン制御する。
【００１６】尚、コントローラ１ａに入力されるセンサ
信号［１］〜［ｍ］（１≦ｍ≦ｎ）が満たす条件によ
り、コントローラ１ａは以下の（ａ）と（ｂ）との動作
を切り換えるようにしてもよい。 （ａ）センサ信号［１］〜［ｍ］の監視のみを行う。こ
の動作に不必要なセンサ信号処理回路、クラッチ制御回
路、ＦＥＴ制御回路の電流はオフし、ＣＰＵ２ａへのク
ロック周波数も低周波数へ切り換える。必要ならばフェ
イルモードに入る。 （ｂ）全ての電源をオンし、コントローラ１ａの全ての
機能を実行する。例えば、ドライバーがキーＳＷをオン
にしながら、意図的にエンジンをかけないまたはかから
ないというような状況時に、不必要にバッテリを消耗し
ないようにするためである。 上記条件としては、エンジン回転センサの検出値が所定
値以下のとき、上記待機モード（ａ）とし、所定値より
大きいときは、上記通常モード（ｂ）を行う。
信号［１］〜［ｍ］（１≦ｍ≦ｎ）が満たす条件によ
り、コントローラ１ａは以下の（ａ）と（ｂ）との動作
を切り換えるようにしてもよい。 （ａ）センサ信号［１］〜［ｍ］の監視のみを行う。こ
の動作に不必要なセンサ信号処理回路、クラッチ制御回
路、ＦＥＴ制御回路の電流はオフし、ＣＰＵ２ａへのク
ロック周波数も低周波数へ切り換える。必要ならばフェ
イルモードに入る。 （ｂ）全ての電源をオンし、コントローラ１ａの全ての
機能を実行する。例えば、ドライバーがキーＳＷをオン
にしながら、意図的にエンジンをかけないまたはかから
ないというような状況時に、不必要にバッテリを消耗し
ないようにするためである。 上記条件としては、エンジン回転センサの検出値が所定
値以下のとき、上記待機モード（ａ）とし、所定値より
大きいときは、上記通常モード（ｂ）を行う。
【００１７】
【発明の効果】本発明の第１，２発明に係る電動パワー
ステアリング装置によれば、フェイルセーフリレーがオ
フされた後の電力消費を抑制できると共に、イグニッシ
ョンキースイッチがオフされるまで、発生する異常を確
実に把握することができる。
ステアリング装置によれば、フェイルセーフリレーがオ
フされた後の電力消費を抑制できると共に、イグニッシ
ョンキースイッチがオフされるまで、発生する異常を確
実に把握することができる。
【図１】第１，２発明に係る電動パワーステアリング装
置の１実施例の要部構成を示すブロック図である。
置の１実施例の要部構成を示すブロック図である。
【図２】図１に示す電動パワーステアリング装置に異常
が発生したときのＣＰＵの動作を示すフローチャートで
ある。
が発生したときのＣＰＵの動作を示すフローチャートで
ある。
【図３】従来の電動パワーステアリング装置の１例の要
部構成を示すブロック図である。
部構成を示すブロック図である。
【図４】図３に示す電動パワーステアリング装置に異常
が発生したときのＣＰＵの動作を示すフローチャートで
ある。
が発生したときのＣＰＵの動作を示すフローチャートで
ある。
１ａ コントローラ（制御手段） ２ａ ＣＰＵ ３ フェイルセーフリレー ４ａ，７ａ，ｄ１ａ〜ｄｎａ 電源回路 ６ クラッチ（電磁クラッチ） ８ ＦＥＴ制御回路（モータ駆動回路） ９ ＦＥＴブリッジ １０ａ 周波数可変クロック発生回路 Ｂ バッテリ ｓ１〜ｓｎ センサ Ｍ モータ ｐ１〜ｐｎ センサ信号処理回路
Claims (2)
- 【請求項１】 モータを制御する制御手段と、走行状態
と前記制御手段の動作状態とを検出する複数のセンサの
各別の信号処理回路及びモータ駆動回路それぞれの電源
回路と、前記複数のセンサの異常を検知する異常検知手
段とを備え、前記複数のセンサの各別の信号処理回路が
出力する検出信号に基づいて、前記制御手段が前記モー
タ駆動回路によりモータを駆動制御し、その駆動力を操
舵機構へ与えて操舵補助を行う電動パワーステアリング
装置において、 前記異常検知手段が前記複数のセンサの何れかの異常を
検知したときに、前記モータ駆動回路及び異常が発生し
たセンサの信号処理回路の各電源回路をオフ制御する電
源制御手段を備えることを特徴とする電動パワーステア
リング装置。 - 【請求項２】 モータを制御する制御手段と、走行状態
と前記制御手段の動作状態とを検出する複数のセンサの
各別の信号処理回路及びモータ駆動回路それぞれの電源
回路と、前記複数のセンサの異常を検知する異常検知手
段を有するＣＰＵとを備え、前記複数のセンサの各別の
信号処理回路が出力する検出信号に基づいて、前記ＣＰ
Ｕが前記モータ駆動回路によりモータを駆動し、その駆
動力を操舵機構へ与えて操舵補助を行う電動パワーステ
アリング装置において、 前記ＣＰＵは、さらに、前記異常検知手段が前記複数の
センサの何れかの異常を検知したときに、前記モータ駆
動回路及び異常が発生したセンサの信号処理回路の各電
源回路をオフ制御する電源制御手段と、前記異常検知手
段が前記複数のセンサの何れかの異常を検知したとき
に、クロック周波数を低周波数へ切り換え制御する周波
数制御手段とを有することを特徴とする電動パワーステ
アリング装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2840895A JPH08216900A (ja) | 1995-02-16 | 1995-02-16 | 電動パワーステアリング装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2840895A JPH08216900A (ja) | 1995-02-16 | 1995-02-16 | 電動パワーステアリング装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08216900A true JPH08216900A (ja) | 1996-08-27 |
Family
ID=12247839
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2840895A Pending JPH08216900A (ja) | 1995-02-16 | 1995-02-16 | 電動パワーステアリング装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08216900A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007203786A (ja) * | 2006-01-31 | 2007-08-16 | Fujitsu Ten Ltd | 車両の異常検出装置 |
| WO2014119092A1 (ja) * | 2013-02-01 | 2014-08-07 | 日立オートモティブシステムズ株式会社 | 複合センサ |
-
1995
- 1995-02-16 JP JP2840895A patent/JPH08216900A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007203786A (ja) * | 2006-01-31 | 2007-08-16 | Fujitsu Ten Ltd | 車両の異常検出装置 |
| WO2014119092A1 (ja) * | 2013-02-01 | 2014-08-07 | 日立オートモティブシステムズ株式会社 | 複合センサ |
| JP2014149220A (ja) * | 2013-02-01 | 2014-08-21 | Hitachi Automotive Systems Ltd | 複合センサ |
| US9810734B2 (en) | 2013-02-01 | 2017-11-07 | Hitachi Automotive Systems, Ltd. | Compound sensor including a plurality of detection elements and a plurality of fault detection circuits |
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