JPH07200415A - プログラムバックアップ方式 - Google Patents
プログラムバックアップ方式Info
- Publication number
- JPH07200415A JPH07200415A JP5334259A JP33425993A JPH07200415A JP H07200415 A JPH07200415 A JP H07200415A JP 5334259 A JP5334259 A JP 5334259A JP 33425993 A JP33425993 A JP 33425993A JP H07200415 A JPH07200415 A JP H07200415A
- Authority
- JP
- Japan
- Prior art keywords
- backup
- memory
- contents
- program
- memories
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】
【目的】 バックアップメモリ更新中の障害に対しても
システムダウンしないような情報処理装置のプログラム
バックアップ方式を提供する。 【構成】 ２つの書き替え可能なバックアップメモリ
３，４とバックアップメモリの片方を選択してメモリ２
の内容を圧縮して書き込む圧縮選択回路５と、バックア
ップメモリの他方を選択してメモリ２に展開する展開選
択回路６とバックアップメモリの更新を交互に行うため
の手段である１ビットカウンタ７、論理反転回路８から
成る。
システムダウンしないような情報処理装置のプログラム
バックアップ方式を提供する。 【構成】 ２つの書き替え可能なバックアップメモリ
３，４とバックアップメモリの片方を選択してメモリ２
の内容を圧縮して書き込む圧縮選択回路５と、バックア
ップメモリの他方を選択してメモリ２に展開する展開選
択回路６とバックアップメモリの更新を交互に行うため
の手段である１ビットカウンタ７、論理反転回路８から
成る。
Description
【０００１】
【産業上の利用分野】本発明は情報処理装置のプログラ
ムバックアップ方式に関し、特にバックアップメモリの
更新中の障害に対してもシステムダウンをおこさないプ
ログラムバックアップ方式に関する。
ムバックアップ方式に関し、特にバックアップメモリの
更新中の障害に対してもシステムダウンをおこさないプ
ログラムバックアップ方式に関する。
【０００２】
【従来の技術】情報処理装置においてはプログラム及び
データはメモリに保持されるが、一般のメモリは電源断
やプログラムのバグ等によりメモリ内容が破壊されるこ
とがある。
データはメモリに保持されるが、一般のメモリは電源断
やプログラムのバグ等によりメモリ内容が破壊されるこ
とがある。
【０００３】このような際にプログラムを再開させる度
に書き替え可能なメモリ、ＥＥＰＲＯＭなどによりバッ
クアップをとり再開時にＥＥＰＲＯＭからバックアップ
されたプログラム及びデータのＩＰＬ（初期プログラム
ロード）を行なってメモリ内容を再設定することが行な
われる。
に書き替え可能なメモリ、ＥＥＰＲＯＭなどによりバッ
クアップをとり再開時にＥＥＰＲＯＭからバックアップ
されたプログラム及びデータのＩＰＬ（初期プログラム
ロード）を行なってメモリ内容を再設定することが行な
われる。
【０００４】またプログラム自体は機能追加等により更
新が行なわれることがあり、そのような場合に、メモリ
の書きかえが行なわれる。これをバックアップのための
ＥＥＰＲＯＭに反映させる必要があり、このような例と
して特開昭６３−５９２９７号公報に記載されているよ
うな方法が知られている。
新が行なわれることがあり、そのような場合に、メモリ
の書きかえが行なわれる。これをバックアップのための
ＥＥＰＲＯＭに反映させる必要があり、このような例と
して特開昭６３−５９２９７号公報に記載されているよ
うな方法が知られている。
【０００５】この例ではバックアップを読出専用メモリ
（ＲＯＭ）に持ち、また、バックアップ内容の変更デー
タをＥＰＲＯＭに持つことによりＲＯＭからのＩＰＬ後
にＥＰＲＯＭのデータで変更することでプログラムの変
更に対処している。
（ＲＯＭ）に持ち、また、バックアップ内容の変更デー
タをＥＰＲＯＭに持つことによりＲＯＭからのＩＰＬ後
にＥＰＲＯＭのデータで変更することでプログラムの変
更に対処している。
【０００６】
【発明が解決しようとする課題】このような従来のバッ
クアップ技術ではＥＰＲＯＭの書き替え中の障害発生に
対して対策がなされていなかった。即ち変更情報をＥＰ
ＲＯＭに対して書き込みを行なっている時刻に障害が発
生してＩＰＬが行なわれると、不完全な変更情報により
メモリが設定され、結果的に不完全なメモリ内容で再開
されてシステムダウンすることがあるという問題があ
る。
クアップ技術ではＥＰＲＯＭの書き替え中の障害発生に
対して対策がなされていなかった。即ち変更情報をＥＰ
ＲＯＭに対して書き込みを行なっている時刻に障害が発
生してＩＰＬが行なわれると、不完全な変更情報により
メモリが設定され、結果的に不完全なメモリ内容で再開
されてシステムダウンすることがあるという問題があ
る。
【０００７】
【課題を解決するための手段】上述した問題点を解決す
るために本発明のプログラムバックアップ方式は、主メ
モリの内容をバックアップする２つのバックアップメモ
リと、前記主メモリの内容を圧縮し、前記２つのバック
アップメモリの片方を選択して書き込む圧縮選択手段
と、前記２つのバックアップメモリの片方を選択し、当
該バックアップメモリに圧縮蓄積されている内容を復元
して前記主メモリに書き込む展開選択手段と、前記圧縮
選択手段が前記２つのバックアップメモリの片方に圧縮
蓄積を完了する度に１度数更新する１ビットのカウンタ
手段と、前記カウンタ手段の内容の論理を反転して出力
する論理反転手段とを有し、前記圧縮選択手段は、前記
論理反転手段の出力情報に基づいて前記２つのバックア
ップメモリの片方を選択し、前記展開選択手段は、前記
カウンタ手段の内容情報に基づいて前記２つのバックア
ップメモリの片方を選択することを特徴とする。
るために本発明のプログラムバックアップ方式は、主メ
モリの内容をバックアップする２つのバックアップメモ
リと、前記主メモリの内容を圧縮し、前記２つのバック
アップメモリの片方を選択して書き込む圧縮選択手段
と、前記２つのバックアップメモリの片方を選択し、当
該バックアップメモリに圧縮蓄積されている内容を復元
して前記主メモリに書き込む展開選択手段と、前記圧縮
選択手段が前記２つのバックアップメモリの片方に圧縮
蓄積を完了する度に１度数更新する１ビットのカウンタ
手段と、前記カウンタ手段の内容の論理を反転して出力
する論理反転手段とを有し、前記圧縮選択手段は、前記
論理反転手段の出力情報に基づいて前記２つのバックア
ップメモリの片方を選択し、前記展開選択手段は、前記
カウンタ手段の内容情報に基づいて前記２つのバックア
ップメモリの片方を選択することを特徴とする。
【０００８】
【実施例】本発明のプログラムバックアップ方式の一実
施例を説明する。
施例を説明する。
【０００９】図１は本発明の一実施例の構成を示すブロ
ック図である。１はマイクロプロセッサ、２は読み書き
可能なメモリ、３，４は読み書きの可能な不揮発性メモ
リ、５は圧縮選択回路、６は展開選択回路、７は不揮発
性の１ビットカウンタ、８は論理反転回路、９はバス、
１０は障害検出回路である。マイクロプロセッサ１はバ
ス９によりメモリ２に接続され、メモリ２に格納された
プログラム及びデータによりデータ処理を行う。
ック図である。１はマイクロプロセッサ、２は読み書き
可能なメモリ、３，４は読み書きの可能な不揮発性メモ
リ、５は圧縮選択回路、６は展開選択回路、７は不揮発
性の１ビットカウンタ、８は論理反転回路、９はバス、
１０は障害検出回路である。マイクロプロセッサ１はバ
ス９によりメモリ２に接続され、メモリ２に格納された
プログラム及びデータによりデータ処理を行う。
【００１０】圧縮選択回路５はバス９に接続され、バス
９から送られる固定長のデータブロックを受け取り、更
に、圧縮開始指令をマイクロプロセッサ１からバス９を
通じて受け付けると圧縮を開始し、圧縮が終了すると選
択入力Ｓ１の論理値が０であればバックアップメモリ３
にまた選択入力Ｓ１の論理値が１であればバックアップ
メモリ４に圧縮データを書き込む。
９から送られる固定長のデータブロックを受け取り、更
に、圧縮開始指令をマイクロプロセッサ１からバス９を
通じて受け付けると圧縮を開始し、圧縮が終了すると選
択入力Ｓ１の論理値が０であればバックアップメモリ３
にまた選択入力Ｓ１の論理値が１であればバックアップ
メモリ４に圧縮データを書き込む。
【００１１】展開選択回路６はバス９から展開指令を受
け付け、選択入力Ｓ２の論理値が０であればバックアッ
プメモリ４から、また選択入力Ｓ２の論理値が１であれ
ばバックアップメモリ３から展開データを読みだし元の
メモリデータを復元する。すべての展開が完了するとバ
ス９をとおして障害検出回路１０に展開完了を通知す
る。
け付け、選択入力Ｓ２の論理値が０であればバックアッ
プメモリ４から、また選択入力Ｓ２の論理値が１であれ
ばバックアップメモリ３から展開データを読みだし元の
メモリデータを復元する。すべての展開が完了するとバ
ス９をとおして障害検出回路１０に展開完了を通知す
る。
【００１２】１ビットカウンタ７はバックアップメモリ
の更新の回数をカウントするものであり、バックアップ
メモリの更新の回数ごとにマイクロプロセッサ１の指令
により１を加算される。障害検出回路１０は電源断・投
入、プログラムの暴走等を検出し信号線Ｓ３によりマイ
クロプロセッサ１にリセット信号を出す。また展開選択
回路６からの信号線Ｓ４によって、リセット信号の解除
を行う。
の更新の回数をカウントするものであり、バックアップ
メモリの更新の回数ごとにマイクロプロセッサ１の指令
により１を加算される。障害検出回路１０は電源断・投
入、プログラムの暴走等を検出し信号線Ｓ３によりマイ
クロプロセッサ１にリセット信号を出す。また展開選択
回路６からの信号線Ｓ４によって、リセット信号の解除
を行う。
【００１３】プログラムが機能追加等により変更され、
バックアップの更新が必要となると以下の動作を行う。
バックアップの更新が必要となると以下の動作を行う。
【００１４】更新が必要となるとマイクロプロセッサ１
は更新プログラムを起動し、バックアップを必要とする
メモリを読みだし、その先頭アドレス、データサイズ及
びメモリデータを圧縮選択回路５に送り転送が完了する
と、圧縮開始指令を圧縮選択回路５に送る。圧縮選択回
路５はこれにより圧縮を開始し、圧縮が完了すると選択
入力Ｓ１により決定されるバックアップメモリ３又は４
に圧縮されたデータを書き込む。
は更新プログラムを起動し、バックアップを必要とする
メモリを読みだし、その先頭アドレス、データサイズ及
びメモリデータを圧縮選択回路５に送り転送が完了する
と、圧縮開始指令を圧縮選択回路５に送る。圧縮選択回
路５はこれにより圧縮を開始し、圧縮が完了すると選択
入力Ｓ１により決定されるバックアップメモリ３又は４
に圧縮されたデータを書き込む。
【００１５】書き込みが完了すると書込み完了をバス９
によりマイクロプロセッサ１に通知する。これによりマ
イクロプロセッサ１は他のメモリエリアのバックアップ
動作に入る。
によりマイクロプロセッサ１に通知する。これによりマ
イクロプロセッサ１は他のメモリエリアのバックアップ
動作に入る。
【００１６】すべてのバックアップが完了するとマイク
ロプロセッサは１ビットカウンタ７への加算指令を出
す。従ってバックアップメモリ更新が１回行なわれるた
びにカウンタが１加算され、バックアップメモリ３，４
が交互に更新される。
ロプロセッサは１ビットカウンタ７への加算指令を出
す。従ってバックアップメモリ更新が１回行なわれるた
びにカウンタが１加算され、バックアップメモリ３，４
が交互に更新される。
【００１７】次に、障害により初期プログラムロード
（ＩＰＬ）が必要となった時の動作について説明する。
（ＩＰＬ）が必要となった時の動作について説明する。
【００１８】障害が検出されると、マイクロプロセッサ
１は動作を停止してメモリが書込まれるのを待つ。これ
は障害検出回路１０により行われ、障害検出後メモリ設
定完了までマイクロプロセッサにリセット信号を出しつ
づける。
１は動作を停止してメモリが書込まれるのを待つ。これ
は障害検出回路１０により行われ、障害検出後メモリ設
定完了までマイクロプロセッサにリセット信号を出しつ
づける。
【００１９】障害検出回路１０は同時に展開選択回路６
にバス９を通じて展開指令を出す。展開選択回路は選択
入力Ｓ２により選ばれるバックアップメモリ３又は４を
選び展開動作を行い復元されたメモリの先頭アドレス、
メモリサイズ及びメモリ内容を復元する。
にバス９を通じて展開指令を出す。展開選択回路は選択
入力Ｓ２により選ばれるバックアップメモリ３又は４を
選び展開動作を行い復元されたメモリの先頭アドレス、
メモリサイズ及びメモリ内容を復元する。
【００２０】バックアップメモリ３，４の選択は、論理
反転回路８により書込み中のバックアップメモリが選択
されることはないため更新途中のデータによりＩＰＬさ
れることはない。
反転回路８により書込み中のバックアップメモリが選択
されることはないため更新途中のデータによりＩＰＬさ
れることはない。
【００２１】展開選択回路６は、展開が完了すると障害
検出回路１０に完了を通知し、さらに信号線Ｓ４により
マイクロプロセッサ１のリセットを解除する。そして、
マイクロプロセッサ１はＩＰＬされたプログラムの実行
を開始する。
検出回路１０に完了を通知し、さらに信号線Ｓ４により
マイクロプロセッサ１のリセットを解除する。そして、
マイクロプロセッサ１はＩＰＬされたプログラムの実行
を開始する。
【００２２】以上説明した構成、動作によってメモリの
バックアップをとることにより、更新中の障害に対して
も前回のプログラムを使用してシステムが動作するため
耐障害性が高まるとともに、圧縮によりバックアップを
効率的に行うことができる。
バックアップをとることにより、更新中の障害に対して
も前回のプログラムを使用してシステムが動作するため
耐障害性が高まるとともに、圧縮によりバックアップを
効率的に行うことができる。
【００２３】
【発明の効果】以上説明したように、本発明のプログラ
ムバックアップ方式は２つのバックアップメモリを交互
に使用することによりバックアップメモリ更新中の障害
に対しても１世代前のバックアップメモリによりＩＰＬ
させるのでシステムダウンすることなく、また圧縮を行
うことで２つのバックアップメモリを持っていても少な
い容量のバックアップメモリで対処することができると
いう効果がある。
ムバックアップ方式は２つのバックアップメモリを交互
に使用することによりバックアップメモリ更新中の障害
に対しても１世代前のバックアップメモリによりＩＰＬ
させるのでシステムダウンすることなく、また圧縮を行
うことで２つのバックアップメモリを持っていても少な
い容量のバックアップメモリで対処することができると
いう効果がある。
【図１】本発明の一実施例の構成を示すブロック図であ
る。
る。
１ マイクロプロセッサ ２ メモリ ３，４ バックアップメモリ ５ 圧縮選択回路 ６ 展開選択回路 ７ １ビットカウンタ ８ 論理反転回路 ９ バス １０ 障害検出回路 Ｓ１，Ｓ２ 選択入力 Ｓ３ 信号線（リセット） Ｓ４ 信号線（リセット解除）
Claims (1)
- 【請求項１】 主メモリに蓄積されたプログラム及びデ
ータにより情報処理を行う情報処理装置において主メモ
リの内容をバックアップする２つのバックアップメモリ
と、 前記主メモリの内容を圧縮し、前記２つのバックアップ
メモリの片方を選択して書き込む圧縮選択手段と、 前記２つのバックアップメモリの片方を選択し、当該バ
ックアップメモリに圧縮蓄積されている内容を復元して
前記主メモリに書き込む展開選択手段と、 前記圧縮選択手段が前記２つのバックアップメモリの片
方に圧縮蓄積を完了する度に１度数更新する１ビットの
カウンタ手段と、 前記カウンタ手段の内容の論理を反転して出力する論理
反転手段とを有し、 前記圧縮選択手段は、前記論理反転手段の出力情報に基
づいて前記２つのバックアップメモリの片方を選択し、
前記展開選択手段は、前記カウンタ手段の内容情報に基
づいて前記２つのバックアップメモリの片方を選択する
ことを特徴とするプログラムバックアップ方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5334259A JPH07200415A (ja) | 1993-12-28 | 1993-12-28 | プログラムバックアップ方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5334259A JPH07200415A (ja) | 1993-12-28 | 1993-12-28 | プログラムバックアップ方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07200415A true JPH07200415A (ja) | 1995-08-04 |
Family
ID=18275345
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5334259A Pending JPH07200415A (ja) | 1993-12-28 | 1993-12-28 | プログラムバックアップ方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07200415A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6611902B2 (en) | 2000-11-13 | 2003-08-26 | Matsushita Electric Industrial Co., Ltd. | Information processor and information processing method |
| KR20030082779A (ko) * | 2002-04-18 | 2003-10-23 | 주식회사 트론웰 | 네트워크 저장 장치의 듀얼 플레쉬 디스크 에러복구 방법 |
| KR100474897B1 (ko) * | 2002-04-01 | 2005-03-08 | 엘지전자 주식회사 | 전자제품의 구동 프로그램 백업장치 |
| JP2012002577A (ja) * | 2010-06-15 | 2012-01-05 | Fujitsu Telecom Networks Ltd | 試験装置と試験方法 |
| US8516208B2 (en) | 2009-03-19 | 2013-08-20 | Fujitsu Limited | Data backup method and information processing apparatus |
| JP2016118879A (ja) * | 2014-12-19 | 2016-06-30 | 株式会社デンソー | マイクロコンピュータ |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01271856A (ja) * | 1988-04-22 | 1989-10-30 | Mitsubishi Electric Corp | バツテリーバツクアツプメモリ装置 |
| JPH02213966A (ja) * | 1989-02-14 | 1990-08-27 | Nec Corp | データセーブリストア方式 |
-
1993
- 1993-12-28 JP JP5334259A patent/JPH07200415A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01271856A (ja) * | 1988-04-22 | 1989-10-30 | Mitsubishi Electric Corp | バツテリーバツクアツプメモリ装置 |
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| KR20030082779A (ko) * | 2002-04-18 | 2003-10-23 | 주식회사 트론웰 | 네트워크 저장 장치의 듀얼 플레쉬 디스크 에러복구 방법 |
| US8516208B2 (en) | 2009-03-19 | 2013-08-20 | Fujitsu Limited | Data backup method and information processing apparatus |
| JP2012002577A (ja) * | 2010-06-15 | 2012-01-05 | Fujitsu Telecom Networks Ltd | 試験装置と試験方法 |
| JP2016118879A (ja) * | 2014-12-19 | 2016-06-30 | 株式会社デンソー | マイクロコンピュータ |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19970513 |