JPH07177130A - エラーカウント回路 - Google Patents

エラーカウント回路

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JPH07177130A
JPH07177130A JP5321468A JP32146893A JPH07177130A JP H07177130 A JPH07177130 A JP H07177130A JP 5321468 A JP5321468 A JP 5321468A JP 32146893 A JP32146893 A JP 32146893A JP H07177130 A JPH07177130 A JP H07177130A
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pulse
counter
optical transmission
external device
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JP5321468A
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English (en)
Inventor
Katsumi Fukumitsu
勝巳 福満
Tadayuki Takada
忠行 高田
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00—Arrangements for detecting or preventing errors in the information received
    • H04L1/24—Testing correct operation

Abstract

(57)【要約】 【目的】 光伝送路に接続された外部装置における主信
号の符号誤り数を高速エラーパルスとして入力しエラー
カウンタで該エラーパルスを、発振器から一定時間毎に
送出されるクロックを用いてカウントし該一定時間毎の
エラーカウント値を出力するエラーカウント回路に関
し、電源障害時にエラーカウント値を出力しないように
する。 【構成】 外部装置から与えられるエラーパルスの正誤
を示す別のパルスを入力するかあるいは自装置の中で生
成することにより、入力したエラーパルスが誤っている
ときにエラーカウンタの動作を停止させる。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明はエラーカウント回路に関
し、特に光海底通信システムの光伝送端局装置等におけ
る主信号の符号誤りを検出するためのエラーカウント回
路に関するものである。
【０００２】光海底通信システムを構成する光伝送端局
装置や光海底中継器における光信号を光伝送端局装置の
受信側にて光−電気信号変換した後、例えば、１４０Mb
psの伝送速度の主信号を４チャネル分多重化して、５６
０Mbpsの伝送速度で通信する光海底通信システムの場
合、受信側にて４チャネルに分離して１４０Mbpsとし、
それぞれのチャネルについて光伝送端局装置とは違う別
の共通装置にて、主信号の符号誤りを検出している。
【０００３】また近年では、このような光海底通信シス
テムの需要が増加の一途を辿っており、更には高品質の
回線を維持する為、現用システムと予備システムとで構
成することにより、通信システムの増設が進められて来
ている。
【０００４】このような現用システムと予備システムと
の切替えは主信号の符号誤りが大きくなったときに行わ
れるので、主信号の符号誤りをより正確に検出すること
ができるエラーカウント回路が求められている。
【０００５】
【従来の技術】図１１は、従来から知られているエラー
カウント回路を示す図であり、このエラーカウント回路
１は上記のように光伝送路に接続される外部装置として
の光伝送端局装置２に接続されて光伝送端局装置２にお
ける主信号の符号誤り数をカウントする回路である。
【０００６】光伝送端局装置２には図示の様にその主信
号の符号誤り数を発生するエラーパルス発生部２１が設
けられている。また、エラーカウント回路１は、エラー
パルス発光部２１からの主信号の符号誤り数を示すエラ
ーパルス（光伝送路の速度に対応した例えば３０ｎｓ周
期の高速パルス）をカウントするエラーカウンタ１１
と、カウンタ１１のカウント値を１６ビットのパラレル
データとして出力するバッファ１２と、このバッファ１
２からのパラレルデータのカウント値を外部のＭＰＵ部
３へアドレスバス・コントロールバス・データバスから
成るバスインタフェース４を介して転送するパラレル・
インタフェース・アダプタ（以下、ＰＩＡと略称する）
１３と、１秒間のエラー個数をカウントする為にエラー
カウンタ１１とバッファ１２とＰＩＡ１３に１秒周期の
リセットパルスを送出する発振器１４とで構成されてい
る。
【０００７】このようなエラーカウント回路１の動作に
おいては、エラーカウンタ１１にて光伝送端局装置２か
ら送信されるエラーパルスを１秒間カウントしてそのカ
ウント値をパラレルデータに変換し、バッファ１２を経
由してＰＩＡ１３へ転送する。転送されたカウント値は
ＰＩＡ１３からバスインタフェース４を介してＭＰＵ部
３へ転送される。
【０００８】ＭＰＵ部３はこのようなエラーカウント値
を用いて回線の品質を判定し、適宜アラーム信号の発生
等を行ったり、現用システムから予備システムへの切替
えを実行する。
【０００９】
【発明が解決しようとする課題】しかしながら、このよ
うなエラーカウント回路においては、光伝送端局装置等
の外部装置の電源断時や電源電圧低下時等の電源障害時
やエラーパルス発生部のパッケージ挿抜等で光伝送端局
装置等から送信される高速エラーパルスがばたついたり
ノイズ等が発生すると、エラーカウンタが誤動作してし
まう。
【００１０】このような誤動作を防止する装置として
は、特開昭62-254532 号や特開平2-112330号が既に提案
しているが、これらの装置は自装置の電源障害時に通信
相手装置（例えば光伝送端局装置）に影響を及ぼさない
ように構成したものであり、自装置が障害状態にあるか
否かが分からないときには使用できない。
【００１１】また、特開昭59-79663号においては、送信
データを、そのままのデータと論理反転させたデータの
２系統で伝送し、受信側では反転して送られてきたデー
タを元に戻して両者の論理積を取った後に受信処理する
ように構成しているが、これはデータにおける伝送路上
のノイズを防止して誤動作することを狙ったものであ
り、このようなデータ（よりずっと速い光信号）を受信
する光伝送端局装置等の外部装置の電源障害時における
高速なエラーパルスの誤動作を防止することはできない
という問題点があった。
【００１２】従って本発明は、光伝送路に接続された外
部装置における主信号の符号誤り数を高速エラーパルス
として入力しエラーカウンタで該エラーパルスを、発振
器から一定時間毎に送出されるクロックを用いてカウン
トし該一定時間毎のエラーカウント値を出力するエラー
カウント回路において、電源障害時にエラーカウント値
を出力しないようにすることを目的とする。
【００１３】
【課題を解決するための手段及び作用】上記の目的を達
成するための本発明に係るエラーカウント回路を以下に
種々説明する。
【００１４】本発明（その１）：本発明の手段は、外
部装置に設けられている電源監視部がその電源障害時に
発生するディスエーブル信号を受けたとき、エラーカウ
ント回路中のエラーカウンタがカウント動作を停止する
ようにしたものである。
【００１５】本発明の動作（作用）においては、外部装
置は自己の電源電圧を監視して、電圧低下・電源断等の
電源障害を検出すると、エラーカウント回路に対してデ
ィスエーブル信号を出力する。
【００１６】これにより、エラーカウント回路は、通常
時は外部装置からのイネーブル信号によってエラーカウ
ンタの動作を可能とし、電源障害時は、ディスエーブル
信号によりノイズ等が入力される前にエラーカウンタの
動作を禁止するのでエラーカウンタの誤カウントを防止
することが出来る。そして、再びイネーブル信号が入力
されたときにはカウント動作を再開する。
【００１７】本発明（その２）：本発明の手段は、上
記の外部装置から該エラーパルスと共に該エラーパルス
の逆相パルスを同時に入力し、該エラーカウンタの前段
で両パルスを差動入力する回路を設けたものである。
【００１８】本発明の動作においては、外部装置からの
エラーパルスに加えてエラーパルスの逆相パルスも同時
に入力する差動入力方式を採っているので、エラーカウ
ント回路では、電源障害に伴うノイズ等を除去できる
為、エラーカウンタの誤カウント動作を防止出来る。
【００１９】本発明（その３）：本発明の手段は、上
記の外部装置からの該エラーパルスと共に該エラーパル
スを検出する為のサンプリングパルスを同時に入力し、
該エラーカウンタが、該サンプリングパルスに同期した
エラーパルスのみを入力する回路を設けたものである。
【００２０】本発明の動作においては、外部装置からの
エラーパルスに加えて、エラーカウンタを動作させる為
のサンプリングパルスを同時に入力してエラーカウント
回路で該サンプリングパルスに対して正確な関係にある
エラーパルスのみを検出してエラーカウンタの動作を可
能とすることで、エラーカウンタの誤カウントを防止出
来る。
【００２１】本発明（その４）：本発明の手段は、該
エラーパルスをその周期だけ遅延させることによりその
パルス幅が正常であるか否かを検出するパルス幅検出部
を備え、該パルス幅検出部が正常でないパルス幅のエラ
ーパルスを検出したとき該エラーカウンタのカウント動
作を禁止することを特徴としたものである。
【００２２】本発明の動作においては、外部装置のエラ
ーパルス発生部からのエラーパルスの出力は一定周期と
なり得るので、エラーカウンタに入力されるエラーパル
スをその周期だけ遅延させることによりパルス幅を検出
し、一定幅以外のエラーパルスを検出するとエラーカウ
ンタの動作を禁止することで、エラーカウンタの誤カウ
ントを防止出来る。
【００２３】本発明（その５）：本発明の手段は、該
エラーパルスをその周期だけ遅延させることによりその
パルス幅が正常であるか否かを検出するパルス幅検出部
と、該パルス幅検出部の出力信号を受けて訂正パルスの
カウント値を出力する訂正カウンタとを備え、該該パル
ス幅検出部が正常でないパルス幅のエラーパルスを検出
したときこれを該訂正カウンタがカウントし、該エラー
カウンタの値と該訂正カウンタの値を並列に出力し、処
理装置にて該エラーカウンタの値から該訂正カウンタの
値を引くことにより真のエラーカウンタ値を検出するこ
とを特徴としたものである。
【００２４】本発明の動作においては、外部装置からの
エラーパルスの出力は一定周期となり得るので、エラー
カウンタに入力されるエラーパルスのパルス幅を検出し
て、一定幅以外のエラーパルスを検出するとそのカウン
ト動作を訂正カウンタで行い、エラーカウンタの値と訂
正カウンタの値を外部処理装置に出力してエラーカウン
タの値から訂正カウンタの値を引くことにより真のエラ
ーカウンタ値を検出することで、エラーカウンタの誤カ
ウントを防止出来る。
【００２５】
【実施例】本発明（その１）の実施例：図１及び図２ この実施例では、外部装置として光伝送端局装置２を用
い、この光伝送端局装置２においてその電源電圧を監視
し電圧低下（パッケージの抜取りにより電圧低下を含
む）や電源断を検出する電源監視部２２が設けられてお
り、この電源監視部２２からは制御信号ＣＳとしてのイ
ネーブル信号又はディスエーブル信号がエラーカウント
回路１におけるエラーカウンタ１１の端子Ｅ／Ｄに与え
られるようになっており、イネーブル信号がエラーカウ
ンタ１１の端子Ｅ／Ｄに与えられるときにはエラーカウ
ンタ１１の動作が可能となり、ディスエーブル信号が与
えられたときにはカウント動作を停止するようになって
いる。この他の構成は図１１に示した従来例と同様であ
る。
【００２６】このような実施例の動作を図２に示すタイ
ムチャートを参照して以下に説明する。
【００２７】先ず、光伝送端局装置２の電源電圧が正常
であるときには、エラーパルス発生部２１からのエラー
パルスＥＰは図２（１）の左側部分（ａ）に示すように
負論理で一定の周期（例えば３０ｎｓ）によりエラーカ
ウンタ１１に高速で与えられている。
【００２８】このときの光伝送端局装置２の電源電圧は
同図（２）（ａ）に示すように＋５Ｖであり、電源監視
部２２からは同図（３）（ａ）に示すように論理“１”
のイネーブル信号が発生されている。
【００２９】従って、エラーカウンタ１１は同図（４）
（ａ）に示すように通常のカウント動作を実行する。
【００３０】一方、同図（２）の右側部分（ｂ）に示す
ように光伝送端局装置２の電源電圧が＋５Ｖから徐々に
低下して行くような場合、電源監視部２２は電源電圧が
＋４Ｖになった時点で、同図（３）（ｂ）に示すように
制御信号ＣＳとしてイネーブル信号からディスエーブル
信号に切り替えて（立ち下げて）エラーカウンタ１１に
送る。
【００３１】即ち、この例では電源電圧が＋４Ｖより低
下して行くと、図２（１）（ｂ）に示すようにエラーパ
ルスＥＰはバタツキを生じ、このバタツキによるエラー
パルスＥＰに対するカウント動作を実行すると、誤った
カウント値になってしまうので、制御信号ＣＳがイネー
ブル状態からディスエーブル状態になることにより、同
図（４）（ｂ）に示すようにエラーカウンタ１１は電源
電圧が正常な＋５Ｖに復帰するまでカウント動作を中断
することとなる。この中断している間に発振器１４によ
るリセットパルスがエラーカウンタ１１に与えられたと
きには上記のようにエラーカウンタ１１はリセットされ
る。
【００３２】尚、図示の例では、バタツキは高速なエラ
ーパルスＥＰより小さな周期の更に高速なパルスとなっ
ているためエラーカウンタ１１は元々カウント動作でき
ない状態にあるが、バタツキはエラーパルスＥＰの周期
より大きなパルスとなる場合もあるので、上記のように
カウント動作を禁止させる必要がある。
【００３３】この様にして、電圧低下や電源断等の電源
障害時においてはノイズがそのままエラーカウンタ１１
を動作させないようにしており、誤カウントを防止する
事が出来る。
【００３４】本発明（その２）の実施例：図３及び図
４ この実施例においては、外部装置としての光伝送端局装
置２においてエラーパルス発生部２１の出力側に差動出
力用ゲート２３を設けている。このゲート２３はエラー
パルス発生部２１から出力されたエラーパルスを図４
（１）（ａ）に示すようにそのままのエラーパルスＥＰ
として出力するとともに、同図（２）（ａ）に示すよう
にエラーパルスＥＰを反転させた反転エラーパルスＥＰ
* を出力するものである。
【００３５】また、この実施例では、エラーカウント回
路１において、エラーカウンタ１１の前段にＮＡＮＤゲ
ート１５を設けている。このＮＡＮＤゲート１５は、光
伝送端局装置２におけるゲート２３から出力されたエラ
ーパルスＥＰと反転エラーパルスＥＰ* とを入力すると
ともに、反転エラーパルスＥＰ* を更に反転させてエラ
ーパルスＥＰと同相にして両者の論理積をとるゲートで
ある。
【００３６】この様な実施例の動作を図４に示すタイム
チャートを参照して以下に説明する。尚、このタイムチ
ャートでは電圧低下の一例としてパッケージの抜取りを
示している。
【００３７】先ず光伝送端局装置２の電源が正常に動作
しているときには、エラーパルス発生部２１からエラー
パルスを受けた差動出力ゲート２３は図４（１）（ａ）
に示すように一定の周期（３０ｎｓ）で定期的に高速エ
ラーパルスＥＰを出力するとともに、このエラーパルス
ＥＰと丁度逆相の反転エラーパルスＥＰ* を同図（２）
（ａ）に示すように出力する。
【００３８】従って、エラーカウント回路１におけるＮ
ＡＮＤゲート１５においては、エラーパルスＥＰと反転
エラーパルスＥＰ* の更に反転したパルスとの論理積が
取られてエラーカウンタ１１に与えられるので、エラー
カウンタ１１は同図（３）（ａ）に示すように正常なカ
ウント動作を行う。
【００３９】一方、光伝送端局装置２の電源電圧が低下
するなどした場合には、差動出力ゲート２３の動作が正
常に行われなくなり、図４（１）（ａ）及び（２）
（ａ）に示すような丁度逆相状態の二つのエラーパルス
を出力する事が出来なくなり、同図（１）（ｂ）に示す
ようにエラーパルスＥＰにはバタツキが生ずるととも
に、反転エラーパルスＥＰ* は同図（２）（ｂ）に示す
ようにあるところから一定の論理値しか出力しないよう
なこととなる。
【００４０】従って、この様なエラーパルスＥＰと反転
エラーパルスＥＰ* を入力したＮＡＮＤゲート１５にお
いては正しいエラーパルスは出力されないこととなり、
同図（３）（ｂ）に示すようにパッケージを抜いた時点
からエラーカウンタ１１の動作は中断することとなる。
尚、この場合も、通常の動作に戻ったときにはエラーカ
ウンタ１１はカウント動作を再開する。
【００４１】本発明（その３）の実施例：図５及び図
６ この実施例においては、外部装置としての光伝送端局装
置２において通常、エラーパルス発生部２１の前段に設
けられるエラー検出部２０で用いられるサンプリングパ
ルスＳＰをエラーパルスＥＰとともに発生している。
【００４２】また、エラーカウント回路１においては、
エラーカウンタ１１の前段にＮＡＮＤゲート１６を設け
ており、このＮＡＮＤゲート１６は光伝送端局装置２に
おけるエラーパルス発生部２１からのエラーパルスＥＰ
と、光伝送端局装置２におけるエラー検出部２０で用い
られるサンプリングパルスＳＰを反転させたパルスの双
方を入力してＮＡＮＤ論理をとってエラーカウンタ１１
に与えるものである。
【００４３】この実施例の動作を図６に示したタイムチ
ャートを参照して以下に説明する。
【００４４】先ず光伝送端局装置２における電源電圧が
正常なときには、図６（１）（ａ）に示すようにエラー
パルスＥＰは負論理で一定周期の出力を行い、これと丁
度逆相の同期したサンプリングパルスＳＰが制御信号と
して同図（２）（ａ）に示すように出力される。
【００４５】従って、これらのエラーパルスＥＰとサン
プリングパルスＳＰとを入力したＮＡＮＤゲート１６は
図４の場合と同様にサンプリングパルスＳＰを反転させ
て両者が論理“０”となったときのみ論理“１”となる
パルスを出力してエラーカウンタ１１に与える。従っ
て、この様なパルスを受けたエラーカウンタ１１は図６
（３）（ａ）に示すように一定周期でカウント動作を行
う。
【００４６】一方、光伝送端局装置２に電源障害が発生
したような場合には、エラーパルス発生部２１から出力
されるエラーパルスＥＰは同図（１）（ｂ）に示すよう
にバタツキを生ずる。
【００４７】しかしながら、このエラーパルス発生部２
１の前段に用いられるエラー検出部２０のサンプリング
パルスＳＰは同図（２）（ａ）に示すように電源電圧の
変動を受け難いので正常の状態と同様のパルスを出力す
る。
【００４８】従って、サンプリングパルスＳＰを反転さ
せてエラーパルスＥＰとのＮＡＮＤ論理積を取れば、エ
ラーカウンタ１１は、同図（３）（ｂ）に示すようにカ
ウント動作が中断されることとなる。
【００４９】尚、この場合も、ゲート１６の出力はバタ
ツキパルスを含む微小なパルスとなり得るが、これらの
高速なバタツキパルスにはエラーカウンタ１１は追従で
きないのでカウントしないこととなる。
【００５０】また、エラーパルスＥＰが正常に戻ったと
きにはＮＡＮＤゲート１６を介してエラーカウンタ１１
は正常なカウント動作を再開する。
【００５１】本発明（その４）の実施例：図７〜図９ この実施例においては、エラーカウント回路１において
光伝送端局装置２のエラーパルス発生部２１から出力さ
れたエラーパルスＥＰのパルス幅を検出するパルス幅検
出部１７を設け、このパルス幅検出部１７で一定のパル
ス幅以下のパルス幅をエラーカウンタ１１のカウント動
作から除外するようにしている。
【００５２】図８は図７に示したエラーカウント回路１
におけるパルス幅検出部１７の実施例を示したもので、
この実施例ではエラーパルスＥＰを入力して同極性のパ
ルスと逆相のパルスとを出力するゲートＧ１（これは図
３に示した光伝送端局装置２における差動出力ゲート２
３と同様のものである）と、ゲートＧ１からの正転パル
スをクロック信号としてこの正転パルスを２分周する為
のフリップフロップＦＦ１と、ゲートＧ１の反転出力パ
ルスを一定時間Ｔｓ（３０ｎｓ）だけ遅延させる為の遅
延回路ＤＬと、この遅延回路ＤＬの出力をクロック信号
として２分周するフリップフロップＦＦ２と、これらフ
リップフロップＦＦ１とＦＦ２のＱ出力を入力して不一
致検出するための排他的論理和ゲートＥＯＲ１とで構成
されている。尚、フリップフロップＦＦ１，ＦＦ２はパ
ワーオンリセット信号ＲＳＴによってリセットされるよ
うになっている。
【００５３】このような実施例の動作を図９に示したタ
イムチャートを参照して以下に説明する。
【００５４】まず光伝送端局装置２のエラーパルス発生
部２１から出力されたエラーパルスＥＰはエラーカウン
ト回路１におけるエラーカウンタ１１に送られ、従来と
同様のカウント動作を実行する。
【００５５】これと共にエラーパルスＥＰはパルス幅検
出部１７に送られ、ゲートＧ１によりエラーパルスＥＰ
と同相のパルスを出力してフリップフロップＦＦ１にク
ロック信号として与えるとともに、反転パルスを遅延回
路ＤＬを経由して同図（２）（ａ）に示すようなエラー
パルスとしてフリップフロップＦＦ２にクロック信号と
して与える。
【００５６】そして、フリップフロップＦＦ１では同図
（３）（ａ）に示すようにエラーパルスＥＰを２分周し
たパルスが出力され、フリップフロップＦＦ２からは同
図（４）（ａ）に示すように遅延回路ＤＬから出力され
たエラーパルスを２分周したパルスが出力される。
【００５７】従って、エラーパルスＥＰのパルス幅が正
常であればＦＦ１とＦＦ２の各出力信号は同期すること
となり、これらの信号を入力した排他的論理和ゲートＥ
ＯＲ１の出力は同図（５）（ａ）に示すように論理
“０”となってエラーカウンタ１１のイネーブル／ディ
スエーブル端子Ｅ／Ｄに与えられるので、エラーカウン
タ１１は通常の動作を行い、同図（６）（ａ）に示すよ
うに通常のカウント動作を呈する。
【００５８】一方、光伝送端局装置２の電源電圧に変動
が生じてエラーパルスＥＰが図９（１）（ｂ）に示すよ
うにバタツキを生じた場合、このようなバタついたエラ
ーパルスＥＰを遅延回路ＤＬで一定時間Ｔｓだけ遅延さ
せ、これら両者のパルスをそれぞれフリップフロップＦ
Ｆ１とＦＦ２にそれぞれ与えて排他的論理和ゲートＥＯ
Ｒ１に与えることによりゲートＥＯＲ１の出力は同図
（５）（ｂ）に示すようにエラーパルスＥＰのバタツキ
に対応した出力が発生される。
【００５９】このような同図（５）（ｂ）に示すパルス
を受けたエラーカウンタ１１はこれをディスエーブル信
号として受けるので、同図（６）（ａ）に示すようにバ
タツキエラーパルスのカウント動作を禁止する事とな
る。
【００６０】即ち、この実施例では、エラーパルスのパ
ルス幅（３０ｎｓ）に対して一定の遅延を与え、そこで
このパルス幅を監視している。また、このパルス幅以外
の大きいノイズや小さいノイズは全て除去することがで
き、従って一定のエラーパルス幅（３０ｎｓ）を監視
し、そのパルス以外はエラーカウンタ１１の動作を禁止
していることになる。
【００６１】本発明（その５）の実施例：図１０ この実施例においては、エラーカウント回路１に上記の
パルス幅検出部１７を設けるとともに、エラーカウンタ
１１とバッファ１２とＰＩＡ１３との組合せをもう一組
設け、それぞれ訂正カウンタ１１’とバッファ１２’と
ＰＩＡ１３’とし、訂正カウンタ１１’にパルス幅検出
部１７の出力パルスを与えている。そして、ＰＩＡ１３
とＭＰＵ部３とを接続するインターフェースバス４に対
してインターフェースバス４’を設けてＰＩＡ１３’を
並列に接続している。
【００６２】この実施例の動作においては、エラーカウ
ンタ１１は従来と同様の動作を行うが、パルス幅検出部
１７が図９（５）（ｂ）に示すようなパルス（エラーカ
ウンタ制御信号）を発生したときには、このパルスを訂
正カウンタ１１’でカウントし、バッファ１２’及びＰ
ＩＡ１３’並びにインターフェースバス４’を介してＭ
ＰＵ部３に送る。
【００６３】従って、ＭＰＵ部３においては、エラーカ
ウンタ１１の側から与えれらたカウント値から訂正カウ
ンタ１１’より与えられた誤パルスを引き算することに
より正常なパルス数を算出することが可能となる。
【００６４】
【発明の効果】以上のように本発明に係るエラーカウン
ト回路によれば、外部装置から与えられるエラーパルス
の正誤を示す別のパルスを入力するかあるいは自装置の
中で生成することにより、入力したエラーパルスが誤っ
ているときにエラーカウンタの動作を停止させるように
構成したので、電源断や電圧低下並びにパッケージ抜き
取りなどによる電源障害時の誤カウントを防止すること
が可能となる。
【００６５】特に、エラーパルスが高速であっても誤っ
たカウント動作を防止する事が可能となる。
【図面の簡単な説明】
【図１】本発明（その１）に係るエラーカウント回路の
実施例を示したブロック図である。
【図２】本発明（その１）に係るエラーカウント回路の
動作タイムチャート図である。
【図３】本発明（その２）に係るエラーカウント回路の
実施例を示したブロック図である。
【図４】本発明（その２）に係るエラーカウント回路の
動作タイムチャート図である。
【図５】本発明（その３）に係るエラーカウント回路の
実施例を示したブロック図である。
【図６】本発明（その３）に係るエラーカウント回路の
動作タイムチャート図である。
【図７】本発明（その４）に係るエラーカウント回路の
実施例を示したブロック図である。
【図８】本発明（その４）に用いるパルス幅検出部の実
施例を示した回路図である。
【図９】本発明（その４）に係るエラーカウント回路の
動作タイムチャート図である。
【図１０】本発明（その５）に係るエラーカウント回路
の実施例を示したブロック図である。
【図１１】従来の構成例を示したブロック図である。
【符号の説明】
１ エラーカウント回路 ２ 光伝送端局装置 ３ ＭＰＵ部 １１ エラーカウンタ １４ 発振器 ２１ エラーパルス発生部 ２２ 電源監視部 ２３ 差動出力ゲート １５，１６ ＮＡＮＤゲート ２０ エラー検出部 １７ パルス幅検出部 １１’ 訂正カウンタ 図中、同一符号は同一または相当部分を示す。

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】 光伝送路に接続された外部装置における
    主信号の符号誤り数を高速エラーパルスとして入力しエ
    ラーカウンタで該エラーパルスを、発振器から一定時間
    毎に送出されるクロックを用いてカウントし該一定時間
    毎のエラーカウント値を出力するエラーカウント回路に
    おいて、 該外部装置に設けられている電源監視部がその電源障害
    時に発生するディスエーブル信号を受けたとき該エラー
    カウンタがカウント動作を停止することを特徴としたエ
    ラーカウント回路。
  2. 【請求項２】 光伝送路に接続された外部装置における
    主信号の符号誤り数を高速エラーパルスとして入力しエ
    ラーカウンタで該エラーパルスを、発振器から一定時間
    毎に送出されるクロックを用いてカウントし該一定時間
    毎のエラーカウント値を出力するエラーカウント回路に
    おいて、 該外部装置から該エラーパルスと共に該エラーパルスの
    逆相パルスを同時に入力し、該エラーカウンタの前段で
    両パルスを差動入力する回路を設けたことを特徴とする
    エラーカウント回路。
  3. 【請求項３】 光伝送路に接続された外部装置における
    主信号の符号誤り数を高速エラーパルスとして入力しエ
    ラーカウンタで該エラーパルスを、発振器から一定時間
    毎に送出されるクロックを用いてカウントし該一定時間
    毎のエラーカウント値を出力するエラーカウント回路に
    おいて、 該外部装置からの該エラーパルスと共に該エラーパルス
    を検出する為のサンプリングパルスを同時に入力し、該
    エラーカウンタが、該サンプリングパルスに同期したエ
    ラーパルスのみを入力する回路を設けたことを特徴とす
    るエラーカウント回路。
  4. 【請求項４】 光伝送路に接続された外部装置における
    主信号の符号誤り数を高速エラーパルスとして入力しエ
    ラーカウンタで該エラーパルスを、発振器から一定時間
    毎に送出されるクロックを用いてカウントし該一定時間
    毎のエラーカウント値を出力するエラーカウント回路に
    おいて、 該エラーパルスをその周期だけ遅延させることによりそ
    のパルス幅が正常であるか否かを検出するパルス幅検出
    部を備え、該パルス幅検出部が正常でないパルス幅のエ
    ラーパルスを検出したとき該エラーカウンタのカウント
    動作を禁止することを特徴としたエラーカウント回路。
  5. 【請求項５】 光伝送路に接続された外部装置における
    主信号の符号誤り数を高速エラーパルスとして入力しエ
    ラーカウンタで該エラーパルスを、発振器から一定時間
    毎に送出されるクロックを用いてカウントし該一定時間
    毎のエラーカウント値を出力するエラーカウント回路に
    おいて、 該エラーパルスをその周期だけ遅延させることによりそ
    のパルス幅が正常であるか否かを検出するパルス幅検出
    部と、該パルス幅検出部の出力信号により訂正パルスの
    カウント値を出力する訂正カウンタとを備え、該パルス
    幅検出部が正常でないパルス幅のエラーパルスを検出し
    たときこれを該訂正カウンタがカウントし、該エラーカ
    ウンタの値と該訂正カウンタの値を並列に出力し、外部
    処理装置にて該エラーカウンタの値から該訂正カウンタ
    の値を引くことにより真のエラーカウンタ値を検出する
    ことを特徴としたエラーカウント回路。
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