JPH0664214A - サーマルヘッド - Google Patents
サーマルヘッドInfo
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- JPH0664214A JPH0664214A JP22441992A JP22441992A JPH0664214A JP H0664214 A JPH0664214 A JP H0664214A JP 22441992 A JP22441992 A JP 22441992A JP 22441992 A JP22441992 A JP 22441992A JP H0664214 A JPH0664214 A JP H0664214A
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- thermal head
- signal
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Abstract
(57)【要約】
【目的】 印字動作を行わない待機時において、ヘッド
基板部１１の各電極に一定の電圧が長時間にわたって印
加することを防止するサーマルヘッドを提供する。 【構成】 サーマルヘッド１０のプリント基板部１２に
は、ヘッド基板部１１の第１電極２１ａ、第２電極２２
ａ、接続電極２３ａおよび信号電極３１ａがそれぞれ接
続される第１電極２１ｂ、第２電極２２ｂ、接続電極２
３ｂおよび信号電極３１ｂと、第１電極２１ｂと第２電
極２２ｂとの間に接続されたノイズ吸収用のコンデンサ
ＣＡと、接続電極２３ｂと第２電極２２ｂとの間に接続
された選択スイッチング素子１６とが形成されている。
基板部１１の各電極に一定の電圧が長時間にわたって印
加することを防止するサーマルヘッドを提供する。 【構成】 サーマルヘッド１０のプリント基板部１２に
は、ヘッド基板部１１の第１電極２１ａ、第２電極２２
ａ、接続電極２３ａおよび信号電極３１ａがそれぞれ接
続される第１電極２１ｂ、第２電極２２ｂ、接続電極２
３ｂおよび信号電極３１ｂと、第１電極２１ｂと第２電
極２２ｂとの間に接続されたノイズ吸収用のコンデンサ
ＣＡと、接続電極２３ｂと第２電極２２ｂとの間に接続
された選択スイッチング素子１６とが形成されている。
Description
【０００１】
【産業上の利用分野】本発明は、ファクシミリ装置や画
像記録装置などに用いられるサーマルヘッドに関する。
像記録装置などに用いられるサーマルヘッドに関する。
【０００２】
【従来の技術】図１２は、従来のサーマルヘッド６０の
電気的構成を示す回路図である。サーマルヘッド６０
は、ヘッド基板部６１とプリント基板部６２などから構
成されており、ヘッド基板部６１には、記録画像の画素
に対応した複数の発熱抵抗体Ｒ１〜Ｒｎ（ただし、ｎは
自然数。以下同じ）と、各発熱抵抗体Ｒ１〜Ｒｎの一端
と接続される複数のスイッチング素子Ｔ１〜Ｔｎおよび
これらを所定のタイミングで駆動する駆動回路６４から
成る駆動集積回路６３と、各発熱抵抗体Ｒ１〜Ｒｎの他
端を互いに接続する第１電極７１ａと、各スイッチング
素子Ｔ１〜Ｔｎの他端を互いに接続する第２電極７２ａ
と、駆動集積回路６４を制御する信号が伝わる信号電極
８１ａとが形成されている。プリント基板部６２には、
ヘッド基板部６１の第１電極７１ａ、第２電極７２ａお
よび信号電極８１ａがそれぞれ接続される第１電極７１
ｂ、第２電極７２ｂおよび信号電極８１ｂと、第１電極
７１ｂと第２電極７２ｂとの間に接続されたノイズ吸収
用のコンデンサＣＡとが形成されている。
電気的構成を示す回路図である。サーマルヘッド６０
は、ヘッド基板部６１とプリント基板部６２などから構
成されており、ヘッド基板部６１には、記録画像の画素
に対応した複数の発熱抵抗体Ｒ１〜Ｒｎ（ただし、ｎは
自然数。以下同じ）と、各発熱抵抗体Ｒ１〜Ｒｎの一端
と接続される複数のスイッチング素子Ｔ１〜Ｔｎおよび
これらを所定のタイミングで駆動する駆動回路６４から
成る駆動集積回路６３と、各発熱抵抗体Ｒ１〜Ｒｎの他
端を互いに接続する第１電極７１ａと、各スイッチング
素子Ｔ１〜Ｔｎの他端を互いに接続する第２電極７２ａ
と、駆動集積回路６４を制御する信号が伝わる信号電極
８１ａとが形成されている。プリント基板部６２には、
ヘッド基板部６１の第１電極７１ａ、第２電極７２ａお
よび信号電極８１ａがそれぞれ接続される第１電極７１
ｂ、第２電極７２ｂおよび信号電極８１ｂと、第１電極
７１ｂと第２電極７２ｂとの間に接続されたノイズ吸収
用のコンデンサＣＡとが形成されている。
【０００３】このようなサーマルヘッド６０において、
外部からスイッチＳＷを介して電源ＰＳの第１電極７１
ｂおよび第２電極７２ｂに接続するとともに、信号制御
回路８０からの出力信号を信号電極８１ｂに供給するこ
とによって、画像信号に対応する各発熱抵抗体Ｒ１〜Ｒ
ｎを選択的に発熱させて、サーマルヘッドに密着する感
熱紙や熱転写フィルムを加熱し印字している。
外部からスイッチＳＷを介して電源ＰＳの第１電極７１
ｂおよび第２電極７２ｂに接続するとともに、信号制御
回路８０からの出力信号を信号電極８１ｂに供給するこ
とによって、画像信号に対応する各発熱抵抗体Ｒ１〜Ｒ
ｎを選択的に発熱させて、サーマルヘッドに密着する感
熱紙や熱転写フィルムを加熱し印字している。
【０００４】
【発明が解決しようとする課題】従来のサーマルヘッド
６０では、駆動回路６４がノイズの影響を受けて誤動作
して発熱抵抗体の過熱や破壊が生じたり、空気中の水分
や感熱紙上の電解質がヘッド基板部６１に付着すること
によって電極腐食が生じることを防止するため、印字動
作を行わない待機時にスイッチＳＷを遮断状態にしてい
る。したがって、コンデンサＣＡに充電された電荷が、
ヘッド基板部やプリント基板部の高絶縁抵抗を介してゆ
っくりと放電されるため、スイッチＳＷの遮断後は、一
定の電圧が第１電極７１ａ、７１ｂと第２電極７２ａ、
７２ｂとの間で長時間にわたって印加され続け、ヘッド
基板部６１の各電極の腐食がさらに加速されるという課
題がある。
６０では、駆動回路６４がノイズの影響を受けて誤動作
して発熱抵抗体の過熱や破壊が生じたり、空気中の水分
や感熱紙上の電解質がヘッド基板部６１に付着すること
によって電極腐食が生じることを防止するため、印字動
作を行わない待機時にスイッチＳＷを遮断状態にしてい
る。したがって、コンデンサＣＡに充電された電荷が、
ヘッド基板部やプリント基板部の高絶縁抵抗を介してゆ
っくりと放電されるため、スイッチＳＷの遮断後は、一
定の電圧が第１電極７１ａ、７１ｂと第２電極７２ａ、
７２ｂとの間で長時間にわたって印加され続け、ヘッド
基板部６１の各電極の腐食がさらに加速されるという課
題がある。
【０００５】本発明の目的は、前述した課題を解決する
ため、印加動作を行わない待機時において、ヘッド基板
部６１の各電極に一定の電圧が長時間にわたって印加す
ることを防止するサーマルヘッドを提供することであ
る。
ため、印加動作を行わない待機時において、ヘッド基板
部６１の各電極に一定の電圧が長時間にわたって印加す
ることを防止するサーマルヘッドを提供することであ
る。
【０００６】
【課題を解決するための手段】本発明は、複数の発熱抵
抗体と、各発熱抵抗体の一端と接続される複数のスイッ
チング素子と、各発熱抵抗体の他端を互いに接続する第
１電極と、各スイッチング素子の他端を互いに接続する
第２電極と、第１電極と第２電極との間で接続されたコ
ンデンサとを備えたサーマルヘッドにおいて、第１電極
と第２電極との間に抵抗と選択スイッチング素子が直列
に接続されており、前記選択スイッチング素子は、各発
熱抵抗体の非動作時に導通状態となることを特徴とする
サーマルヘッドである。
抗体と、各発熱抵抗体の一端と接続される複数のスイッ
チング素子と、各発熱抵抗体の他端を互いに接続する第
１電極と、各スイッチング素子の他端を互いに接続する
第２電極と、第１電極と第２電極との間で接続されたコ
ンデンサとを備えたサーマルヘッドにおいて、第１電極
と第２電極との間に抵抗と選択スイッチング素子が直列
に接続されており、前記選択スイッチング素子は、各発
熱抵抗体の非動作時に導通状態となることを特徴とする
サーマルヘッドである。
【０００７】
【作用】本発明に従えば、サーマルヘッドの各発熱抵抗
体の非動作時に導通状態となる選択スイッチング素子と
抵抗が、第１電極と第２電極との間で直列接続されてい
ることによって、サーマルヘッドが印字待機状態になっ
た場合、コンデンサに蓄積された電荷を速やかに放電す
ることができる。また、このようなコンデンサの放電
は、待機時などの非印画状態に限定して動作するため、
印画動作時には何ら電力損失を起こすこともない。
体の非動作時に導通状態となる選択スイッチング素子と
抵抗が、第１電極と第２電極との間で直列接続されてい
ることによって、サーマルヘッドが印字待機状態になっ
た場合、コンデンサに蓄積された電荷を速やかに放電す
ることができる。また、このようなコンデンサの放電
は、待機時などの非印画状態に限定して動作するため、
印画動作時には何ら電力損失を起こすこともない。
【０００８】
【実施例】図１は、本発明の一実施例であるサーマルヘ
ッド１０の電気的構成を示す回路図である。サーマルヘ
ッド１０は、ヘッド基板部１１とプリント基板部１２な
どから構成されており、ヘッド基板部１１には、記録画
像の画素に対応した複数の発熱抵抗体Ｒ１〜Ｒｎと、各
発熱抵抗体Ｒ１〜Ｒｎの一端と接続される複数のスイッ
チング素子Ｔ１〜Ｔｎおよびこれらを所定のタイミング
で駆動する駆動回路１４から成る駆動集積回路１３と、
各発熱抵抗体Ｒ１〜Ｒｎの他端を互いに接続する第１電
極２１ａと、スイッチング素子Ｔ１〜Ｔｎの他端を互い
に接続する第２電極２２ａと、駆動集積回路１３を制御
する信号が伝わる信号電極３１ａと、第１電極２１ａと
接続電極２３ａとの間で接続された抵抗ＲＡとが形成さ
れている。プリント基板部１２には、ヘッド基板部１１
の第１電極２１ａ、第２電極２２ａ、接続電極２３ａお
よび信号電極３１ａがそれぞれ接続される第１電極２１
ｂ、第２電極２２ｂ、接続電極２３ｂおよび信号電極３
１ｂと、第１電極２１ｂと第２電極２２ｂとの間で接続
されたノイズ吸収用のコンデンサＣＡと、接続電極２３
ｂと第２電極２２ｂとの間で接続された選択スイッチン
グ素子１６とが形成されている。
ッド１０の電気的構成を示す回路図である。サーマルヘ
ッド１０は、ヘッド基板部１１とプリント基板部１２な
どから構成されており、ヘッド基板部１１には、記録画
像の画素に対応した複数の発熱抵抗体Ｒ１〜Ｒｎと、各
発熱抵抗体Ｒ１〜Ｒｎの一端と接続される複数のスイッ
チング素子Ｔ１〜Ｔｎおよびこれらを所定のタイミング
で駆動する駆動回路１４から成る駆動集積回路１３と、
各発熱抵抗体Ｒ１〜Ｒｎの他端を互いに接続する第１電
極２１ａと、スイッチング素子Ｔ１〜Ｔｎの他端を互い
に接続する第２電極２２ａと、駆動集積回路１３を制御
する信号が伝わる信号電極３１ａと、第１電極２１ａと
接続電極２３ａとの間で接続された抵抗ＲＡとが形成さ
れている。プリント基板部１２には、ヘッド基板部１１
の第１電極２１ａ、第２電極２２ａ、接続電極２３ａお
よび信号電極３１ａがそれぞれ接続される第１電極２１
ｂ、第２電極２２ｂ、接続電極２３ｂおよび信号電極３
１ｂと、第１電極２１ｂと第２電極２２ｂとの間で接続
されたノイズ吸収用のコンデンサＣＡと、接続電極２３
ｂと第２電極２２ｂとの間で接続された選択スイッチン
グ素子１６とが形成されている。
【０００９】このようなサーマルヘッド１０において、
外部からスイッチＳＷを介して電源ＰＳを第１電極２１
ｂおよび第２電極２２ｂに接続するとともに、信号制御
回路３０からの出力信号を信号電極３１ｂに供給するこ
とによって、画像信号に対応する各発熱抵抗体Ｒ１〜Ｒ
ｎを選択的に発熱させて、サーマルヘッド１０に密着す
る感熱紙や熱転写フィルムを加熱し印字している。印字
動作を行わない待機時には、スイッチＳＷは遮断され、
このとき選択的スイッチング素子１６が導通状態とな
り、コンデンサＣＡに充電された電荷は抵抗ＲＡを介し
て速やかに放電される。
外部からスイッチＳＷを介して電源ＰＳを第１電極２１
ｂおよび第２電極２２ｂに接続するとともに、信号制御
回路３０からの出力信号を信号電極３１ｂに供給するこ
とによって、画像信号に対応する各発熱抵抗体Ｒ１〜Ｒ
ｎを選択的に発熱させて、サーマルヘッド１０に密着す
る感熱紙や熱転写フィルムを加熱し印字している。印字
動作を行わない待機時には、スイッチＳＷは遮断され、
このとき選択的スイッチング素子１６が導通状態とな
り、コンデンサＣＡに充電された電荷は抵抗ＲＡを介し
て速やかに放電される。
【００１０】図２は、本発明の一実施例であるサーマル
ヘッドの構成を示す斜視図であり、図３は、その側面図
である。ヘッド基板部１１とプリント基板部１２は、接
着剤５１によってアルミニウムなどから成る放熱器５０
に固定され、ヘッド基板部１１の第１電極２１ａ、第２
電極２２ａ、接続電極２３ａおよび信号電極３１ａとプ
リント基板部１２の第１電極２１ｂ、第２電極２２ｂ、
接続電極２３ｂおよび信号電極３１ｂとがハンダ付けな
どによってそれぞれ接続される。ヘッド基板部１１に
は、走査線１に沿って複数の発熱抵抗体Ｒ１〜Ｒｎが形
成されており、各発熱抵抗体Ｒ１〜Ｒｎに流れる電流を
制御する複数の駆動集積回路１３が樹脂１５で被包され
ている。プリント基板部１２には、電源ＰＳや信号制御
回路３０を接続するためのコネクタ３２と、第１電極２
１ｂと第２電極２２ｂとの間で接続されたコンデンサＣ
Ａと、一端が抵抗ＲＡに直列に接続され他端が第２電極
２２ｂに接続される選択スイッチング素子１６が固定さ
れている。なお、選択スイッチング素子１６には、図１
に示すように、信号電極３１ｂのうち、駆動回路１４に
おいて印字時間を制御するためのストローブ信号がＳＴ
Ｒ１、ＳＴＲ２の分岐線が制御信号として独立に入力さ
れている。なお、以下の説明では２分割印字動作を例に
とって説明するが、たとえば４分割印字動作の場合は４
本のストローブ信号が入力される。
ヘッドの構成を示す斜視図であり、図３は、その側面図
である。ヘッド基板部１１とプリント基板部１２は、接
着剤５１によってアルミニウムなどから成る放熱器５０
に固定され、ヘッド基板部１１の第１電極２１ａ、第２
電極２２ａ、接続電極２３ａおよび信号電極３１ａとプ
リント基板部１２の第１電極２１ｂ、第２電極２２ｂ、
接続電極２３ｂおよび信号電極３１ｂとがハンダ付けな
どによってそれぞれ接続される。ヘッド基板部１１に
は、走査線１に沿って複数の発熱抵抗体Ｒ１〜Ｒｎが形
成されており、各発熱抵抗体Ｒ１〜Ｒｎに流れる電流を
制御する複数の駆動集積回路１３が樹脂１５で被包され
ている。プリント基板部１２には、電源ＰＳや信号制御
回路３０を接続するためのコネクタ３２と、第１電極２
１ｂと第２電極２２ｂとの間で接続されたコンデンサＣ
Ａと、一端が抵抗ＲＡに直列に接続され他端が第２電極
２２ｂに接続される選択スイッチング素子１６が固定さ
れている。なお、選択スイッチング素子１６には、図１
に示すように、信号電極３１ｂのうち、駆動回路１４に
おいて印字時間を制御するためのストローブ信号がＳＴ
Ｒ１、ＳＴＲ２の分岐線が制御信号として独立に入力さ
れている。なお、以下の説明では２分割印字動作を例に
とって説明するが、たとえば４分割印字動作の場合は４
本のストローブ信号が入力される。
【００１１】図４は、図２中のＡ領域における電極形状
を示す部分拡大図であり、図５はそのＣ−Ｃ線に沿った
ヘッド基板部１１の部分断面図である。ヘッド基板部１
１の製造方法を、図５を参照しながら説明すると、アル
ミナＡｌ2Ｏ3などの電気絶縁性基板２の上に、ガラスな
どの蓄熱層３を全面に形成して、その上に窒化タンタル
Ｔａ3Ｎ4などの発熱抵抗体層４を全面に形成し、さらに
その上に個別電極５ａおよび共通電極５ｂの元となるア
ルミニウムなどから成る電極層を全面に形成する。次
に、図４に示す電極形状を有する第１のマスクを用いて
レジストを形成して、該電極層および発熱抵抗体層４を
エッチングし、該レジストを除去した後、図４に示す斜
線部を開口部とする第２のマスクを用いてレジストを再
び形成して、斜線部の電極層のみをエッチングして除去
することによって、走査線１に沿って発熱抵抗体Ｒ１〜
Ｒｎを形成するとともに、抵抗ＲＡを発熱抵抗体Ｒ１〜
Ｒｎと同じ材料かつ同一工程で形成する。そして表面に
窒化珪素Ｓｉ3Ｎ4などの保護層６を形成することによっ
て、ヘッド基板部１１を得ることができる。
を示す部分拡大図であり、図５はそのＣ−Ｃ線に沿った
ヘッド基板部１１の部分断面図である。ヘッド基板部１
１の製造方法を、図５を参照しながら説明すると、アル
ミナＡｌ2Ｏ3などの電気絶縁性基板２の上に、ガラスな
どの蓄熱層３を全面に形成して、その上に窒化タンタル
Ｔａ3Ｎ4などの発熱抵抗体層４を全面に形成し、さらに
その上に個別電極５ａおよび共通電極５ｂの元となるア
ルミニウムなどから成る電極層を全面に形成する。次
に、図４に示す電極形状を有する第１のマスクを用いて
レジストを形成して、該電極層および発熱抵抗体層４を
エッチングし、該レジストを除去した後、図４に示す斜
線部を開口部とする第２のマスクを用いてレジストを再
び形成して、斜線部の電極層のみをエッチングして除去
することによって、走査線１に沿って発熱抵抗体Ｒ１〜
Ｒｎを形成するとともに、抵抗ＲＡを発熱抵抗体Ｒ１〜
Ｒｎと同じ材料かつ同一工程で形成する。そして表面に
窒化珪素Ｓｉ3Ｎ4などの保護層６を形成することによっ
て、ヘッド基板部１１を得ることができる。
【００１２】なお、抵抗ＲＡは、図２中の領域Ａだけで
なく領域Ｂにも同一工程で形成することが可能であり、
さらに複数の抵抗体を複数の領域に分散させて形成して
もよい。また、抵抗ＲＡの抵抗値は、通電時の極端な発
熱を避けるために、発熱抵抗体Ｒ１〜Ｒｎの各１本の抵
抗値以上の値、好ましくは５倍程度以上であればよい。
したがって、抵抗ＲＡを発熱抵抗体Ｒ１〜Ｒｎの製造工
程で同時に形成する場合、層の厚みが同一となるため、
大きな抵抗値を得るために図６に示すような、電流路が
長い蛇行状に形成してもよい。このように、従来用いら
れてきた第２のマスク形状を変更するだけで、抵抗ＲＡ
を発熱抵抗体Ｒ１〜Ｒｎと同一工程で形成することが可
能になり、サーマルヘッド１０の製造コストの増加を抑
えることができる。
なく領域Ｂにも同一工程で形成することが可能であり、
さらに複数の抵抗体を複数の領域に分散させて形成して
もよい。また、抵抗ＲＡの抵抗値は、通電時の極端な発
熱を避けるために、発熱抵抗体Ｒ１〜Ｒｎの各１本の抵
抗値以上の値、好ましくは５倍程度以上であればよい。
したがって、抵抗ＲＡを発熱抵抗体Ｒ１〜Ｒｎの製造工
程で同時に形成する場合、層の厚みが同一となるため、
大きな抵抗値を得るために図６に示すような、電流路が
長い蛇行状に形成してもよい。このように、従来用いら
れてきた第２のマスク形状を変更するだけで、抵抗ＲＡ
を発熱抵抗体Ｒ１〜Ｒｎと同一工程で形成することが可
能になり、サーマルヘッド１０の製造コストの増加を抑
えることができる。
【００１３】図７は、選択スイッチング素子１６の等価
回路図である。選択スイッチング素子１６は、ストロー
ブ信号ＳＴＲ１、ＳＴＲ２がそれぞれ入力されるインバ
ータＩＮＶ１，ＩＮＶ２と、インバータＩＮＶ１，ＩＮ
Ｖ２の出力が入力されるノアゲートＮＯＲと、ノアゲー
トＮＯＲの出力によって抵抗ＲＡと第２電極２２ｂとの
間を導通または遮断するトランジスタＴＲとで構成され
る。その動作は、ストローブ信号ＳＴＲ１，ＳＴＲ２の
両方がハイレベルのとき、ノアゲートＮＯＲの出力信号
ＳＥＬがハイレベルとなり、ストローブＳＴＲ１，ＳＴ
Ｒ２の少なくとも１つがローレベルのとき、ノアゲート
ＮＯＲの出力信号ＳＥＬがローレベルとなる。
回路図である。選択スイッチング素子１６は、ストロー
ブ信号ＳＴＲ１、ＳＴＲ２がそれぞれ入力されるインバ
ータＩＮＶ１，ＩＮＶ２と、インバータＩＮＶ１，ＩＮ
Ｖ２の出力が入力されるノアゲートＮＯＲと、ノアゲー
トＮＯＲの出力によって抵抗ＲＡと第２電極２２ｂとの
間を導通または遮断するトランジスタＴＲとで構成され
る。その動作は、ストローブ信号ＳＴＲ１，ＳＴＲ２の
両方がハイレベルのとき、ノアゲートＮＯＲの出力信号
ＳＥＬがハイレベルとなり、ストローブＳＴＲ１，ＳＴ
Ｒ２の少なくとも１つがローレベルのとき、ノアゲート
ＮＯＲの出力信号ＳＥＬがローレベルとなる。
【００１４】図８は、選択スイッチング素子１６の動作
を示すタイミングチャートである。発熱抵抗体Ｒ１〜Ｒ
ｎを選択的に駆動するための駆動集積回路１３には、ク
ロック信号ＣＬＯＣＫに同期してシリアルデータとして
転送された１ライン分の印字信号ＤＡＴＡを、パラレル
データに変換するためのシフトレジスタと、ラッチ信号
ＬＡＴＣＨによって該シフトレジスタの出力を一時的に
記憶する複数のラッチ回路と、各ラッチ回路の出力と各
スイッチング素子Ｔ１〜Ｔｎとの間を、ストローブ信号
ＳＴＲ１，ＳＴＲ２などの制御信号によって開閉する複
数のゲート素子などが組込まれており、２分割印字動作
の場合、ストローブ信号ＳＴＲ１がローレベルのとき１
ライン分の発熱抵抗体のうちの半分が選択的に発熱する
とともに、残りの半分はストローブ信号ＳＴＲ２がロー
レベルのときに選択的に発熱する。
を示すタイミングチャートである。発熱抵抗体Ｒ１〜Ｒ
ｎを選択的に駆動するための駆動集積回路１３には、ク
ロック信号ＣＬＯＣＫに同期してシリアルデータとして
転送された１ライン分の印字信号ＤＡＴＡを、パラレル
データに変換するためのシフトレジスタと、ラッチ信号
ＬＡＴＣＨによって該シフトレジスタの出力を一時的に
記憶する複数のラッチ回路と、各ラッチ回路の出力と各
スイッチング素子Ｔ１〜Ｔｎとの間を、ストローブ信号
ＳＴＲ１，ＳＴＲ２などの制御信号によって開閉する複
数のゲート素子などが組込まれており、２分割印字動作
の場合、ストローブ信号ＳＴＲ１がローレベルのとき１
ライン分の発熱抵抗体のうちの半分が選択的に発熱する
とともに、残りの半分はストローブ信号ＳＴＲ２がロー
レベルのときに選択的に発熱する。
【００１５】選択スイッチング素子１６のトランジスタ
ＴＲは、各発熱抵抗体Ｒ１〜Ｒｎが印画動作状態である
とき、すなわちストローブ信号ＳＴＲ１，ＳＴＲ２のど
ちらかがローレベルであるとき、遮断状態となるが、一
方、発熱抵抗体Ｒ１〜Ｒｎが非動作状態であるとき、す
なわちストローブ信号ＳＴＲ１，ＳＴＲ２の両方がハイ
レベルであるとき導通状態となって、抵抗ＲＡを介して
コンデンサＣＡの放電を行う。
ＴＲは、各発熱抵抗体Ｒ１〜Ｒｎが印画動作状態である
とき、すなわちストローブ信号ＳＴＲ１，ＳＴＲ２のど
ちらかがローレベルであるとき、遮断状態となるが、一
方、発熱抵抗体Ｒ１〜Ｒｎが非動作状態であるとき、す
なわちストローブ信号ＳＴＲ１，ＳＴＲ２の両方がハイ
レベルであるとき導通状態となって、抵抗ＲＡを介して
コンデンサＣＡの放電を行う。
【００１６】図９は、本発明の他の実施例であるサーマ
ルヘッド１０の電気的構成を示す回路図である。本実施
例におけるサーマルヘッド１０は、図１に示したものと
同様な構成であるが、選択スイッチング素子１６に論理
回路用の電源ＰＳａの出力ＶＤが入力信号として接続さ
れる点が相違する。
ルヘッド１０の電気的構成を示す回路図である。本実施
例におけるサーマルヘッド１０は、図１に示したものと
同様な構成であるが、選択スイッチング素子１６に論理
回路用の電源ＰＳａの出力ＶＤが入力信号として接続さ
れる点が相違する。
【００１７】図１０は、図９の選択スイッチング素子１
６の等価回路図である。この選択スイッチング素子１６
は、電源ＰＳａの出力ＶＤとストローブ信号ＳＴＲ１，
ＳＴＲ２が入力されるアンドゲートＡＮＤ１，ＡＮＤ２
と、アンドゲートＡＮＤ１と、ＡＮＤ２の出力が入力さ
れるアンドゲートＡＮＤ３と、アンドゲートＡＮＤ３の
出力によって抵抗ＲＡと第２電極２２ｂとの間を導通ま
たは遮断するトランジスタＴＲとで構成される。
６の等価回路図である。この選択スイッチング素子１６
は、電源ＰＳａの出力ＶＤとストローブ信号ＳＴＲ１，
ＳＴＲ２が入力されるアンドゲートＡＮＤ１，ＡＮＤ２
と、アンドゲートＡＮＤ１と、ＡＮＤ２の出力が入力さ
れるアンドゲートＡＮＤ３と、アンドゲートＡＮＤ３の
出力によって抵抗ＲＡと第２電極２２ｂとの間を導通ま
たは遮断するトランジスタＴＲとで構成される。
【００１８】その動作は、出力ＶＤおよびストローブ信
号ＳＴＲ１，ＳＴＲ２の全てがハイレベルのとき、アン
ドゲートＡＮＤ３の出力信号ＳＥＬがハイレベルとなっ
て、トランジスタＴＲが導通して抵抗ＲＡを介してコン
デンサＣＡを放電する。一方、出力ＶＤおよびストロー
ブ信号ＳＴＲ１，ＳＴＲ２の少なくとも１つがローレベ
ルのとき、出力信号ＳＥＬがローレベルとなって、トラ
ンジスタＴＲは遮断状態となる。したがって、論理回路
用の電源ＰＳａが所定電圧を出力している限り、図８に
示すタイミングチャートと同様な動作を行うことにな
る。
号ＳＴＲ１，ＳＴＲ２の全てがハイレベルのとき、アン
ドゲートＡＮＤ３の出力信号ＳＥＬがハイレベルとなっ
て、トランジスタＴＲが導通して抵抗ＲＡを介してコン
デンサＣＡを放電する。一方、出力ＶＤおよびストロー
ブ信号ＳＴＲ１，ＳＴＲ２の少なくとも１つがローレベ
ルのとき、出力信号ＳＥＬがローレベルとなって、トラ
ンジスタＴＲは遮断状態となる。したがって、論理回路
用の電源ＰＳａが所定電圧を出力している限り、図８に
示すタイミングチャートと同様な動作を行うことにな
る。
【００１９】図１１は、本発明の係るサーマルヘッド１
０のコンデンサＣＡの端子間電圧の放電特性を示すグラ
フである。縦軸は、コンデンサＣＡの端子間電圧を示
し、横軸はスイッチＳＷが遮断したときからの経過時間
を示している。
０のコンデンサＣＡの端子間電圧の放電特性を示すグラ
フである。縦軸は、コンデンサＣＡの端子間電圧を示
し、横軸はスイッチＳＷが遮断したときからの経過時間
を示している。
【００２０】図１２に示す従来のサーマルヘッド６０に
おいて、コンデンサＣＡが２２μＦであって、電源ＰＳ
の供給電圧が２４Ｖの半分、すなわち１２Ｖに低下する
まで、約４８時間経過している。一方、図１および図９
に示す本発明のサーマルヘッド１０において、抵抗ＲＡ
が５ｋΩ、コンデンサＣＡが２２μＦ、電源ＰＳの供給
電圧が同じ２４Ｖの場合、スイッチＳＷが遮断してから
約１秒間でほぼ完全に放電している。
おいて、コンデンサＣＡが２２μＦであって、電源ＰＳ
の供給電圧が２４Ｖの半分、すなわち１２Ｖに低下する
まで、約４８時間経過している。一方、図１および図９
に示す本発明のサーマルヘッド１０において、抵抗ＲＡ
が５ｋΩ、コンデンサＣＡが２２μＦ、電源ＰＳの供給
電圧が同じ２４Ｖの場合、スイッチＳＷが遮断してから
約１秒間でほぼ完全に放電している。
【００２１】
【発明の効果】以上詳説したように、本発明によれば、
サーマルヘッドが印画待機状態になる場合、第１電極と
第２電極との間に接続されるコンデンサに充電された電
荷が、第１電極と第２電極との間に接続された抵抗およ
び非印字動作時に導通する選択スイッチング素子を介し
て速やかに放電されるため、サーマルヘッドの各電極に
長時間にわたって一定の電圧が印加されることを解消す
ることができる。したがって、サーマルヘッドでの電極
の腐食進行を防止することができ、信頼性の高いサーマ
ルヘッドを供給することができる。
サーマルヘッドが印画待機状態になる場合、第１電極と
第２電極との間に接続されるコンデンサに充電された電
荷が、第１電極と第２電極との間に接続された抵抗およ
び非印字動作時に導通する選択スイッチング素子を介し
て速やかに放電されるため、サーマルヘッドの各電極に
長時間にわたって一定の電圧が印加されることを解消す
ることができる。したがって、サーマルヘッドでの電極
の腐食進行を防止することができ、信頼性の高いサーマ
ルヘッドを供給することができる。
【図１】本発明の一実施例であるサーマルヘッド１０の
電気的構成を示す回路図である。
電気的構成を示す回路図である。
【図２】本発明の一実施例であるサーマルヘッド１０の
構成を示す斜視図である。
構成を示す斜視図である。
【図３】本発明の一実施例であるサーマルヘッド１０の
構成を示す側面図である。
構成を示す側面図である。
【図４】図２のＡ領域における電極形状を示す部分拡大
図である。
図である。
【図５】図４のＣ−Ｃ線に沿ったヘッド基板部１１の断
面図である。
面図である。
【図６】図２のＡ領域における電極の他の形状を示す部
分拡大図である。
分拡大図である。
【図７】選択スイッチング素子１６の等価回路図であ
る。
る。
【図８】選択スイッチング素子１５の動作を示すタイミ
ングチャートである。
ングチャートである。
【図９】本発明の他の実施例であるサーマルヘッド１０
の電気的構成を示す回路図である。
の電気的構成を示す回路図である。
【図１０】図９の選択スイッチング素子１６の等価回路
図である。
図である。
【図１１】本発明に係るサーマルヘッド１０のコンデン
サＣＡの端子間の放電特性を示すグラフである。
サＣＡの端子間の放電特性を示すグラフである。
【図１２】従来のサーマルヘッド６０の電気的構成を示
す回路図である。
す回路図である。
１ 走査線 ２ 電気絶縁性基板 ３ 蓄熱層 ４ 発熱抵抗体層 ５ａ 個別電極 ５ｂ 共通電極 ６ 保護層 １０ サーマルヘッド １１ ヘッド基板部 １２ プリント基板部 １３ 駆動集積回路 １４ 駆動回路 １５ 樹脂 １６ 選択スイッチング素子 ２１ａ，２１ｂ 第１電極 ２２ａ，２２ｂ 第２電極 ２３ａ，２３ｂ 接続電極 ３１ａ，３１ｂ 信号電極 ３２ コネクタ ５０ 放熱器 Ｒ１〜Ｒｎ 発熱抵抗体 ＲＡ 抵抗 ＣＡ コンデンサＴ１〜Ｔｎ スイッチング素子 ＴＲ トランジスタ
Claims (1)
- 【請求項１】 複数の発熱抵抗体と、 各発熱抵抗体の一端と接続される複数のスイッチング素
子と、 各発熱抵抗体の他端を互いに接続する第１電極と、 各スイッチング素子の他端を互いに接続する第２電極
と、 第１電極と第２電極との間で接続されたコンデンサとを
備えたサーマルヘッドにおいて、 第１電極と第２電極との間に抵抗と選択スイッチング素
子が直列に接続されており、前記選択スイッチング素子
は、各発熱抵抗体の非動作時に導通状態となることを特
徴とするサーマルヘッド。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22441992A JPH0664214A (ja) | 1992-08-24 | 1992-08-24 | サーマルヘッド |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22441992A JPH0664214A (ja) | 1992-08-24 | 1992-08-24 | サーマルヘッド |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0664214A true JPH0664214A (ja) | 1994-03-08 |
Family
ID=16813487
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22441992A Pending JPH0664214A (ja) | 1992-08-24 | 1992-08-24 | サーマルヘッド |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0664214A (ja) |
-
1992
- 1992-08-24 JP JP22441992A patent/JPH0664214A/ja active Pending
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