JPH06303132A - サンプリング同期監視回路 - Google Patents

サンプリング同期監視回路

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Publication number
JPH06303132A
JPH06303132A JP5089598A JP8959893A JPH06303132A JP H06303132 A JPH06303132 A JP H06303132A JP 5089598 A JP5089598 A JP 5089598A JP 8959893 A JP8959893 A JP 8959893A JP H06303132 A JPH06303132 A JP H06303132A
Authority
JP
Japan
Prior art keywords
synchronization
signal
circuit
width
sampling
Prior art date
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Pending
Application number
JP5089598A
Other languages
English (en)
Inventor
Masaki Fukumura
政規 福村
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Meidensha Corp
Meidensha Electric Manufacturing Co Ltd
Original Assignee
Meidensha Corp
Meidensha Electric Manufacturing Co Ltd
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Filing date
Publication date
Application filed by Meidensha Corp, Meidensha Electric Manufacturing Co Ltd filed Critical Meidensha Corp
Priority to JP5089598A priority Critical patent/JPH06303132A/ja
Publication of JPH06303132A publication Critical patent/JPH06303132A/ja
Pending legal-status Critical Current

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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

(57)【要約】 【目的】 構成簡単で同期判定仕様の変更が容易なサン
プリング同期監視回路を得る。 【構成】 同期幅作成回路1は自局サンプリング信号の
立上がりの前後所定幅の自局同期判定幅信号を作成し、
同期判定回路2は自局同期判定幅信号の幅内で外部サン
プリング信号が立上がるか否かによって瞬時同期か否か
を判定する。この判定信号は同期判定ホールド回路3及
びインタフェース回路7を介してマイクロコンピュータ
へ入力され、マイクロコンピュータ内においては瞬時同
期又は瞬時非同期が所定期間継続したことにより同期中
又は非同期中を判定する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は、継電器における複数
ユニットのアナログデータの取込みにおいて、それぞれ
の同時性が必要な場合に用いられるサンプリング信号の
同期信号の監視回路に関するものである。
【0002】
【従来の技術】図3は従来のサンプリング同期監視回路
の構成を示し、1は同期幅作成回路、2は同期判定回
路、3は同期判定ホールド回路、4は同期確認カウン
タ、5は非同期確認カウンタ、6は同期中外部出力回路
である。
【0003】次に、図4のタイムチャートを用いて上記
回路の動作を説明する。同期幅作成回路1は図4(b)
に示す自局サンプリング信号bを入力され、その立上が
り前後所定幅である図4(c)に示す自局同期判定信号
cを出力する。同期判定回路2は図4(a)に示す外部
サンプリング信号aと自局同期判定幅信号cを入力さ
れ、図4(d)に示す同期判定瞬時信号dを出力する。
即ち、同期判定回路2は自局サンプリング信号bの立上
がりの前後所定幅(信号cの幅)以内に外部サンプリン
グ信号aの立上がりがあるか否かにより同期中か否かを
判定し、同期判定瞬時信号dを出力する。
【0004】同期判定ホールド回路3は信号dの立上が
りで図4(e)に示す同期判定ホールド信号eを発生
し、信号eを所定期間ホールドする。又、同期判定ホー
ルド回路3からはリセット信号が同期判定回路2に入力
され、その一周期毎にリセットが行われる。同期確認カ
ウンタ4及び非同期確認カウンタ5は同期判定ホールド
回路3の出力を入力され、同期判定瞬時信号dの出力期
間及び非出力期間をそれぞれカウントし、所定期間に達
したら図4(f),(g)に示す同期中信号f及び非同
期中信号gを出力する。これは、一定期間の間は同期外
れが生じても再び同期状態に復帰することがあるからで
ある。同期中外部出力回路6は同期中信号f及び非同期
中信号gを入力され、図4(h)に示すように同期中信
号fを入力された場合には同期中外部出力信号hを出力
し、それ以外の場合には信号hを出力しない。出力され
た同期中外部出力信号hはマイクロコンピュータに読み
込まれ、リレー演算結果の制御に使われる。
【0005】
【発明が解決しようとする課題】従来のサンプリング同
期監視回路は上記のように構成されており、同期確認カ
ウンタ4、非同期確認カウンタ及び同期中外部出力回路
6等のカウンタ類が多くなり、構成が複雑になった。
又、例えばカウンタ4,5が何回カウントすれば同期又
は非同期と判定するかなどの同期判定のための使用が変
更されると、ハードウェアの変更も必要となり、容易に
対応できなかった。
【0006】この発明は上記のような課題を解決するた
めに成されたものであり、構成簡単で同期判定仕様の変
更に容易に対応することができるサンプリング同期監視
回路を得ることを目的とする。
【0007】
【課題を解決するための手段】この発明に係るサンプリ
ング同期監視回路は、自局サンプリング信号に対応して
同期判定幅信号を作成する同期幅作成手段と、外部サン
プリング信号と同期判定幅信号とから瞬時同期か否かを
判定する瞬時同期判定手段と、瞬時同期判定手段の出力
を所定期間ホールドするホールド手段と、ホールド手段
の出力をインタフェース回路を介して入力され、瞬時同
期又は瞬時非同期が所定期間継続したことにより同期中
又は非同期中を判定する判定手段を設けたものである。
【0008】
【作用】この発明においては、自局サンプリング信号に
応じて同期判定幅信号が作成され、該信号と外部サンプ
リング信号とから瞬時同期か否かが判断される。この判
断は所定期間ホールドされ、インタフェース回路を介し
て判定手段に入力され、瞬時同期又は瞬時非同期が所定
期間継続したことにより同期中又は非同期中と判定され
る。
【0009】
【実施例】以下、この発明の実施例を図面とともに説明
する。図1はこの実施例によるサンプリング同期監視回
路の構成を示し、符号1〜3で示した部分は従来と同様
である。7は同期判定ホールド回路3から同期判定ホー
ルド信号eを入力されるマイクロコンピュータ(CP
U)のインタフェース回路である。
【0010】次に、上記回路の動作を図2のフローチャ
ートを用いて説明する。同期判定回路2は自局サンプリ
ング信号bの立上がりの前後所定幅以内に外部サンプリ
ング信号aの立上がりがあるか否かにより同期中か否か
を判定し、同期判定瞬時信号dを出力する。同期判定ホ
ールド回路2は信号dの立上がりで同期判定ホールド信
号eを発生し、信号dが発生しなくなると信号eも消滅
する。又、同期判定ホールド回路3は同期判定回路2へ
リセット信号iを入力して一周期毎にリセットするとと
もに、マイクロコンピュータへの割込み信号kを出力す
る。一方、インタフェース回路7は同期判定ホールド信
号eを入力され、マイクロコンピュータへデータ信号j
を出力する。
【0011】図2のフローチャートは割込み信号kを入
力されてスタートし、ステップS1では瞬時同期か否か
が判定される。瞬時同期即ち同期判定瞬時信号eが入力
されていればステップS2で同期中カウントを+1し、
ステップS3で非同期中カウントを0にする。ステップ
S4では同期中カウント数が同期確認カウント以上か否
かを判定し、同期確認カウント以上であればステップS
5で同期中と判定し、同期確認カウント以上でなければ
フローを終了し、再スタートする。
【0012】ステップS1で瞬時同期でないと判定され
た場合にはステップS6で非同期中カウントを+1し、
ステップS7で同期中カウントを0とし、ステップS8
では非同期中カウント数が非同期確認カウント以上か否
かを判定し、以上であればステップS9で非同期中と判
定し、以上でなければフローを終了して再スタートす
る。
【0013】
【発明の効果】以上のようにこの発明によれば、瞬時同
期判定手段の出力はホールドされてインタフェース回路
を介してマイクロコンピュータへ入力され、瞬時同期又
は瞬時非同期が所定期間継続したことにより同期中か非
同期中かがソフトウェアで判定される。従って、カウン
タ類が不要となって構成が簡単になるとともに、同期判
定のための仕様変更もソフトウェアで容易に行うことが
できる。
【図面の簡単な説明】
【図1】この発明によるサンプリング同期監視回路の構
成図である。
【図2】この発明によるサンプリング同期監視回路の動
作を示すフローチャートである。
【図3】従来のサンプリング同期監視回路の構成図であ
る。
【図4】従来のサンプリング同期監視回路の動作を示す
タイムチャートである。
【符号の説明】
1…同期幅作成回路 2…同期判定回路 3…同期判定ホールド回路 7…マイクロコンピュータのインタフェース回路

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 自局サンプリング信号に対応して同期判
    定幅信号を作成する同期幅作成手段と、外部サンプリン
    グ信号と同期判定幅信号とから瞬時同期か否かを判定す
    る瞬時同期判定手段と、瞬時同期判定手段の出力を所定
    期間ホールドするホールド手段と、ホールド手段の出力
    をインタフェース回路を介して入力され、瞬時同期又は
    瞬時非同期が所定期間継続したことにより同期中又は非
    同期中と判定する判定手段を備えたことを特徴とするサ
    ンプリング同期監視回路。
JP5089598A 1993-04-16 1993-04-16 サンプリング同期監視回路 Pending JPH06303132A (ja)

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JP5089598A JPH06303132A (ja) 1993-04-16 1993-04-16 サンプリング同期監視回路

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JPH06303132A true JPH06303132A (ja) 1994-10-28

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