JPH06236946A - ヒートスプレッダ及びリードとプラスチックパッケージとの間の強化接着を有する半導体デバイス - Google Patents
ヒートスプレッダ及びリードとプラスチックパッケージとの間の強化接着を有する半導体デバイスInfo
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Abstract
(57)【要約】
【目的】 ヒートスプレッダ及びリードにプラスチック
パッケージとの間をボイドが生じないように強化接着し
た半導体デバイスを提供する。 【構成】 半導体チップ18の発生熱を運び去るために
チップ18に隣接する金属ヒートスプレッダ16は、銅
心30及びこの銅心の少なくとも部分上に形成された密
に詰めた複数の酸化第二銅の針を含む酸化第二銅コーテ
ィング32を有する。プラスチックパッケージ12は、
チップ18及びヒートスプレッダ16上にモールディン
グされてこれらを支持する。コーティング32は、プラ
スチックパッケージ12へのヒートスプレッダ16の接
着を強化する。半導体チップ18に電気的に接続するリ
ード14も、プラスチックパッケージ12へのその接着
を強化するために、同様に、酸化第二銅コーティングを
有することがある。
パッケージとの間をボイドが生じないように強化接着し
た半導体デバイスを提供する。 【構成】 半導体チップ18の発生熱を運び去るために
チップ18に隣接する金属ヒートスプレッダ16は、銅
心30及びこの銅心の少なくとも部分上に形成された密
に詰めた複数の酸化第二銅の針を含む酸化第二銅コーテ
ィング32を有する。プラスチックパッケージ12は、
チップ18及びヒートスプレッダ16上にモールディン
グされてこれらを支持する。コーティング32は、プラ
スチックパッケージ12へのヒートスプレッダ16の接
着を強化する。半導体チップ18に電気的に接続するリ
ード14も、プラスチックパッケージ12へのその接着
を強化するために、同様に、酸化第二銅コーティングを
有することがある。
Description
【0001】
【産業上の利用分野】本発明は、一般に、半導体デバイ
ス、特に、ヒートスプレッダ、リードとプラスチックモ
ールドコンパウンドとの間に強化接着を有する半導体デ
バイスに関する。
ス、特に、ヒートスプレッダ、リードとプラスチックモ
ールドコンパウンドとの間に強化接着を有する半導体デ
バイスに関する。
【0002】
【従来の技術】大規模集積における発展は、絶えず幾何
的配置を縮小しかつ密度を増大しながら集積回路を生産
している。この密度の増大に、単位面積当たり半導体チ
ップによって発生される熱量の増大が関連している。こ
の熱を有効に消散する要求から、パッケージ半導体デバ
イス内へ金属ヒートスプレッダを組み込むようになっ
た。金属ヒートスプレッダは、典型的に、その半導体チ
ップ又はこの半導体チップが取り付けられるチップパッ
ドと接触して、このチップによって発生される熱をその
パッケージデバイスの外部に効率的に伝導する低熱イン
ピーダンスの通路として働く。
的配置を縮小しかつ密度を増大しながら集積回路を生産
している。この密度の増大に、単位面積当たり半導体チ
ップによって発生される熱量の増大が関連している。こ
の熱を有効に消散する要求から、パッケージ半導体デバ
イス内へ金属ヒートスプレッダを組み込むようになっ
た。金属ヒートスプレッダは、典型的に、その半導体チ
ップ又はこの半導体チップが取り付けられるチップパッ
ドと接触して、このチップによって発生される熱をその
パッケージデバイスの外部に効率的に伝導する低熱イン
ピーダンスの通路として働く。
【0003】インジェクションモールドプラスチックパ
ッケージを有する半導体デバイスにおいては、その金属
ヒートスプレッダは、全体的にカプセル封止されるか又
はそのヒートスプレッダの表面が露出されるように部分
的にのみカプセル封止されるかのいずれかである。その
プラスチックモールドコンパウンドにその金属ヒートス
プレッダを固定するのを助援するために機械的係合がモ
ールドプラスチックパッケージ内にしばしば使用され
る。
ッケージを有する半導体デバイスにおいては、その金属
ヒートスプレッダは、全体的にカプセル封止されるか又
はそのヒートスプレッダの表面が露出されるように部分
的にのみカプセル封止されるかのいずれかである。その
プラスチックモールドコンパウンドにその金属ヒートス
プレッダを固定するのを助援するために機械的係合がモ
ールドプラスチックパッケージ内にしばしば使用され
る。
【0004】
【発明が解決しようとする課題】モールドプラスチック
パッケージにおいては、ヒートスプレッダとそのカプセ
ル封止プラスチックとの間のボンディングが比較的弱い
ことが発見されている。強力なボンドを確保する能力の
欠如が、そのデバイスの熱サイクル中に、プリント配線
板へのそのデバイスのリフローはんだ付け中に、又はそ
のデバイスの正規動作中にさえも、その金属とプラスチ
ックとの間のボンディング線に沿って微小ボイド又はギ
ャップを生じることがある。このようなボイドの存在
は、湿気又はその他の汚染がそのパッケージ内に侵入し
かつその半導体チップの表面に達してこのデバイスを故
障させる可能性を実質的に増大することになる。
パッケージにおいては、ヒートスプレッダとそのカプセ
ル封止プラスチックとの間のボンディングが比較的弱い
ことが発見されている。強力なボンドを確保する能力の
欠如が、そのデバイスの熱サイクル中に、プリント配線
板へのそのデバイスのリフローはんだ付け中に、又はそ
のデバイスの正規動作中にさえも、その金属とプラスチ
ックとの間のボンディング線に沿って微小ボイド又はギ
ャップを生じることがある。このようなボイドの存在
は、湿気又はその他の汚染がそのパッケージ内に侵入し
かつその半導体チップの表面に達してこのデバイスを故
障させる可能性を実質的に増大することになる。
【0005】この問題は、充分な熱消散を施すためにそ
のヒートスプレッダの表面を露出しなければならない高
パワートランジスタにおいて特に深刻である。このよう
なデバイスにおいては、そのボンディング線の部分は、
環境に露出される。そのボンディング線の露出部分に沿
うどのボイドも、湿気又はその他の汚染がそのパッケー
ジに侵入する入口を容易に提供するであろう。
のヒートスプレッダの表面を露出しなければならない高
パワートランジスタにおいて特に深刻である。このよう
なデバイスにおいては、そのボンディング線の部分は、
環境に露出される。そのボンディング線の露出部分に沿
うどのボイドも、湿気又はその他の汚染がそのパッケー
ジに侵入する入口を容易に提供するであろう。
【0006】したがって、金属ヒートスプレッダとプラ
スチックカプセル封止との間に強化接着を有する半導体
パッケージに対する要求が存在する。
スチックカプセル封止との間に強化接着を有する半導体
パッケージに対する要求が存在する。
【0007】
【課題を解決するための手段】一般に、かつ本発明の1
形式において、半導体デバイスは、半導体チップ及びこ
の半導体チップから熱を運び去るためにこの半導体チッ
プに隣接するヒートスプレッダを含む。このヒートスプ
レッダは、銅心及びこの銅心の少なくとも部分上に形成
された酸化第二銅コーティイングを有する。プラスチッ
クパッケージは、この半導体チップ及びこのヒートスプ
レッダを支持するためにこの半導体チップ及びこのヒー
トスプレッダの上にモールディングされる。この酸化第
二銅コーティングは、このプラスチックパッケージへの
このヒートスプレッダの接着を強化する。
形式において、半導体デバイスは、半導体チップ及びこ
の半導体チップから熱を運び去るためにこの半導体チッ
プに隣接するヒートスプレッダを含む。このヒートスプ
レッダは、銅心及びこの銅心の少なくとも部分上に形成
された酸化第二銅コーティイングを有する。プラスチッ
クパッケージは、この半導体チップ及びこのヒートスプ
レッダを支持するためにこの半導体チップ及びこのヒー
トスプレッダの上にモールディングされる。この酸化第
二銅コーティングは、このプラスチックパッケージへの
このヒートスプレッダの接着を強化する。
【0008】本発明の他の形式におては、半導体デバイ
スは、半導体チップ及びこの半導体チップに電気的に接
続された少なくとも1本のリードを含む。この少なくと
も1本のリードは、銅心及びこの銅心の部分上に形成さ
れた酸化第二銅コーティングを有する。プラスチックパ
ッージは、この半導体チップを支持しこの少なくとも1
本のリードをこのプラスチックパッケージから延びるよ
うに及びこの少なくとも1本のリードを支持するため
に、この半導体チップ及びこの少なくとも1本のリード
上にモールディングされる。この酸化第二銅コーティン
グは、このプラスチックパッケージへのこの少なくとも
1本のリードの接着を強化する。
スは、半導体チップ及びこの半導体チップに電気的に接
続された少なくとも1本のリードを含む。この少なくと
も1本のリードは、銅心及びこの銅心の部分上に形成さ
れた酸化第二銅コーティングを有する。プラスチックパ
ッージは、この半導体チップを支持しこの少なくとも1
本のリードをこのプラスチックパッケージから延びるよ
うに及びこの少なくとも1本のリードを支持するため
に、この半導体チップ及びこの少なくとも1本のリード
上にモールディングされる。この酸化第二銅コーティン
グは、このプラスチックパッケージへのこの少なくとも
1本のリードの接着を強化する。
【0009】本発明の他の形式においては、半導体デバ
イスは、半導体チップ及びこの半導体チップから熱を運
び去るためにこの半導体チップに隣接するヒートスプレ
ッダを含む。複数の針が、このヒートスプレッダの表面
の少なくとも部分上に形成される。これらの複数の針の
各々は、この表面に付着した第1端及びこの表面から間
隔を取った第2端を有する。プラスチックパッケージ
は、この半導体チップ及びこのヒートスプレッダを支持
するために、この半導体チップ及びこのヒートスプレッ
ダ上にモールディングされる。これら複数の針は、この
プラスチックパッケージへのこのヒートスプレッダの接
着を強化する。
イスは、半導体チップ及びこの半導体チップから熱を運
び去るためにこの半導体チップに隣接するヒートスプレ
ッダを含む。複数の針が、このヒートスプレッダの表面
の少なくとも部分上に形成される。これらの複数の針の
各々は、この表面に付着した第1端及びこの表面から間
隔を取った第2端を有する。プラスチックパッケージ
は、この半導体チップ及びこのヒートスプレッダを支持
するために、この半導体チップ及びこのヒートスプレッ
ダ上にモールディングされる。これら複数の針は、この
プラスチックパッケージへのこのヒートスプレッダの接
着を強化する。
【0010】本発明の他の形式におては、半導体デバイ
スは、半導体チップ及びこの半導体チップに電気的に接
続された少なくとも1本のリードを含む。この少なくと
も1本のリードは、この少なくとも1本のリードの表面
の部分上に形成された複数の針を有する。これらの複数
の針の各々は、この少なくとも1本のリードの表面の部
分に付着した第1端及びこの少なくとも1本のリードの
表面のこの部分から間隔を取った第2端を有する。プラ
スチックパッージは、この半導体チップを支持し及びこ
の少なくとも1本のリードをこのプラスチックパッケー
ジから延びるようにこの少なくとも1本のリードを支持
するために、この半導体チップ及びこの少なくとも1本
のリード上にモールディングされる。これら複数の針
は、このプラスチックパッケージへのこの少なくとも1
本のリードの接着を強化する。
スは、半導体チップ及びこの半導体チップに電気的に接
続された少なくとも1本のリードを含む。この少なくと
も1本のリードは、この少なくとも1本のリードの表面
の部分上に形成された複数の針を有する。これらの複数
の針の各々は、この少なくとも1本のリードの表面の部
分に付着した第1端及びこの少なくとも1本のリードの
表面のこの部分から間隔を取った第2端を有する。プラ
スチックパッージは、この半導体チップを支持し及びこ
の少なくとも1本のリードをこのプラスチックパッケー
ジから延びるようにこの少なくとも1本のリードを支持
するために、この半導体チップ及びこの少なくとも1本
のリード上にモールディングされる。これら複数の針
は、このプラスチックパッケージへのこの少なくとも1
本のリードの接着を強化する。
【0011】本発明の利点は、その酸化第二銅コーティ
ング内のこれら複数の針が、そのプラスチックパッケー
ジのモールディング中にそのプラスチックモールドパッ
ケージ内に埋め込まれるようになり、これによってヒー
トスプレッダとこのプラスチックパッケージとの間の接
着を極めて強化すると云うことである。
ング内のこれら複数の針が、そのプラスチックパッケー
ジのモールディング中にそのプラスチックモールドパッ
ケージ内に埋め込まれるようになり、これによってヒー
トスプレッダとこのプラスチックパッケージとの間の接
着を極めて強化すると云うことである。
【0012】
【実施例】次に、本発明について図面を参照して説明す
る。図1は本発明の第1実施例によるパッケージ半導体
デバイスの上面図であり、図2は図1のデバイスの底面
図であり、図3aは図1の切断線3−3に沿い取られた
図1のデバイスの正断面図であり、図3bは本発明の第
1実施例によるヒートスプレッダの部分高倍率拡大図で
あり、図4は本発明の第2実施例によるパッケージ半導
体デバイスの部分正断面図であり、図5は本発明の第3
実施例によるパッケージ半導体デバイスの部分正断面図
であり、図6は本発明の第4実施例によるパッケージ半
導体デバイスの部分正断面図であり、図7は第1プラス
チックモールドコンパウンドを使用して遂行されたせん
断試験の結果を示すグラフ図であり、図7は第2プラス
チックモールドコンパウンドを使用して遂行されたせん
断試験の結果を示すグラフ図である。これらの異なる図
面において、相当する符号は、別の指示がない限り、相
当する部品を参照する。
る。図1は本発明の第1実施例によるパッケージ半導体
デバイスの上面図であり、図2は図1のデバイスの底面
図であり、図3aは図1の切断線3−3に沿い取られた
図1のデバイスの正断面図であり、図3bは本発明の第
1実施例によるヒートスプレッダの部分高倍率拡大図で
あり、図4は本発明の第2実施例によるパッケージ半導
体デバイスの部分正断面図であり、図5は本発明の第3
実施例によるパッケージ半導体デバイスの部分正断面図
であり、図6は本発明の第4実施例によるパッケージ半
導体デバイスの部分正断面図であり、図7は第1プラス
チックモールドコンパウンドを使用して遂行されたせん
断試験の結果を示すグラフ図であり、図7は第2プラス
チックモールドコンパウンドを使用して遂行されたせん
断試験の結果を示すグラフ図である。これらの異なる図
面において、相当する符号は、別の指示がない限り、相
当する部品を参照する。
【0013】これらの図面のうちの図1を参照すると、
本発明の第1実施例によるパッケージ半導体デバイスの
上面図が示されている。半導体デバイス10は、カッド
フラットパッケージデバイスであり、エポキシNovl
acのような、この産業に普通使用されるプラスチック
モールドコンパウンドから形成されたインジェクション
モールドフラットプラスチックパッケージ12を含む。
プラスチックパッケージ12は、デバイス10内に含ま
れる半導体チップ(図3aに示された要素18)に対す
る支持及び環境からの保護を提供する。この半導体チッ
プ内の回路構成に電気的に接続される金属リード14
は、プリント配線板等上の導体との接続のためにプラス
チックパッケージ12の縁から延びる。
本発明の第1実施例によるパッケージ半導体デバイスの
上面図が示されている。半導体デバイス10は、カッド
フラットパッケージデバイスであり、エポキシNovl
acのような、この産業に普通使用されるプラスチック
モールドコンパウンドから形成されたインジェクション
モールドフラットプラスチックパッケージ12を含む。
プラスチックパッケージ12は、デバイス10内に含ま
れる半導体チップ(図3aに示された要素18)に対す
る支持及び環境からの保護を提供する。この半導体チッ
プ内の回路構成に電気的に接続される金属リード14
は、プリント配線板等上の導体との接続のためにプラス
チックパッケージ12の縁から延びる。
【0014】デバイス10は、また、半導体チップによ
って発生された熱をデバイス10の外部へ伝導するため
にヒートスプレッダ16を含む。ヒートスプレッダ16
は、プラスチックパッケージ12によって支持されかつ
部分的にカプセル封止され、及びデバイス10の外部へ
の極めて有効な熱通路を提供するためにデバイス10の
上面上の周囲環境に露出される表面17を有する。デバ
イス10を覆って流れる空気は、ヒートスプレッダ16
の露出表面17へ運ばれる熱の消散を助援する。
って発生された熱をデバイス10の外部へ伝導するため
にヒートスプレッダ16を含む。ヒートスプレッダ16
は、プラスチックパッケージ12によって支持されかつ
部分的にカプセル封止され、及びデバイス10の外部へ
の極めて有効な熱通路を提供するためにデバイス10の
上面上の周囲環境に露出される表面17を有する。デバ
イス10を覆って流れる空気は、ヒートスプレッダ16
の露出表面17へ運ばれる熱の消散を助援する。
【0015】プラスチックパッケージ12は、図2にお
いてデバイス10の底面図に見られるように、半導体デ
バイス10の全底面にわたり広がりかつこれを封止す
る。
いてデバイス10の底面図に見られるように、半導体デ
バイス10の全底面にわたり広がりかつこれを封止す
る。
【0016】図3を参照すると、デバイス10は、表面
22上に形成されたボンディングパッド20を有する半
導体チップ18を含む。チップ18の反対面24は、例
えば、エポキシのような、接着剤で以てヒートスプレッ
ダ16の表面26にボンディングされる。リード14
は、プラスチックパッケージ12によって部分的にカプ
ゼル封止され、両面ポリイミド接着剤テープような、接
着剤15で以てヒートスプレッダ16の表面26にボン
ディングされる。ワイヤ28は、リード14をチップ1
8内の回路構成に電気的に接続するためにリード14に
ボンディングされた一端及びボンディングパッド20に
ボンディングされた他端を有する。ワイヤ28は、プラ
スチックパッケージ12によってデバイス10内に完全
にカプセル封止される。
22上に形成されたボンディングパッド20を有する半
導体チップ18を含む。チップ18の反対面24は、例
えば、エポキシのような、接着剤で以てヒートスプレッ
ダ16の表面26にボンディングされる。リード14
は、プラスチックパッケージ12によって部分的にカプ
ゼル封止され、両面ポリイミド接着剤テープような、接
着剤15で以てヒートスプレッダ16の表面26にボン
ディングされる。ワイヤ28は、リード14をチップ1
8内の回路構成に電気的に接続するためにリード14に
ボンディングされた一端及びボンディングパッド20に
ボンディングされた他端を有する。ワイヤ28は、プラ
スチックパッケージ12によってデバイス10内に完全
にカプセル封止される。
【0017】ヒートスプレッダ16は銅心30を含み、
この銅心はその表面上に薄い酸化第二銅コーティング3
2を有する。酸化第二銅コーティング32は化学式Cu
Oを有する個別の第二酸化銅の針31で作られ、図3b
に示されるように、これらの針は、一端で銅心30に付
着付しかつこれらの針の他端が銅心30の表面から間隔
を取るように銅心30から延びる。これら針は、黒色で
あってかつ(1cm2当たり約1,000本の針の程度
で)密に詰められ、ヒートスプレッダ16に全体的に黒
い外観を与える。酸化第二銅コーティング32は、好適
には、0.6〜4μmの厚さを有する。ヒートスプレッ
ダ16上へのそのプラスチックモールドコンパウンドの
モールディング中、これらの酸化第二銅の針は、このプ
ラスチックモールドコンパウンド内に埋め込みされるよ
うになり、ヒートスプレッダ16をプラスチックパッケ
ージ12に強力にボンディングする。酸化第二銅コーテ
ィング32は、これによって、ヒートスプレッダ16と
プラスチックパッケージ12との間の接着を極めて強化
する。酸化第二銅コーティング32の使用によって提供
されるこの強化接着は、ヒートスプレッダ16とプラス
チックパッケージ12との間のボイドの形成を防止する
ことを助援することによってデバイス故障率を減少す
る。酸化第二銅コーティングは絶縁性であるから、リー
ド14を短絡のおそれを伴わずにずヒートスプレッダ1
6にボンディングすることができる。
この銅心はその表面上に薄い酸化第二銅コーティング3
2を有する。酸化第二銅コーティング32は化学式Cu
Oを有する個別の第二酸化銅の針31で作られ、図3b
に示されるように、これらの針は、一端で銅心30に付
着付しかつこれらの針の他端が銅心30の表面から間隔
を取るように銅心30から延びる。これら針は、黒色で
あってかつ(1cm2当たり約1,000本の針の程度
で)密に詰められ、ヒートスプレッダ16に全体的に黒
い外観を与える。酸化第二銅コーティング32は、好適
には、0.6〜4μmの厚さを有する。ヒートスプレッ
ダ16上へのそのプラスチックモールドコンパウンドの
モールディング中、これらの酸化第二銅の針は、このプ
ラスチックモールドコンパウンド内に埋め込みされるよ
うになり、ヒートスプレッダ16をプラスチックパッケ
ージ12に強力にボンディングする。酸化第二銅コーテ
ィング32は、これによって、ヒートスプレッダ16と
プラスチックパッケージ12との間の接着を極めて強化
する。酸化第二銅コーティング32の使用によって提供
されるこの強化接着は、ヒートスプレッダ16とプラス
チックパッケージ12との間のボイドの形成を防止する
ことを助援することによってデバイス故障率を減少す
る。酸化第二銅コーティングは絶縁性であるから、リー
ド14を短絡のおそれを伴わずにずヒートスプレッダ1
6にボンディングすることができる。
【0018】酸化第二銅コーティング32は、好適に
は、銅上に酸化第二銅コーティングを形成するための、
ASTM(アメリカ材料試験協会規格)表示番号D 2
651−79(確認 1984)、ページ170に記載
されている方法によって形成される。この方法によれ
ば、銅ヒートスプレッダがグリース除去され、次いで、
室温で30秒間、水90に対して硝酸10の割合の溶液
に漬けられる。このヒートスプレッダは、次いで、流水
中ですすがれ、かつ直ちに98℃で1〜2分間、水とE
bonol Cの溶液(溶液1リットル当たり149g
のEbonol Cを含む)に漬けられる。Ebono
l Cは、米国、コネクトチカット、ニューヘブン(N
ew Haven)、エトーネ社(Ethone,In
c.)から入手可能である。このヒートスプレッダは、
次いで、この溶液から取り出され、水ですすがれる。こ
の結果、その表面上に所望の酸化第二銅コーティング備
える銅心30を有するヒートスプレッダが得られる。
は、銅上に酸化第二銅コーティングを形成するための、
ASTM(アメリカ材料試験協会規格)表示番号D 2
651−79(確認 1984)、ページ170に記載
されている方法によって形成される。この方法によれ
ば、銅ヒートスプレッダがグリース除去され、次いで、
室温で30秒間、水90に対して硝酸10の割合の溶液
に漬けられる。このヒートスプレッダは、次いで、流水
中ですすがれ、かつ直ちに98℃で1〜2分間、水とE
bonol Cの溶液(溶液1リットル当たり149g
のEbonol Cを含む)に漬けられる。Ebono
l Cは、米国、コネクトチカット、ニューヘブン(N
ew Haven)、エトーネ社(Ethone,In
c.)から入手可能である。このヒートスプレッダは、
次いで、この溶液から取り出され、水ですすがれる。こ
の結果、その表面上に所望の酸化第二銅コーティング備
える銅心30を有するヒートスプレッダが得られる。
【0019】酸化第二銅コーティング32は、最強接着
のためにそのプラスチックモールドコンパウンドに接触
するそのヒートスプレッダの全表面を覆って形成される
のが好適であるが、この酸化第二銅コーティングはその
プラスチックモールドコンパウンドに接触するそのヒー
トスプレッダの表面の部分のみの上に形成されることが
ある。そのヒートスプレッダの表面の部分のみの上の酸
化第二銅コーティングは、この酸化物を形成する前のプ
ロセスステップに従来のマスキング技術を使用して達成
されるか又は従来の研磨技術を使用してこの酸化物を選
択除去することによって達成される。銅上に酸化第二銅
コーティングを形成する上述の技術は好適的であるが、
既知の他の方法も使用することができる。
のためにそのプラスチックモールドコンパウンドに接触
するそのヒートスプレッダの全表面を覆って形成される
のが好適であるが、この酸化第二銅コーティングはその
プラスチックモールドコンパウンドに接触するそのヒー
トスプレッダの表面の部分のみの上に形成されることが
ある。そのヒートスプレッダの表面の部分のみの上の酸
化第二銅コーティングは、この酸化物を形成する前のプ
ロセスステップに従来のマスキング技術を使用して達成
されるか又は従来の研磨技術を使用してこの酸化物を選
択除去することによって達成される。銅上に酸化第二銅
コーティングを形成する上述の技術は好適的であるが、
既知の他の方法も使用することができる。
【0020】図7は、Plaskon 760なるエポ
キシプラスチックモールドコンパウンドからヒートスプ
レッダを分離するに要する力を測定したせん断強さ試験
の結果を示すグラフである。温度サイクル又は高温への
露出の前(0時間)、酸化第二銅コーティングを備えな
い標準パラジウムめっきヒートスプレッダは、約2.3
kgfのせん断強さを有したが、他方、本発明による酸
化第二銅コーティングを備える残りのヒートスプレッダ
は、それぞれ、約25.0及び47.7kgfのせん断
強さを有した。少なくとも1桁の大きさのせん断強さの
増大が、本発明を使用することによって得られる。温度
サイクル及び高温貯蔵後に実施された本発明により形成
されたヒートスプレッダのせん断強さ試験は、典型的
に、極めて苛酷な動作条件の下においても増強した接着
が維持されることを示す。
キシプラスチックモールドコンパウンドからヒートスプ
レッダを分離するに要する力を測定したせん断強さ試験
の結果を示すグラフである。温度サイクル又は高温への
露出の前(0時間)、酸化第二銅コーティングを備えな
い標準パラジウムめっきヒートスプレッダは、約2.3
kgfのせん断強さを有したが、他方、本発明による酸
化第二銅コーティングを備える残りのヒートスプレッダ
は、それぞれ、約25.0及び47.7kgfのせん断
強さを有した。少なくとも1桁の大きさのせん断強さの
増大が、本発明を使用することによって得られる。温度
サイクル及び高温貯蔵後に実施された本発明により形成
されたヒートスプレッダのせん断強さ試験は、典型的
に、極めて苛酷な動作条件の下においても増強した接着
が維持されることを示す。
【0021】図8は、Shinetsu KMC 16
5−4なるエポキシプラスチックモールドコンパウンド
からヒートスプレッダを分離するに要する力を測定した
せん断強さ試験の結果を示すグラフである。温度サイク
ル又は高温への露出の前(0時間)、酸化第二銅コーテ
ィングを備えない標準パラジウムめっきヒートスプレッ
ダは、約2.3kgfのせん断強さを有したが、他方、
本発明による酸化第二銅コーティングを備える残りのヒ
ートスプレッダは、それぞれ、約43.1及び72.6
kgfのせん断強さを有した。この場合も、少なくとも
1桁の大きさのせん断強さの増大が、本発明を使用する
ことによって得られる。温度サイクル及び高温貯蔵後に
実施された本発明により形成されたヒートスプレッダの
せん断強さ試験は、典型的に、極めて苛酷な動作条件の
下においても増強した接着が維持されることを示す。
5−4なるエポキシプラスチックモールドコンパウンド
からヒートスプレッダを分離するに要する力を測定した
せん断強さ試験の結果を示すグラフである。温度サイク
ル又は高温への露出の前(0時間)、酸化第二銅コーテ
ィングを備えない標準パラジウムめっきヒートスプレッ
ダは、約2.3kgfのせん断強さを有したが、他方、
本発明による酸化第二銅コーティングを備える残りのヒ
ートスプレッダは、それぞれ、約43.1及び72.6
kgfのせん断強さを有した。この場合も、少なくとも
1桁の大きさのせん断強さの増大が、本発明を使用する
ことによって得られる。温度サイクル及び高温貯蔵後に
実施された本発明により形成されたヒートスプレッダの
せん断強さ試験は、典型的に、極めて苛酷な動作条件の
下においても増強した接着が維持されることを示す。
【0022】図4は、本発明の第2実施例による半導体
デバイス34の断面を示す。半導体デバイス34は、リ
ード14の代わりにリード36が使用されることを除
き、図1〜図3aのデバイス10と同等である。リード
36は銅心37を有し、銅心37はこの銅心の部分を覆
い形成された酸化第二銅コーティング38を備える。コ
ーティング38は絶縁性であり、したがって、ワイヤ2
8及びプリント配線板上の導体に、それぞれ、ボンディ
ングされる銅心37の端部32及び44から間隔を取ら
なければならない。
デバイス34の断面を示す。半導体デバイス34は、リ
ード14の代わりにリード36が使用されることを除
き、図1〜図3aのデバイス10と同等である。リード
36は銅心37を有し、銅心37はこの銅心の部分を覆
い形成された酸化第二銅コーティング38を備える。コ
ーティング38は絶縁性であり、したがって、ワイヤ2
8及びプリント配線板上の導体に、それぞれ、ボンディ
ングされる銅心37の端部32及び44から間隔を取ら
なければならない。
【0023】酸化第二銅コーティング38は、銅リード
フレームの全表面を覆う酸化第二銅コーティングをまず
形成するために上に説明された方法を使用することによ
って形成される。この酸化物は、次いで、機械的研磨又
は化学エッチングによって銅心37の端部42及び44
から除去される。代替的に、コーティング38が端部4
2及び44上に形成されないことを保証するためにコー
ティング38の形成の前に従来のマスキング技術を使用
して銅心37の端部42及び44をマスクしてもよい。
リード34を備える酸化第二銅コーティング38の使用
は、プラスチックパッケージ12へのこれらのリードの
接着を強化する。酸化第二銅コーティング38の使用に
よって提供されるこの強化接着は、リード34とプラス
チックパッケージ12との間のボイドの形成を防止する
ことを助援することによってデバイス故障率を減少す
る。
フレームの全表面を覆う酸化第二銅コーティングをまず
形成するために上に説明された方法を使用することによ
って形成される。この酸化物は、次いで、機械的研磨又
は化学エッチングによって銅心37の端部42及び44
から除去される。代替的に、コーティング38が端部4
2及び44上に形成されないことを保証するためにコー
ティング38の形成の前に従来のマスキング技術を使用
して銅心37の端部42及び44をマスクしてもよい。
リード34を備える酸化第二銅コーティング38の使用
は、プラスチックパッケージ12へのこれらのリードの
接着を強化する。酸化第二銅コーティング38の使用に
よって提供されるこの強化接着は、リード34とプラス
チックパッケージ12との間のボイドの形成を防止する
ことを助援することによってデバイス故障率を減少す
る。
【0024】図5は、本発明の第3実施例による半導体
デバイス46の断面を示す。半導体デバイス46は、プ
ラスチックパッケージ12がヒートスプレッダ16を完
全にカプセル封止することを除き、図1〜図3aのデバ
イス10と同等である。図4のリード36を、もし所望
されるならば、リード14の代わりにデバイス46内に
使用してもよい。
デバイス46の断面を示す。半導体デバイス46は、プ
ラスチックパッケージ12がヒートスプレッダ16を完
全にカプセル封止することを除き、図1〜図3aのデバ
イス10と同等である。図4のリード36を、もし所望
されるならば、リード14の代わりにデバイス46内に
使用してもよい。
【0025】図6は、本発明の第4実施例による半導体
デバイス48の断面を示す。デバイス48は、図1〜図
3aのデバイス10に類似している。しかしながら、半
導体チップ18をヒートスプレッダ16に直接取り付け
る代わりに、チップ18は、エポキシのような、接着剤
を使用してチップパッド50上に取り付けられる。リー
ド14は、ヒートスプレッダ16にボンディングされる
代わりに、プラスチックパッケージ12によって完全に
支持される。チップパッド50は、エポキシのような、
接着剤で以てヒートスプレッダ16にボンディングされ
てもよい。代替的に、チップパッド50は、ヒートスプ
レッダ16に隣接して位置決めされ、かつ接着剤を使用
しないでプラスチックパッケージ12によって位置決め
位置に保持されてもよい。図4のリード36を、もし所
望されるならば、リード14の代わりにデバイス48内
に使用してもよい。プラスチックパッケージ12は、ま
た、ヒートスプレッダ16を完全にカプセル封止しても
よい。
デバイス48の断面を示す。デバイス48は、図1〜図
3aのデバイス10に類似している。しかしながら、半
導体チップ18をヒートスプレッダ16に直接取り付け
る代わりに、チップ18は、エポキシのような、接着剤
を使用してチップパッド50上に取り付けられる。リー
ド14は、ヒートスプレッダ16にボンディングされる
代わりに、プラスチックパッケージ12によって完全に
支持される。チップパッド50は、エポキシのような、
接着剤で以てヒートスプレッダ16にボンディングされ
てもよい。代替的に、チップパッド50は、ヒートスプ
レッダ16に隣接して位置決めされ、かつ接着剤を使用
しないでプラスチックパッケージ12によって位置決め
位置に保持されてもよい。図4のリード36を、もし所
望されるならば、リード14の代わりにデバイス48内
に使用してもよい。プラスチックパッケージ12は、ま
た、ヒートスプレッダ16を完全にカプセル封止しても
よい。
【0026】本発明の少数の好適実施例が、これまでに
詳細に説明された。云うまでもなく、本発明の範囲は、
説明されたこれらの実施例と異なるがしかしなおその特
許請求の範囲内にある実施例も包含する。
詳細に説明された。云うまでもなく、本発明の範囲は、
説明されたこれらの実施例と異なるがしかしなおその特
許請求の範囲内にある実施例も包含する。
【0027】例えば、カッドフラットパッケージ以外の
パッケージが使用されることがり、半導体チップ上のボ
ンディングパッドに直接ボンディングされるリードがボ
ンディングパッドにワイヤボンディングされるリードの
代わりに使用されることがあり、酸化第二銅以外の材料
で形成された針のコーティングが使用されることがあ
り、及び、もし所望されるならば、デバイス内でそのヒ
ートスプレッダがその半導体チップの下側に位置決めさ
れるようにそのデバイスを反転させることがある。
パッケージが使用されることがり、半導体チップ上のボ
ンディングパッドに直接ボンディングされるリードがボ
ンディングパッドにワイヤボンディングされるリードの
代わりに使用されることがあり、酸化第二銅以外の材料
で形成された針のコーティングが使用されることがあ
り、及び、もし所望されるならば、デバイス内でそのヒ
ートスプレッダがその半導体チップの下側に位置決めさ
れるようにそのデバイスを反転させることがある。
【0028】本発明が図示の実施例を参照して説明され
たが、この説明を限定的な意味に解釈される意図はな
い。図示の実施例の種々の変更及び組合わせばかりでな
なく、本発明の他の実施例は、この説明を参照するなら
ば、その技術の習熟者にとって明白であろう。したがっ
て、添付の特許請求の範囲は、あらゆるこのような変更
又は実施例を包含することを意図する。
たが、この説明を限定的な意味に解釈される意図はな
い。図示の実施例の種々の変更及び組合わせばかりでな
なく、本発明の他の実施例は、この説明を参照するなら
ば、その技術の習熟者にとって明白であろう。したがっ
て、添付の特許請求の範囲は、あらゆるこのような変更
又は実施例を包含することを意図する。
【0029】以上の説明に関し更に次の項を開示する。
【0030】(1) 半導体チップと、銅心と該銅心の
少なくとも部分上に形成された酸化第二銅コーティング
とを有し、前記半導体チップから熱を運び去るために前
記半導体チップに隣接するヒートスプレッダと、前記半
導体チップと前記ヒートスプレッダとを支持するために
前記半導体チップと前記ヒートスプレッダとの上にモー
ルディングされたプラスチックパッケージであって、前
記酸化第二銅コーティングが前記プラスチックパッケー
ジへの前記ヒートスプレッダの接着を強化する、前記プ
ラスチックパッケージとを含む半導体デバイス。
少なくとも部分上に形成された酸化第二銅コーティング
とを有し、前記半導体チップから熱を運び去るために前
記半導体チップに隣接するヒートスプレッダと、前記半
導体チップと前記ヒートスプレッダとを支持するために
前記半導体チップと前記ヒートスプレッダとの上にモー
ルディングされたプラスチックパッケージであって、前
記酸化第二銅コーティングが前記プラスチックパッケー
ジへの前記ヒートスプレッダの接着を強化する、前記プ
ラスチックパッケージとを含む半導体デバイス。
【0031】(2) 第1項記載の半導体デバイスにお
いて、前記ヒートスプレッダは前記半導体チップに付着
する、半導体デバイス。
いて、前記ヒートスプレッダは前記半導体チップに付着
する、半導体デバイス。
【0032】(3) 第1項記載の半導体デバイスであ
って、チップパッドを更に含み、前記半導体チップは前
記チップパッドに付着する、半導体デバイス。
って、チップパッドを更に含み、前記半導体チップは前
記チップパッドに付着する、半導体デバイス。
【0033】(4) 第3項記載の半導体デバイスにお
いて、前記ヒートスプレッダは前記記チップパッドにボ
ンディングされる、半導体デバイス。
いて、前記ヒートスプレッダは前記記チップパッドにボ
ンディングされる、半導体デバイス。
【0034】(5) 第1項記載の半導体デバイスにお
いて、前記ヒートスプレッダの表面が露出されるように
前記プラスチックパッケージは前記ヒートスプレッダ上
にモールディングされる、半導体デバイス。
いて、前記ヒートスプレッダの表面が露出されるように
前記プラスチックパッケージは前記ヒートスプレッダ上
にモールディングされる、半導体デバイス。
【0035】(6) 第1項記載の半導体デバイスにお
いて、前記プラスチックパッケージは前記ヒートスプレ
ッダを完全にカプセル封止する、半導体デバイス。
いて、前記プラスチックパッケージは前記ヒートスプレ
ッダを完全にカプセル封止する、半導体デバイス。
【0036】(7) 第1項記載の半導体デバイスにお
いて、前記酸化第二銅コーティングは前記銅心を完全に
覆って形成される、半導体デバイス。
いて、前記酸化第二銅コーティングは前記銅心を完全に
覆って形成される、半導体デバイス。
【0037】(8) 第1項記載の半導体デバイスであ
って、前記半導体チップに電気的に接続された少なくと
も1本のリードを更に含み、前記プラスチックパッージ
は前記少なくとも1本のリードの部分をカプセル封止す
る、半導体デバイス。
って、前記半導体チップに電気的に接続された少なくと
も1本のリードを更に含み、前記プラスチックパッージ
は前記少なくとも1本のリードの部分をカプセル封止す
る、半導体デバイス。
【0038】(9) 第8項記載の半導体デバイスにお
いて、前記少なくとも1本のリードは前記銅心の部分を
覆って形成された酸化第二銅コーティングを備える銅心
を有し、前記酸化第二銅コーティングは前記プラスチッ
クパッケージへの前記少なくとも1本のリードの接着を
強化する、半導体デバイス。
いて、前記少なくとも1本のリードは前記銅心の部分を
覆って形成された酸化第二銅コーティングを備える銅心
を有し、前記酸化第二銅コーティングは前記プラスチッ
クパッケージへの前記少なくとも1本のリードの接着を
強化する、半導体デバイス。
【0039】(10) 第8項記載の半導体デバイスで
あって、前記半導体チップに前記少なくとも1本のリー
ドを電気的に接続するために前記プラスチックパッケー
ジ内にカプセル封止されたワイヤを更に含む半導体デバ
イス。
あって、前記半導体チップに前記少なくとも1本のリー
ドを電気的に接続するために前記プラスチックパッケー
ジ内にカプセル封止されたワイヤを更に含む半導体デバ
イス。
【0040】(11) 第8項記載の半導体デバイスに
おいて、前記少なくとも1本のリードは前記半導体チッ
プに電気的に接続された複数のリードを含み、前記プラ
スチックパッケージは前記複数のリードの各々の部分を
カプセル封止する、半導体デバイス。
おいて、前記少なくとも1本のリードは前記半導体チッ
プに電気的に接続された複数のリードを含み、前記プラ
スチックパッケージは前記複数のリードの各々の部分を
カプセル封止する、半導体デバイス。
【0041】(12) 第1項記載の半導体デバイスに
おいて、前記酸化第二銅コーティングは前記銅心に付着
した第1端と前記銅心から間隔を取った第2端とを有す
る複数の密に詰められた酸化第二銅の針を含む、半導体
デバイス。
おいて、前記酸化第二銅コーティングは前記銅心に付着
した第1端と前記銅心から間隔を取った第2端とを有す
る複数の密に詰められた酸化第二銅の針を含む、半導体
デバイス。
【0042】(13) 半導体チップと、銅心と該銅心
の部分上に形成された酸化第二銅コーティングとを有
し、前記半導体チップに電気的に接続された少なくとも
1本のリードと、前記半導体チップと前記少なくとも1
本のリードとを支持するために前記半導体チップと前記
少なくとも1本のリードとの上にモールディングされた
プラスチックパッケージであって、前記酸化第二銅コー
ティングが前記プラスチックパッケージへの前記少なく
とも1本のリードの接着を強化する、前記プラスチック
パッケージとを含む半導体デバイス。
の部分上に形成された酸化第二銅コーティングとを有
し、前記半導体チップに電気的に接続された少なくとも
1本のリードと、前記半導体チップと前記少なくとも1
本のリードとを支持するために前記半導体チップと前記
少なくとも1本のリードとの上にモールディングされた
プラスチックパッケージであって、前記酸化第二銅コー
ティングが前記プラスチックパッケージへの前記少なく
とも1本のリードの接着を強化する、前記プラスチック
パッケージとを含む半導体デバイス。
【0043】(14) 第13項記載の半導体デバイス
であって、チップパッドを更に含み、前記半導体チップ
は前記チップパッドに付着する、半導体デバイス。
であって、チップパッドを更に含み、前記半導体チップ
は前記チップパッドに付着する、半導体デバイス。
【0044】(15) 第14項記載の半導体デバイス
において、前記ヒートスプレッダは前記記チップパッド
にボンディングされる、半導体デバイス。
において、前記ヒートスプレッダは前記記チップパッド
にボンディングされる、半導体デバイス。
【0045】(16) 第13項記載の半導体デバイス
であって、前記半導体チップに前記少なくとも1本のリ
ードを電気的に接続するために前記プラスチックパッケ
ージ内にカプセル封止された導電ワイヤを更に含む半導
体デバイス。
であって、前記半導体チップに前記少なくとも1本のリ
ードを電気的に接続するために前記プラスチックパッケ
ージ内にカプセル封止された導電ワイヤを更に含む半導
体デバイス。
【0046】(17) 第13項記載の半導体デバイス
において、前記少なくとも1本のリードは前記半導体チ
ップに電気的に接続された複数のリードを含み、前記複
数のリードの各々は前記プラスチックパッケージから延
びる、半導体デバイス。
において、前記少なくとも1本のリードは前記半導体チ
ップに電気的に接続された複数のリードを含み、前記複
数のリードの各々は前記プラスチックパッケージから延
びる、半導体デバイス。
【0047】(18) 第13項記載の半導体デバイス
において、前記酸化第二銅コーティングは前記銅心に付
着した第1端と前記銅心から間隔を取った第2端とを有
する複数の密に詰められた酸化第二銅の針を含む、半導
体デバイス。
において、前記酸化第二銅コーティングは前記銅心に付
着した第1端と前記銅心から間隔を取った第2端とを有
する複数の密に詰められた酸化第二銅の針を含む、半導
体デバイス。
【0048】(19) 半導体チップと、前記半導体チ
ップから熱を運び去るために前記半導体チップに隣接す
るヒートスプレッダであって、第1複数の針が前記ヒー
トスプレッダの表面の少なくとも部分上に形成され、前
記第1複数の針の各々が前記表面に付着した第1端と前
記表面から間隔を取った第2端を有する、前記ヒートス
プレッダと、前記半導体チップと前記ヒートスプレッダ
とを支持するために前記半導体チップと前記ヒートスプ
レッダとの上にモールディングされたプラスチックパッ
ケージであって、前記第1複数の針が前記プラスチック
パッケージへの前記ヒートスプレッダの接着を強化す
る、前記プラスチックパッケージとを含む半導体デバイ
ス。
ップから熱を運び去るために前記半導体チップに隣接す
るヒートスプレッダであって、第1複数の針が前記ヒー
トスプレッダの表面の少なくとも部分上に形成され、前
記第1複数の針の各々が前記表面に付着した第1端と前
記表面から間隔を取った第2端を有する、前記ヒートス
プレッダと、前記半導体チップと前記ヒートスプレッダ
とを支持するために前記半導体チップと前記ヒートスプ
レッダとの上にモールディングされたプラスチックパッ
ケージであって、前記第1複数の針が前記プラスチック
パッケージへの前記ヒートスプレッダの接着を強化す
る、前記プラスチックパッケージとを含む半導体デバイ
ス。
【0049】(20) 第19項記載の半導体デバイス
において、前記ヒートスプレッダは金属である、半導体
デバイス。
において、前記ヒートスプレッダは金属である、半導体
デバイス。
【0050】(21) 第19項記載の半導体デバイス
において、前記第1複数の針は金属酸化物で形成され
る、半導体デバイス。
において、前記第1複数の針は金属酸化物で形成され
る、半導体デバイス。
【0051】(22) 第19項記載の半導体デバイス
において、前記ヒートスプレッダは銅で形成され、前記
第1複数の針は酸化第二銅で形成される、半導体デバイ
ス。
において、前記ヒートスプレッダは銅で形成され、前記
第1複数の針は酸化第二銅で形成される、半導体デバイ
ス。
【0052】(23) 第19項記載の半導体デバイス
であって、前記半導体チップに電気的に接続されかつ前
記プラスチックパッケージから延びる少なくとも1本の
リードを更に含み、第2複数の針前が記少なくとも1本
のリードの表面の部分上に形成され、前記第2複数の針
の各々は前記少なくとも1本のリードの表面の部分に付
着した第1端と前記少なくとも1本のリードの表面の前
記部分から間隔を取った第2端を有し、前記第2複数の
針は前記プラスチックパッケージへの前記少なくとも1
本のリードの接着を強化する、半導体デバイス。
であって、前記半導体チップに電気的に接続されかつ前
記プラスチックパッケージから延びる少なくとも1本の
リードを更に含み、第2複数の針前が記少なくとも1本
のリードの表面の部分上に形成され、前記第2複数の針
の各々は前記少なくとも1本のリードの表面の部分に付
着した第1端と前記少なくとも1本のリードの表面の前
記部分から間隔を取った第2端を有し、前記第2複数の
針は前記プラスチックパッケージへの前記少なくとも1
本のリードの接着を強化する、半導体デバイス。
【0053】(24) 第23項記載の半導体デバイス
において、前記少なくとも1本のリードは銅で形成さ
れ、前記第2複数の針は酸化第二銅で形成される、半導
体デバイス。
において、前記少なくとも1本のリードは銅で形成さ
れ、前記第2複数の針は酸化第二銅で形成される、半導
体デバイス。
【0054】(25) 半導体チップと、少なくとも1
本のリードの表面の部分上に形成された複数の針を有
し、前記半導体チップに電気的に接続された前記少なく
とも1本のリードであって、前記複数の針の各々が前記
少なくとも1本のリードの表面の前記部分に付着した第
1端と前記少なくとも1本のリードの表面の前記部分か
ら間隔を取った第2端とを有する、前記少なくとも1本
のリードと、前記半導体チップと前記少なくとも1本の
リードとを支持するために前記半導体チップと前記少な
くとも1本のリードとの上にモールディングされたプラ
スチックパッケージであって、前記少なくとも1本のリ
ードが前記プラスチックパッケージから延び、前記複数
の針が前記プラスチックパッケージへの前記少なくとも
1本のリードの接着を強化する、前記プラスチックパッ
ケージとを含む半導体デバイス。
本のリードの表面の部分上に形成された複数の針を有
し、前記半導体チップに電気的に接続された前記少なく
とも1本のリードであって、前記複数の針の各々が前記
少なくとも1本のリードの表面の前記部分に付着した第
1端と前記少なくとも1本のリードの表面の前記部分か
ら間隔を取った第2端とを有する、前記少なくとも1本
のリードと、前記半導体チップと前記少なくとも1本の
リードとを支持するために前記半導体チップと前記少な
くとも1本のリードとの上にモールディングされたプラ
スチックパッケージであって、前記少なくとも1本のリ
ードが前記プラスチックパッケージから延び、前記複数
の針が前記プラスチックパッケージへの前記少なくとも
1本のリードの接着を強化する、前記プラスチックパッ
ケージとを含む半導体デバイス。
【0055】(26) 第25項記載の半導体デバイス
において、前記少なくとも1本のリードは金属である、
半導体デバイス。
において、前記少なくとも1本のリードは金属である、
半導体デバイス。
【0056】(27) 第25項記載の半導体デバイス
において、前記複数の針は金属酸化物で形成される、半
導体デバイス。
において、前記複数の針は金属酸化物で形成される、半
導体デバイス。
【0057】(28) 第25項記載の半導体デバイス
において、前記少なくとも1本のリードは銅で形成さ
れ、前記複数の針は酸化第二銅で形成される、半導体デ
バイス。
において、前記少なくとも1本のリードは銅で形成さ
れ、前記複数の針は酸化第二銅で形成される、半導体デ
バイス。
【0058】(29) 半導体デバイス10は、半導体
チップ18と該半導体チップから熱を運び去るために前
記半導体チップ上に隣接するヒートスプレッダ16とを
含む。前記ヒートスプレッダ16は、銅心30と該銅心
の少なくとも部分上に形成された酸化第二銅コーティイ
ング32を有する。プラスチックパッケージ12が、前
記半導体チップ18と前記ヒートスプレッダ16とを支
持するために前記半導体チップ18と前記ヒートスプレ
ッダ16との上にモールディングされる。前記酸化第二
銅コーティング32は、前記プラスチックパッケージ1
2への前記ヒートスプレッダ16の接着を強化する。
チップ18と該半導体チップから熱を運び去るために前
記半導体チップ上に隣接するヒートスプレッダ16とを
含む。前記ヒートスプレッダ16は、銅心30と該銅心
の少なくとも部分上に形成された酸化第二銅コーティイ
ング32を有する。プラスチックパッケージ12が、前
記半導体チップ18と前記ヒートスプレッダ16とを支
持するために前記半導体チップ18と前記ヒートスプレ
ッダ16との上にモールディングされる。前記酸化第二
銅コーティング32は、前記プラスチックパッケージ1
2への前記ヒートスプレッダ16の接着を強化する。
【0059】関連出願とのクロスリファレンス 次の共同譲渡特許出願は、この意味によって、参考資料
として本明細書に編入される。 米国特許出願番号 出願日 TI事件番号 07/973,903 11/10/92 17109
として本明細書に編入される。 米国特許出願番号 出願日 TI事件番号 07/973,903 11/10/92 17109
【図1】本発明の第1実施例によるパッケージ半導体デ
バイスの上面図。
バイスの上面図。
【図2】図1のデバイスの底面図。
【図3】本発明の第1実施例によるデバイスの断面図及
び部分拡大図であって、aは図1の切断線3−3に沿い
取られた正断面図であり、bはヒートスプレッダの高倍
率部分拡大図。
び部分拡大図であって、aは図1の切断線3−3に沿い
取られた正断面図であり、bはヒートスプレッダの高倍
率部分拡大図。
【図4】本発明の第2実施例によるパッケージ半導体デ
バイスの部分正断面図。
バイスの部分正断面図。
【図5】本発明の第3実施例によるパッケージ半導体デ
バイスの部分正断面図。
バイスの部分正断面図。
【図6】本発明の第4実施例によるパッケージ半導体デ
バイスの部分正断面図。
バイスの部分正断面図。
【図7】第1プラスチックモールドコンパウンドを使用
して遂行されたせん断試験の結果を示すグラフ図。
して遂行されたせん断試験の結果を示すグラフ図。
【図8】第2プラスチックモールドコンパウンドを使用
して遂行されたせん断試験の結果を示すグラフ図。
して遂行されたせん断試験の結果を示すグラフ図。
【符号の説明】 10 半導体デバイス 12 プラスチックパッケージ 14 リード 15 接着剤 16 ヒートスプレッダ 18 半導体チップ 20 ボンディングパッド 28 ワイヤ 30 銅心 31 酸化第二銅の針 32 酸化第二銅コーティング 34 半導体デバイス 36 リード 37 銅心 38 酸化第二銅コーティング 46 半導体デバイス 48 半導体デバイス 50 チップパッド
Claims (1)
- 【請求項1】 半導体チップと、 銅心と該銅心の少なくとも部分上に形成された酸化第二
銅コーティングとを有し、前記半導体チップから熱を運
び去るために前記半導体チップに隣接するヒートスプレ
ッダと、 前記半導体チップと前記ヒートスプレッダとを支持する
ために前記半導体チップと前記ヒートスプレッダとの上
にモールディングされたプラスチックパッケージであっ
て、前記酸化第二銅コーティングが前記プラスチックパ
ッケージへの前記ヒートスプレッダの接着を強化する、
前記プラスチックパッケージとを含む半導体デバイス。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
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US973894 | 1992-11-10 | ||
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KR100591235B1 (ko) * | 2001-08-30 | 2006-06-19 | 가부시키가이샤 히타치세이사쿠쇼 | 반도체 장치 |
Also Published As
Publication number | Publication date |
---|---|
US5402006A (en) | 1995-03-28 |
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