JPH061775B2 - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPH061775B2
JPH061775B2 JP60158618A JP15861885A JPH061775B2 JP H061775 B2 JPH061775 B2 JP H061775B2 JP 60158618 A JP60158618 A JP 60158618A JP 15861885 A JP15861885 A JP 15861885A JP H061775 B2 JPH061775 B2 JP H061775B2
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silicide layer
polysilicon layer
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silicon
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純司 清野
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、MOS型半導体装置、特に、ポリサイド構造
を有するMOS型集積回路装置の製造方法に関する。
〔従来の技術〕
昨今、MOS型集積回路装置の高速化・高密度化の進歩
はめざましく、ゲート電極,配線層の材料としても従来
のポリシリコンにより、層抵抗が低い、ポリサイド構造
が用いられるようになってきた。
従来、この種のポリサイド構造は、数千Åのポリシリコ
ン層を被着後、層抵抗を下げるため、不純物をドープ
し、前処理を行った後、シリサイド層をスパッタ又はC
VD法で被着していた。
〔発明が解決しようとする問題点〕
上述した従来のポリサイド構造の製造方法では、ポリシ
リコン層と、シリサイド層の密着性が弱く、熱処理工程
に於いて、シリサイド層が、剥離してしまうという問題
点がある。
一般に、酸化膜上に被着されたシリサイド層は、密着性
に乏しく、シリコンとメタルの組成比に於いては、メタ
ルの比率が大きくなるに従い、密着強度は著しく劣化す
る。
すなわち、従来のポリサイド構造の製造方法では、シリ
サイド層の被着面に、前処理を行ってはいるが、前処理
後に形成されるポリシリコン層の自然シリコン酸化膜は
除去できず、これが密着性劣化の原因と考えられる。
そこで通常は、シリサイド層のシリコンの比率を増や
し、密着性を高めているが、当然層抵抗は高くなってし
まう。
〔問題点を解決するための手段〕
本発明によるポリサイド構造の製造方法は、ポリシリコ
ン層を被着する工程と、このポリシリコン層に、不純物
をドープする工程と、シリサイド層を被着する工程と、
全面にイオン注入する工程とを有している。
〔実施例〕
次に、本発明について、図面を参照して説明する。第1
図は、本発明の一実施例で、MOS電界効果型トランジ
スタ(以下MOSFETと記す)の工程毎の断面図である。P
型のシリコン半導体基板1の主表面に、通常の選択層化
の方法により、厚いシリコン酸化膜よりなる素子分離領
域2を形成後、熱酸化により形成したゲート絶縁膜3を
介して、ポリシリコン層4をCVD法により被着した。
次に、適正なVFBが得られるよう、リンを熱拡散し
た。ここまでを、第1図(a)に示す。
その後、前処理を行った後、スパッタ法で、モリブデン
シリサイド層5を被着した。そして、全面に、シリコン
イオンのイオン注入を行った。加速エネルギーはプロフ
ァイルのピークが、ポリシリコン層4と、シリサイド層
5の界面に設定した。またドーズは、1016/cm2とし
た。ここまでを第1図(b)に示す。
その後、フォトリソグラフィの技術と、リアクテイブス
パッタエッチングの技術を用い、MOS‐FETのゲー
ト電極6を形成した。
次に、シリサイド層5の低抵抗化のため、1100℃の熱処
理を行った後、MOSFETのリース・ドレイン領域
7,8形成のため、ヒ素のイオン注入を行った。イオン
注入ダメッジ回復のため、窒素雰囲気中で、熱処理を行
った後、層間絶縁膜9,電極引き出し用コンタクトホー
ル10,11及びアルミ配線12,13を形成した。
本実施例ではNチャネル型MOSFETを示したが、n
型半導体基板を用い、ソース・ドレイン領域形成のた
め、ボタンのイオンを行うことにより、P−チャネル型
MOSFETに適用しても良い。
また、上記シリサイド層5の抵抗抗化のための熱処理及
び、リース・ドレイン領域のダメッジ回復のための熱処
理として、ランプアニールを用いても良い。さらに、本
実施例では第1図(b)に於ける全面イオン注入として、
シリコンイオンを用いたが、他の元素のイオン、たとえ
ば、ヒ素、リン・金属のイオンを用いても、同様の効果
が得られる。本実施例では、シリサイド層5として、モ
リブデンシリサイドを用いたが、他のタングステン,チ
タン,タンタル,コバルト,プラチナ,パラジウム、ジ
リコニウム、ハフニウムのシリサイドを用いても良い。
また、本実施例に於いては、シリサイド層5の被着後
に、シリコンイオンの全面イオン注入を行っているが、
ゲート電極6形成後に、このシリコンイオンの全面イオ
ン注入を行っても、同様の効果が得られる。
さらに、本実施例では、MOSFETのゲート電極に、
適用したものであるが、このポリサイド構造の製法を、
ポリサイド配線層に用いることもできる。
〔発明の効果〕
以上説明したように、本発明は、シリサイド層被着後、
全面に、イオン注入を行うことにより、ポリサイド構造
のポリシリコン層と、シリサイド層の間の密着性を高め
る効果がある。
さらに、シリサイド層のシリコンとメタルの組成で、メ
タルの比率を増やすことが可能となり、より低い層抵抗
を持つポリサイド構造が得られると言う効果がある。
【図面の簡単な説明】
第1図は、本発明の一実施例で、工程毎の断面図であ
る。 図中1は、シリコン半導体基板、2はシリコン酸化膜に
よりなる素子分離領域、3はゲート絶縁膜、4はポリシ
リコン層、5はシリサイド層、6はゲート電極、7,8
はMOSFETのリース・ドレイン領域、9は層間絶縁
膜、10,11はコンタクトホール、12,13はアル
ミ配線を示す。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】ポリサイド構造を有する半導体装置の製造
    方法において、絶縁膜上にポリシリコン層を被着する工
    程と、前記ポリシリコン層上に金属のシリサイド物を被
    着して前記ポリシリコン層上に金属シリサイド層を形成
    する工程と、前記ポリシリコン層と前記金属シリサイド
    層との界面にその注入量のピークがくるようにイオンを
    前記金属シリサイド層を介して注入する工程とを有する
    ことを特徴とする半導体装置の製造方法。
JP60158618A 1985-07-17 1985-07-17 半導体装置の製造方法 Expired - Lifetime JPH061775B2 (ja)

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